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authorDave Airlie <airlied@redhat.com>2017-09-28 22:30:23 -0400
committerAlex Deucher <alexander.deucher@amd.com>2017-09-29 12:24:40 -0400
commit63cdc76e29a60d810263474ab072a587009d18b8 (patch)
treeb10af41c92463aecd26cbbf64e7511dfdec44fcb
parent6f5c2f9d3c5c335ae86203f9548e1a861bdd154a (diff)
amdgpu/pp: rewrite fiji pwr virus upload code.
Along the same lines as rewriting the polaris code, this rewrites the fiji code, and reduces the driver size by ~40k. Signed-off-by: Dave Airlie <airlied@redhat.com> Signed-off-by: Alex Deucher <alexander.deucher@amd.com>
Diffstat
-rw-r--r--drivers/gpu/drm/amd/powerplay/inc/fiji_pwrvirus.h10797
-rw-r--r--drivers/gpu/drm/amd/powerplay/smumgr/fiji_smumgr.c35
2 files changed, 1284 insertions, 9548 deletions
diff --git a/drivers/gpu/drm/amd/powerplay/inc/fiji_pwrvirus.h b/drivers/gpu/drm/amd/powerplay/inc/fiji_pwrvirus.h
index e202e567faf4..9d391f0eca94 100644
--- a/drivers/gpu/drm/amd/powerplay/inc/fiji_pwrvirus.h
+++ b/drivers/gpu/drm/amd/powerplay/inc/fiji_pwrvirus.h
@@ -35,7 +35,16 @@ struct PWR_Command_Table
35}; 35};
36typedef struct PWR_Command_Table PWR_Command_Table; 36typedef struct PWR_Command_Table PWR_Command_Table;
37 37
38static const PWR_Command_Table PwrVirusTable[] = 38struct PWR_DFY_Section {
39 uint32_t dfy_cntl;
40 uint32_t dfy_addr_hi, dfy_addr_lo;
41 uint32_t dfy_size;
42 uint32_t dfy_data[];
43};
44
45typedef struct PWR_DFY_Section PWR_DFY_Section;
46
47static const PWR_Command_Table PwrVirusTable_pre[] =
39{ 48{
40 { 0x100100b6, mmPCIE_INDEX }, 49 { 0x100100b6, mmPCIE_INDEX },
41 { 0x00000000, mmPCIE_DATA }, 50 { 0x00000000, mmPCIE_DATA },
@@ -457,9544 +466,1254 @@ static const PWR_Command_Table PwrVirusTable[] =
457 { 0x000f016a, mmCP_HYP_MEC2_UCODE_DATA }, 466 { 0x000f016a, mmCP_HYP_MEC2_UCODE_DATA },
458 { 0x000f016a, mmCP_HYP_MEC2_UCODE_DATA }, 467 { 0x000f016a, mmCP_HYP_MEC2_UCODE_DATA },
459 { 0x000f016a, mmCP_HYP_MEC2_UCODE_DATA }, 468 { 0x000f016a, mmCP_HYP_MEC2_UCODE_DATA },
460 { 0x80000004, mmCP_DFY_CNTL }, 469 { 0x00000000, 0xFFFFFFFF },
461 { 0x000000b4, mmCP_DFY_ADDR_HI }, 470};
462 { 0x540fe800, mmCP_DFY_ADDR_LO }, 471
463 { 0x7e000200, mmCP_DFY_DATA_0 }, 472static const PWR_DFY_Section pwr_virus_section1 = {
464 { 0x7e020201, mmCP_DFY_DATA_0 }, 473 .dfy_cntl = 0x80000004,
465 { 0x7e040204, mmCP_DFY_DATA_0 }, 474 .dfy_addr_hi = 0x000000b4,
466 { 0x7e060205, mmCP_DFY_DATA_0 }, 475 .dfy_addr_lo = 0x540fe800,
467 { 0x0a080102, mmCP_DFY_DATA_0 }, 476 .dfy_data = {
468 { 0x0a0a0701, mmCP_DFY_DATA_0 }, 477 0x7e000200, 0x7e020201, 0x7e040204, 0x7e060205, 0x0a080102, 0x0a0a0701, 0x0a080102, 0x0a0a0701,
469 { 0x0a080102, mmCP_DFY_DATA_0 }, 478 0x0a080500, 0x0a0a0303, 0x0a080500, 0x0a0a0303, 0x0a080102, 0x0a0a0701, 0x0a080102, 0x0a0a0701,
470 { 0x0a0a0701, mmCP_DFY_DATA_0 }, 479 0x0a080500, 0x0a0a0303, 0x0a080500, 0x0a0a0303, 0x0a080102, 0x0a0a0701, 0x0a080102, 0x0a0a0701,
471 { 0x0a080500, mmCP_DFY_DATA_0 }, 480 0x0a080500, 0x0a0a0303, 0x0a080500, 0x0a0a0303, 0x0a080102, 0x0a0a0701, 0x0a080102, 0x0a0a0701,
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516 { 0x0a0a0701, mmCP_DFY_DATA_0 }, 525 0x0a080500, 0x0a0a0303, 0x0a080500, 0x0a0a0303, 0xbf810000, 0x00000000, 0x00000000, 0x00000000,
517 { 0x0a080102, mmCP_DFY_DATA_0 }, 526 0x00000005, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000,
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9964 { 0x00000000, mmCP_DFY_DATA_0 },
9965 { 0x00000000, mmCP_DFY_DATA_0 },
9966 { 0x00000000, mmCP_DFY_DATA_0 },
9967 { 0x00000000, mmCP_DFY_DATA_0 },
9968 { 0x00000000, mmCP_DFY_DATA_0 },
9969 { 0x00000000, mmCP_DFY_DATA_0 },
9970 { 0x00000000, mmCP_DFY_DATA_0 },
9971 { 0x00000000, mmCP_DFY_DATA_0 },
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9998 { 0x00000000, mmCP_MEC_CNTL }, 1717 { 0x00000000, mmCP_MEC_CNTL },
9999 { 0x00000000, mmCP_MEC_CNTL }, 1718 { 0x00000000, mmCP_MEC_CNTL },
10000 { 0x00000004, mmSRBM_GFX_CNTL }, 1719 { 0x00000004, mmSRBM_GFX_CNTL },
diff --git a/drivers/gpu/drm/amd/powerplay/smumgr/fiji_smumgr.c b/drivers/gpu/drm/amd/powerplay/smumgr/fiji_smumgr.c
index 289006b8d421..592a89aff12b 100644
--- a/drivers/gpu/drm/amd/powerplay/smumgr/fiji_smumgr.c
+++ b/drivers/gpu/drm/amd/powerplay/smumgr/fiji_smumgr.c
@@ -159,27 +159,44 @@ static int fiji_start_smu_in_non_protection_mode(struct pp_hwmgr *hwmgr)
159 return result; 159 return result;
160} 160}
161 161
162static int fiji_setup_pwr_virus(struct pp_hwmgr *hwmgr) 162static void execute_pwr_table(struct pp_hwmgr *hwmgr, const PWR_Command_Table *pvirus, int size)
163{ 163{
164 int i; 164 int i;
165 int result = -EINVAL;
166 uint32_t reg, data; 165 uint32_t reg, data;
167 166
168 const PWR_Command_Table *pvirus = PwrVirusTable; 167 for (i = 0; i < size; i++) {
169
170 for (i = 0; i < ARRAY_SIZE(PwrVirusTable); i++) {
171 reg = pvirus->reg; 168 reg = pvirus->reg;
172 data = pvirus->data; 169 data = pvirus->data;
173 if (reg != 0xffffffff) 170 if (reg != 0xffffffff)
174 cgs_write_register(hwmgr->device, reg, data); 171 cgs_write_register(hwmgr->device, reg, data);
175 else { 172 else
176 result = 0;
177 break; 173 break;
178 }
179 pvirus++; 174 pvirus++;
180 } 175 }
176}
181 177
182 return result; 178static void execute_pwr_dfy_table(struct pp_hwmgr *hwmgr, const PWR_DFY_Section *section)
179{
180 int i;
181 cgs_write_register(hwmgr->device, mmCP_DFY_CNTL, section->dfy_cntl);
182 cgs_write_register(hwmgr->device, mmCP_DFY_ADDR_HI, section->dfy_addr_hi);
183 cgs_write_register(hwmgr->device, mmCP_DFY_ADDR_LO, section->dfy_addr_lo);
184 for (i = 0; i < section->dfy_size; i++)
185 cgs_write_register(hwmgr->device, mmCP_DFY_DATA_0, section->dfy_data[i]);
186}
187
188static int fiji_setup_pwr_virus(struct pp_hwmgr *hwmgr)
189{
190 execute_pwr_table(hwmgr, PwrVirusTable_pre, ARRAY_SIZE(PwrVirusTable_pre));
191 execute_pwr_dfy_table(hwmgr, &pwr_virus_section1);
192 execute_pwr_dfy_table(hwmgr, &pwr_virus_section2);
193 execute_pwr_dfy_table(hwmgr, &pwr_virus_section3);
194 execute_pwr_dfy_table(hwmgr, &pwr_virus_section4);
195 execute_pwr_dfy_table(hwmgr, &pwr_virus_section5);
196 execute_pwr_dfy_table(hwmgr, &pwr_virus_section6);
197 execute_pwr_table(hwmgr, PwrVirusTable_post, ARRAY_SIZE(PwrVirusTable_post));
198
199 return 0;
183} 200}
184 201
185static int fiji_start_avfs_btc(struct pp_hwmgr *hwmgr) 202static int fiji_start_avfs_btc(struct pp_hwmgr *hwmgr)
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