tegra: GPIO: Add support for T194 GPIO

Add T194 GPIO tables for AON and MAIN GPIO's
Add new compatible strings for T194 to support AON and MAIN GPIO's

Bug 1842952

Change-Id: I8a90b9067165d348388e558ed2cc9e5517634133
Signed-off-by: Suresh Mangipudi <smangipudi@nvidia.com>
Reviewed-on: http://git-master/r/1276130
Reviewed-by: svccoveritychecker <svccoveritychecker@nvidia.com>
GVS: Gerrit_Virtual_Submit
Reviewed-by: Laxman Dewangan <ldewangan@nvidia.com>

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diff --git a/include/dt-bindings/gpio/tegra194-gpio.h b/include/dt-bindings/gpio/tegra194-gpio.h
new file mode 100644
index 000000000..5d4a481d3
--- /dev/null
+++ b/include/dt-bindings/gpio/tegra194-gpio.h
@@ -0,0 +1,101 @@
+/*
+ * This header provides constants for binding nvidia,tegra1i94-gpio*.
+ *
+ * The first cell in Tegra's GPIO specifier is the GPIO ID. The macros below
+ * provide names for this.
+ *
+ * The second cell contains standard flag values specified in gpio.h.
+ */
+
+#ifndef _DT_BINDINGS_GPIO_TEGRA194_GPIO_H
+#define _DT_BINDINGS_GPIO_TEGRA194_GPIO_H
+
+#include <dt-bindings/gpio/gpio.h>
+
+/* GPIOs implemented by main GPIO controller */
+#define TEGRA194_MAIN_GPIO_PORT_A 0
+#define TEGRA194_MAIN_GPIO_PORT_B 1
+#define TEGRA194_MAIN_GPIO_PORT_C 2
+#define TEGRA194_MAIN_GPIO_PORT_D 3
+#define TEGRA194_MAIN_GPIO_PORT_E 4
+#define TEGRA194_MAIN_GPIO_PORT_F 5
+#define TEGRA194_MAIN_GPIO_PORT_G 6
+#define TEGRA194_MAIN_GPIO_PORT_H 7
+#define TEGRA194_MAIN_GPIO_PORT_I 8
+#define TEGRA194_MAIN_GPIO_PORT_J 9
+#define TEGRA194_MAIN_GPIO_PORT_K 10
+#define TEGRA194_MAIN_GPIO_PORT_L 11
+#define TEGRA194_MAIN_GPIO_PORT_M 12
+#define TEGRA194_MAIN_GPIO_PORT_N 13
+#define TEGRA194_MAIN_GPIO_PORT_O 14
+#define TEGRA194_MAIN_GPIO_PORT_P 15
+#define TEGRA194_MAIN_GPIO_PORT_Q 16
+#define TEGRA194_MAIN_GPIO_PORT_R 17
+#define TEGRA194_MAIN_GPIO_PORT_S 18
+#define TEGRA194_MAIN_GPIO_PORT_T 19
+#define TEGRA194_MAIN_GPIO_PORT_U 20
+#define TEGRA194_MAIN_GPIO_PORT_V 21
+#define TEGRA194_MAIN_GPIO_PORT_W 22
+#define TEGRA194_MAIN_GPIO_PORT_X 23
+#define TEGRA194_MAIN_GPIO_PORT_Y 24
+#define TEGRA194_MAIN_GPIO_PORT_Z 25
+
+#define TEGRA194_MAIN_GPIO(port, offset) \
+        ((TEGRA194_MAIN_GPIO_PORT_##port * 8) + offset)
+
+/* GPIOs implemented by AON GPIO controller */
+#define TEGRA194_AON_GPIO_PORT_AA 0
+#define TEGRA194_AON_GPIO_PORT_BB 1
+#define TEGRA194_AON_GPIO_PORT_CC 2
+#define TEGRA194_AON_GPIO_PORT_DD 3
+#define TEGRA194_AON_GPIO_PORT_EE 4
+#define TEGRA194_AON_GPIO_PORT_FF 5
+
+#define TEGRA194_AON_GPIO(port, offset) \
+        ((TEGRA194_AON_GPIO_PORT_##port * 8) + offset)
+
+/* All pins */
+#define TEGRA_PIN_BASE_ID_A 0
+#define TEGRA_PIN_BASE_ID_B 1
+#define TEGRA_PIN_BASE_ID_C 2
+#define TEGRA_PIN_BASE_ID_D 3
+#define TEGRA_PIN_BASE_ID_E 4
+#define TEGRA_PIN_BASE_ID_F 5
+#define TEGRA_PIN_BASE_ID_G 6
+#define TEGRA_PIN_BASE_ID_H 7
+#define TEGRA_PIN_BASE_ID_I 8
+#define TEGRA_PIN_BASE_ID_J 9
+#define TEGRA_PIN_BASE_ID_K 10
+#define TEGRA_PIN_BASE_ID_L 11
+#define TEGRA_PIN_BASE_ID_M 12
+#define TEGRA_PIN_BASE_ID_N 13
+#define TEGRA_PIN_BASE_ID_O 14
+#define TEGRA_PIN_BASE_ID_P 15
+#define TEGRA_PIN_BASE_ID_Q 16
+#define TEGRA_PIN_BASE_ID_R 17
+#define TEGRA_PIN_BASE_ID_S 18
+#define TEGRA_PIN_BASE_ID_T 19
+#define TEGRA_PIN_BASE_ID_U 20
+#define TEGRA_PIN_BASE_ID_V 21
+#define TEGRA_PIN_BASE_ID_W 22
+#define TEGRA_PIN_BASE_ID_X 23
+#define TEGRA_PIN_BASE_ID_Y 24
+#define TEGRA_PIN_BASE_ID_Z 25
+#define TEGRA_PIN_BASE_ID_AA 26
+#define TEGRA_PIN_BASE_ID_BB 27
+#define TEGRA_PIN_BASE_ID_CC 28
+#define TEGRA_PIN_BASE_ID_DD 29
+#define TEGRA_PIN_BASE_ID_EE 30
+#define TEGRA_PIN_BASE_ID_FF 31
+
+#define TEGRA_PIN_BASE(port) (TEGRA_PIN_BASE_ID_##port * 8)
+
+#define TEGRA194_MAIN_GPIO_RANGE(st, end) \
+        ((TEGRA194_MAIN_GPIO_PORT_##end - TEGRA194_MAIN_GPIO_PORT_##st + 1) * 8)
+#define TEGRA194_MAIN_GPIO_BASE(port) (TEGRA194_MAIN_GPIO_PORT_##port * 8)
+
+#define TEGRA194_AON_GPIO_RANGE(st, end) \
+        ((TEGRA194_AON_GPIO_PORT_##end - TEGRA194_AON_GPIO_PORT_##st + 1) * 8)
+#define TEGRA194_AON_GPIO_BASE(port) (TEGRA194_AON_GPIO_PORT_##port * 8)
+
+#endif