aboutsummaryrefslogtreecommitdiffstats
diff options
context:
space:
mode:
Diffstat
-rw-r--r--MAINTAINERS4
-rw-r--r--arch/arm/mach-ep93xx/core.c34
-rw-r--r--arch/arm/mach-ep93xx/include/mach/ep93xx-regs.h1
-rw-r--r--arch/arm/mach-ep93xx/include/mach/platform.h1
-rw-r--r--arch/arm/mach-ep93xx/simone.c1
-rw-r--r--arch/powerpc/configs/mpc85xx_defconfig3
-rw-r--r--arch/powerpc/configs/mpc85xx_smp_defconfig3
-rw-r--r--arch/powerpc/platforms/85xx/p1022_ds.c212
-rw-r--r--drivers/video/Kconfig2
-rw-r--r--include/sound/max98088.h50
-rw-r--r--include/sound/soc.h3
-rw-r--r--sound/soc/codecs/Kconfig4
-rw-r--r--sound/soc/codecs/Makefile4
-rw-r--r--sound/soc/codecs/ac97.c7
-rw-r--r--sound/soc/codecs/ad1980.c2
-rw-r--r--sound/soc/codecs/ak4642.c64
-rw-r--r--sound/soc/codecs/cs4270.c2
-rw-r--r--sound/soc/codecs/max98088.c2097
-rw-r--r--sound/soc/codecs/max98088.h193
-rw-r--r--sound/soc/codecs/wm8580.c4
-rw-r--r--sound/soc/codecs/wm8804.c8
-rw-r--r--sound/soc/codecs/wm8962-tables.c42299
-rw-r--r--sound/soc/codecs/wm8962.c1836
-rw-r--r--sound/soc/codecs/wm8962.h11
-rw-r--r--sound/soc/codecs/wm8985.c8
-rw-r--r--sound/soc/codecs/wm8994.c3150
-rw-r--r--sound/soc/davinci/davinci-mcasp.c2
-rw-r--r--sound/soc/ep93xx/Kconfig16
-rw-r--r--sound/soc/ep93xx/Makefile4
-rw-r--r--sound/soc/ep93xx/ep93xx-ac97.c468
-rw-r--r--sound/soc/ep93xx/simone.c89
-rw-r--r--sound/soc/s3c24xx/Kconfig11
-rw-r--r--sound/soc/s3c24xx/Makefile4
-rw-r--r--sound/soc/s3c24xx/smdk_spdif.c223
-rw-r--r--sound/soc/s3c24xx/spdif.c501
-rw-r--r--sound/soc/s3c24xx/spdif.h19
-rw-r--r--sound/soc/sh/fsi.c216
-rw-r--r--sound/soc/soc-core.c78
-rw-r--r--sound/soc/soc-jack.c11
39 files changed, 7607 insertions, 44038 deletions
diff --git a/MAINTAINERS b/MAINTAINERS
index f51409b1527a..31306ceb5677 100644
--- a/MAINTAINERS
+++ b/MAINTAINERS
@@ -6411,8 +6411,10 @@ F: include/linux/wm97xx.h
6411WOLFSON MICROELECTRONICS DRIVERS 6411WOLFSON MICROELECTRONICS DRIVERS
6412M: Mark Brown <broonie@opensource.wolfsonmicro.com> 6412M: Mark Brown <broonie@opensource.wolfsonmicro.com>
6413M: Ian Lartey <ian@opensource.wolfsonmicro.com> 6413M: Ian Lartey <ian@opensource.wolfsonmicro.com>
6414M: Dimitris Papastamos <dp@opensource.wolfsonmicro.com>
6415T: git git://opensource.wolfsonmicro.com/linux-2.6-asoc
6414T: git git://opensource.wolfsonmicro.com/linux-2.6-audioplus 6416T: git git://opensource.wolfsonmicro.com/linux-2.6-audioplus
6415W: http://opensource.wolfsonmicro.com/node/8 6417W: http://opensource.wolfsonmicro.com/content/linux-drivers-wolfson-devices
6416S: Supported 6418S: Supported
6417F: Documentation/hwmon/wm83?? 6419F: Documentation/hwmon/wm83??
6418F: drivers/leds/leds-wm83*.c 6420F: drivers/leds/leds-wm83*.c
diff --git a/arch/arm/mach-ep93xx/core.c b/arch/arm/mach-ep93xx/core.c
index 1990e2299841..ffdf87be2958 100644
--- a/arch/arm/mach-ep93xx/core.c
+++ b/arch/arm/mach-ep93xx/core.c
@@ -832,6 +832,40 @@ void ep93xx_i2s_release(void)
832} 832}
833EXPORT_SYMBOL(ep93xx_i2s_release); 833EXPORT_SYMBOL(ep93xx_i2s_release);
834 834
835/*************************************************************************
836 * EP93xx AC97 audio peripheral handling
837 *************************************************************************/
838static struct resource ep93xx_ac97_resources[] = {
839 {
840 .start = EP93XX_AAC_PHYS_BASE,
841 .end = EP93XX_AAC_PHYS_BASE + 0xb0 - 1,
842 .flags = IORESOURCE_MEM,
843 },
844 {
845 .start = IRQ_EP93XX_AACINTR,
846 .end = IRQ_EP93XX_AACINTR,
847 .flags = IORESOURCE_IRQ,
848 },
849};
850
851static struct platform_device ep93xx_ac97_device = {
852 .name = "ep93xx-ac97",
853 .id = -1,
854 .num_resources = ARRAY_SIZE(ep93xx_ac97_resources),
855 .resource = ep93xx_ac97_resources,
856};
857
858void __init ep93xx_register_ac97(void)
859{
860 /*
861 * Make sure that the AC97 pins are not used by I2S.
862 */
863 ep93xx_devcfg_clear_bits(EP93XX_SYSCON_DEVCFG_I2SONAC97);
864
865 platform_device_register(&ep93xx_ac97_device);
866 platform_device_register(&ep93xx_pcm_device);
867}
868
835extern void ep93xx_gpio_init(void); 869extern void ep93xx_gpio_init(void);
836 870
837void __init ep93xx_init_devices(void) 871void __init ep93xx_init_devices(void)
diff --git a/arch/arm/mach-ep93xx/include/mach/ep93xx-regs.h b/arch/arm/mach-ep93xx/include/mach/ep93xx-regs.h
index c54b3e56ba63..9ac4d1055097 100644
--- a/arch/arm/mach-ep93xx/include/mach/ep93xx-regs.h
+++ b/arch/arm/mach-ep93xx/include/mach/ep93xx-regs.h
@@ -105,6 +105,7 @@
105#define EP93XX_GPIO_B_INT_STATUS EP93XX_GPIO_REG(0xbc) 105#define EP93XX_GPIO_B_INT_STATUS EP93XX_GPIO_REG(0xbc)
106#define EP93XX_GPIO_EEDRIVE EP93XX_GPIO_REG(0xc8) 106#define EP93XX_GPIO_EEDRIVE EP93XX_GPIO_REG(0xc8)
107 107
108#define EP93XX_AAC_PHYS_BASE EP93XX_APB_PHYS(0x00080000)
108#define EP93XX_AAC_BASE EP93XX_APB_IOMEM(0x00080000) 109#define EP93XX_AAC_BASE EP93XX_APB_IOMEM(0x00080000)
109 110
110#define EP93XX_SPI_PHYS_BASE EP93XX_APB_PHYS(0x000a0000) 111#define EP93XX_SPI_PHYS_BASE EP93XX_APB_PHYS(0x000a0000)
diff --git a/arch/arm/mach-ep93xx/include/mach/platform.h b/arch/arm/mach-ep93xx/include/mach/platform.h
index 3330b36d79e6..50660455b1d8 100644
--- a/arch/arm/mach-ep93xx/include/mach/platform.h
+++ b/arch/arm/mach-ep93xx/include/mach/platform.h
@@ -61,6 +61,7 @@ void ep93xx_keypad_release_gpio(struct platform_device *pdev);
61void ep93xx_register_i2s(void); 61void ep93xx_register_i2s(void);
62int ep93xx_i2s_acquire(unsigned i2s_pins, unsigned i2s_config); 62int ep93xx_i2s_acquire(unsigned i2s_pins, unsigned i2s_config);
63void ep93xx_i2s_release(void); 63void ep93xx_i2s_release(void);
64void ep93xx_register_ac97(void);
64 65
65void ep93xx_init_devices(void); 66void ep93xx_init_devices(void);
66extern struct sys_timer ep93xx_timer; 67extern struct sys_timer ep93xx_timer;
diff --git a/arch/arm/mach-ep93xx/simone.c b/arch/arm/mach-ep93xx/simone.c
index 5dded5884133..f5f81f9719bd 100644
--- a/arch/arm/mach-ep93xx/simone.c
+++ b/arch/arm/mach-ep93xx/simone.c
@@ -61,6 +61,7 @@ static void __init simone_init_machine(void)
61 ep93xx_register_fb(&simone_fb_info); 61 ep93xx_register_fb(&simone_fb_info);
62 ep93xx_register_i2c(&simone_i2c_gpio_data, simone_i2c_board_info, 62 ep93xx_register_i2c(&simone_i2c_gpio_data, simone_i2c_board_info,
63 ARRAY_SIZE(simone_i2c_board_info)); 63 ARRAY_SIZE(simone_i2c_board_info));
64 ep93xx_register_ac97();
64} 65}
65 66
66MACHINE_START(SIM_ONE, "Simplemachines Sim.One Board") 67MACHINE_START(SIM_ONE, "Simplemachines Sim.One Board")
diff --git a/arch/powerpc/configs/mpc85xx_defconfig b/arch/powerpc/configs/mpc85xx_defconfig
index c3b113b2ca31..3aeb5949cfef 100644
--- a/arch/powerpc/configs/mpc85xx_defconfig
+++ b/arch/powerpc/configs/mpc85xx_defconfig
@@ -124,6 +124,9 @@ CONFIG_I2C_CPM=m
124CONFIG_I2C_MPC=y 124CONFIG_I2C_MPC=y
125# CONFIG_HWMON is not set 125# CONFIG_HWMON is not set
126CONFIG_VIDEO_OUTPUT_CONTROL=y 126CONFIG_VIDEO_OUTPUT_CONTROL=y
127CONFIG_FB=y
128CONFIG_FB_FSL_DIU=y
129# CONFIG_VGA_CONSOLE is not set
127CONFIG_SOUND=y 130CONFIG_SOUND=y
128CONFIG_SND=y 131CONFIG_SND=y
129# CONFIG_SND_SUPPORT_OLD_API is not set 132# CONFIG_SND_SUPPORT_OLD_API is not set
diff --git a/arch/powerpc/configs/mpc85xx_smp_defconfig b/arch/powerpc/configs/mpc85xx_smp_defconfig
index a075da2ea3fb..d62c8016f4bc 100644
--- a/arch/powerpc/configs/mpc85xx_smp_defconfig
+++ b/arch/powerpc/configs/mpc85xx_smp_defconfig
@@ -126,6 +126,9 @@ CONFIG_I2C_CPM=m
126CONFIG_I2C_MPC=y 126CONFIG_I2C_MPC=y
127# CONFIG_HWMON is not set 127# CONFIG_HWMON is not set
128CONFIG_VIDEO_OUTPUT_CONTROL=y 128CONFIG_VIDEO_OUTPUT_CONTROL=y
129CONFIG_FB=y
130CONFIG_FB_FSL_DIU=y
131# CONFIG_VGA_CONSOLE is not set
129CONFIG_SOUND=y 132CONFIG_SOUND=y
130CONFIG_SND=y 133CONFIG_SND=y
131# CONFIG_SND_SUPPORT_OLD_API is not set 134# CONFIG_SND_SUPPORT_OLD_API is not set
diff --git a/arch/powerpc/platforms/85xx/p1022_ds.c b/arch/powerpc/platforms/85xx/p1022_ds.c
index e1467c937450..e984d4ea351a 100644
--- a/arch/powerpc/platforms/85xx/p1022_ds.c
+++ b/arch/powerpc/platforms/85xx/p1022_ds.c
@@ -8,7 +8,6 @@
8 * Copyright 2010 Freescale Semiconductor, Inc. 8 * Copyright 2010 Freescale Semiconductor, Inc.
9 * 9 *
10 * This file is taken from the Freescale P1022DS BSP, with modifications: 10 * This file is taken from the Freescale P1022DS BSP, with modifications:
11 * 1) No DIU support (pending rewrite of DIU code)
12 * 2) No AMP support 11 * 2) No AMP support
13 * 3) No PCI endpoint support 12 * 3) No PCI endpoint support
14 * 13 *
@@ -20,12 +19,212 @@
20#include <linux/pci.h> 19#include <linux/pci.h>
21#include <linux/of_platform.h> 20#include <linux/of_platform.h>
22#include <linux/lmb.h> 21#include <linux/lmb.h>
23 22#include <linux/memblock.h>
23#include <asm/div64.h>
24#include <asm/mpic.h> 24#include <asm/mpic.h>
25#include <asm/swiotlb.h> 25#include <asm/swiotlb.h>
26 26
27#include <sysdev/fsl_soc.h> 27#include <sysdev/fsl_soc.h>
28#include <sysdev/fsl_pci.h> 28#include <sysdev/fsl_pci.h>
29#include <asm/fsl_guts.h>
30
31#if defined(CONFIG_FB_FSL_DIU) || defined(CONFIG_FB_FSL_DIU_MODULE)
32
33/*
34 * Board-specific initialization of the DIU. This code should probably be
35 * executed when the DIU is opened, rather than in arch code, but the DIU
36 * driver does not have a mechanism for this (yet).
37 *
38 * This is especially problematic on the P1022DS because the local bus (eLBC)
39 * and the DIU video signals share the same pins, which means that enabling the
40 * DIU will disable access to NOR flash.
41 */
42
43/* DIU Pixel Clock bits of the CLKDVDR Global Utilities register */
44#define CLKDVDR_PXCKEN 0x80000000
45#define CLKDVDR_PXCKINV 0x10000000
46#define CLKDVDR_PXCKDLY 0x06000000
47#define CLKDVDR_PXCLK_MASK 0x00FF0000
48
49/* Some ngPIXIS register definitions */
50#define PX_BRDCFG1_DVIEN 0x80
51#define PX_BRDCFG1_DFPEN 0x40
52#define PX_BRDCFG1_BACKLIGHT 0x20
53#define PX_BRDCFG1_DDCEN 0x10
54
55/*
56 * DIU Area Descriptor
57 *
58 * Note that we need to byte-swap the value before it's written to the AD
59 * register. So even though the registers don't look like they're in the same
60 * bit positions as they are on the MPC8610, the same value is written to the
61 * AD register on the MPC8610 and on the P1022.
62 */
63#define AD_BYTE_F 0x10000000
64#define AD_ALPHA_C_MASK 0x0E000000
65#define AD_ALPHA_C_SHIFT 25
66#define AD_BLUE_C_MASK 0x01800000
67#define AD_BLUE_C_SHIFT 23
68#define AD_GREEN_C_MASK 0x00600000
69#define AD_GREEN_C_SHIFT 21
70#define AD_RED_C_MASK 0x00180000
71#define AD_RED_C_SHIFT 19
72#define AD_PALETTE 0x00040000
73#define AD_PIXEL_S_MASK 0x00030000
74#define AD_PIXEL_S_SHIFT 16
75#define AD_COMP_3_MASK 0x0000F000
76#define AD_COMP_3_SHIFT 12
77#define AD_COMP_2_MASK 0x00000F00
78#define AD_COMP_2_SHIFT 8
79#define AD_COMP_1_MASK 0x000000F0
80#define AD_COMP_1_SHIFT 4
81#define AD_COMP_0_MASK 0x0000000F
82#define AD_COMP_0_SHIFT 0
83
84#define MAKE_AD(alpha, red, blue, green, size, c0, c1, c2, c3) \
85 cpu_to_le32(AD_BYTE_F | (alpha << AD_ALPHA_C_SHIFT) | \
86 (blue << AD_BLUE_C_SHIFT) | (green << AD_GREEN_C_SHIFT) | \
87 (red << AD_RED_C_SHIFT) | (c3 << AD_COMP_3_SHIFT) | \
88 (c2 << AD_COMP_2_SHIFT) | (c1 << AD_COMP_1_SHIFT) | \
89 (c0 << AD_COMP_0_SHIFT) | (size << AD_PIXEL_S_SHIFT))
90
91/**
92 * p1022ds_get_pixel_format: return the Area Descriptor for a given pixel depth
93 *
94 * The Area Descriptor is a 32-bit value that determine which bits in each
95 * pixel are to be used for each color.
96 */
97static unsigned int p1022ds_get_pixel_format(unsigned int bits_per_pixel,
98 int monitor_port)
99{
100 switch (bits_per_pixel) {
101 case 32:
102 /* 0x88883316 */
103 return MAKE_AD(3, 2, 0, 1, 3, 8, 8, 8, 8);
104 case 24:
105 /* 0x88082219 */
106 return MAKE_AD(4, 0, 1, 2, 2, 0, 8, 8, 8);
107 case 16:
108 /* 0x65053118 */
109 return MAKE_AD(4, 2, 1, 0, 1, 5, 6, 5, 0);
110 default:
111 pr_err("fsl-diu: unsupported pixel depth %u\n", bits_per_pixel);
112 return 0;
113 }
114}
115
116/**
117 * p1022ds_set_gamma_table: update the gamma table, if necessary
118 *
119 * On some boards, the gamma table for some ports may need to be modified.
120 * This is not the case on the P1022DS, so we do nothing.
121*/
122static void p1022ds_set_gamma_table(int monitor_port, char *gamma_table_base)
123{
124}
125
126/**
127 * p1022ds_set_monitor_port: switch the output to a different monitor port
128 *
129 */
130static void p1022ds_set_monitor_port(int monitor_port)
131{
132 struct device_node *pixis_node;
133 u8 __iomem *brdcfg1;
134
135 pixis_node = of_find_compatible_node(NULL, NULL, "fsl,p1022ds-pixis");
136 if (!pixis_node) {
137 pr_err("p1022ds: missing ngPIXIS node\n");
138 return;
139 }
140
141 brdcfg1 = of_iomap(pixis_node, 0);
142 if (!brdcfg1) {
143 pr_err("p1022ds: could not map ngPIXIS registers\n");
144 return;
145 }
146 brdcfg1 += 9; /* BRDCFG1 is at offset 9 in the ngPIXIS */
147
148 switch (monitor_port) {
149 case 0: /* DVI */
150 /* Enable the DVI port, disable the DFP and the backlight */
151 clrsetbits_8(brdcfg1, PX_BRDCFG1_DFPEN | PX_BRDCFG1_BACKLIGHT,
152 PX_BRDCFG1_DVIEN);
153 break;
154 case 1: /* Single link LVDS */
155 /* Enable the DFP port, disable the DVI and the backlight */
156 clrsetbits_8(brdcfg1, PX_BRDCFG1_DVIEN | PX_BRDCFG1_BACKLIGHT,
157 PX_BRDCFG1_DFPEN);
158 break;
159 default:
160 pr_err("p1022ds: unsupported monitor port %i\n", monitor_port);
161 }
162}
163
164/**
165 * p1022ds_set_pixel_clock: program the DIU's clock
166 *
167 * @pixclock: the wavelength, in picoseconds, of the clock
168 */
169void p1022ds_set_pixel_clock(unsigned int pixclock)
170{
171 struct device_node *guts_np = NULL;
172 struct ccsr_guts_85xx __iomem *guts;
173 unsigned long freq;
174 u64 temp;
175 u32 pxclk;
176
177 /* Map the global utilities registers. */
178 guts_np = of_find_compatible_node(NULL, NULL, "fsl,p1022-guts");
179 if (!guts_np) {
180 pr_err("p1022ds: missing global utilties device node\n");
181 return;
182 }
183
184 guts = of_iomap(guts_np, 0);
185 of_node_put(guts_np);
186 if (!guts) {
187 pr_err("p1022ds: could not map global utilties device\n");
188 return;
189 }
190
191 /* Convert pixclock from a wavelength to a frequency */
192 temp = 1000000000000ULL;
193 do_div(temp, pixclock);
194 freq = temp;
195
196 /* pixclk is the ratio of the platform clock to the pixel clock */
197 pxclk = DIV_ROUND_CLOSEST(fsl_get_sys_freq(), freq);
198
199 /* Disable the pixel clock, and set it to non-inverted and no delay */
200 clrbits32(&guts->clkdvdr,
201 CLKDVDR_PXCKEN | CLKDVDR_PXCKDLY | CLKDVDR_PXCLK_MASK);
202
203 /* Enable the clock and set the pxclk */
204 setbits32(&guts->clkdvdr, CLKDVDR_PXCKEN | (pxclk << 16));
205}
206
207/**
208 * p1022ds_show_monitor_port: show the current monitor
209 *
210 * This function returns a string indicating whether the current monitor is
211 * set to DVI or LVDS.
212 */
213ssize_t p1022ds_show_monitor_port(int monitor_port, char *buf)
214{
215 return sprintf(buf, "%c0 - DVI\n%c1 - Single link LVDS\n",
216 monitor_port == 0 ? '*' : ' ', monitor_port == 1 ? '*' : ' ');
217}
218
219/**
220 * p1022ds_set_sysfs_monitor_port: set the monitor port for sysfs
221 */
222int p1022ds_set_sysfs_monitor_port(int val)
223{
224 return val < 2 ? val : 0;
225}
226
227#endif
29 228
30void __init p1022_ds_pic_init(void) 229void __init p1022_ds_pic_init(void)
31{ 230{
@@ -92,6 +291,15 @@ static void __init p1022_ds_setup_arch(void)
92 } 291 }
93#endif 292#endif
94 293
294#if defined(CONFIG_FB_FSL_DIU) || defined(CONFIG_FB_FSL_DIU_MODULE)
295 diu_ops.get_pixel_format = p1022ds_get_pixel_format;
296 diu_ops.set_gamma_table = p1022ds_set_gamma_table;
297 diu_ops.set_monitor_port = p1022ds_set_monitor_port;
298 diu_ops.set_pixel_clock = p1022ds_set_pixel_clock;
299 diu_ops.show_monitor_port = p1022ds_show_monitor_port;
300 diu_ops.set_sysfs_monitor_port = p1022ds_set_sysfs_monitor_port;
301#endif
302
95#ifdef CONFIG_SMP 303#ifdef CONFIG_SMP
96 mpc85xx_smp_init(); 304 mpc85xx_smp_init();
97#endif 305#endif
diff --git a/drivers/video/Kconfig b/drivers/video/Kconfig
index 43e90b899fe1..935cdc204f93 100644
--- a/drivers/video/Kconfig
+++ b/drivers/video/Kconfig
@@ -1919,6 +1919,8 @@ config FB_SH_MOBILE_HDMI
1919 tristate "SuperH Mobile HDMI controller support" 1919 tristate "SuperH Mobile HDMI controller support"
1920 depends on FB_SH_MOBILE_LCDC 1920 depends on FB_SH_MOBILE_LCDC
1921 select FB_MODE_HELPERS 1921 select FB_MODE_HELPERS
1922 select SOUND
1923 select SND
1922 select SND_SOC 1924 select SND_SOC
1923 ---help--- 1925 ---help---
1924 Driver for the on-chip SH-Mobile HDMI controller. 1926 Driver for the on-chip SH-Mobile HDMI controller.
diff --git a/include/sound/max98088.h b/include/sound/max98088.h
new file mode 100644
index 000000000000..c3ba8239182d
--- /dev/null
+++ b/include/sound/max98088.h
@@ -0,0 +1,50 @@
1/*
2 * Platform data for MAX98088
3 *
4 * Copyright 2010 Maxim Integrated Products
5 *
6 * This program is free software; you can redistribute it and/or modify it
7 * under the terms of the GNU General Public License as published by the
8 * Free Software Foundation; either version 2 of the License, or (at your
9 * option) any later version.
10 *
11 */
12
13#ifndef __SOUND_MAX98088_PDATA_H__
14#define __SOUND_MAX98088_PDATA_H__
15
16/* Equalizer filter response configuration */
17struct max98088_eq_cfg {
18 const char *name;
19 unsigned int rate;
20 u16 band1[5];
21 u16 band2[5];
22 u16 band3[5];
23 u16 band4[5];
24 u16 band5[5];
25};
26
27/* codec platform data */
28struct max98088_pdata {
29
30 /* Equalizers for DAI1 and DAI2 */
31 struct max98088_eq_cfg *eq_cfg;
32 unsigned int eq_cfgcnt;
33
34 /* Receiver output can be configured as power amplifier or LINE out */
35 /* Set receiver_mode to:
36 * 0 = amplifier output, or
37 * 1 = LINE level output
38 */
39 unsigned int receiver_mode:1;
40
41 /* Analog/digital microphone configuration:
42 * 0 = analog microphone input (normal setting)
43 * 1 = digital microphone input
44 */
45 unsigned int digmic_left_mode:1;
46 unsigned int digmic_right_mode:1;
47
48};
49
50#endif
diff --git a/include/sound/soc.h b/include/sound/soc.h
index 493b3a4c193a..5c3bce83f28a 100644
--- a/include/sound/soc.h
+++ b/include/sound/soc.h
@@ -385,7 +385,7 @@ struct snd_soc_jack_gpio {
385 int invert; 385 int invert;
386 int debounce_time; 386 int debounce_time;
387 struct snd_soc_jack *jack; 387 struct snd_soc_jack *jack;
388 struct work_struct work; 388 struct delayed_work work;
389 389
390 int (*jack_status_check)(void); 390 int (*jack_status_check)(void);
391}; 391};
@@ -442,6 +442,7 @@ struct snd_soc_codec {
442 unsigned int suspended:1; /* Codec is in suspend PM state */ 442 unsigned int suspended:1; /* Codec is in suspend PM state */
443 unsigned int probed:1; /* Codec has been probed */ 443 unsigned int probed:1; /* Codec has been probed */
444 unsigned int ac97_registered:1; /* Codec has been AC97 registered */ 444 unsigned int ac97_registered:1; /* Codec has been AC97 registered */
445 unsigned int ac97_created:1; /* Codec has been created by SoC */
445 unsigned int sysfs_registered:1; /* codec has been sysfs registered */ 446 unsigned int sysfs_registered:1; /* codec has been sysfs registered */
446 447
447 /* codec IO */ 448 /* codec IO */
diff --git a/sound/soc/codecs/Kconfig b/sound/soc/codecs/Kconfig
index ff7b922a0f41..94a9d06b9027 100644
--- a/sound/soc/codecs/Kconfig
+++ b/sound/soc/codecs/Kconfig
@@ -27,6 +27,7 @@ config SND_SOC_ALL_CODECS
27 select SND_SOC_CS4270 if I2C 27 select SND_SOC_CS4270 if I2C
28 select SND_SOC_DA7210 if I2C 28 select SND_SOC_DA7210 if I2C
29 select SND_SOC_JZ4740 if SOC_JZ4740 29 select SND_SOC_JZ4740 if SOC_JZ4740
30 select SND_SOC_MAX98088 if I2C
30 select SND_SOC_MAX9877 if I2C 31 select SND_SOC_MAX9877 if I2C
31 select SND_SOC_PCM3008 32 select SND_SOC_PCM3008
32 select SND_SOC_SPDIF 33 select SND_SOC_SPDIF
@@ -158,6 +159,9 @@ config SND_SOC_L3
158config SND_SOC_DA7210 159config SND_SOC_DA7210
159 tristate 160 tristate
160 161
162config SND_SOC_MAX98088
163 tristate
164
161config SND_SOC_PCM3008 165config SND_SOC_PCM3008
162 tristate 166 tristate
163 167
diff --git a/sound/soc/codecs/Makefile b/sound/soc/codecs/Makefile
index 0c5f329240c5..f67a2d6f7a46 100644
--- a/sound/soc/codecs/Makefile
+++ b/sound/soc/codecs/Makefile
@@ -15,6 +15,7 @@ snd-soc-cs4270-objs := cs4270.o
15snd-soc-cx20442-objs := cx20442.o 15snd-soc-cx20442-objs := cx20442.o
16snd-soc-da7210-objs := da7210.o 16snd-soc-da7210-objs := da7210.o
17snd-soc-l3-objs := l3.o 17snd-soc-l3-objs := l3.o
18snd-soc-max98088-objs := max98088.o
18snd-soc-pcm3008-objs := pcm3008.o 19snd-soc-pcm3008-objs := pcm3008.o
19snd-soc-spdif-objs := spdif_transciever.o 20snd-soc-spdif-objs := spdif_transciever.o
20snd-soc-ssm2602-objs := ssm2602.o 21snd-soc-ssm2602-objs := ssm2602.o
@@ -49,7 +50,7 @@ snd-soc-wm8940-objs := wm8940.o
49snd-soc-wm8955-objs := wm8955.o 50snd-soc-wm8955-objs := wm8955.o
50snd-soc-wm8960-objs := wm8960.o 51snd-soc-wm8960-objs := wm8960.o
51snd-soc-wm8961-objs := wm8961.o 52snd-soc-wm8961-objs := wm8961.o
52snd-soc-wm8962-objs := wm8962.o wm8962-tables.o 53snd-soc-wm8962-objs := wm8962.o
53snd-soc-wm8971-objs := wm8971.o 54snd-soc-wm8971-objs := wm8971.o
54snd-soc-wm8974-objs := wm8974.o 55snd-soc-wm8974-objs := wm8974.o
55snd-soc-wm8978-objs := wm8978.o 56snd-soc-wm8978-objs := wm8978.o
@@ -89,6 +90,7 @@ obj-$(CONFIG_SND_SOC_CX20442) += snd-soc-cx20442.o
89obj-$(CONFIG_SND_SOC_DA7210) += snd-soc-da7210.o 90obj-$(CONFIG_SND_SOC_DA7210) += snd-soc-da7210.o
90obj-$(CONFIG_SND_SOC_L3) += snd-soc-l3.o 91obj-$(CONFIG_SND_SOC_L3) += snd-soc-l3.o
91obj-$(CONFIG_SND_SOC_JZ4740_CODEC) += snd-soc-jz4740-codec.o 92obj-$(CONFIG_SND_SOC_JZ4740_CODEC) += snd-soc-jz4740-codec.o
93obj-$(CONFIG_SND_SOC_MAX98088) += snd-soc-max98088.o
92obj-$(CONFIG_SND_SOC_PCM3008) += snd-soc-pcm3008.o 94obj-$(CONFIG_SND_SOC_PCM3008) += snd-soc-pcm3008.o
93obj-$(CONFIG_SND_SOC_SPDIF) += snd-soc-spdif.o 95obj-$(CONFIG_SND_SOC_SPDIF) += snd-soc-spdif.o
94obj-$(CONFIG_SND_SOC_SSM2602) += snd-soc-ssm2602.o 96obj-$(CONFIG_SND_SOC_SSM2602) += snd-soc-ssm2602.o
diff --git a/sound/soc/codecs/ac97.c b/sound/soc/codecs/ac97.c
index 2c824a588756..3c087936aa57 100644
--- a/sound/soc/codecs/ac97.c
+++ b/sound/soc/codecs/ac97.c
@@ -79,12 +79,6 @@ static int ac97_soc_probe(struct snd_soc_codec *codec)
79 struct snd_ac97_template ac97_template; 79 struct snd_ac97_template ac97_template;
80 int ret; 80 int ret;
81 81
82 ret = snd_soc_new_ac97_codec(codec, &soc_ac97_ops, 0);
83 if (ret < 0) {
84 printk(KERN_ERR "ASoC: failed to init generic ac97 glue\n");
85 return ret;
86 }
87
88 /* add codec as bus device for standard ac97 */ 82 /* add codec as bus device for standard ac97 */
89 ret = snd_ac97_bus(codec->card->snd_card, 0, &soc_ac97_ops, NULL, &ac97_bus); 83 ret = snd_ac97_bus(codec->card->snd_card, 0, &soc_ac97_ops, NULL, &ac97_bus);
90 if (ret < 0) 84 if (ret < 0)
@@ -168,3 +162,4 @@ module_exit(ac97_exit);
168MODULE_DESCRIPTION("Soc Generic AC97 driver"); 162MODULE_DESCRIPTION("Soc Generic AC97 driver");
169MODULE_AUTHOR("Liam Girdwood"); 163MODULE_AUTHOR("Liam Girdwood");
170MODULE_LICENSE("GPL"); 164MODULE_LICENSE("GPL");
165MODULE_ALIAS("platform:ac97-codec");
diff --git a/sound/soc/codecs/ad1980.c b/sound/soc/codecs/ad1980.c
index d36bd1c333b8..410ccd5d41cd 100644
--- a/sound/soc/codecs/ad1980.c
+++ b/sound/soc/codecs/ad1980.c
@@ -133,7 +133,7 @@ static int ac97_write(struct snd_soc_codec *codec, unsigned int reg,
133 return 0; 133 return 0;
134} 134}
135 135
136struct snd_soc_dai_driver ad1980_dai = { 136static struct snd_soc_dai_driver ad1980_dai = {
137 .name = "ad1980-hifi", 137 .name = "ad1980-hifi",
138 .ac97_control = 1, 138 .ac97_control = 1,
139 .playback = { 139 .playback = {
diff --git a/sound/soc/codecs/ak4642.c b/sound/soc/codecs/ak4642.c
index a95ff4f9f42c..90c90b7f4a2e 100644
--- a/sound/soc/codecs/ak4642.c
+++ b/sound/soc/codecs/ak4642.c
@@ -72,6 +72,12 @@
72 72
73#define AK4642_CACHEREGNUM 0x25 73#define AK4642_CACHEREGNUM 0x25
74 74
75/* PW_MGMT1*/
76#define PMVCM (1 << 6) /* VCOM Power Management */
77#define PMMIN (1 << 5) /* MIN Input Power Management */
78#define PMDAC (1 << 2) /* DAC Power Management */
79#define PMADL (1 << 0) /* MIC Amp Lch and ADC Lch Power Management */
80
75/* PW_MGMT2 */ 81/* PW_MGMT2 */
76#define HPMTN (1 << 6) 82#define HPMTN (1 << 6)
77#define PMHPL (1 << 5) 83#define PMHPL (1 << 5)
@@ -83,6 +89,23 @@
83#define PMHP_MASK (PMHPL | PMHPR) 89#define PMHP_MASK (PMHPL | PMHPR)
84#define PMHP PMHP_MASK 90#define PMHP PMHP_MASK
85 91
92/* PW_MGMT3 */
93#define PMADR (1 << 0) /* MIC L / ADC R Power Management */
94
95/* SG_SL1 */
96#define MINS (1 << 6) /* Switch from MIN to Speaker */
97#define DACL (1 << 4) /* Switch from DAC to Stereo or Receiver */
98#define PMMP (1 << 2) /* MPWR pin Power Management */
99#define MGAIN0 (1 << 0) /* MIC amp gain*/
100
101/* TIMER */
102#define ZTM(param) ((param & 0x3) << 4) /* ALC Zoro Crossing TimeOut */
103#define WTM(param) (((param & 0x4) << 4) | ((param & 0x3) << 2))
104
105/* ALC_CTL1 */
106#define ALC (1 << 5) /* ALC Enable */
107#define LMTH0 (1 << 0) /* ALC Limiter / Recovery Level */
108
86/* MD_CTL1 */ 109/* MD_CTL1 */
87#define PLL3 (1 << 7) 110#define PLL3 (1 << 7)
88#define PLL2 (1 << 6) 111#define PLL2 (1 << 6)
@@ -100,6 +123,11 @@
100#define FS3 (1 << 5) 123#define FS3 (1 << 5)
101#define FS_MASK (FS0 | FS1 | FS2 | FS3) 124#define FS_MASK (FS0 | FS1 | FS2 | FS3)
102 125
126/* MD_CTL3 */
127#define BST1 (1 << 3)
128
129/* MD_CTL4 */
130#define DACH (1 << 0)
103 131
104/* 132/*
105 * Playback Volume (table 39) 133 * Playback Volume (table 39)
@@ -216,11 +244,12 @@ static int ak4642_dai_startup(struct snd_pcm_substream *substream,
216 * This operation came from example code of 244 * This operation came from example code of
217 * "ASAHI KASEI AK4642" (japanese) manual p97. 245 * "ASAHI KASEI AK4642" (japanese) manual p97.
218 */ 246 */
219 ak4642_write(codec, 0x0f, 0x09); 247 snd_soc_update_bits(codec, MD_CTL4, DACH, DACH);
220 ak4642_write(codec, 0x0e, 0x19); 248 snd_soc_update_bits(codec, MD_CTL3, BST1, BST1);
221 ak4642_write(codec, 0x09, 0x91); 249 ak4642_write(codec, L_IVC, 0x91); /* volume */
222 ak4642_write(codec, 0x0c, 0x91); 250 ak4642_write(codec, R_IVC, 0x91); /* volume */
223 ak4642_write(codec, 0x00, 0x64); 251 snd_soc_update_bits(codec, PW_MGMT1, PMVCM | PMMIN | PMDAC,
252 PMVCM | PMMIN | PMDAC);
224 snd_soc_update_bits(codec, PW_MGMT2, PMHP_MASK, PMHP); 253 snd_soc_update_bits(codec, PW_MGMT2, PMHP_MASK, PMHP);
225 snd_soc_update_bits(codec, PW_MGMT2, HPMTN, HPMTN); 254 snd_soc_update_bits(codec, PW_MGMT2, HPMTN, HPMTN);
226 } else { 255 } else {
@@ -237,13 +266,12 @@ static int ak4642_dai_startup(struct snd_pcm_substream *substream,
237 * This operation came from example code of 266 * This operation came from example code of
238 * "ASAHI KASEI AK4642" (japanese) manual p94. 267 * "ASAHI KASEI AK4642" (japanese) manual p94.
239 */ 268 */
240 ak4642_write(codec, 0x02, 0x05); 269 ak4642_write(codec, SG_SL1, PMMP | MGAIN0);
241 ak4642_write(codec, 0x06, 0x3c); 270 ak4642_write(codec, TIMER, ZTM(0x3) | WTM(0x3));
242 ak4642_write(codec, 0x08, 0xe1); 271 ak4642_write(codec, ALC_CTL1, ALC | LMTH0);
243 ak4642_write(codec, 0x0b, 0x00); 272 snd_soc_update_bits(codec, PW_MGMT1, PMVCM | PMADL,
244 ak4642_write(codec, 0x07, 0x21); 273 PMVCM | PMADL);
245 ak4642_write(codec, 0x00, 0x41); 274 snd_soc_update_bits(codec, PW_MGMT3, PMADR, PMADR);
246 ak4642_write(codec, 0x10, 0x01);
247 } 275 }
248 276
249 return 0; 277 return 0;
@@ -259,14 +287,14 @@ static void ak4642_dai_shutdown(struct snd_pcm_substream *substream,
259 /* stop headphone output */ 287 /* stop headphone output */
260 snd_soc_update_bits(codec, PW_MGMT2, HPMTN, 0); 288 snd_soc_update_bits(codec, PW_MGMT2, HPMTN, 0);
261 snd_soc_update_bits(codec, PW_MGMT2, PMHP_MASK, 0); 289 snd_soc_update_bits(codec, PW_MGMT2, PMHP_MASK, 0);
262 ak4642_write(codec, 0x00, 0x40); 290 snd_soc_update_bits(codec, PW_MGMT1, PMMIN | PMDAC, 0);
263 ak4642_write(codec, 0x0e, 0x11); 291 snd_soc_update_bits(codec, MD_CTL3, BST1, 0);
264 ak4642_write(codec, 0x0f, 0x08); 292 snd_soc_update_bits(codec, MD_CTL4, DACH, 0);
265 } else { 293 } else {
266 /* stop stereo input */ 294 /* stop stereo input */
267 ak4642_write(codec, 0x00, 0x40); 295 snd_soc_update_bits(codec, PW_MGMT1, PMADL, 0);
268 ak4642_write(codec, 0x10, 0x00); 296 snd_soc_update_bits(codec, PW_MGMT3, PMADR, 0);
269 ak4642_write(codec, 0x07, 0x01); 297 snd_soc_update_bits(codec, ALC_CTL1, ALC, 0);
270 } 298 }
271} 299}
272 300
diff --git a/sound/soc/codecs/cs4270.c b/sound/soc/codecs/cs4270.c
index 5fd8e0d0dab8..6d4bdc609ac8 100644
--- a/sound/soc/codecs/cs4270.c
+++ b/sound/soc/codecs/cs4270.c
@@ -518,7 +518,7 @@ static struct snd_soc_dai_ops cs4270_dai_ops = {
518 .digital_mute = cs4270_dai_mute, 518 .digital_mute = cs4270_dai_mute,
519}; 519};
520 520
521struct snd_soc_dai_driver cs4270_dai = { 521static struct snd_soc_dai_driver cs4270_dai = {
522 .name = "cs4270-hifi", 522 .name = "cs4270-hifi",
523 .playback = { 523 .playback = {
524 .stream_name = "Playback", 524 .stream_name = "Playback",
diff --git a/sound/soc/codecs/max98088.c b/sound/soc/codecs/max98088.c
new file mode 100644
index 000000000000..e7a40d16df90
--- /dev/null
+++ b/sound/soc/codecs/max98088.c
@@ -0,0 +1,2097 @@
1/*
2 * max98088.c -- MAX98088 ALSA SoC Audio driver
3 *
4 * Copyright 2010 Maxim Integrated Products
5 *
6 * This program is free software; you can redistribute it and/or modify
7 * it under the terms of the GNU General Public License version 2 as
8 * published by the Free Software Foundation.
9 */
10
11#include <linux/module.h>
12#include <linux/moduleparam.h>
13#include <linux/kernel.h>
14#include <linux/init.h>
15#include <linux/delay.h>
16#include <linux/pm.h>
17#include <linux/i2c.h>
18#include <linux/platform_device.h>
19#include <sound/core.h>
20#include <sound/pcm.h>
21#include <sound/pcm_params.h>
22#include <sound/soc.h>
23#include <sound/soc-dapm.h>
24#include <sound/initval.h>
25#include <sound/tlv.h>
26#include <linux/slab.h>
27#include <asm/div64.h>
28#include <sound/max98088.h>
29#include "max98088.h"
30
31struct max98088_cdata {
32 unsigned int rate;
33 unsigned int fmt;
34 int eq_sel;
35};
36
37struct max98088_priv {
38 u8 reg_cache[M98088_REG_CNT];
39 void *control_data;
40 struct max98088_pdata *pdata;
41 unsigned int sysclk;
42 struct max98088_cdata dai[2];
43 int eq_textcnt;
44 const char **eq_texts;
45 struct soc_enum eq_enum;
46 u8 ina_state;
47 u8 inb_state;
48 unsigned int ex_mode;
49 unsigned int digmic;
50 unsigned int mic1pre;
51 unsigned int mic2pre;
52 unsigned int extmic_mode;
53};
54
55static const u8 max98088_reg[M98088_REG_CNT] = {
56 0x00, /* 00 IRQ status */
57 0x00, /* 01 MIC status */
58 0x00, /* 02 jack status */
59 0x00, /* 03 battery voltage */
60 0x00, /* 04 */
61 0x00, /* 05 */
62 0x00, /* 06 */
63 0x00, /* 07 */
64 0x00, /* 08 */
65 0x00, /* 09 */
66 0x00, /* 0A */
67 0x00, /* 0B */
68 0x00, /* 0C */
69 0x00, /* 0D */
70 0x00, /* 0E */
71 0x00, /* 0F interrupt enable */
72
73 0x00, /* 10 master clock */
74 0x00, /* 11 DAI1 clock mode */
75 0x00, /* 12 DAI1 clock control */
76 0x00, /* 13 DAI1 clock control */
77 0x00, /* 14 DAI1 format */
78 0x00, /* 15 DAI1 clock */
79 0x00, /* 16 DAI1 config */
80 0x00, /* 17 DAI1 TDM */
81 0x00, /* 18 DAI1 filters */
82 0x00, /* 19 DAI2 clock mode */
83 0x00, /* 1A DAI2 clock control */
84 0x00, /* 1B DAI2 clock control */
85 0x00, /* 1C DAI2 format */
86 0x00, /* 1D DAI2 clock */
87 0x00, /* 1E DAI2 config */
88 0x00, /* 1F DAI2 TDM */
89
90 0x00, /* 20 DAI2 filters */
91 0x00, /* 21 data config */
92 0x00, /* 22 DAC mixer */
93 0x00, /* 23 left ADC mixer */
94 0x00, /* 24 right ADC mixer */
95 0x00, /* 25 left HP mixer */
96 0x00, /* 26 right HP mixer */
97 0x00, /* 27 HP control */
98 0x00, /* 28 left REC mixer */
99 0x00, /* 29 right REC mixer */
100 0x00, /* 2A REC control */
101 0x00, /* 2B left SPK mixer */
102 0x00, /* 2C right SPK mixer */
103 0x00, /* 2D SPK control */
104 0x00, /* 2E sidetone */
105 0x00, /* 2F DAI1 playback level */
106
107 0x00, /* 30 DAI1 playback level */
108 0x00, /* 31 DAI2 playback level */
109 0x00, /* 32 DAI2 playbakc level */
110 0x00, /* 33 left ADC level */
111 0x00, /* 34 right ADC level */
112 0x00, /* 35 MIC1 level */
113 0x00, /* 36 MIC2 level */
114 0x00, /* 37 INA level */
115 0x00, /* 38 INB level */
116 0x00, /* 39 left HP volume */
117 0x00, /* 3A right HP volume */
118 0x00, /* 3B left REC volume */
119 0x00, /* 3C right REC volume */
120 0x00, /* 3D left SPK volume */
121 0x00, /* 3E right SPK volume */
122 0x00, /* 3F MIC config */
123
124 0x00, /* 40 MIC threshold */
125 0x00, /* 41 excursion limiter filter */
126 0x00, /* 42 excursion limiter threshold */
127 0x00, /* 43 ALC */
128 0x00, /* 44 power limiter threshold */
129 0x00, /* 45 power limiter config */
130 0x00, /* 46 distortion limiter config */
131 0x00, /* 47 audio input */
132 0x00, /* 48 microphone */
133 0x00, /* 49 level control */
134 0x00, /* 4A bypass switches */
135 0x00, /* 4B jack detect */
136 0x00, /* 4C input enable */
137 0x00, /* 4D output enable */
138 0xF0, /* 4E bias control */
139 0x00, /* 4F DAC power */
140
141 0x0F, /* 50 DAC power */
142 0x00, /* 51 system */
143 0x00, /* 52 DAI1 EQ1 */
144 0x00, /* 53 DAI1 EQ1 */
145 0x00, /* 54 DAI1 EQ1 */
146 0x00, /* 55 DAI1 EQ1 */
147 0x00, /* 56 DAI1 EQ1 */
148 0x00, /* 57 DAI1 EQ1 */
149 0x00, /* 58 DAI1 EQ1 */
150 0x00, /* 59 DAI1 EQ1 */
151 0x00, /* 5A DAI1 EQ1 */
152 0x00, /* 5B DAI1 EQ1 */
153 0x00, /* 5C DAI1 EQ2 */
154 0x00, /* 5D DAI1 EQ2 */
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156 0x00, /* 5F DAI1 EQ2 */
157
158 0x00, /* 60 DAI1 EQ2 */
159 0x00, /* 61 DAI1 EQ2 */
160 0x00, /* 62 DAI1 EQ2 */
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162 0x00, /* 64 DAI1 EQ2 */
163 0x00, /* 65 DAI1 EQ2 */
164 0x00, /* 66 DAI1 EQ3 */
165 0x00, /* 67 DAI1 EQ3 */
166 0x00, /* 68 DAI1 EQ3 */
167 0x00, /* 69 DAI1 EQ3 */
168 0x00, /* 6A DAI1 EQ3 */
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170 0x00, /* 6C DAI1 EQ3 */
171 0x00, /* 6D DAI1 EQ3 */
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174
175 0x00, /* 70 DAI1 EQ4 */
176 0x00, /* 71 DAI1 EQ4 */
177 0x00, /* 72 DAI1 EQ4 */
178 0x00, /* 73 DAI1 EQ4 */
179 0x00, /* 74 DAI1 EQ4 */
180 0x00, /* 75 DAI1 EQ4 */
181 0x00, /* 76 DAI1 EQ4 */
182 0x00, /* 77 DAI1 EQ4 */
183 0x00, /* 78 DAI1 EQ4 */
184 0x00, /* 79 DAI1 EQ4 */
185 0x00, /* 7A DAI1 EQ5 */
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189 0x00, /* 7E DAI1 EQ5 */
190 0x00, /* 7F DAI1 EQ5 */
191
192 0x00, /* 80 DAI1 EQ5 */
193 0x00, /* 81 DAI1 EQ5 */
194 0x00, /* 82 DAI1 EQ5 */
195 0x00, /* 83 DAI1 EQ5 */
196 0x00, /* 84 DAI2 EQ1 */
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198 0x00, /* 86 DAI2 EQ1 */
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200 0x00, /* 88 DAI2 EQ1 */
201 0x00, /* 89 DAI2 EQ1 */
202 0x00, /* 8A DAI2 EQ1 */
203 0x00, /* 8B DAI2 EQ1 */
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208
209 0x00, /* 90 DAI2 EQ2 */
210 0x00, /* 91 DAI2 EQ2 */
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217 0x00, /* 98 DAI2 EQ3 */
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219 0x00, /* 9A DAI2 EQ3 */
220 0x00, /* 9B DAI2 EQ3 */
221 0x00, /* 9C DAI2 EQ3 */
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225
226 0x00, /* A0 DAI2 EQ3 */
227 0x00, /* A1 DAI2 EQ3 */
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230 0x00, /* A4 DAI2 EQ4 */
231 0x00, /* A5 DAI2 EQ4 */
232 0x00, /* A6 DAI2 EQ4 */
233 0x00, /* A7 DAI2 EQ4 */
234 0x00, /* A8 DAI2 EQ4 */
235 0x00, /* A9 DAI2 EQ4 */
236 0x00, /* AA DAI2 EQ4 */
237 0x00, /* AB DAI2 EQ4 */
238 0x00, /* AC DAI2 EQ5 */
239 0x00, /* AD DAI2 EQ5 */
240 0x00, /* AE DAI2 EQ5 */
241 0x00, /* AF DAI2 EQ5 */
242
243 0x00, /* B0 DAI2 EQ5 */
244 0x00, /* B1 DAI2 EQ5 */
245 0x00, /* B2 DAI2 EQ5 */
246 0x00, /* B3 DAI2 EQ5 */
247 0x00, /* B4 DAI2 EQ5 */
248 0x00, /* B5 DAI2 EQ5 */
249 0x00, /* B6 DAI1 biquad */
250 0x00, /* B7 DAI1 biquad */
251 0x00, /* B8 DAI1 biquad */
252 0x00, /* B9 DAI1 biquad */
253 0x00, /* BA DAI1 biquad */
254 0x00, /* BB DAI1 biquad */
255 0x00, /* BC DAI1 biquad */
256 0x00, /* BD DAI1 biquad */
257 0x00, /* BE DAI1 biquad */
258 0x00, /* BF DAI1 biquad */
259
260 0x00, /* C0 DAI2 biquad */
261 0x00, /* C1 DAI2 biquad */
262 0x00, /* C2 DAI2 biquad */
263 0x00, /* C3 DAI2 biquad */
264 0x00, /* C4 DAI2 biquad */
265 0x00, /* C5 DAI2 biquad */
266 0x00, /* C6 DAI2 biquad */
267 0x00, /* C7 DAI2 biquad */
268 0x00, /* C8 DAI2 biquad */
269 0x00, /* C9 DAI2 biquad */
270 0x00, /* CA */
271 0x00, /* CB */
272 0x00, /* CC */
273 0x00, /* CD */
274 0x00, /* CE */
275 0x00, /* CF */
276
277 0x00, /* D0 */
278 0x00, /* D1 */
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289 0x00, /* DC */
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291 0x00, /* DE */
292 0x00, /* DF */
293
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304 0x00, /* EA */
305 0x00, /* EB */
306 0x00, /* EC */
307 0x00, /* ED */
308 0x00, /* EE */
309 0x00, /* EF */
310
311 0x00, /* F0 */
312 0x00, /* F1 */
313 0x00, /* F2 */
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316 0x00, /* F5 */
317 0x00, /* F6 */
318 0x00, /* F7 */
319 0x00, /* F8 */
320 0x00, /* F9 */
321 0x00, /* FA */
322 0x00, /* FB */
323 0x00, /* FC */
324 0x00, /* FD */
325 0x00, /* FE */
326 0x00, /* FF */
327};
328
329static struct {
330 int readable;
331 int writable;
332 int vol;
333} max98088_access[M98088_REG_CNT] = {
334 { 0xFF, 0xFF, 1 }, /* 00 IRQ status */
335 { 0xFF, 0x00, 1 }, /* 01 MIC status */
336 { 0xFF, 0x00, 1 }, /* 02 jack status */
337 { 0x1F, 0x1F, 1 }, /* 03 battery voltage */
338 { 0xFF, 0xFF, 0 }, /* 04 */
339 { 0xFF, 0xFF, 0 }, /* 05 */
340 { 0xFF, 0xFF, 0 }, /* 06 */
341 { 0xFF, 0xFF, 0 }, /* 07 */
342 { 0xFF, 0xFF, 0 }, /* 08 */
343 { 0xFF, 0xFF, 0 }, /* 09 */
344 { 0xFF, 0xFF, 0 }, /* 0A */
345 { 0xFF, 0xFF, 0 }, /* 0B */
346 { 0xFF, 0xFF, 0 }, /* 0C */
347 { 0xFF, 0xFF, 0 }, /* 0D */
348 { 0xFF, 0xFF, 0 }, /* 0E */
349 { 0xFF, 0xFF, 0 }, /* 0F interrupt enable */
350
351 { 0xFF, 0xFF, 0 }, /* 10 master clock */
352 { 0xFF, 0xFF, 0 }, /* 11 DAI1 clock mode */
353 { 0xFF, 0xFF, 0 }, /* 12 DAI1 clock control */
354 { 0xFF, 0xFF, 0 }, /* 13 DAI1 clock control */
355 { 0xFF, 0xFF, 0 }, /* 14 DAI1 format */
356 { 0xFF, 0xFF, 0 }, /* 15 DAI1 clock */
357 { 0xFF, 0xFF, 0 }, /* 16 DAI1 config */
358 { 0xFF, 0xFF, 0 }, /* 17 DAI1 TDM */
359 { 0xFF, 0xFF, 0 }, /* 18 DAI1 filters */
360 { 0xFF, 0xFF, 0 }, /* 19 DAI2 clock mode */
361 { 0xFF, 0xFF, 0 }, /* 1A DAI2 clock control */
362 { 0xFF, 0xFF, 0 }, /* 1B DAI2 clock control */
363 { 0xFF, 0xFF, 0 }, /* 1C DAI2 format */
364 { 0xFF, 0xFF, 0 }, /* 1D DAI2 clock */
365 { 0xFF, 0xFF, 0 }, /* 1E DAI2 config */
366 { 0xFF, 0xFF, 0 }, /* 1F DAI2 TDM */
367
368 { 0xFF, 0xFF, 0 }, /* 20 DAI2 filters */
369 { 0xFF, 0xFF, 0 }, /* 21 data config */
370 { 0xFF, 0xFF, 0 }, /* 22 DAC mixer */
371 { 0xFF, 0xFF, 0 }, /* 23 left ADC mixer */
372 { 0xFF, 0xFF, 0 }, /* 24 right ADC mixer */
373 { 0xFF, 0xFF, 0 }, /* 25 left HP mixer */
374 { 0xFF, 0xFF, 0 }, /* 26 right HP mixer */
375 { 0xFF, 0xFF, 0 }, /* 27 HP control */
376 { 0xFF, 0xFF, 0 }, /* 28 left REC mixer */
377 { 0xFF, 0xFF, 0 }, /* 29 right REC mixer */
378 { 0xFF, 0xFF, 0 }, /* 2A REC control */
379 { 0xFF, 0xFF, 0 }, /* 2B left SPK mixer */
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381 { 0xFF, 0xFF, 0 }, /* 2D SPK control */
382 { 0xFF, 0xFF, 0 }, /* 2E sidetone */
383 { 0xFF, 0xFF, 0 }, /* 2F DAI1 playback level */
384
385 { 0xFF, 0xFF, 0 }, /* 30 DAI1 playback level */
386 { 0xFF, 0xFF, 0 }, /* 31 DAI2 playback level */
387 { 0xFF, 0xFF, 0 }, /* 32 DAI2 playbakc level */
388 { 0xFF, 0xFF, 0 }, /* 33 left ADC level */
389 { 0xFF, 0xFF, 0 }, /* 34 right ADC level */
390 { 0xFF, 0xFF, 0 }, /* 35 MIC1 level */
391 { 0xFF, 0xFF, 0 }, /* 36 MIC2 level */
392 { 0xFF, 0xFF, 0 }, /* 37 INA level */
393 { 0xFF, 0xFF, 0 }, /* 38 INB level */
394 { 0xFF, 0xFF, 0 }, /* 39 left HP volume */
395 { 0xFF, 0xFF, 0 }, /* 3A right HP volume */
396 { 0xFF, 0xFF, 0 }, /* 3B left REC volume */
397 { 0xFF, 0xFF, 0 }, /* 3C right REC volume */
398 { 0xFF, 0xFF, 0 }, /* 3D left SPK volume */
399 { 0xFF, 0xFF, 0 }, /* 3E right SPK volume */
400 { 0xFF, 0xFF, 0 }, /* 3F MIC config */
401
402 { 0xFF, 0xFF, 0 }, /* 40 MIC threshold */
403 { 0xFF, 0xFF, 0 }, /* 41 excursion limiter filter */
404 { 0xFF, 0xFF, 0 }, /* 42 excursion limiter threshold */
405 { 0xFF, 0xFF, 0 }, /* 43 ALC */
406 { 0xFF, 0xFF, 0 }, /* 44 power limiter threshold */
407 { 0xFF, 0xFF, 0 }, /* 45 power limiter config */
408 { 0xFF, 0xFF, 0 }, /* 46 distortion limiter config */
409 { 0xFF, 0xFF, 0 }, /* 47 audio input */
410 { 0xFF, 0xFF, 0 }, /* 48 microphone */
411 { 0xFF, 0xFF, 0 }, /* 49 level control */
412 { 0xFF, 0xFF, 0 }, /* 4A bypass switches */
413 { 0xFF, 0xFF, 0 }, /* 4B jack detect */
414 { 0xFF, 0xFF, 0 }, /* 4C input enable */
415 { 0xFF, 0xFF, 0 }, /* 4D output enable */
416 { 0xFF, 0xFF, 0 }, /* 4E bias control */
417 { 0xFF, 0xFF, 0 }, /* 4F DAC power */
418
419 { 0xFF, 0xFF, 0 }, /* 50 DAC power */
420 { 0xFF, 0xFF, 0 }, /* 51 system */
421 { 0xFF, 0xFF, 0 }, /* 52 DAI1 EQ1 */
422 { 0xFF, 0xFF, 0 }, /* 53 DAI1 EQ1 */
423 { 0xFF, 0xFF, 0 }, /* 54 DAI1 EQ1 */
424 { 0xFF, 0xFF, 0 }, /* 55 DAI1 EQ1 */
425 { 0xFF, 0xFF, 0 }, /* 56 DAI1 EQ1 */
426 { 0xFF, 0xFF, 0 }, /* 57 DAI1 EQ1 */
427 { 0xFF, 0xFF, 0 }, /* 58 DAI1 EQ1 */
428 { 0xFF, 0xFF, 0 }, /* 59 DAI1 EQ1 */
429 { 0xFF, 0xFF, 0 }, /* 5A DAI1 EQ1 */
430 { 0xFF, 0xFF, 0 }, /* 5B DAI1 EQ1 */
431 { 0xFF, 0xFF, 0 }, /* 5C DAI1 EQ2 */
432 { 0xFF, 0xFF, 0 }, /* 5D DAI1 EQ2 */
433 { 0xFF, 0xFF, 0 }, /* 5E DAI1 EQ2 */
434 { 0xFF, 0xFF, 0 }, /* 5F DAI1 EQ2 */
435
436 { 0xFF, 0xFF, 0 }, /* 60 DAI1 EQ2 */
437 { 0xFF, 0xFF, 0 }, /* 61 DAI1 EQ2 */
438 { 0xFF, 0xFF, 0 }, /* 62 DAI1 EQ2 */
439 { 0xFF, 0xFF, 0 }, /* 63 DAI1 EQ2 */
440 { 0xFF, 0xFF, 0 }, /* 64 DAI1 EQ2 */
441 { 0xFF, 0xFF, 0 }, /* 65 DAI1 EQ2 */
442 { 0xFF, 0xFF, 0 }, /* 66 DAI1 EQ3 */
443 { 0xFF, 0xFF, 0 }, /* 67 DAI1 EQ3 */
444 { 0xFF, 0xFF, 0 }, /* 68 DAI1 EQ3 */
445 { 0xFF, 0xFF, 0 }, /* 69 DAI1 EQ3 */
446 { 0xFF, 0xFF, 0 }, /* 6A DAI1 EQ3 */
447 { 0xFF, 0xFF, 0 }, /* 6B DAI1 EQ3 */
448 { 0xFF, 0xFF, 0 }, /* 6C DAI1 EQ3 */
449 { 0xFF, 0xFF, 0 }, /* 6D DAI1 EQ3 */
450 { 0xFF, 0xFF, 0 }, /* 6E DAI1 EQ3 */
451 { 0xFF, 0xFF, 0 }, /* 6F DAI1 EQ3 */
452
453 { 0xFF, 0xFF, 0 }, /* 70 DAI1 EQ4 */
454 { 0xFF, 0xFF, 0 }, /* 71 DAI1 EQ4 */
455 { 0xFF, 0xFF, 0 }, /* 72 DAI1 EQ4 */
456 { 0xFF, 0xFF, 0 }, /* 73 DAI1 EQ4 */
457 { 0xFF, 0xFF, 0 }, /* 74 DAI1 EQ4 */
458 { 0xFF, 0xFF, 0 }, /* 75 DAI1 EQ4 */
459 { 0xFF, 0xFF, 0 }, /* 76 DAI1 EQ4 */
460 { 0xFF, 0xFF, 0 }, /* 77 DAI1 EQ4 */
461 { 0xFF, 0xFF, 0 }, /* 78 DAI1 EQ4 */
462 { 0xFF, 0xFF, 0 }, /* 79 DAI1 EQ4 */
463 { 0xFF, 0xFF, 0 }, /* 7A DAI1 EQ5 */
464 { 0xFF, 0xFF, 0 }, /* 7B DAI1 EQ5 */
465 { 0xFF, 0xFF, 0 }, /* 7C DAI1 EQ5 */
466 { 0xFF, 0xFF, 0 }, /* 7D DAI1 EQ5 */
467 { 0xFF, 0xFF, 0 }, /* 7E DAI1 EQ5 */
468 { 0xFF, 0xFF, 0 }, /* 7F DAI1 EQ5 */
469
470 { 0xFF, 0xFF, 0 }, /* 80 DAI1 EQ5 */
471 { 0xFF, 0xFF, 0 }, /* 81 DAI1 EQ5 */
472 { 0xFF, 0xFF, 0 }, /* 82 DAI1 EQ5 */
473 { 0xFF, 0xFF, 0 }, /* 83 DAI1 EQ5 */
474 { 0xFF, 0xFF, 0 }, /* 84 DAI2 EQ1 */
475 { 0xFF, 0xFF, 0 }, /* 85 DAI2 EQ1 */
476 { 0xFF, 0xFF, 0 }, /* 86 DAI2 EQ1 */
477 { 0xFF, 0xFF, 0 }, /* 87 DAI2 EQ1 */
478 { 0xFF, 0xFF, 0 }, /* 88 DAI2 EQ1 */
479 { 0xFF, 0xFF, 0 }, /* 89 DAI2 EQ1 */
480 { 0xFF, 0xFF, 0 }, /* 8A DAI2 EQ1 */
481 { 0xFF, 0xFF, 0 }, /* 8B DAI2 EQ1 */
482 { 0xFF, 0xFF, 0 }, /* 8C DAI2 EQ1 */
483 { 0xFF, 0xFF, 0 }, /* 8D DAI2 EQ1 */
484 { 0xFF, 0xFF, 0 }, /* 8E DAI2 EQ2 */
485 { 0xFF, 0xFF, 0 }, /* 8F DAI2 EQ2 */
486
487 { 0xFF, 0xFF, 0 }, /* 90 DAI2 EQ2 */
488 { 0xFF, 0xFF, 0 }, /* 91 DAI2 EQ2 */
489 { 0xFF, 0xFF, 0 }, /* 92 DAI2 EQ2 */
490 { 0xFF, 0xFF, 0 }, /* 93 DAI2 EQ2 */
491 { 0xFF, 0xFF, 0 }, /* 94 DAI2 EQ2 */
492 { 0xFF, 0xFF, 0 }, /* 95 DAI2 EQ2 */
493 { 0xFF, 0xFF, 0 }, /* 96 DAI2 EQ2 */
494 { 0xFF, 0xFF, 0 }, /* 97 DAI2 EQ2 */
495 { 0xFF, 0xFF, 0 }, /* 98 DAI2 EQ3 */
496 { 0xFF, 0xFF, 0 }, /* 99 DAI2 EQ3 */
497 { 0xFF, 0xFF, 0 }, /* 9A DAI2 EQ3 */
498 { 0xFF, 0xFF, 0 }, /* 9B DAI2 EQ3 */
499 { 0xFF, 0xFF, 0 }, /* 9C DAI2 EQ3 */
500 { 0xFF, 0xFF, 0 }, /* 9D DAI2 EQ3 */
501 { 0xFF, 0xFF, 0 }, /* 9E DAI2 EQ3 */
502 { 0xFF, 0xFF, 0 }, /* 9F DAI2 EQ3 */
503
504 { 0xFF, 0xFF, 0 }, /* A0 DAI2 EQ3 */
505 { 0xFF, 0xFF, 0 }, /* A1 DAI2 EQ3 */
506 { 0xFF, 0xFF, 0 }, /* A2 DAI2 EQ4 */
507 { 0xFF, 0xFF, 0 }, /* A3 DAI2 EQ4 */
508 { 0xFF, 0xFF, 0 }, /* A4 DAI2 EQ4 */
509 { 0xFF, 0xFF, 0 }, /* A5 DAI2 EQ4 */
510 { 0xFF, 0xFF, 0 }, /* A6 DAI2 EQ4 */
511 { 0xFF, 0xFF, 0 }, /* A7 DAI2 EQ4 */
512 { 0xFF, 0xFF, 0 }, /* A8 DAI2 EQ4 */
513 { 0xFF, 0xFF, 0 }, /* A9 DAI2 EQ4 */
514 { 0xFF, 0xFF, 0 }, /* AA DAI2 EQ4 */
515 { 0xFF, 0xFF, 0 }, /* AB DAI2 EQ4 */
516 { 0xFF, 0xFF, 0 }, /* AC DAI2 EQ5 */
517 { 0xFF, 0xFF, 0 }, /* AD DAI2 EQ5 */
518 { 0xFF, 0xFF, 0 }, /* AE DAI2 EQ5 */
519 { 0xFF, 0xFF, 0 }, /* AF DAI2 EQ5 */
520
521 { 0xFF, 0xFF, 0 }, /* B0 DAI2 EQ5 */
522 { 0xFF, 0xFF, 0 }, /* B1 DAI2 EQ5 */
523 { 0xFF, 0xFF, 0 }, /* B2 DAI2 EQ5 */
524 { 0xFF, 0xFF, 0 }, /* B3 DAI2 EQ5 */
525 { 0xFF, 0xFF, 0 }, /* B4 DAI2 EQ5 */
526 { 0xFF, 0xFF, 0 }, /* B5 DAI2 EQ5 */
527 { 0xFF, 0xFF, 0 }, /* B6 DAI1 biquad */
528 { 0xFF, 0xFF, 0 }, /* B7 DAI1 biquad */
529 { 0xFF, 0xFF, 0 }, /* B8 DAI1 biquad */
530 { 0xFF, 0xFF, 0 }, /* B9 DAI1 biquad */
531 { 0xFF, 0xFF, 0 }, /* BA DAI1 biquad */
532 { 0xFF, 0xFF, 0 }, /* BB DAI1 biquad */
533 { 0xFF, 0xFF, 0 }, /* BC DAI1 biquad */
534 { 0xFF, 0xFF, 0 }, /* BD DAI1 biquad */
535 { 0xFF, 0xFF, 0 }, /* BE DAI1 biquad */
536 { 0xFF, 0xFF, 0 }, /* BF DAI1 biquad */
537
538 { 0xFF, 0xFF, 0 }, /* C0 DAI2 biquad */
539 { 0xFF, 0xFF, 0 }, /* C1 DAI2 biquad */
540 { 0xFF, 0xFF, 0 }, /* C2 DAI2 biquad */
541 { 0xFF, 0xFF, 0 }, /* C3 DAI2 biquad */
542 { 0xFF, 0xFF, 0 }, /* C4 DAI2 biquad */
543 { 0xFF, 0xFF, 0 }, /* C5 DAI2 biquad */
544 { 0xFF, 0xFF, 0 }, /* C6 DAI2 biquad */
545 { 0xFF, 0xFF, 0 }, /* C7 DAI2 biquad */
546 { 0xFF, 0xFF, 0 }, /* C8 DAI2 biquad */
547 { 0xFF, 0xFF, 0 }, /* C9 DAI2 biquad */
548 { 0x00, 0x00, 0 }, /* CA */
549 { 0x00, 0x00, 0 }, /* CB */
550 { 0x00, 0x00, 0 }, /* CC */
551 { 0x00, 0x00, 0 }, /* CD */
552 { 0x00, 0x00, 0 }, /* CE */
553 { 0x00, 0x00, 0 }, /* CF */
554
555 { 0x00, 0x00, 0 }, /* D0 */
556 { 0x00, 0x00, 0 }, /* D1 */
557 { 0x00, 0x00, 0 }, /* D2 */
558 { 0x00, 0x00, 0 }, /* D3 */
559 { 0x00, 0x00, 0 }, /* D4 */
560 { 0x00, 0x00, 0 }, /* D5 */
561 { 0x00, 0x00, 0 }, /* D6 */
562 { 0x00, 0x00, 0 }, /* D7 */
563 { 0x00, 0x00, 0 }, /* D8 */
564 { 0x00, 0x00, 0 }, /* D9 */
565 { 0x00, 0x00, 0 }, /* DA */
566 { 0x00, 0x00, 0 }, /* DB */
567 { 0x00, 0x00, 0 }, /* DC */
568 { 0x00, 0x00, 0 }, /* DD */
569 { 0x00, 0x00, 0 }, /* DE */
570 { 0x00, 0x00, 0 }, /* DF */
571
572 { 0x00, 0x00, 0 }, /* E0 */
573 { 0x00, 0x00, 0 }, /* E1 */
574 { 0x00, 0x00, 0 }, /* E2 */
575 { 0x00, 0x00, 0 }, /* E3 */
576 { 0x00, 0x00, 0 }, /* E4 */
577 { 0x00, 0x00, 0 }, /* E5 */
578 { 0x00, 0x00, 0 }, /* E6 */
579 { 0x00, 0x00, 0 }, /* E7 */
580 { 0x00, 0x00, 0 }, /* E8 */
581 { 0x00, 0x00, 0 }, /* E9 */
582 { 0x00, 0x00, 0 }, /* EA */
583 { 0x00, 0x00, 0 }, /* EB */
584 { 0x00, 0x00, 0 }, /* EC */
585 { 0x00, 0x00, 0 }, /* ED */
586 { 0x00, 0x00, 0 }, /* EE */
587 { 0x00, 0x00, 0 }, /* EF */
588
589 { 0x00, 0x00, 0 }, /* F0 */
590 { 0x00, 0x00, 0 }, /* F1 */
591 { 0x00, 0x00, 0 }, /* F2 */
592 { 0x00, 0x00, 0 }, /* F3 */
593 { 0x00, 0x00, 0 }, /* F4 */
594 { 0x00, 0x00, 0 }, /* F5 */
595 { 0x00, 0x00, 0 }, /* F6 */
596 { 0x00, 0x00, 0 }, /* F7 */
597 { 0x00, 0x00, 0 }, /* F8 */
598 { 0x00, 0x00, 0 }, /* F9 */
599 { 0x00, 0x00, 0 }, /* FA */
600 { 0x00, 0x00, 0 }, /* FB */
601 { 0x00, 0x00, 0 }, /* FC */
602 { 0x00, 0x00, 0 }, /* FD */
603 { 0x00, 0x00, 0 }, /* FE */
604 { 0xFF, 0x00, 1 }, /* FF */
605};
606
607static int max98088_volatile_register(unsigned int reg)
608{
609 return max98088_access[reg].vol;
610}
611
612
613/*
614 * Load equalizer DSP coefficient configurations registers
615 */
616static void m98088_eq_band(struct snd_soc_codec *codec, unsigned int dai,
617 unsigned int band, u16 *coefs)
618{
619 unsigned int eq_reg;
620 unsigned int i;
621
622 BUG_ON(band > 4);
623 BUG_ON(dai > 1);
624
625 /* Load the base register address */
626 eq_reg = dai ? M98088_REG_84_DAI2_EQ_BASE : M98088_REG_52_DAI1_EQ_BASE;
627
628 /* Add the band address offset, note adjustment for word address */
629 eq_reg += band * (M98088_COEFS_PER_BAND << 1);
630
631 /* Step through the registers and coefs */
632 for (i = 0; i < M98088_COEFS_PER_BAND; i++) {
633 snd_soc_write(codec, eq_reg++, M98088_BYTE1(coefs[i]));
634 snd_soc_write(codec, eq_reg++, M98088_BYTE0(coefs[i]));
635 }
636}
637
638/*
639 * Excursion limiter modes
640 */
641static const char *max98088_exmode_texts[] = {
642 "Off", "100Hz", "400Hz", "600Hz", "800Hz", "1000Hz", "200-400Hz",
643 "400-600Hz", "400-800Hz",
644};
645
646static const unsigned int max98088_exmode_values[] = {
647 0x00, 0x43, 0x10, 0x20, 0x30, 0x40, 0x11, 0x22, 0x32
648};
649
650static const struct soc_enum max98088_exmode_enum =
651 SOC_VALUE_ENUM_SINGLE(M98088_REG_41_SPKDHP, 0, 127,
652 ARRAY_SIZE(max98088_exmode_texts),
653 max98088_exmode_texts,
654 max98088_exmode_values);
655static const struct snd_kcontrol_new max98088_exmode_controls =
656 SOC_DAPM_VALUE_ENUM("Route", max98088_exmode_enum);
657
658static const char *max98088_ex_thresh[] = { /* volts PP */
659 "0.6", "1.2", "1.8", "2.4", "3.0", "3.6", "4.2", "4.8"};
660static const struct soc_enum max98088_ex_thresh_enum[] = {
661 SOC_ENUM_SINGLE(M98088_REG_42_SPKDHP_THRESH, 0, 8,
662 max98088_ex_thresh),
663};
664
665static const char *max98088_fltr_mode[] = {"Voice", "Music" };
666static const struct soc_enum max98088_filter_mode_enum[] = {
667 SOC_ENUM_SINGLE(M98088_REG_18_DAI1_FILTERS, 7, 2, max98088_fltr_mode),
668};
669
670static const char *max98088_extmic_text[] = { "None", "MIC1", "MIC2" };
671
672static const struct soc_enum max98088_extmic_enum =
673 SOC_ENUM_SINGLE(M98088_REG_48_CFG_MIC, 0, 3, max98088_extmic_text);
674
675static const struct snd_kcontrol_new max98088_extmic_mux =
676 SOC_DAPM_ENUM("External MIC Mux", max98088_extmic_enum);
677
678static const char *max98088_dai1_fltr[] = {
679 "Off", "fc=258/fs=16k", "fc=500/fs=16k",
680 "fc=258/fs=8k", "fc=500/fs=8k", "fc=200"};
681static const struct soc_enum max98088_dai1_dac_filter_enum[] = {
682 SOC_ENUM_SINGLE(M98088_REG_18_DAI1_FILTERS, 0, 6, max98088_dai1_fltr),
683};
684static const struct soc_enum max98088_dai1_adc_filter_enum[] = {
685 SOC_ENUM_SINGLE(M98088_REG_18_DAI1_FILTERS, 4, 6, max98088_dai1_fltr),
686};
687
688static int max98088_mic1pre_set(struct snd_kcontrol *kcontrol,
689 struct snd_ctl_elem_value *ucontrol)
690{
691 struct snd_soc_codec *codec = snd_kcontrol_chip(kcontrol);
692 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
693 unsigned int sel = ucontrol->value.integer.value[0];
694
695 max98088->mic1pre = sel;
696 snd_soc_update_bits(codec, M98088_REG_35_LVL_MIC1, M98088_MICPRE_MASK,
697 (1+sel)<<M98088_MICPRE_SHIFT);
698
699 return 0;
700}
701
702static int max98088_mic1pre_get(struct snd_kcontrol *kcontrol,
703 struct snd_ctl_elem_value *ucontrol)
704{
705 struct snd_soc_codec *codec = snd_kcontrol_chip(kcontrol);
706 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
707
708 ucontrol->value.integer.value[0] = max98088->mic1pre;
709 return 0;
710}
711
712static int max98088_mic2pre_set(struct snd_kcontrol *kcontrol,
713 struct snd_ctl_elem_value *ucontrol)
714{
715 struct snd_soc_codec *codec = snd_kcontrol_chip(kcontrol);
716 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
717 unsigned int sel = ucontrol->value.integer.value[0];
718
719 max98088->mic2pre = sel;
720 snd_soc_update_bits(codec, M98088_REG_36_LVL_MIC2, M98088_MICPRE_MASK,
721 (1+sel)<<M98088_MICPRE_SHIFT);
722
723 return 0;
724}
725
726static int max98088_mic2pre_get(struct snd_kcontrol *kcontrol,
727 struct snd_ctl_elem_value *ucontrol)
728{
729 struct snd_soc_codec *codec = snd_kcontrol_chip(kcontrol);
730 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
731
732 ucontrol->value.integer.value[0] = max98088->mic2pre;
733 return 0;
734}
735
736static const unsigned int max98088_micboost_tlv[] = {
737 TLV_DB_RANGE_HEAD(2),
738 0, 1, TLV_DB_SCALE_ITEM(0, 2000, 0),
739 2, 2, TLV_DB_SCALE_ITEM(3000, 0, 0),
740};
741
742static const struct snd_kcontrol_new max98088_snd_controls[] = {
743
744 SOC_DOUBLE_R("Headphone Volume", M98088_REG_39_LVL_HP_L,
745 M98088_REG_3A_LVL_HP_R, 0, 31, 0),
746 SOC_DOUBLE_R("Speaker Volume", M98088_REG_3D_LVL_SPK_L,
747 M98088_REG_3E_LVL_SPK_R, 0, 31, 0),
748 SOC_DOUBLE_R("Receiver Volume", M98088_REG_3B_LVL_REC_L,
749 M98088_REG_3C_LVL_REC_R, 0, 31, 0),
750
751 SOC_DOUBLE_R("Headphone Switch", M98088_REG_39_LVL_HP_L,
752 M98088_REG_3A_LVL_HP_R, 7, 1, 1),
753 SOC_DOUBLE_R("Speaker Switch", M98088_REG_3D_LVL_SPK_L,
754 M98088_REG_3E_LVL_SPK_R, 7, 1, 1),
755 SOC_DOUBLE_R("Receiver Switch", M98088_REG_3B_LVL_REC_L,
756 M98088_REG_3C_LVL_REC_R, 7, 1, 1),
757
758 SOC_SINGLE("MIC1 Volume", M98088_REG_35_LVL_MIC1, 0, 31, 1),
759 SOC_SINGLE("MIC2 Volume", M98088_REG_36_LVL_MIC2, 0, 31, 1),
760
761 SOC_SINGLE_EXT_TLV("MIC1 Boost Volume",
762 M98088_REG_35_LVL_MIC1, 5, 2, 0,
763 max98088_mic1pre_get, max98088_mic1pre_set,
764 max98088_micboost_tlv),
765 SOC_SINGLE_EXT_TLV("MIC2 Boost Volume",
766 M98088_REG_36_LVL_MIC2, 5, 2, 0,
767 max98088_mic2pre_get, max98088_mic2pre_set,
768 max98088_micboost_tlv),
769
770 SOC_SINGLE("INA Volume", M98088_REG_37_LVL_INA, 0, 7, 1),
771 SOC_SINGLE("INB Volume", M98088_REG_38_LVL_INB, 0, 7, 1),
772
773 SOC_SINGLE("ADCL Volume", M98088_REG_33_LVL_ADC_L, 0, 15, 0),
774 SOC_SINGLE("ADCR Volume", M98088_REG_34_LVL_ADC_R, 0, 15, 0),
775
776 SOC_SINGLE("ADCL Boost Volume", M98088_REG_33_LVL_ADC_L, 4, 3, 0),
777 SOC_SINGLE("ADCR Boost Volume", M98088_REG_34_LVL_ADC_R, 4, 3, 0),
778
779 SOC_SINGLE("EQ1 Switch", M98088_REG_49_CFG_LEVEL, 0, 1, 0),
780 SOC_SINGLE("EQ2 Switch", M98088_REG_49_CFG_LEVEL, 1, 1, 0),
781
782 SOC_ENUM("EX Limiter Threshold", max98088_ex_thresh_enum),
783
784 SOC_ENUM("DAI1 Filter Mode", max98088_filter_mode_enum),
785 SOC_ENUM("DAI1 DAC Filter", max98088_dai1_dac_filter_enum),
786 SOC_ENUM("DAI1 ADC Filter", max98088_dai1_adc_filter_enum),
787 SOC_SINGLE("DAI2 DC Block Switch", M98088_REG_20_DAI2_FILTERS,
788 0, 1, 0),
789
790 SOC_SINGLE("ALC Switch", M98088_REG_43_SPKALC_COMP, 7, 1, 0),
791 SOC_SINGLE("ALC Threshold", M98088_REG_43_SPKALC_COMP, 0, 7, 0),
792 SOC_SINGLE("ALC Multiband", M98088_REG_43_SPKALC_COMP, 3, 1, 0),
793 SOC_SINGLE("ALC Release Time", M98088_REG_43_SPKALC_COMP, 4, 7, 0),
794
795 SOC_SINGLE("PWR Limiter Threshold", M98088_REG_44_PWRLMT_CFG,
796 4, 15, 0),
797 SOC_SINGLE("PWR Limiter Weight", M98088_REG_44_PWRLMT_CFG, 0, 7, 0),
798 SOC_SINGLE("PWR Limiter Time1", M98088_REG_45_PWRLMT_TIME, 0, 15, 0),
799 SOC_SINGLE("PWR Limiter Time2", M98088_REG_45_PWRLMT_TIME, 4, 15, 0),
800
801 SOC_SINGLE("THD Limiter Threshold", M98088_REG_46_THDLMT_CFG, 4, 15, 0),
802 SOC_SINGLE("THD Limiter Time", M98088_REG_46_THDLMT_CFG, 0, 7, 0),
803};
804
805/* Left speaker mixer switch */
806static const struct snd_kcontrol_new max98088_left_speaker_mixer_controls[] = {
807 SOC_DAPM_SINGLE("Left DAC1 Switch", M98088_REG_2B_MIX_SPK_LEFT, 7, 1, 0),
808 SOC_DAPM_SINGLE("Right DAC1 Switch", M98088_REG_2B_MIX_SPK_LEFT, 0, 1, 0),
809 SOC_DAPM_SINGLE("Left DAC2 Switch", M98088_REG_2B_MIX_SPK_LEFT, 7, 1, 0),
810 SOC_DAPM_SINGLE("Right DAC2 Switch", M98088_REG_2B_MIX_SPK_LEFT, 0, 1, 0),
811 SOC_DAPM_SINGLE("MIC1 Switch", M98088_REG_2B_MIX_SPK_LEFT, 5, 1, 0),
812 SOC_DAPM_SINGLE("MIC2 Switch", M98088_REG_2B_MIX_SPK_LEFT, 6, 1, 0),
813 SOC_DAPM_SINGLE("INA1 Switch", M98088_REG_2B_MIX_SPK_LEFT, 1, 1, 0),
814 SOC_DAPM_SINGLE("INA2 Switch", M98088_REG_2B_MIX_SPK_LEFT, 2, 1, 0),
815 SOC_DAPM_SINGLE("INB1 Switch", M98088_REG_2B_MIX_SPK_LEFT, 3, 1, 0),
816 SOC_DAPM_SINGLE("INB2 Switch", M98088_REG_2B_MIX_SPK_LEFT, 4, 1, 0),
817};
818
819/* Right speaker mixer switch */
820static const struct snd_kcontrol_new max98088_right_speaker_mixer_controls[] = {
821 SOC_DAPM_SINGLE("Left DAC1 Switch", M98088_REG_2C_MIX_SPK_RIGHT, 7, 1, 0),
822 SOC_DAPM_SINGLE("Right DAC1 Switch", M98088_REG_2C_MIX_SPK_RIGHT, 0, 1, 0),
823 SOC_DAPM_SINGLE("Left DAC2 Switch", M98088_REG_2C_MIX_SPK_RIGHT, 7, 1, 0),
824 SOC_DAPM_SINGLE("Right DAC2 Switch", M98088_REG_2C_MIX_SPK_RIGHT, 0, 1, 0),
825 SOC_DAPM_SINGLE("MIC1 Switch", M98088_REG_2C_MIX_SPK_RIGHT, 5, 1, 0),
826 SOC_DAPM_SINGLE("MIC2 Switch", M98088_REG_2C_MIX_SPK_RIGHT, 6, 1, 0),
827 SOC_DAPM_SINGLE("INA1 Switch", M98088_REG_2C_MIX_SPK_RIGHT, 1, 1, 0),
828 SOC_DAPM_SINGLE("INA2 Switch", M98088_REG_2C_MIX_SPK_RIGHT, 2, 1, 0),
829 SOC_DAPM_SINGLE("INB1 Switch", M98088_REG_2C_MIX_SPK_RIGHT, 3, 1, 0),
830 SOC_DAPM_SINGLE("INB2 Switch", M98088_REG_2C_MIX_SPK_RIGHT, 4, 1, 0),
831};
832
833/* Left headphone mixer switch */
834static const struct snd_kcontrol_new max98088_left_hp_mixer_controls[] = {
835 SOC_DAPM_SINGLE("Left DAC1 Switch", M98088_REG_25_MIX_HP_LEFT, 7, 1, 0),
836 SOC_DAPM_SINGLE("Right DAC1 Switch", M98088_REG_25_MIX_HP_LEFT, 0, 1, 0),
837 SOC_DAPM_SINGLE("Left DAC2 Switch", M98088_REG_25_MIX_HP_LEFT, 7, 1, 0),
838 SOC_DAPM_SINGLE("Right DAC2 Switch", M98088_REG_25_MIX_HP_LEFT, 0, 1, 0),
839 SOC_DAPM_SINGLE("MIC1 Switch", M98088_REG_25_MIX_HP_LEFT, 5, 1, 0),
840 SOC_DAPM_SINGLE("MIC2 Switch", M98088_REG_25_MIX_HP_LEFT, 6, 1, 0),
841 SOC_DAPM_SINGLE("INA1 Switch", M98088_REG_25_MIX_HP_LEFT, 1, 1, 0),
842 SOC_DAPM_SINGLE("INA2 Switch", M98088_REG_25_MIX_HP_LEFT, 2, 1, 0),
843 SOC_DAPM_SINGLE("INB1 Switch", M98088_REG_25_MIX_HP_LEFT, 3, 1, 0),
844 SOC_DAPM_SINGLE("INB2 Switch", M98088_REG_25_MIX_HP_LEFT, 4, 1, 0),
845};
846
847/* Right headphone mixer switch */
848static const struct snd_kcontrol_new max98088_right_hp_mixer_controls[] = {
849 SOC_DAPM_SINGLE("Left DAC1 Switch", M98088_REG_26_MIX_HP_RIGHT, 7, 1, 0),
850 SOC_DAPM_SINGLE("Right DAC1 Switch", M98088_REG_26_MIX_HP_RIGHT, 0, 1, 0),
851 SOC_DAPM_SINGLE("Left DAC2 Switch", M98088_REG_26_MIX_HP_RIGHT, 7, 1, 0),
852 SOC_DAPM_SINGLE("Right DAC2 Switch", M98088_REG_26_MIX_HP_RIGHT, 0, 1, 0),
853 SOC_DAPM_SINGLE("MIC1 Switch", M98088_REG_26_MIX_HP_RIGHT, 5, 1, 0),
854 SOC_DAPM_SINGLE("MIC2 Switch", M98088_REG_26_MIX_HP_RIGHT, 6, 1, 0),
855 SOC_DAPM_SINGLE("INA1 Switch", M98088_REG_26_MIX_HP_RIGHT, 1, 1, 0),
856 SOC_DAPM_SINGLE("INA2 Switch", M98088_REG_26_MIX_HP_RIGHT, 2, 1, 0),
857 SOC_DAPM_SINGLE("INB1 Switch", M98088_REG_26_MIX_HP_RIGHT, 3, 1, 0),
858 SOC_DAPM_SINGLE("INB2 Switch", M98088_REG_26_MIX_HP_RIGHT, 4, 1, 0),
859};
860
861/* Left earpiece/receiver mixer switch */
862static const struct snd_kcontrol_new max98088_left_rec_mixer_controls[] = {
863 SOC_DAPM_SINGLE("Left DAC1 Switch", M98088_REG_28_MIX_REC_LEFT, 7, 1, 0),
864 SOC_DAPM_SINGLE("Right DAC1 Switch", M98088_REG_28_MIX_REC_LEFT, 0, 1, 0),
865 SOC_DAPM_SINGLE("Left DAC2 Switch", M98088_REG_28_MIX_REC_LEFT, 7, 1, 0),
866 SOC_DAPM_SINGLE("Right DAC2 Switch", M98088_REG_28_MIX_REC_LEFT, 0, 1, 0),
867 SOC_DAPM_SINGLE("MIC1 Switch", M98088_REG_28_MIX_REC_LEFT, 5, 1, 0),
868 SOC_DAPM_SINGLE("MIC2 Switch", M98088_REG_28_MIX_REC_LEFT, 6, 1, 0),
869 SOC_DAPM_SINGLE("INA1 Switch", M98088_REG_28_MIX_REC_LEFT, 1, 1, 0),
870 SOC_DAPM_SINGLE("INA2 Switch", M98088_REG_28_MIX_REC_LEFT, 2, 1, 0),
871 SOC_DAPM_SINGLE("INB1 Switch", M98088_REG_28_MIX_REC_LEFT, 3, 1, 0),
872 SOC_DAPM_SINGLE("INB2 Switch", M98088_REG_28_MIX_REC_LEFT, 4, 1, 0),
873};
874
875/* Right earpiece/receiver mixer switch */
876static const struct snd_kcontrol_new max98088_right_rec_mixer_controls[] = {
877 SOC_DAPM_SINGLE("Left DAC1 Switch", M98088_REG_29_MIX_REC_RIGHT, 7, 1, 0),
878 SOC_DAPM_SINGLE("Right DAC1 Switch", M98088_REG_29_MIX_REC_RIGHT, 0, 1, 0),
879 SOC_DAPM_SINGLE("Left DAC2 Switch", M98088_REG_29_MIX_REC_RIGHT, 7, 1, 0),
880 SOC_DAPM_SINGLE("Right DAC2 Switch", M98088_REG_29_MIX_REC_RIGHT, 0, 1, 0),
881 SOC_DAPM_SINGLE("MIC1 Switch", M98088_REG_29_MIX_REC_RIGHT, 5, 1, 0),
882 SOC_DAPM_SINGLE("MIC2 Switch", M98088_REG_29_MIX_REC_RIGHT, 6, 1, 0),
883 SOC_DAPM_SINGLE("INA1 Switch", M98088_REG_29_MIX_REC_RIGHT, 1, 1, 0),
884 SOC_DAPM_SINGLE("INA2 Switch", M98088_REG_29_MIX_REC_RIGHT, 2, 1, 0),
885 SOC_DAPM_SINGLE("INB1 Switch", M98088_REG_29_MIX_REC_RIGHT, 3, 1, 0),
886 SOC_DAPM_SINGLE("INB2 Switch", M98088_REG_29_MIX_REC_RIGHT, 4, 1, 0),
887};
888
889/* Left ADC mixer switch */
890static const struct snd_kcontrol_new max98088_left_ADC_mixer_controls[] = {
891 SOC_DAPM_SINGLE("MIC1 Switch", M98088_REG_23_MIX_ADC_LEFT, 7, 1, 0),
892 SOC_DAPM_SINGLE("MIC2 Switch", M98088_REG_23_MIX_ADC_LEFT, 6, 1, 0),
893 SOC_DAPM_SINGLE("INA1 Switch", M98088_REG_23_MIX_ADC_LEFT, 3, 1, 0),
894 SOC_DAPM_SINGLE("INA2 Switch", M98088_REG_23_MIX_ADC_LEFT, 2, 1, 0),
895 SOC_DAPM_SINGLE("INB1 Switch", M98088_REG_23_MIX_ADC_LEFT, 1, 1, 0),
896 SOC_DAPM_SINGLE("INB2 Switch", M98088_REG_23_MIX_ADC_LEFT, 0, 1, 0),
897};
898
899/* Right ADC mixer switch */
900static const struct snd_kcontrol_new max98088_right_ADC_mixer_controls[] = {
901 SOC_DAPM_SINGLE("MIC1 Switch", M98088_REG_24_MIX_ADC_RIGHT, 7, 1, 0),
902 SOC_DAPM_SINGLE("MIC2 Switch", M98088_REG_24_MIX_ADC_RIGHT, 6, 1, 0),
903 SOC_DAPM_SINGLE("INA1 Switch", M98088_REG_24_MIX_ADC_RIGHT, 3, 1, 0),
904 SOC_DAPM_SINGLE("INA2 Switch", M98088_REG_24_MIX_ADC_RIGHT, 2, 1, 0),
905 SOC_DAPM_SINGLE("INB1 Switch", M98088_REG_24_MIX_ADC_RIGHT, 1, 1, 0),
906 SOC_DAPM_SINGLE("INB2 Switch", M98088_REG_24_MIX_ADC_RIGHT, 0, 1, 0),
907};
908
909static int max98088_mic_event(struct snd_soc_dapm_widget *w,
910 struct snd_kcontrol *kcontrol, int event)
911{
912 struct snd_soc_codec *codec = w->codec;
913 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
914
915 switch (event) {
916 case SND_SOC_DAPM_POST_PMU:
917 if (w->reg == M98088_REG_35_LVL_MIC1) {
918 snd_soc_update_bits(codec, w->reg, M98088_MICPRE_MASK,
919 (1+max98088->mic1pre)<<M98088_MICPRE_SHIFT);
920 } else {
921 snd_soc_update_bits(codec, w->reg, M98088_MICPRE_MASK,
922 (1+max98088->mic2pre)<<M98088_MICPRE_SHIFT);
923 }
924 break;
925 case SND_SOC_DAPM_POST_PMD:
926 snd_soc_update_bits(codec, w->reg, M98088_MICPRE_MASK, 0);
927 break;
928 default:
929 return -EINVAL;
930 }
931
932 return 0;
933}
934
935/*
936 * The line inputs are 2-channel stereo inputs with the left
937 * and right channels sharing a common PGA power control signal.
938 */
939static int max98088_line_pga(struct snd_soc_dapm_widget *w,
940 int event, int line, u8 channel)
941{
942 struct snd_soc_codec *codec = w->codec;
943 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
944 u8 *state;
945
946 BUG_ON(!((channel == 1) || (channel == 2)));
947
948 switch (line) {
949 case LINE_INA:
950 state = &max98088->ina_state;
951 break;
952 case LINE_INB:
953 state = &max98088->inb_state;
954 break;
955 default:
956 return -EINVAL;
957 }
958
959 switch (event) {
960 case SND_SOC_DAPM_POST_PMU:
961 *state |= channel;
962 snd_soc_update_bits(codec, w->reg,
963 (1 << w->shift), (1 << w->shift));
964 break;
965 case SND_SOC_DAPM_POST_PMD:
966 *state &= ~channel;
967 if (*state == 0) {
968 snd_soc_update_bits(codec, w->reg,
969 (1 << w->shift), 0);
970 }
971 break;
972 default:
973 return -EINVAL;
974 }
975
976 return 0;
977}
978
979static int max98088_pga_ina1_event(struct snd_soc_dapm_widget *w,
980 struct snd_kcontrol *k, int event)
981{
982 return max98088_line_pga(w, event, LINE_INA, 1);
983}
984
985static int max98088_pga_ina2_event(struct snd_soc_dapm_widget *w,
986 struct snd_kcontrol *k, int event)
987{
988 return max98088_line_pga(w, event, LINE_INA, 2);
989}
990
991static int max98088_pga_inb1_event(struct snd_soc_dapm_widget *w,
992 struct snd_kcontrol *k, int event)
993{
994 return max98088_line_pga(w, event, LINE_INB, 1);
995}
996
997static int max98088_pga_inb2_event(struct snd_soc_dapm_widget *w,
998 struct snd_kcontrol *k, int event)
999{
1000 return max98088_line_pga(w, event, LINE_INB, 2);
1001}
1002
1003static const struct snd_soc_dapm_widget max98088_dapm_widgets[] = {
1004
1005 SND_SOC_DAPM_ADC("ADCL", "HiFi Capture", M98088_REG_4C_PWR_EN_IN, 1, 0),
1006 SND_SOC_DAPM_ADC("ADCR", "HiFi Capture", M98088_REG_4C_PWR_EN_IN, 0, 0),
1007
1008 SND_SOC_DAPM_DAC("DACL1", "HiFi Playback",
1009 M98088_REG_4D_PWR_EN_OUT, 1, 0),
1010 SND_SOC_DAPM_DAC("DACR1", "HiFi Playback",
1011 M98088_REG_4D_PWR_EN_OUT, 0, 0),
1012 SND_SOC_DAPM_DAC("DACL2", "Aux Playback",
1013 M98088_REG_4D_PWR_EN_OUT, 1, 0),
1014 SND_SOC_DAPM_DAC("DACR2", "Aux Playback",
1015 M98088_REG_4D_PWR_EN_OUT, 0, 0),
1016
1017 SND_SOC_DAPM_PGA("HP Left Out", M98088_REG_4D_PWR_EN_OUT,
1018 7, 0, NULL, 0),
1019 SND_SOC_DAPM_PGA("HP Right Out", M98088_REG_4D_PWR_EN_OUT,
1020 6, 0, NULL, 0),
1021
1022 SND_SOC_DAPM_PGA("SPK Left Out", M98088_REG_4D_PWR_EN_OUT,
1023 5, 0, NULL, 0),
1024 SND_SOC_DAPM_PGA("SPK Right Out", M98088_REG_4D_PWR_EN_OUT,
1025 4, 0, NULL, 0),
1026
1027 SND_SOC_DAPM_PGA("REC Left Out", M98088_REG_4D_PWR_EN_OUT,
1028 3, 0, NULL, 0),
1029 SND_SOC_DAPM_PGA("REC Right Out", M98088_REG_4D_PWR_EN_OUT,
1030 2, 0, NULL, 0),
1031
1032 SND_SOC_DAPM_MUX("External MIC", SND_SOC_NOPM, 0, 0,
1033 &max98088_extmic_mux),
1034
1035 SND_SOC_DAPM_MIXER("Left HP Mixer", SND_SOC_NOPM, 0, 0,
1036 &max98088_left_hp_mixer_controls[0],
1037 ARRAY_SIZE(max98088_left_hp_mixer_controls)),
1038
1039 SND_SOC_DAPM_MIXER("Right HP Mixer", SND_SOC_NOPM, 0, 0,
1040 &max98088_right_hp_mixer_controls[0],
1041 ARRAY_SIZE(max98088_right_hp_mixer_controls)),
1042
1043 SND_SOC_DAPM_MIXER("Left SPK Mixer", SND_SOC_NOPM, 0, 0,
1044 &max98088_left_speaker_mixer_controls[0],
1045 ARRAY_SIZE(max98088_left_speaker_mixer_controls)),
1046
1047 SND_SOC_DAPM_MIXER("Right SPK Mixer", SND_SOC_NOPM, 0, 0,
1048 &max98088_right_speaker_mixer_controls[0],
1049 ARRAY_SIZE(max98088_right_speaker_mixer_controls)),
1050
1051 SND_SOC_DAPM_MIXER("Left REC Mixer", SND_SOC_NOPM, 0, 0,
1052 &max98088_left_rec_mixer_controls[0],
1053 ARRAY_SIZE(max98088_left_rec_mixer_controls)),
1054
1055 SND_SOC_DAPM_MIXER("Right REC Mixer", SND_SOC_NOPM, 0, 0,
1056 &max98088_right_rec_mixer_controls[0],
1057 ARRAY_SIZE(max98088_right_rec_mixer_controls)),
1058
1059 SND_SOC_DAPM_MIXER("Left ADC Mixer", SND_SOC_NOPM, 0, 0,
1060 &max98088_left_ADC_mixer_controls[0],
1061 ARRAY_SIZE(max98088_left_ADC_mixer_controls)),
1062
1063 SND_SOC_DAPM_MIXER("Right ADC Mixer", SND_SOC_NOPM, 0, 0,
1064 &max98088_right_ADC_mixer_controls[0],
1065 ARRAY_SIZE(max98088_right_ADC_mixer_controls)),
1066
1067 SND_SOC_DAPM_PGA_E("MIC1 Input", M98088_REG_35_LVL_MIC1,
1068 5, 0, NULL, 0, max98088_mic_event,
1069 SND_SOC_DAPM_POST_PMU | SND_SOC_DAPM_POST_PMD),
1070
1071 SND_SOC_DAPM_PGA_E("MIC2 Input", M98088_REG_36_LVL_MIC2,
1072 5, 0, NULL, 0, max98088_mic_event,
1073 SND_SOC_DAPM_POST_PMU | SND_SOC_DAPM_POST_PMD),
1074
1075 SND_SOC_DAPM_PGA_E("INA1 Input", M98088_REG_4C_PWR_EN_IN,
1076 7, 0, NULL, 0, max98088_pga_ina1_event,
1077 SND_SOC_DAPM_POST_PMU | SND_SOC_DAPM_POST_PMD),
1078
1079 SND_SOC_DAPM_PGA_E("INA2 Input", M98088_REG_4C_PWR_EN_IN,
1080 7, 0, NULL, 0, max98088_pga_ina2_event,
1081 SND_SOC_DAPM_POST_PMU | SND_SOC_DAPM_POST_PMD),
1082
1083 SND_SOC_DAPM_PGA_E("INB1 Input", M98088_REG_4C_PWR_EN_IN,
1084 6, 0, NULL, 0, max98088_pga_inb1_event,
1085 SND_SOC_DAPM_POST_PMU | SND_SOC_DAPM_POST_PMD),
1086
1087 SND_SOC_DAPM_PGA_E("INB2 Input", M98088_REG_4C_PWR_EN_IN,
1088 6, 0, NULL, 0, max98088_pga_inb2_event,
1089 SND_SOC_DAPM_POST_PMU | SND_SOC_DAPM_POST_PMD),
1090
1091 SND_SOC_DAPM_MICBIAS("MICBIAS", M98088_REG_4C_PWR_EN_IN, 3, 0),
1092
1093 SND_SOC_DAPM_MUX("EX Limiter Mode", SND_SOC_NOPM, 0, 0,
1094 &max98088_exmode_controls),
1095
1096 SND_SOC_DAPM_OUTPUT("HPL"),
1097 SND_SOC_DAPM_OUTPUT("HPR"),
1098 SND_SOC_DAPM_OUTPUT("SPKL"),
1099 SND_SOC_DAPM_OUTPUT("SPKR"),
1100 SND_SOC_DAPM_OUTPUT("RECL"),
1101 SND_SOC_DAPM_OUTPUT("RECR"),
1102
1103 SND_SOC_DAPM_INPUT("MIC1"),
1104 SND_SOC_DAPM_INPUT("MIC2"),
1105 SND_SOC_DAPM_INPUT("INA1"),
1106 SND_SOC_DAPM_INPUT("INA2"),
1107 SND_SOC_DAPM_INPUT("INB1"),
1108 SND_SOC_DAPM_INPUT("INB2"),
1109};
1110
1111static const struct snd_soc_dapm_route audio_map[] = {
1112 /* Left headphone output mixer */
1113 {"Left HP Mixer", "Left DAC1 Switch", "DACL1"},
1114 {"Left HP Mixer", "Left DAC2 Switch", "DACL2"},
1115 {"Left HP Mixer", "Right DAC1 Switch", "DACR1"},
1116 {"Left HP Mixer", "Right DAC2 Switch", "DACR2"},
1117 {"Left HP Mixer", "MIC1 Switch", "MIC1 Input"},
1118 {"Left HP Mixer", "MIC2 Switch", "MIC2 Input"},
1119 {"Left HP Mixer", "INA1 Switch", "INA1 Input"},
1120 {"Left HP Mixer", "INA2 Switch", "INA2 Input"},
1121 {"Left HP Mixer", "INB1 Switch", "INB1 Input"},
1122 {"Left HP Mixer", "INB2 Switch", "INB2 Input"},
1123
1124 /* Right headphone output mixer */
1125 {"Right HP Mixer", "Left DAC1 Switch", "DACL1"},
1126 {"Right HP Mixer", "Left DAC2 Switch", "DACL2" },
1127 {"Right HP Mixer", "Right DAC1 Switch", "DACR1"},
1128 {"Right HP Mixer", "Right DAC2 Switch", "DACR2"},
1129 {"Right HP Mixer", "MIC1 Switch", "MIC1 Input"},
1130 {"Right HP Mixer", "MIC2 Switch", "MIC2 Input"},
1131 {"Right HP Mixer", "INA1 Switch", "INA1 Input"},
1132 {"Right HP Mixer", "INA2 Switch", "INA2 Input"},
1133 {"Right HP Mixer", "INB1 Switch", "INB1 Input"},
1134 {"Right HP Mixer", "INB2 Switch", "INB2 Input"},
1135
1136 /* Left speaker output mixer */
1137 {"Left SPK Mixer", "Left DAC1 Switch", "DACL1"},
1138 {"Left SPK Mixer", "Left DAC2 Switch", "DACL2"},
1139 {"Left SPK Mixer", "Right DAC1 Switch", "DACR1"},
1140 {"Left SPK Mixer", "Right DAC2 Switch", "DACR2"},
1141 {"Left SPK Mixer", "MIC1 Switch", "MIC1 Input"},
1142 {"Left SPK Mixer", "MIC2 Switch", "MIC2 Input"},
1143 {"Left SPK Mixer", "INA1 Switch", "INA1 Input"},
1144 {"Left SPK Mixer", "INA2 Switch", "INA2 Input"},
1145 {"Left SPK Mixer", "INB1 Switch", "INB1 Input"},
1146 {"Left SPK Mixer", "INB2 Switch", "INB2 Input"},
1147
1148 /* Right speaker output mixer */
1149 {"Right SPK Mixer", "Left DAC1 Switch", "DACL1"},
1150 {"Right SPK Mixer", "Left DAC2 Switch", "DACL2"},
1151 {"Right SPK Mixer", "Right DAC1 Switch", "DACR1"},
1152 {"Right SPK Mixer", "Right DAC2 Switch", "DACR2"},
1153 {"Right SPK Mixer", "MIC1 Switch", "MIC1 Input"},
1154 {"Right SPK Mixer", "MIC2 Switch", "MIC2 Input"},
1155 {"Right SPK Mixer", "INA1 Switch", "INA1 Input"},
1156 {"Right SPK Mixer", "INA2 Switch", "INA2 Input"},
1157 {"Right SPK Mixer", "INB1 Switch", "INB1 Input"},
1158 {"Right SPK Mixer", "INB2 Switch", "INB2 Input"},
1159
1160 /* Earpiece/Receiver output mixer */
1161 {"Left REC Mixer", "Left DAC1 Switch", "DACL1"},
1162 {"Left REC Mixer", "Left DAC2 Switch", "DACL2"},
1163 {"Left REC Mixer", "Right DAC1 Switch", "DACR1"},
1164 {"Left REC Mixer", "Right DAC2 Switch", "DACR2"},
1165 {"Left REC Mixer", "MIC1 Switch", "MIC1 Input"},
1166 {"Left REC Mixer", "MIC2 Switch", "MIC2 Input"},
1167 {"Left REC Mixer", "INA1 Switch", "INA1 Input"},
1168 {"Left REC Mixer", "INA2 Switch", "INA2 Input"},
1169 {"Left REC Mixer", "INB1 Switch", "INB1 Input"},
1170 {"Left REC Mixer", "INB2 Switch", "INB2 Input"},
1171
1172 /* Earpiece/Receiver output mixer */
1173 {"Right REC Mixer", "Left DAC1 Switch", "DACL1"},
1174 {"Right REC Mixer", "Left DAC2 Switch", "DACL2"},
1175 {"Right REC Mixer", "Right DAC1 Switch", "DACR1"},
1176 {"Right REC Mixer", "Right DAC2 Switch", "DACR2"},
1177 {"Right REC Mixer", "MIC1 Switch", "MIC1 Input"},
1178 {"Right REC Mixer", "MIC2 Switch", "MIC2 Input"},
1179 {"Right REC Mixer", "INA1 Switch", "INA1 Input"},
1180 {"Right REC Mixer", "INA2 Switch", "INA2 Input"},
1181 {"Right REC Mixer", "INB1 Switch", "INB1 Input"},
1182 {"Right REC Mixer", "INB2 Switch", "INB2 Input"},
1183
1184 {"HP Left Out", NULL, "Left HP Mixer"},
1185 {"HP Right Out", NULL, "Right HP Mixer"},
1186 {"SPK Left Out", NULL, "Left SPK Mixer"},
1187 {"SPK Right Out", NULL, "Right SPK Mixer"},
1188 {"REC Left Out", NULL, "Left REC Mixer"},
1189 {"REC Right Out", NULL, "Right REC Mixer"},
1190
1191 {"HPL", NULL, "HP Left Out"},
1192 {"HPR", NULL, "HP Right Out"},
1193 {"SPKL", NULL, "SPK Left Out"},
1194 {"SPKR", NULL, "SPK Right Out"},
1195 {"RECL", NULL, "REC Left Out"},
1196 {"RECR", NULL, "REC Right Out"},
1197
1198 /* Left ADC input mixer */
1199 {"Left ADC Mixer", "MIC1 Switch", "MIC1 Input"},
1200 {"Left ADC Mixer", "MIC2 Switch", "MIC2 Input"},
1201 {"Left ADC Mixer", "INA1 Switch", "INA1 Input"},
1202 {"Left ADC Mixer", "INA2 Switch", "INA2 Input"},
1203 {"Left ADC Mixer", "INB1 Switch", "INB1 Input"},
1204 {"Left ADC Mixer", "INB2 Switch", "INB2 Input"},
1205
1206 /* Right ADC input mixer */
1207 {"Right ADC Mixer", "MIC1 Switch", "MIC1 Input"},
1208 {"Right ADC Mixer", "MIC2 Switch", "MIC2 Input"},
1209 {"Right ADC Mixer", "INA1 Switch", "INA1 Input"},
1210 {"Right ADC Mixer", "INA2 Switch", "INA2 Input"},
1211 {"Right ADC Mixer", "INB1 Switch", "INB1 Input"},
1212 {"Right ADC Mixer", "INB2 Switch", "INB2 Input"},
1213
1214 /* Inputs */
1215 {"ADCL", NULL, "Left ADC Mixer"},
1216 {"ADCR", NULL, "Right ADC Mixer"},
1217 {"INA1 Input", NULL, "INA1"},
1218 {"INA2 Input", NULL, "INA2"},
1219 {"INB1 Input", NULL, "INB1"},
1220 {"INB2 Input", NULL, "INB2"},
1221 {"MIC1 Input", NULL, "MIC1"},
1222 {"MIC2 Input", NULL, "MIC2"},
1223};
1224
1225static int max98088_add_widgets(struct snd_soc_codec *codec)
1226{
1227 snd_soc_dapm_new_controls(codec, max98088_dapm_widgets,
1228 ARRAY_SIZE(max98088_dapm_widgets));
1229
1230 snd_soc_dapm_add_routes(codec, audio_map, ARRAY_SIZE(audio_map));
1231
1232 snd_soc_add_controls(codec, max98088_snd_controls,
1233 ARRAY_SIZE(max98088_snd_controls));
1234
1235 snd_soc_dapm_new_widgets(codec);
1236 return 0;
1237}
1238
1239/* codec mclk clock divider coefficients */
1240static const struct {
1241 u32 rate;
1242 u8 sr;
1243} rate_table[] = {
1244 {8000, 0x10},
1245 {11025, 0x20},
1246 {16000, 0x30},
1247 {22050, 0x40},
1248 {24000, 0x50},
1249 {32000, 0x60},
1250 {44100, 0x70},
1251 {48000, 0x80},
1252 {88200, 0x90},
1253 {96000, 0xA0},
1254};
1255
1256static inline int rate_value(int rate, u8 *value)
1257{
1258 int i;
1259
1260 for (i = 0; i < ARRAY_SIZE(rate_table); i++) {
1261 if (rate_table[i].rate >= rate) {
1262 *value = rate_table[i].sr;
1263 return 0;
1264 }
1265 }
1266 *value = rate_table[0].sr;
1267 return -EINVAL;
1268}
1269
1270static int max98088_dai1_hw_params(struct snd_pcm_substream *substream,
1271 struct snd_pcm_hw_params *params,
1272 struct snd_soc_dai *dai)
1273{
1274 struct snd_soc_codec *codec = dai->codec;
1275 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1276 struct max98088_cdata *cdata;
1277 unsigned long long ni;
1278 unsigned int rate;
1279 u8 regval;
1280
1281 cdata = &max98088->dai[0];
1282
1283 rate = params_rate(params);
1284
1285 switch (params_format(params)) {
1286 case SNDRV_PCM_FORMAT_S16_LE:
1287 snd_soc_update_bits(codec, M98088_REG_14_DAI1_FORMAT,
1288 M98088_DAI_WS, 0);
1289 break;
1290 case SNDRV_PCM_FORMAT_S24_LE:
1291 snd_soc_update_bits(codec, M98088_REG_14_DAI1_FORMAT,
1292 M98088_DAI_WS, M98088_DAI_WS);
1293 break;
1294 default:
1295 return -EINVAL;
1296 }
1297
1298 snd_soc_update_bits(codec, M98088_REG_51_PWR_SYS, M98088_SHDNRUN, 0);
1299
1300 if (rate_value(rate, &regval))
1301 return -EINVAL;
1302
1303 snd_soc_update_bits(codec, M98088_REG_11_DAI1_CLKMODE,
1304 M98088_CLKMODE_MASK, regval);
1305 cdata->rate = rate;
1306
1307 /* Configure NI when operating as master */
1308 if (snd_soc_read(codec, M98088_REG_14_DAI1_FORMAT)
1309 & M98088_DAI_MAS) {
1310 if (max98088->sysclk == 0) {
1311 dev_err(codec->dev, "Invalid system clock frequency\n");
1312 return -EINVAL;
1313 }
1314 ni = 65536ULL * (rate < 50000 ? 96ULL : 48ULL)
1315 * (unsigned long long int)rate;
1316 do_div(ni, (unsigned long long int)max98088->sysclk);
1317 snd_soc_write(codec, M98088_REG_12_DAI1_CLKCFG_HI,
1318 (ni >> 8) & 0x7F);
1319 snd_soc_write(codec, M98088_REG_13_DAI1_CLKCFG_LO,
1320 ni & 0xFF);
1321 }
1322
1323 /* Update sample rate mode */
1324 if (rate < 50000)
1325 snd_soc_update_bits(codec, M98088_REG_18_DAI1_FILTERS,
1326 M98088_DAI_DHF, 0);
1327 else
1328 snd_soc_update_bits(codec, M98088_REG_18_DAI1_FILTERS,
1329 M98088_DAI_DHF, M98088_DAI_DHF);
1330
1331 snd_soc_update_bits(codec, M98088_REG_51_PWR_SYS, M98088_SHDNRUN,
1332 M98088_SHDNRUN);
1333
1334 return 0;
1335}
1336
1337static int max98088_dai2_hw_params(struct snd_pcm_substream *substream,
1338 struct snd_pcm_hw_params *params,
1339 struct snd_soc_dai *dai)
1340{
1341 struct snd_soc_codec *codec = dai->codec;
1342 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1343 struct max98088_cdata *cdata;
1344 unsigned long long ni;
1345 unsigned int rate;
1346 u8 regval;
1347
1348 cdata = &max98088->dai[1];
1349
1350 rate = params_rate(params);
1351
1352 switch (params_format(params)) {
1353 case SNDRV_PCM_FORMAT_S16_LE:
1354 snd_soc_update_bits(codec, M98088_REG_1C_DAI2_FORMAT,
1355 M98088_DAI_WS, 0);
1356 break;
1357 case SNDRV_PCM_FORMAT_S24_LE:
1358 snd_soc_update_bits(codec, M98088_REG_1C_DAI2_FORMAT,
1359 M98088_DAI_WS, M98088_DAI_WS);
1360 break;
1361 default:
1362 return -EINVAL;
1363 }
1364
1365 snd_soc_update_bits(codec, M98088_REG_51_PWR_SYS, M98088_SHDNRUN, 0);
1366
1367 if (rate_value(rate, &regval))
1368 return -EINVAL;
1369
1370 snd_soc_update_bits(codec, M98088_REG_19_DAI2_CLKMODE,
1371 M98088_CLKMODE_MASK, regval);
1372 cdata->rate = rate;
1373
1374 /* Configure NI when operating as master */
1375 if (snd_soc_read(codec, M98088_REG_1C_DAI2_FORMAT)
1376 & M98088_DAI_MAS) {
1377 if (max98088->sysclk == 0) {
1378 dev_err(codec->dev, "Invalid system clock frequency\n");
1379 return -EINVAL;
1380 }
1381 ni = 65536ULL * (rate < 50000 ? 96ULL : 48ULL)
1382 * (unsigned long long int)rate;
1383 do_div(ni, (unsigned long long int)max98088->sysclk);
1384 snd_soc_write(codec, M98088_REG_1A_DAI2_CLKCFG_HI,
1385 (ni >> 8) & 0x7F);
1386 snd_soc_write(codec, M98088_REG_1B_DAI2_CLKCFG_LO,
1387 ni & 0xFF);
1388 }
1389
1390 /* Update sample rate mode */
1391 if (rate < 50000)
1392 snd_soc_update_bits(codec, M98088_REG_20_DAI2_FILTERS,
1393 M98088_DAI_DHF, 0);
1394 else
1395 snd_soc_update_bits(codec, M98088_REG_20_DAI2_FILTERS,
1396 M98088_DAI_DHF, M98088_DAI_DHF);
1397
1398 snd_soc_update_bits(codec, M98088_REG_51_PWR_SYS, M98088_SHDNRUN,
1399 M98088_SHDNRUN);
1400
1401 return 0;
1402}
1403
1404static int max98088_dai_set_sysclk(struct snd_soc_dai *dai,
1405 int clk_id, unsigned int freq, int dir)
1406{
1407 struct snd_soc_codec *codec = dai->codec;
1408 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1409
1410 /* Requested clock frequency is already setup */
1411 if (freq == max98088->sysclk)
1412 return 0;
1413
1414 max98088->sysclk = freq; /* remember current sysclk */
1415
1416 /* Setup clocks for slave mode, and using the PLL
1417 * PSCLK = 0x01 (when master clk is 10MHz to 20MHz)
1418 * 0x02 (when master clk is 20MHz to 30MHz)..
1419 */
1420 if ((freq >= 10000000) && (freq < 20000000)) {
1421 snd_soc_write(codec, M98088_REG_10_SYS_CLK, 0x10);
1422 } else if ((freq >= 20000000) && (freq < 30000000)) {
1423 snd_soc_write(codec, M98088_REG_10_SYS_CLK, 0x20);
1424 } else {
1425 dev_err(codec->dev, "Invalid master clock frequency\n");
1426 return -EINVAL;
1427 }
1428
1429 if (snd_soc_read(codec, M98088_REG_51_PWR_SYS) & M98088_SHDNRUN) {
1430 snd_soc_update_bits(codec, M98088_REG_51_PWR_SYS,
1431 M98088_SHDNRUN, 0);
1432 snd_soc_update_bits(codec, M98088_REG_51_PWR_SYS,
1433 M98088_SHDNRUN, M98088_SHDNRUN);
1434 }
1435
1436 dev_dbg(dai->dev, "Clock source is %d at %uHz\n", clk_id, freq);
1437
1438 max98088->sysclk = freq;
1439 return 0;
1440}
1441
1442static int max98088_dai1_set_fmt(struct snd_soc_dai *codec_dai,
1443 unsigned int fmt)
1444{
1445 struct snd_soc_codec *codec = codec_dai->codec;
1446 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1447 struct max98088_cdata *cdata;
1448 u8 reg15val;
1449 u8 reg14val = 0;
1450
1451 cdata = &max98088->dai[0];
1452
1453 if (fmt != cdata->fmt) {
1454 cdata->fmt = fmt;
1455
1456 switch (fmt & SND_SOC_DAIFMT_MASTER_MASK) {
1457 case SND_SOC_DAIFMT_CBS_CFS:
1458 /* Slave mode PLL */
1459 snd_soc_write(codec, M98088_REG_12_DAI1_CLKCFG_HI,
1460 0x80);
1461 snd_soc_write(codec, M98088_REG_13_DAI1_CLKCFG_LO,
1462 0x00);
1463 break;
1464 case SND_SOC_DAIFMT_CBM_CFM:
1465 /* Set to master mode */
1466 reg14val |= M98088_DAI_MAS;
1467 break;
1468 case SND_SOC_DAIFMT_CBS_CFM:
1469 case SND_SOC_DAIFMT_CBM_CFS:
1470 default:
1471 dev_err(codec->dev, "Clock mode unsupported");
1472 return -EINVAL;
1473 }
1474
1475 switch (fmt & SND_SOC_DAIFMT_FORMAT_MASK) {
1476 case SND_SOC_DAIFMT_I2S:
1477 reg14val |= M98088_DAI_DLY;
1478 break;
1479 case SND_SOC_DAIFMT_LEFT_J:
1480 break;
1481 default:
1482 return -EINVAL;
1483 }
1484
1485 switch (fmt & SND_SOC_DAIFMT_INV_MASK) {
1486 case SND_SOC_DAIFMT_NB_NF:
1487 break;
1488 case SND_SOC_DAIFMT_NB_IF:
1489 reg14val |= M98088_DAI_WCI;
1490 break;
1491 case SND_SOC_DAIFMT_IB_NF:
1492 reg14val |= M98088_DAI_BCI;
1493 break;
1494 case SND_SOC_DAIFMT_IB_IF:
1495 reg14val |= M98088_DAI_BCI|M98088_DAI_WCI;
1496 break;
1497 default:
1498 return -EINVAL;
1499 }
1500
1501 snd_soc_update_bits(codec, M98088_REG_14_DAI1_FORMAT,
1502 M98088_DAI_MAS | M98088_DAI_DLY | M98088_DAI_BCI |
1503 M98088_DAI_WCI, reg14val);
1504
1505 reg15val = M98088_DAI_BSEL64;
1506 if (max98088->digmic)
1507 reg15val |= M98088_DAI_OSR64;
1508 snd_soc_write(codec, M98088_REG_15_DAI1_CLOCK, reg15val);
1509 }
1510
1511 return 0;
1512}
1513
1514static int max98088_dai2_set_fmt(struct snd_soc_dai *codec_dai,
1515 unsigned int fmt)
1516{
1517 struct snd_soc_codec *codec = codec_dai->codec;
1518 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1519 struct max98088_cdata *cdata;
1520 u8 reg1Cval = 0;
1521
1522 cdata = &max98088->dai[1];
1523
1524 if (fmt != cdata->fmt) {
1525 cdata->fmt = fmt;
1526
1527 switch (fmt & SND_SOC_DAIFMT_MASTER_MASK) {
1528 case SND_SOC_DAIFMT_CBS_CFS:
1529 /* Slave mode PLL */
1530 snd_soc_write(codec, M98088_REG_1A_DAI2_CLKCFG_HI,
1531 0x80);
1532 snd_soc_write(codec, M98088_REG_1B_DAI2_CLKCFG_LO,
1533 0x00);
1534 break;
1535 case SND_SOC_DAIFMT_CBM_CFM:
1536 /* Set to master mode */
1537 reg1Cval |= M98088_DAI_MAS;
1538 break;
1539 case SND_SOC_DAIFMT_CBS_CFM:
1540 case SND_SOC_DAIFMT_CBM_CFS:
1541 default:
1542 dev_err(codec->dev, "Clock mode unsupported");
1543 return -EINVAL;
1544 }
1545
1546 switch (fmt & SND_SOC_DAIFMT_FORMAT_MASK) {
1547 case SND_SOC_DAIFMT_I2S:
1548 reg1Cval |= M98088_DAI_DLY;
1549 break;
1550 case SND_SOC_DAIFMT_LEFT_J:
1551 break;
1552 default:
1553 return -EINVAL;
1554 }
1555
1556 switch (fmt & SND_SOC_DAIFMT_INV_MASK) {
1557 case SND_SOC_DAIFMT_NB_NF:
1558 break;
1559 case SND_SOC_DAIFMT_NB_IF:
1560 reg1Cval |= M98088_DAI_WCI;
1561 break;
1562 case SND_SOC_DAIFMT_IB_NF:
1563 reg1Cval |= M98088_DAI_BCI;
1564 break;
1565 case SND_SOC_DAIFMT_IB_IF:
1566 reg1Cval |= M98088_DAI_BCI|M98088_DAI_WCI;
1567 break;
1568 default:
1569 return -EINVAL;
1570 }
1571
1572 snd_soc_update_bits(codec, M98088_REG_1C_DAI2_FORMAT,
1573 M98088_DAI_MAS | M98088_DAI_DLY | M98088_DAI_BCI |
1574 M98088_DAI_WCI, reg1Cval);
1575
1576 snd_soc_write(codec, M98088_REG_1D_DAI2_CLOCK,
1577 M98088_DAI_BSEL64);
1578 }
1579
1580 return 0;
1581}
1582
1583static void max98088_sync_cache(struct snd_soc_codec *codec)
1584{
1585 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1586 int i;
1587
1588 if (!codec->cache_sync)
1589 return;
1590
1591 codec->cache_only = 0;
1592
1593 /* write back cached values if they're writeable and
1594 * different from the hardware default.
1595 */
1596 for (i = 1; i < ARRAY_SIZE(max98088->reg_cache); i++) {
1597 if (!max98088_access[i].writable)
1598 continue;
1599
1600 if (max98088->reg_cache[i] == max98088_reg[i])
1601 continue;
1602
1603 snd_soc_write(codec, i, max98088->reg_cache[i]);
1604 }
1605
1606 codec->cache_sync = 0;
1607}
1608
1609static int max98088_set_bias_level(struct snd_soc_codec *codec,
1610 enum snd_soc_bias_level level)
1611{
1612 switch (level) {
1613 case SND_SOC_BIAS_ON:
1614 break;
1615
1616 case SND_SOC_BIAS_PREPARE:
1617 break;
1618
1619 case SND_SOC_BIAS_STANDBY:
1620 if (codec->bias_level == SND_SOC_BIAS_OFF)
1621 max98088_sync_cache(codec);
1622
1623 snd_soc_update_bits(codec, M98088_REG_4C_PWR_EN_IN,
1624 M98088_MBEN, M98088_MBEN);
1625 break;
1626
1627 case SND_SOC_BIAS_OFF:
1628 snd_soc_update_bits(codec, M98088_REG_4C_PWR_EN_IN,
1629 M98088_MBEN, 0);
1630 codec->cache_sync = 1;
1631 break;
1632 }
1633 codec->bias_level = level;
1634 return 0;
1635}
1636
1637#define MAX98088_RATES SNDRV_PCM_RATE_8000_96000
1638#define MAX98088_FORMATS (SNDRV_PCM_FMTBIT_S16_LE | SNDRV_PCM_FMTBIT_S24_LE)
1639
1640static struct snd_soc_dai_ops max98088_dai1_ops = {
1641 .set_sysclk = max98088_dai_set_sysclk,
1642 .set_fmt = max98088_dai1_set_fmt,
1643 .hw_params = max98088_dai1_hw_params,
1644};
1645
1646static struct snd_soc_dai_ops max98088_dai2_ops = {
1647 .set_sysclk = max98088_dai_set_sysclk,
1648 .set_fmt = max98088_dai2_set_fmt,
1649 .hw_params = max98088_dai2_hw_params,
1650};
1651
1652static struct snd_soc_dai_driver max98088_dai[] = {
1653{
1654 .name = "HiFi",
1655 .playback = {
1656 .stream_name = "HiFi Playback",
1657 .channels_min = 1,
1658 .channels_max = 2,
1659 .rates = MAX98088_RATES,
1660 .formats = MAX98088_FORMATS,
1661 },
1662 .capture = {
1663 .stream_name = "HiFi Capture",
1664 .channels_min = 1,
1665 .channels_max = 2,
1666 .rates = MAX98088_RATES,
1667 .formats = MAX98088_FORMATS,
1668 },
1669 .ops = &max98088_dai1_ops,
1670},
1671{
1672 .name = "Aux",
1673 .playback = {
1674 .stream_name = "Aux Playback",
1675 .channels_min = 1,
1676 .channels_max = 2,
1677 .rates = MAX98088_RATES,
1678 .formats = MAX98088_FORMATS,
1679 },
1680 .ops = &max98088_dai2_ops,
1681}
1682};
1683
1684static int max98088_get_channel(const char *name)
1685{
1686 if (strcmp(name, "EQ1 Mode") == 0)
1687 return 0;
1688 if (strcmp(name, "EQ2 Mode") == 0)
1689 return 1;
1690 return -EINVAL;
1691}
1692
1693static void max98088_setup_eq1(struct snd_soc_codec *codec)
1694{
1695 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1696 struct max98088_pdata *pdata = max98088->pdata;
1697 struct max98088_eq_cfg *coef_set;
1698 int best, best_val, save, i, sel, fs;
1699 struct max98088_cdata *cdata;
1700
1701 cdata = &max98088->dai[0];
1702
1703 if (!pdata || !max98088->eq_textcnt)
1704 return;
1705
1706 /* Find the selected configuration with nearest sample rate */
1707 fs = cdata->rate;
1708 sel = cdata->eq_sel;
1709
1710 best = 0;
1711 best_val = INT_MAX;
1712 for (i = 0; i < pdata->eq_cfgcnt; i++) {
1713 if (strcmp(pdata->eq_cfg[i].name, max98088->eq_texts[sel]) == 0 &&
1714 abs(pdata->eq_cfg[i].rate - fs) < best_val) {
1715 best = i;
1716 best_val = abs(pdata->eq_cfg[i].rate - fs);
1717 }
1718 }
1719
1720 dev_dbg(codec->dev, "Selected %s/%dHz for %dHz sample rate\n",
1721 pdata->eq_cfg[best].name,
1722 pdata->eq_cfg[best].rate, fs);
1723
1724 /* Disable EQ while configuring, and save current on/off state */
1725 save = snd_soc_read(codec, M98088_REG_49_CFG_LEVEL);
1726 snd_soc_update_bits(codec, M98088_REG_49_CFG_LEVEL, M98088_EQ1EN, 0);
1727
1728 coef_set = &pdata->eq_cfg[sel];
1729
1730 m98088_eq_band(codec, 0, 0, coef_set->band1);
1731 m98088_eq_band(codec, 0, 1, coef_set->band2);
1732 m98088_eq_band(codec, 0, 2, coef_set->band3);
1733 m98088_eq_band(codec, 0, 3, coef_set->band4);
1734 m98088_eq_band(codec, 0, 4, coef_set->band5);
1735
1736 /* Restore the original on/off state */
1737 snd_soc_update_bits(codec, M98088_REG_49_CFG_LEVEL, M98088_EQ1EN, save);
1738}
1739
1740static void max98088_setup_eq2(struct snd_soc_codec *codec)
1741{
1742 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1743 struct max98088_pdata *pdata = max98088->pdata;
1744 struct max98088_eq_cfg *coef_set;
1745 int best, best_val, save, i, sel, fs;
1746 struct max98088_cdata *cdata;
1747
1748 cdata = &max98088->dai[1];
1749
1750 if (!pdata || !max98088->eq_textcnt)
1751 return;
1752
1753 /* Find the selected configuration with nearest sample rate */
1754 fs = cdata->rate;
1755
1756 sel = cdata->eq_sel;
1757 best = 0;
1758 best_val = INT_MAX;
1759 for (i = 0; i < pdata->eq_cfgcnt; i++) {
1760 if (strcmp(pdata->eq_cfg[i].name, max98088->eq_texts[sel]) == 0 &&
1761 abs(pdata->eq_cfg[i].rate - fs) < best_val) {
1762 best = i;
1763 best_val = abs(pdata->eq_cfg[i].rate - fs);
1764 }
1765 }
1766
1767 dev_dbg(codec->dev, "Selected %s/%dHz for %dHz sample rate\n",
1768 pdata->eq_cfg[best].name,
1769 pdata->eq_cfg[best].rate, fs);
1770
1771 /* Disable EQ while configuring, and save current on/off state */
1772 save = snd_soc_read(codec, M98088_REG_49_CFG_LEVEL);
1773 snd_soc_update_bits(codec, M98088_REG_49_CFG_LEVEL, M98088_EQ2EN, 0);
1774
1775 coef_set = &pdata->eq_cfg[sel];
1776
1777 m98088_eq_band(codec, 1, 0, coef_set->band1);
1778 m98088_eq_band(codec, 1, 1, coef_set->band2);
1779 m98088_eq_band(codec, 1, 2, coef_set->band3);
1780 m98088_eq_band(codec, 1, 3, coef_set->band4);
1781 m98088_eq_band(codec, 1, 4, coef_set->band5);
1782
1783 /* Restore the original on/off state */
1784 snd_soc_update_bits(codec, M98088_REG_49_CFG_LEVEL, M98088_EQ2EN,
1785 save);
1786}
1787
1788static int max98088_put_eq_enum(struct snd_kcontrol *kcontrol,
1789 struct snd_ctl_elem_value *ucontrol)
1790{
1791 struct snd_soc_codec *codec = snd_kcontrol_chip(kcontrol);
1792 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1793 struct max98088_pdata *pdata = max98088->pdata;
1794 int channel = max98088_get_channel(kcontrol->id.name);
1795 struct max98088_cdata *cdata;
1796 int sel = ucontrol->value.integer.value[0];
1797
1798 cdata = &max98088->dai[channel];
1799
1800 if (sel >= pdata->eq_cfgcnt)
1801 return -EINVAL;
1802
1803 cdata->eq_sel = sel;
1804
1805 switch (channel) {
1806 case 0:
1807 max98088_setup_eq1(codec);
1808 break;
1809 case 1:
1810 max98088_setup_eq2(codec);
1811 break;
1812 }
1813
1814 return 0;
1815}
1816
1817static int max98088_get_eq_enum(struct snd_kcontrol *kcontrol,
1818 struct snd_ctl_elem_value *ucontrol)
1819{
1820 struct snd_soc_codec *codec = snd_kcontrol_chip(kcontrol);
1821 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1822 int channel = max98088_get_channel(kcontrol->id.name);
1823 struct max98088_cdata *cdata;
1824
1825 cdata = &max98088->dai[channel];
1826 ucontrol->value.enumerated.item[0] = cdata->eq_sel;
1827 return 0;
1828}
1829
1830static void max98088_handle_eq_pdata(struct snd_soc_codec *codec)
1831{
1832 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1833 struct max98088_pdata *pdata = max98088->pdata;
1834 struct max98088_eq_cfg *cfg;
1835 unsigned int cfgcnt;
1836 int i, j;
1837 const char **t;
1838 int ret;
1839
1840 struct snd_kcontrol_new controls[] = {
1841 SOC_ENUM_EXT("EQ1 Mode",
1842 max98088->eq_enum,
1843 max98088_get_eq_enum,
1844 max98088_put_eq_enum),
1845 SOC_ENUM_EXT("EQ2 Mode",
1846 max98088->eq_enum,
1847 max98088_get_eq_enum,
1848 max98088_put_eq_enum),
1849 };
1850
1851 cfg = pdata->eq_cfg;
1852 cfgcnt = pdata->eq_cfgcnt;
1853
1854 /* Setup an array of texts for the equalizer enum.
1855 * This is based on Mark Brown's equalizer driver code.
1856 */
1857 max98088->eq_textcnt = 0;
1858 max98088->eq_texts = NULL;
1859 for (i = 0; i < cfgcnt; i++) {
1860 for (j = 0; j < max98088->eq_textcnt; j++) {
1861 if (strcmp(cfg[i].name, max98088->eq_texts[j]) == 0)
1862 break;
1863 }
1864
1865 if (j != max98088->eq_textcnt)
1866 continue;
1867
1868 /* Expand the array */
1869 t = krealloc(max98088->eq_texts,
1870 sizeof(char *) * (max98088->eq_textcnt + 1),
1871 GFP_KERNEL);
1872 if (t == NULL)
1873 continue;
1874
1875 /* Store the new entry */
1876 t[max98088->eq_textcnt] = cfg[i].name;
1877 max98088->eq_textcnt++;
1878 max98088->eq_texts = t;
1879 }
1880
1881 /* Now point the soc_enum to .texts array items */
1882 max98088->eq_enum.texts = max98088->eq_texts;
1883 max98088->eq_enum.max = max98088->eq_textcnt;
1884
1885 ret = snd_soc_add_controls(codec, controls, ARRAY_SIZE(controls));
1886 if (ret != 0)
1887 dev_err(codec->dev, "Failed to add EQ control: %d\n", ret);
1888}
1889
1890static void max98088_handle_pdata(struct snd_soc_codec *codec)
1891{
1892 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1893 struct max98088_pdata *pdata = max98088->pdata;
1894 u8 regval = 0;
1895
1896 if (!pdata) {
1897 dev_dbg(codec->dev, "No platform data\n");
1898 return;
1899 }
1900
1901 /* Configure mic for analog/digital mic mode */
1902 if (pdata->digmic_left_mode)
1903 regval |= M98088_DIGMIC_L;
1904
1905 if (pdata->digmic_right_mode)
1906 regval |= M98088_DIGMIC_R;
1907
1908 max98088->digmic = (regval ? 1 : 0);
1909
1910 snd_soc_write(codec, M98088_REG_48_CFG_MIC, regval);
1911
1912 /* Configure receiver output */
1913 regval = ((pdata->receiver_mode) ? M98088_REC_LINEMODE : 0);
1914 snd_soc_update_bits(codec, M98088_REG_2A_MIC_REC_CNTL,
1915 M98088_REC_LINEMODE_MASK, regval);
1916
1917 /* Configure equalizers */
1918 if (pdata->eq_cfgcnt)
1919 max98088_handle_eq_pdata(codec);
1920}
1921
1922#ifdef CONFIG_PM
1923static int max98088_suspend(struct snd_soc_codec *codec, pm_message_t state)
1924{
1925 max98088_set_bias_level(codec, SND_SOC_BIAS_OFF);
1926
1927 return 0;
1928}
1929
1930static int max98088_resume(struct snd_soc_codec *codec)
1931{
1932 max98088_set_bias_level(codec, SND_SOC_BIAS_STANDBY);
1933
1934 return 0;
1935}
1936#else
1937#define max98088_suspend NULL
1938#define max98088_resume NULL
1939#endif
1940
1941static int max98088_probe(struct snd_soc_codec *codec)
1942{
1943 struct max98088_priv *max98088 = snd_soc_codec_get_drvdata(codec);
1944 struct max98088_cdata *cdata;
1945 int ret = 0;
1946
1947 codec->cache_sync = 1;
1948 memcpy(codec->reg_cache, max98088_reg, sizeof(max98088_reg));
1949
1950 ret = snd_soc_codec_set_cache_io(codec, 8, 8, SND_SOC_I2C);
1951 if (ret != 0) {
1952 dev_err(codec->dev, "Failed to set cache I/O: %d\n", ret);
1953 return ret;
1954 }
1955
1956 /* initalize private data */
1957
1958 max98088->sysclk = (unsigned)-1;
1959 max98088->eq_textcnt = 0;
1960
1961 cdata = &max98088->dai[0];
1962 cdata->rate = (unsigned)-1;
1963 cdata->fmt = (unsigned)-1;
1964 cdata->eq_sel = 0;
1965
1966 cdata = &max98088->dai[1];
1967 cdata->rate = (unsigned)-1;
1968 cdata->fmt = (unsigned)-1;
1969 cdata->eq_sel = 0;
1970
1971 max98088->ina_state = 0;
1972 max98088->inb_state = 0;
1973 max98088->ex_mode = 0;
1974 max98088->digmic = 0;
1975 max98088->mic1pre = 0;
1976 max98088->mic2pre = 0;
1977
1978 ret = snd_soc_read(codec, M98088_REG_FF_REV_ID);
1979 if (ret < 0) {
1980 dev_err(codec->dev, "Failed to read device revision: %d\n",
1981 ret);
1982 goto err_access;
1983 }
1984 dev_info(codec->dev, "revision %c\n", ret + 'A');
1985
1986 snd_soc_write(codec, M98088_REG_51_PWR_SYS, M98088_PWRSV);
1987
1988 /* initialize registers cache to hardware default */
1989 max98088_set_bias_level(codec, SND_SOC_BIAS_STANDBY);
1990
1991 snd_soc_write(codec, M98088_REG_0F_IRQ_ENABLE, 0x00);
1992
1993 snd_soc_write(codec, M98088_REG_22_MIX_DAC,
1994 M98088_DAI1L_TO_DACL|M98088_DAI2L_TO_DACL|
1995 M98088_DAI1R_TO_DACR|M98088_DAI2R_TO_DACR);
1996
1997 snd_soc_write(codec, M98088_REG_4E_BIAS_CNTL, 0xF0);
1998 snd_soc_write(codec, M98088_REG_50_DAC_BIAS2, 0x0F);
1999
2000 snd_soc_write(codec, M98088_REG_16_DAI1_IOCFG,
2001 M98088_S1NORMAL|M98088_SDATA);
2002
2003 snd_soc_write(codec, M98088_REG_1E_DAI2_IOCFG,
2004 M98088_S2NORMAL|M98088_SDATA);
2005
2006 max98088_handle_pdata(codec);
2007
2008 max98088_add_widgets(codec);
2009
2010err_access:
2011 return ret;
2012}
2013
2014static int max98088_remove(struct snd_soc_codec *codec)
2015{
2016 max98088_set_bias_level(codec, SND_SOC_BIAS_OFF);
2017
2018 return 0;
2019}
2020
2021static struct snd_soc_codec_driver soc_codec_dev_max98088 = {
2022 .probe = max98088_probe,
2023 .remove = max98088_remove,
2024 .suspend = max98088_suspend,
2025 .resume = max98088_resume,
2026 .set_bias_level = max98088_set_bias_level,
2027 .reg_cache_size = ARRAY_SIZE(max98088_reg),
2028 .reg_word_size = sizeof(u8),
2029 .reg_cache_default = max98088_reg,
2030 .volatile_register = max98088_volatile_register,
2031};
2032
2033static int max98088_i2c_probe(struct i2c_client *i2c,
2034 const struct i2c_device_id *id)
2035{
2036 struct max98088_priv *max98088;
2037 int ret;
2038
2039 max98088 = kzalloc(sizeof(struct max98088_priv), GFP_KERNEL);
2040 if (max98088 == NULL)
2041 return -ENOMEM;
2042
2043 i2c_set_clientdata(i2c, max98088);
2044 max98088->control_data = i2c;
2045 max98088->pdata = i2c->dev.platform_data;
2046
2047 ret = snd_soc_register_codec(&i2c->dev,
2048 &soc_codec_dev_max98088, &max98088_dai[0], 2);
2049 if (ret < 0)
2050 kfree(max98088);
2051 return ret;
2052}
2053
2054static int max98088_i2c_remove(struct i2c_client *client)
2055{
2056 snd_soc_unregister_codec(&client->dev);
2057 kfree(i2c_get_clientdata(client));
2058 return 0;
2059}
2060
2061static const struct i2c_device_id max98088_i2c_id[] = {
2062 { "max98088", 0 },
2063 { }
2064};
2065MODULE_DEVICE_TABLE(i2c, max98088_i2c_id);
2066
2067static struct i2c_driver max98088_i2c_driver = {
2068 .driver = {
2069 .name = "max98088",
2070 .owner = THIS_MODULE,
2071 },
2072 .probe = max98088_i2c_probe,
2073 .remove = __devexit_p(max98088_i2c_remove),
2074 .id_table = max98088_i2c_id,
2075};
2076
2077static int __init max98088_init(void)
2078{
2079 int ret;
2080
2081 ret = i2c_add_driver(&max98088_i2c_driver);
2082 if (ret)
2083 pr_err("Failed to register max98088 I2C driver: %d\n", ret);
2084
2085 return ret;
2086}
2087module_init(max98088_init);
2088
2089static void __exit max98088_exit(void)
2090{
2091 i2c_del_driver(&max98088_i2c_driver);
2092}
2093module_exit(max98088_exit);
2094
2095MODULE_DESCRIPTION("ALSA SoC MAX98088 driver");
2096MODULE_AUTHOR("Peter Hsiang, Jesse Marroquin");
2097MODULE_LICENSE("GPL");
diff --git a/sound/soc/codecs/max98088.h b/sound/soc/codecs/max98088.h
new file mode 100644
index 000000000000..56554c797fef
--- /dev/null
+++ b/sound/soc/codecs/max98088.h
@@ -0,0 +1,193 @@
1/*
2 * max98088.h -- MAX98088 ALSA SoC Audio driver
3 *
4 * Copyright 2010 Maxim Integrated Products
5 *
6 * This program is free software; you can redistribute it and/or modify
7 * it under the terms of the GNU General Public License version 2 as
8 * published by the Free Software Foundation.
9 */
10
11#ifndef _MAX98088_H
12#define _MAX98088_H
13
14/*
15 * MAX98088 Registers Definition
16 */
17#define M98088_REG_00_IRQ_STATUS 0x00
18#define M98088_REG_01_MIC_STATUS 0x01
19#define M98088_REG_02_JACK_STAUS 0x02
20#define M98088_REG_03_BATTERY_VOLTAGE 0x03
21#define M98088_REG_0F_IRQ_ENABLE 0x0F
22#define M98088_REG_10_SYS_CLK 0x10
23#define M98088_REG_11_DAI1_CLKMODE 0x11
24#define M98088_REG_12_DAI1_CLKCFG_HI 0x12
25#define M98088_REG_13_DAI1_CLKCFG_LO 0x13
26#define M98088_REG_14_DAI1_FORMAT 0x14
27#define M98088_REG_15_DAI1_CLOCK 0x15
28#define M98088_REG_16_DAI1_IOCFG 0x16
29#define M98088_REG_17_DAI1_TDM 0x17
30#define M98088_REG_18_DAI1_FILTERS 0x18
31#define M98088_REG_19_DAI2_CLKMODE 0x19
32#define M98088_REG_1A_DAI2_CLKCFG_HI 0x1A
33#define M98088_REG_1B_DAI2_CLKCFG_LO 0x1B
34#define M98088_REG_1C_DAI2_FORMAT 0x1C
35#define M98088_REG_1D_DAI2_CLOCK 0x1D
36#define M98088_REG_1E_DAI2_IOCFG 0x1E
37#define M98088_REG_1F_DAI2_TDM 0x1F
38#define M98088_REG_20_DAI2_FILTERS 0x20
39#define M98088_REG_21_SRC 0x21
40#define M98088_REG_22_MIX_DAC 0x22
41#define M98088_REG_23_MIX_ADC_LEFT 0x23
42#define M98088_REG_24_MIX_ADC_RIGHT 0x24
43#define M98088_REG_25_MIX_HP_LEFT 0x25
44#define M98088_REG_26_MIX_HP_RIGHT 0x26
45#define M98088_REG_27_MIX_HP_CNTL 0x27
46#define M98088_REG_28_MIX_REC_LEFT 0x28
47#define M98088_REG_29_MIX_REC_RIGHT 0x29
48#define M98088_REG_2A_MIC_REC_CNTL 0x2A
49#define M98088_REG_2B_MIX_SPK_LEFT 0x2B
50#define M98088_REG_2C_MIX_SPK_RIGHT 0x2C
51#define M98088_REG_2D_MIX_SPK_CNTL 0x2D
52#define M98088_REG_2E_LVL_SIDETONE 0x2E
53#define M98088_REG_2F_LVL_DAI1_PLAY 0x2F
54#define M98088_REG_30_LVL_DAI1_PLAY_EQ 0x30
55#define M98088_REG_31_LVL_DAI2_PLAY 0x31
56#define M98088_REG_32_LVL_DAI2_PLAY_EQ 0x32
57#define M98088_REG_33_LVL_ADC_L 0x33
58#define M98088_REG_34_LVL_ADC_R 0x34
59#define M98088_REG_35_LVL_MIC1 0x35
60#define M98088_REG_36_LVL_MIC2 0x36
61#define M98088_REG_37_LVL_INA 0x37
62#define M98088_REG_38_LVL_INB 0x38
63#define M98088_REG_39_LVL_HP_L 0x39
64#define M98088_REG_3A_LVL_HP_R 0x3A
65#define M98088_REG_3B_LVL_REC_L 0x3B
66#define M98088_REG_3C_LVL_REC_R 0x3C
67#define M98088_REG_3D_LVL_SPK_L 0x3D
68#define M98088_REG_3E_LVL_SPK_R 0x3E
69#define M98088_REG_3F_MICAGC_CFG 0x3F
70#define M98088_REG_40_MICAGC_THRESH 0x40
71#define M98088_REG_41_SPKDHP 0x41
72#define M98088_REG_42_SPKDHP_THRESH 0x42
73#define M98088_REG_43_SPKALC_COMP 0x43
74#define M98088_REG_44_PWRLMT_CFG 0x44
75#define M98088_REG_45_PWRLMT_TIME 0x45
76#define M98088_REG_46_THDLMT_CFG 0x46
77#define M98088_REG_47_CFG_AUDIO_IN 0x47
78#define M98088_REG_48_CFG_MIC 0x48
79#define M98088_REG_49_CFG_LEVEL 0x49
80#define M98088_REG_4A_CFG_BYPASS 0x4A
81#define M98088_REG_4B_CFG_JACKDET 0x4B
82#define M98088_REG_4C_PWR_EN_IN 0x4C
83#define M98088_REG_4D_PWR_EN_OUT 0x4D
84#define M98088_REG_4E_BIAS_CNTL 0x4E
85#define M98088_REG_4F_DAC_BIAS1 0x4F
86#define M98088_REG_50_DAC_BIAS2 0x50
87#define M98088_REG_51_PWR_SYS 0x51
88#define M98088_REG_52_DAI1_EQ_BASE 0x52
89#define M98088_REG_84_DAI2_EQ_BASE 0x84
90#define M98088_REG_B6_DAI1_BIQUAD_BASE 0xB6
91#define M98088_REG_C0_DAI2_BIQUAD_BASE 0xC0
92#define M98088_REG_FF_REV_ID 0xFF
93
94#define M98088_REG_CNT (0xFF+1)
95
96/* MAX98088 Registers Bit Fields */
97
98/* M98088_REG_11_DAI1_CLKMODE, M98088_REG_19_DAI2_CLKMODE */
99 #define M98088_CLKMODE_MASK 0xFF
100
101/* M98088_REG_14_DAI1_FORMAT, M98088_REG_1C_DAI2_FORMAT */
102 #define M98088_DAI_MAS (1<<7)
103 #define M98088_DAI_WCI (1<<6)
104 #define M98088_DAI_BCI (1<<5)
105 #define M98088_DAI_DLY (1<<4)
106 #define M98088_DAI_TDM (1<<2)
107 #define M98088_DAI_FSW (1<<1)
108 #define M98088_DAI_WS (1<<0)
109
110/* M98088_REG_15_DAI1_CLOCK, M98088_REG_1D_DAI2_CLOCK */
111 #define M98088_DAI_BSEL64 (1<<0)
112 #define M98088_DAI_OSR64 (1<<6)
113
114/* M98088_REG_16_DAI1_IOCFG, M98088_REG_1E_DAI2_IOCFG */
115 #define M98088_S1NORMAL (1<<6)
116 #define M98088_S2NORMAL (2<<6)
117 #define M98088_SDATA (3<<0)
118
119/* M98088_REG_18_DAI1_FILTERS, M98088_REG_20_DAI2_FILTERS */
120 #define M98088_DAI_DHF (1<<3)
121
122/* M98088_REG_22_MIX_DAC */
123 #define M98088_DAI1L_TO_DACL (1<<7)
124 #define M98088_DAI1R_TO_DACL (1<<6)
125 #define M98088_DAI2L_TO_DACL (1<<5)
126 #define M98088_DAI2R_TO_DACL (1<<4)
127 #define M98088_DAI1L_TO_DACR (1<<3)
128 #define M98088_DAI1R_TO_DACR (1<<2)
129 #define M98088_DAI2L_TO_DACR (1<<1)
130 #define M98088_DAI2R_TO_DACR (1<<0)
131
132/* M98088_REG_2A_MIC_REC_CNTL */
133 #define M98088_REC_LINEMODE (1<<7)
134 #define M98088_REC_LINEMODE_MASK (1<<7)
135
136/* M98088_REG_35_LVL_MIC1, M98088_REG_36_LVL_MIC2 */
137 #define M98088_MICPRE_MASK (3<<5)
138 #define M98088_MICPRE_SHIFT 5
139
140/* M98088_REG_3A_LVL_HP_R */
141 #define M98088_HP_MUTE (1<<7)
142
143/* M98088_REG_3C_LVL_REC_R */
144 #define M98088_REC_MUTE (1<<7)
145
146/* M98088_REG_3E_LVL_SPK_R */
147 #define M98088_SP_MUTE (1<<7)
148
149/* M98088_REG_48_CFG_MIC */
150 #define M98088_EXTMIC_MASK (3<<0)
151 #define M98088_DIGMIC_L (1<<5)
152 #define M98088_DIGMIC_R (1<<4)
153
154/* M98088_REG_49_CFG_LEVEL */
155 #define M98088_VSEN (1<<6)
156 #define M98088_ZDEN (1<<5)
157 #define M98088_EQ2EN (1<<1)
158 #define M98088_EQ1EN (1<<0)
159
160/* M98088_REG_4C_PWR_EN_IN */
161 #define M98088_INAEN (1<<7)
162 #define M98088_INBEN (1<<6)
163 #define M98088_MBEN (1<<3)
164 #define M98088_ADLEN (1<<1)
165 #define M98088_ADREN (1<<0)
166
167/* M98088_REG_4D_PWR_EN_OUT */
168 #define M98088_HPLEN (1<<7)
169 #define M98088_HPREN (1<<6)
170 #define M98088_HPEN ((1<<7)|(1<<6))
171 #define M98088_SPLEN (1<<5)
172 #define M98088_SPREN (1<<4)
173 #define M98088_RECEN (1<<3)
174 #define M98088_DALEN (1<<1)
175 #define M98088_DAREN (1<<0)
176
177/* M98088_REG_51_PWR_SYS */
178 #define M98088_SHDNRUN (1<<7)
179 #define M98088_PERFMODE (1<<3)
180 #define M98088_HPPLYBACK (1<<2)
181 #define M98088_PWRSV8K (1<<1)
182 #define M98088_PWRSV (1<<0)
183
184/* Line inputs */
185#define LINE_INA 0
186#define LINE_INB 1
187
188#define M98088_COEFS_PER_BAND 5
189
190#define M98088_BYTE1(w) ((w >> 8) & 0xff)
191#define M98088_BYTE0(w) (w & 0xff)
192
193#endif
diff --git a/sound/soc/codecs/wm8580.c b/sound/soc/codecs/wm8580.c
index ad5987e6c9ca..a2e0ed59b376 100644
--- a/sound/soc/codecs/wm8580.c
+++ b/sound/soc/codecs/wm8580.c
@@ -548,11 +548,9 @@ static int wm8580_set_paif_dai_fmt(struct snd_soc_dai *codec_dai,
548 unsigned int fmt) 548 unsigned int fmt)
549{ 549{
550 struct snd_soc_codec *codec = codec_dai->codec; 550 struct snd_soc_codec *codec = codec_dai->codec;
551 struct wm8580_priv *wm8580 = snd_soc_codec_get_drvdata(codec);
552 unsigned int aifa; 551 unsigned int aifa;
553 unsigned int aifb; 552 unsigned int aifb;
554 int can_invert_lrclk; 553 int can_invert_lrclk;
555 int sysclk;
556 554
557 aifa = snd_soc_read(codec, WM8580_PAIF1 + codec_dai->driver->id); 555 aifa = snd_soc_read(codec, WM8580_PAIF1 + codec_dai->driver->id);
558 aifb = snd_soc_read(codec, WM8580_PAIF3 + codec_dai->driver->id); 556 aifb = snd_soc_read(codec, WM8580_PAIF3 + codec_dai->driver->id);
@@ -621,8 +619,6 @@ static int wm8580_set_paif_dai_fmt(struct snd_soc_dai *codec_dai,
621 return -EINVAL; 619 return -EINVAL;
622 } 620 }
623 621
624 sysclk = wm8580->sysclk[codec_dai->driver->id];
625
626 snd_soc_write(codec, WM8580_PAIF1 + codec_dai->driver->id, aifa); 622 snd_soc_write(codec, WM8580_PAIF1 + codec_dai->driver->id, aifa);
627 snd_soc_write(codec, WM8580_PAIF3 + codec_dai->driver->id, aifb); 623 snd_soc_write(codec, WM8580_PAIF3 + codec_dai->driver->id, aifb);
628 624
diff --git a/sound/soc/codecs/wm8804.c b/sound/soc/codecs/wm8804.c
index 642b07ceddfa..4599e8e95aa2 100644
--- a/sound/soc/codecs/wm8804.c
+++ b/sound/soc/codecs/wm8804.c
@@ -720,8 +720,8 @@ static int __devinit wm8804_spi_probe(struct spi_device *spi)
720 int ret; 720 int ret;
721 721
722 wm8804 = kzalloc(sizeof *wm8804, GFP_KERNEL); 722 wm8804 = kzalloc(sizeof *wm8804, GFP_KERNEL);
723 if (IS_ERR(wm8804)) 723 if (!wm8804)
724 return PTR_ERR(wm8804); 724 return -ENOMEM;
725 725
726 wm8804->control_type = SND_SOC_SPI; 726 wm8804->control_type = SND_SOC_SPI;
727 spi_set_drvdata(spi, wm8804); 727 spi_set_drvdata(spi, wm8804);
@@ -758,8 +758,8 @@ static __devinit int wm8804_i2c_probe(struct i2c_client *i2c,
758 int ret; 758 int ret;
759 759
760 wm8804 = kzalloc(sizeof *wm8804, GFP_KERNEL); 760 wm8804 = kzalloc(sizeof *wm8804, GFP_KERNEL);
761 if (IS_ERR(wm8804)) 761 if (!wm8804)
762 return PTR_ERR(wm8804); 762 return -ENOMEM;
763 763
764 wm8804->control_type = SND_SOC_I2C; 764 wm8804->control_type = SND_SOC_I2C;
765 i2c_set_clientdata(i2c, wm8804); 765 i2c_set_clientdata(i2c, wm8804);
diff --git a/sound/soc/codecs/wm8962-tables.c b/sound/soc/codecs/wm8962-tables.c
deleted file mode 100644
index 6fa98ea0ae40..000000000000
--- a/sound/soc/codecs/wm8962-tables.c
+++ /dev/null
@@ -1,42299 +0,0 @@
1/*
2 * wm8962-tables.c -- WM8962 ASoC driver
3 *
4 * Copyright 2010 Wolfson Microelectronics, plc
5 *
6 * Author: Mark Brown <broonie@opensource.wolfsonmicro.com>
7 *
8 * This program is free software; you can redistribute it and/or modify
9 * it under the terms of the GNU General Public License version 2 as
10 * published by the Free Software Foundation.
11 */
12
13#include "wm8962.h"
14
15const u16 wm8962_reg[WM8962_MAX_REGISTER + 1] = {
16 0x009F, /* R0 - Left Input volume */
17 0x049F, /* R1 - Right Input volume */
18 0x0000, /* R2 - HPOUTL volume */
19 0x0000, /* R3 - HPOUTR volume */
20 0x0020, /* R4 - Clocking1 */
21 0x0018, /* R5 - ADC & DAC Control 1 */
22 0x2008, /* R6 - ADC & DAC Control 2 */
23 0x000A, /* R7 - Audio Interface 0 */
24 0x01E4, /* R8 - Clocking2 */
25 0x0300, /* R9 - Audio Interface 1 */
26 0x00C0, /* R10 - Left DAC volume */
27 0x00C0, /* R11 - Right DAC volume */
28 0x0000, /* R12 */
29 0x0000, /* R13 */
30 0x0040, /* R14 - Audio Interface 2 */
31 0x6243, /* R15 - Software Reset */
32 0x0000, /* R16 */
33 0x007B, /* R17 - ALC1 */
34 0x0000, /* R18 - ALC2 */
35 0x1C32, /* R19 - ALC3 */
36 0x3200, /* R20 - Noise Gate */
37 0x00C0, /* R21 - Left ADC volume */
38 0x00C0, /* R22 - Right ADC volume */
39 0x0160, /* R23 - Additional control(1) */
40 0x0000, /* R24 - Additional control(2) */
41 0x0000, /* R25 - Pwr Mgmt (1) */
42 0x0000, /* R26 - Pwr Mgmt (2) */
43 0x0010, /* R27 - Additional Control (3) */
44 0x0000, /* R28 - Anti-pop */
45 0x0000, /* R29 */
46 0x005E, /* R30 - Clocking 3 */
47 0x0000, /* R31 - Input mixer control (1) */
48 0x0145, /* R32 - Left input mixer volume */
49 0x0145, /* R33 - Right input mixer volume */
50 0x0009, /* R34 - Input mixer control (2) */
51 0x0003, /* R35 - Input bias control */
52 0x0000, /* R36 */
53 0x0008, /* R37 - Left input PGA control */
54 0x0008, /* R38 - Right input PGA control */
55 0x0000, /* R39 */
56 0x0000, /* R40 - SPKOUTL volume */
57 0x0000, /* R41 - SPKOUTR volume */
58 0x0000, /* R42 */
59 0x0000, /* R43 */
60 0x0000, /* R44 */
61 0x0000, /* R45 */
62 0x0000, /* R46 */
63 0x0000, /* R47 - Thermal Shutdown Status */
64 0x8027, /* R48 - Additional Control (4) */
65 0x0010, /* R49 - Class D Control 1 */
66 0x0000, /* R50 */
67 0x0003, /* R51 - Class D Control 2 */
68 0x0000, /* R52 */
69 0x0000, /* R53 */
70 0x0000, /* R54 */
71 0x0000, /* R55 */
72 0x0506, /* R56 - Clocking 4 */
73 0x0000, /* R57 - DAC DSP Mixing (1) */
74 0x0000, /* R58 - DAC DSP Mixing (2) */
75 0x0000, /* R59 */
76 0x0300, /* R60 - DC Servo 0 */
77 0x0300, /* R61 - DC Servo 1 */
78 0x0000, /* R62 */
79 0x0000, /* R63 */
80 0x0810, /* R64 - DC Servo 4 */
81 0x0000, /* R65 */
82 0x0000, /* R66 - DC Servo 6 */
83 0x0000, /* R67 */
84 0x001B, /* R68 - Analogue PGA Bias */
85 0x0000, /* R69 - Analogue HP 0 */
86 0x0000, /* R70 */
87 0x01FB, /* R71 - Analogue HP 2 */
88 0x0000, /* R72 - Charge Pump 1 */
89 0x0000, /* R73 */
90 0x0000, /* R74 */
91 0x0000, /* R75 */
92 0x0000, /* R76 */
93 0x0000, /* R77 */
94 0x0000, /* R78 */
95 0x0000, /* R79 */
96 0x0000, /* R80 */
97 0x0000, /* R81 */
98 0x0004, /* R82 - Charge Pump B */
99 0x0000, /* R83 */
100 0x0000, /* R84 */
101 0x0000, /* R85 */
102 0x0000, /* R86 */
103 0x0000, /* R87 - Write Sequencer Control 1 */
104 0x0000, /* R88 */
105 0x0000, /* R89 */
106 0x0000, /* R90 - Write Sequencer Control 2 */
107 0x0000, /* R91 */
108 0x0000, /* R92 */
109 0x0000, /* R93 - Write Sequencer Control 3 */
110 0x0000, /* R94 - Control Interface */
111 0x0000, /* R95 */
112 0x0000, /* R96 */
113 0x0000, /* R97 */
114 0x0000, /* R98 */
115 0x0000, /* R99 - Mixer Enables */
116 0x0000, /* R100 - Headphone Mixer (1) */
117 0x0000, /* R101 - Headphone Mixer (2) */
118 0x013F, /* R102 - Headphone Mixer (3) */
119 0x013F, /* R103 - Headphone Mixer (4) */
120 0x0000, /* R104 */
121 0x0000, /* R105 - Speaker Mixer (1) */
122 0x0000, /* R106 - Speaker Mixer (2) */
123 0x013F, /* R107 - Speaker Mixer (3) */
124 0x013F, /* R108 - Speaker Mixer (4) */
125 0x0003, /* R109 - Speaker Mixer (5) */
126 0x0002, /* R110 - Beep Generator (1) */
127 0x0000, /* R111 */
128 0x0000, /* R112 */
129 0x0000, /* R113 */
130 0x0000, /* R114 */
131 0x0006, /* R115 - Oscillator Trim (3) */
132 0x0026, /* R116 - Oscillator Trim (4) */
133 0x0000, /* R117 */
134 0x0000, /* R118 */
135 0x0000, /* R119 - Oscillator Trim (7) */
136 0x0000, /* R120 */
137 0x0000, /* R121 */
138 0x0000, /* R122 */
139 0x0000, /* R123 */
140 0x0011, /* R124 - Analogue Clocking1 */
141 0x004B, /* R125 - Analogue Clocking2 */
142 0x000D, /* R126 - Analogue Clocking3 */
143 0x0000, /* R127 - PLL Software Reset */
144 0x0000, /* R128 */
145 0x0000, /* R129 - PLL2 */
146 0x0000, /* R130 */
147 0x0000, /* R131 - PLL 4 */
148 0x0000, /* R132 */
149 0x0000, /* R133 */
150 0x0000, /* R134 */
151 0x0000, /* R135 */
152 0x0067, /* R136 - PLL 9 */
153 0x001C, /* R137 - PLL 10 */
154 0x0071, /* R138 - PLL 11 */
155 0x00C7, /* R139 - PLL 12 */
156 0x0067, /* R140 - PLL 13 */
157 0x0048, /* R141 - PLL 14 */
158 0x0022, /* R142 - PLL 15 */
159 0x0097, /* R143 - PLL 16 */
160 0x0000, /* R144 */
161 0x0000, /* R145 */
162 0x0000, /* R146 */
163 0x0000, /* R147 */
164 0x0000, /* R148 */
165 0x0000, /* R149 */
166 0x0000, /* R150 */
167 0x0000, /* R151 */
168 0x0000, /* R152 */
169 0x0000, /* R153 */
170 0x0000, /* R154 */
171 0x000C, /* R155 - FLL Control (1) */
172 0x0039, /* R156 - FLL Control (2) */
173 0x0180, /* R157 - FLL Control (3) */
174 0x0000, /* R158 */
175 0x0032, /* R159 - FLL Control (5) */
176 0x0018, /* R160 - FLL Control (6) */
177 0x007D, /* R161 - FLL Control (7) */
178 0x0008, /* R162 - FLL Control (8) */
179 0x0000, /* R163 */
180 0x0000, /* R164 */
181 0x0000, /* R165 */
182 0x0000, /* R166 */
183 0x0000, /* R167 */
184 0x0000, /* R168 */
185 0x0000, /* R169 */
186 0x0000, /* R170 */
187 0x0000, /* R171 */
188 0x0000, /* R172 */
189 0x0000, /* R173 */
190 0x0000, /* R174 */
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192 0x0000, /* R176 */
193 0x0000, /* R177 */
194 0x0000, /* R178 */
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196 0x0000, /* R180 */
197 0x0000, /* R181 */
198 0x0000, /* R182 */
199 0x0000, /* R183 */
200 0x0000, /* R184 */
201 0x0000, /* R185 */
202 0x0000, /* R186 */
203 0x0000, /* R187 */
204 0x0000, /* R188 */
205 0x0000, /* R189 */
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217 0x0000, /* R201 */
218 0x0000, /* R202 */
219 0x0000, /* R203 */
220 0x0000, /* R204 */
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239 0x0000, /* R223 */
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254 0x0000, /* R238 */
255 0x0000, /* R239 */
256 0x0000, /* R240 */
257 0x0000, /* R241 */
258 0x0000, /* R242 */
259 0x0000, /* R243 */
260 0x0000, /* R244 */
261 0x0000, /* R245 */
262 0x0000, /* R246 */
263 0x0000, /* R247 */
264 0x0000, /* R248 */
265 0x0000, /* R249 */
266 0x0000, /* R250 */
267 0x0000, /* R251 */
268 0x0005, /* R252 - General test 1 */
269 0x0000, /* R253 */
270 0x0000, /* R254 */
271 0x0000, /* R255 */
272 0x0000, /* R256 - DF1 */
273 0x0000, /* R257 - DF2 */
274 0x0000, /* R258 - DF3 */
275 0x0000, /* R259 - DF4 */
276 0x0000, /* R260 - DF5 */
277 0x0000, /* R261 - DF6 */
278 0x0000, /* R262 - DF7 */
279 0x0000, /* R263 */
280 0x0000, /* R264 - LHPF1 */
281 0x0000, /* R265 - LHPF2 */
282 0x0000, /* R266 */
283 0x0000, /* R267 */
284 0x0000, /* R268 - THREED1 */
285 0x0000, /* R269 - THREED2 */
286 0x0000, /* R270 - THREED3 */
287 0x0000, /* R271 - THREED4 */
288 0x0000, /* R272 */
289 0x0000, /* R273 */
290 0x0000, /* R274 */
291 0x0000, /* R275 */
292 0x000C, /* R276 - DRC 1 */
293 0x0925, /* R277 - DRC 2 */
294 0x0000, /* R278 - DRC 3 */
295 0x0000, /* R279 - DRC 4 */
296 0x0000, /* R280 - DRC 5 */
297 0x0000, /* R281 */
298 0x0000, /* R282 */
299 0x0000, /* R283 */
300 0x0000, /* R284 */
301 0x0000, /* R285 - Tloopback */
302 0x0000, /* R286 */
303 0x0000, /* R287 */
304 0x0000, /* R288 */
305 0x0000, /* R289 */
306 0x0000, /* R290 */
307 0x0000, /* R291 */
308 0x0000, /* R292 */
309 0x0000, /* R293 */
310 0x0000, /* R294 */
311 0x0000, /* R295 */
312 0x0000, /* R296 */
313 0x0000, /* R297 */
314 0x0000, /* R298 */
315 0x0000, /* R299 */
316 0x0000, /* R300 */
317 0x0000, /* R301 */
318 0x0000, /* R302 */
319 0x0000, /* R303 */
320 0x0000, /* R304 */
321 0x0000, /* R305 */
322 0x0000, /* R306 */
323 0x0000, /* R307 */
324 0x0000, /* R308 */
325 0x0000, /* R309 */
326 0x0000, /* R310 */
327 0x0000, /* R311 */
328 0x0000, /* R312 */
329 0x0000, /* R313 */
330 0x0000, /* R314 */
331 0x0000, /* R315 */
332 0x0000, /* R316 */
333 0x0000, /* R317 */
334 0x0000, /* R318 */
335 0x0000, /* R319 */
336 0x0000, /* R320 */
337 0x0000, /* R321 */
338 0x0000, /* R322 */
339 0x0000, /* R323 */
340 0x0000, /* R324 */
341 0x0000, /* R325 */
342 0x0000, /* R326 */
343 0x0000, /* R327 */
344 0x0000, /* R328 */
345 0x0000, /* R329 */
346 0x0000, /* R330 */
347 0x0000, /* R331 */
348 0x0000, /* R332 */
349 0x0000, /* R333 */
350 0x0000, /* R334 */
351 0x0004, /* R335 - EQ1 */
352 0x6318, /* R336 - EQ2 */
353 0x6300, /* R337 - EQ3 */
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359 0x0B75, /* R343 - EQ9 */
360 0x01C5, /* R344 - EQ10 */
361 0x1C58, /* R345 - EQ11 */
362 0xF373, /* R346 - EQ12 */
363 0x0A54, /* R347 - EQ13 */
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367 0x07AD, /* R351 - EQ17 */
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374 0x0FCA, /* R358 - EQ24 */
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382 0xF373, /* R366 - EQ32 */
383 0x0A54, /* R367 - EQ33 */
384 0x0558, /* R368 - EQ34 */
385 0x168E, /* R369 - EQ35 */
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387 0x07AD, /* R371 - EQ37 */
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390 0x0559, /* R374 - EQ40 */
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21147 0x57C0, /* R21131 - VSS_XTS28_0 */
21148 0x0003, /* R21132 - VSS_XTS29_1 */
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21150 0x0000, /* R21134 - VSS_XTS30_1 */
21151 0xC6C0, /* R21135 - VSS_XTS30_0 */
21152 0x0003, /* R21136 - VSS_XTS31_1 */
21153 0x12C0, /* R21137 - VSS_XTS31_0 */
21154 0x00FD, /* R21138 - VSS_XTS32_1 */
21155 0x8580, /* R21139 - VSS_XTS32_0 */
21156};
21157
21158const struct wm8962_reg_access wm8962_reg_access[WM8962_MAX_REGISTER + 1] = {
21159 { 0x00FF, 0x01FF, 0x0000 }, /* R0 - Left Input volume */
21160 { 0xFEFF, 0x01FF, 0xFFFF }, /* R1 - Right Input volume */
21161 { 0x00FF, 0x01FF, 0x0000 }, /* R2 - HPOUTL volume */
21162 { 0x00FF, 0x01FF, 0x0000 }, /* R3 - HPOUTR volume */
21163 { 0x07FE, 0x07FE, 0xFFFF }, /* R4 - Clocking1 */
21164 { 0x007F, 0x007F, 0x0000 }, /* R5 - ADC & DAC Control 1 */
21165 { 0x37ED, 0x37ED, 0x0000 }, /* R6 - ADC & DAC Control 2 */
21166 { 0x1FFF, 0x1FFF, 0x0000 }, /* R7 - Audio Interface 0 */
21167 { 0x0FEF, 0x0FEF, 0xFFFF }, /* R8 - Clocking2 */
21168 { 0x0B9F, 0x039F, 0x0000 }, /* R9 - Audio Interface 1 */
21169 { 0x00FF, 0x01FF, 0x0000 }, /* R10 - Left DAC volume */
21170 { 0x00FF, 0x01FF, 0x0000 }, /* R11 - Right DAC volume */
21171 { 0x0000, 0x0000, 0x0000 }, /* R12 */
21172 { 0x0000, 0x0000, 0x0000 }, /* R13 */
21173 { 0x07FF, 0x07FF, 0x0000 }, /* R14 - Audio Interface 2 */
21174 { 0xFFFF, 0xFFFF, 0xFFFF }, /* R15 - Software Reset */
21175 { 0x0000, 0x0000, 0x0000 }, /* R16 */
21176 { 0x07FF, 0x07FF, 0x0000 }, /* R17 - ALC1 */
21177 { 0xF8FF, 0x00FF, 0xFFFF }, /* R18 - ALC2 */
21178 { 0x1DFF, 0x1DFF, 0x0000 }, /* R19 - ALC3 */
21179 { 0xFFFF, 0xFFFF, 0x0000 }, /* R20 - Noise Gate */
21180 { 0x00FF, 0x01FF, 0x0000 }, /* R21 - Left ADC volume */
21181 { 0x00FF, 0x01FF, 0x0000 }, /* R22 - Right ADC volume */
21182 { 0x0161, 0x0161, 0x0000 }, /* R23 - Additional control(1) */
21183 { 0x0008, 0x0008, 0x0000 }, /* R24 - Additional control(2) */
21184 { 0x07FE, 0x07FE, 0x0000 }, /* R25 - Pwr Mgmt (1) */
21185 { 0x01FB, 0x01FB, 0x0000 }, /* R26 - Pwr Mgmt (2) */
21186 { 0x0017, 0x0017, 0x0000 }, /* R27 - Additional Control (3) */
21187 { 0x001C, 0x001C, 0x0000 }, /* R28 - Anti-pop */
21188 { 0x0000, 0x0000, 0x0000 }, /* R29 */
21189 { 0xFFFE, 0xFFFE, 0x0000 }, /* R30 - Clocking 3 */
21190 { 0x000F, 0x000F, 0x0000 }, /* R31 - Input mixer control (1) */
21191 { 0x01FF, 0x01FF, 0x0000 }, /* R32 - Left input mixer volume */
21192 { 0x01FF, 0x01FF, 0x0000 }, /* R33 - Right input mixer volume */
21193 { 0x003F, 0x003F, 0x0000 }, /* R34 - Input mixer control (2) */
21194 { 0x003F, 0x003F, 0x0000 }, /* R35 - Input bias control */
21195 { 0x0000, 0x0000, 0x0000 }, /* R36 */
21196 { 0x001F, 0x001F, 0x0000 }, /* R37 - Left input PGA control */
21197 { 0x001F, 0x001F, 0x0000 }, /* R38 - Right input PGA control */
21198 { 0x0000, 0x0000, 0x0000 }, /* R39 */
21199 { 0x00FF, 0x01FF, 0x0000 }, /* R40 - SPKOUTL volume */
21200 { 0x00FF, 0x01FF, 0x0000 }, /* R41 - SPKOUTR volume */
21201 { 0x0000, 0x0000, 0x0000 }, /* R42 */
21202 { 0x0000, 0x0000, 0x0000 }, /* R43 */
21203 { 0x0000, 0x0000, 0x0000 }, /* R44 */
21204 { 0x0000, 0x0000, 0x0000 }, /* R45 */
21205 { 0x0000, 0x0000, 0x0000 }, /* R46 */
21206 { 0x000F, 0x0000, 0x0000 }, /* R47 - Thermal Shutdown Status */
21207 { 0x7EC7, 0x7E07, 0xFFFF }, /* R48 - Additional Control (4) */
21208 { 0x00D3, 0x00D7, 0xFFFF }, /* R49 - Class D Control 1 */
21209 { 0x0000, 0x0000, 0x0000 }, /* R50 */
21210 { 0x0047, 0x0047, 0x0000 }, /* R51 - Class D Control 2 */
21211 { 0x0000, 0x0000, 0x0000 }, /* R52 */
21212 { 0x0000, 0x0000, 0x0000 }, /* R53 */
21213 { 0x0000, 0x0000, 0x0000 }, /* R54 */
21214 { 0x0000, 0x0000, 0x0000 }, /* R55 */
21215 { 0x001E, 0x001E, 0x0000 }, /* R56 - Clocking 4 */
21216 { 0x02FC, 0x02FC, 0x0000 }, /* R57 - DAC DSP Mixing (1) */
21217 { 0x00FC, 0x00FC, 0x0000 }, /* R58 - DAC DSP Mixing (2) */
21218 { 0x0000, 0x0000, 0x0000 }, /* R59 */
21219 { 0x00CC, 0x00CC, 0x0000 }, /* R60 - DC Servo 0 */
21220 { 0x00DD, 0x00DD, 0x0000 }, /* R61 - DC Servo 1 */
21221 { 0x0000, 0x0000, 0x0000 }, /* R62 */
21222 { 0x0000, 0x0000, 0x0000 }, /* R63 */
21223 { 0x3F80, 0x3F80, 0x0000 }, /* R64 - DC Servo 4 */
21224 { 0x0000, 0x0000, 0x0000 }, /* R65 */
21225 { 0x0780, 0x0000, 0xFFFF }, /* R66 - DC Servo 6 */
21226 { 0x0000, 0x0000, 0x0000 }, /* R67 */
21227 { 0x0007, 0x0007, 0x0000 }, /* R68 - Analogue PGA Bias */
21228 { 0x00FF, 0x00FF, 0x0000 }, /* R69 - Analogue HP 0 */
21229 { 0x0000, 0x0000, 0x0000 }, /* R70 */
21230 { 0x01FF, 0x01FF, 0x0000 }, /* R71 - Analogue HP 2 */
21231 { 0x0001, 0x0001, 0x0000 }, /* R72 - Charge Pump 1 */
21232 { 0x0000, 0x0000, 0x0000 }, /* R73 */
21233 { 0x0000, 0x0000, 0x0000 }, /* R74 */
21234 { 0x0000, 0x0000, 0x0000 }, /* R75 */
21235 { 0x0000, 0x0000, 0x0000 }, /* R76 */
21236 { 0x0000, 0x0000, 0x0000 }, /* R77 */
21237 { 0x0000, 0x0000, 0x0000 }, /* R78 */
21238 { 0x0000, 0x0000, 0x0000 }, /* R79 */
21239 { 0x0000, 0x0000, 0x0000 }, /* R80 */
21240 { 0x0000, 0x0000, 0x0000 }, /* R81 */
21241 { 0x0001, 0x0001, 0x0000 }, /* R82 - Charge Pump B */
21242 { 0x0000, 0x0000, 0x0000 }, /* R83 */
21243 { 0x0000, 0x0000, 0x0000 }, /* R84 */
21244 { 0x0000, 0x0000, 0x0000 }, /* R85 */
21245 { 0x0000, 0x0000, 0x0000 }, /* R86 */
21246 { 0x00A0, 0x00A0, 0x0000 }, /* R87 - Write Sequencer Control 1 */
21247 { 0x0000, 0x0000, 0x0000 }, /* R88 */
21248 { 0x0000, 0x0000, 0x0000 }, /* R89 */
21249 { 0x007F, 0x01FF, 0x0000 }, /* R90 - Write Sequencer Control 2 */
21250 { 0x0000, 0x0000, 0x0000 }, /* R91 */
21251 { 0x0000, 0x0000, 0x0000 }, /* R92 */
21252 { 0x03F9, 0x0000, 0x0000 }, /* R93 - Write Sequencer Control 3 */
21253 { 0x0070, 0x0070, 0x0000 }, /* R94 - Control Interface */
21254 { 0x0000, 0x0000, 0x0000 }, /* R95 */
21255 { 0x0000, 0x0000, 0x0000 }, /* R96 */
21256 { 0x0000, 0x0000, 0x0000 }, /* R97 */
21257 { 0x0000, 0x0000, 0x0000 }, /* R98 */
21258 { 0x000F, 0x000F, 0x0000 }, /* R99 - Mixer Enables */
21259 { 0x00BF, 0x00BF, 0x0000 }, /* R100 - Headphone Mixer (1) */
21260 { 0x00BF, 0x00BF, 0x0000 }, /* R101 - Headphone Mixer (2) */
21261 { 0x01FF, 0x01FF, 0x0000 }, /* R102 - Headphone Mixer (3) */
21262 { 0x01FF, 0x01FF, 0x0000 }, /* R103 - Headphone Mixer (4) */
21263 { 0x0000, 0x0000, 0x0000 }, /* R104 */
21264 { 0x00BF, 0x00BF, 0x0000 }, /* R105 - Speaker Mixer (1) */
21265 { 0x00BF, 0x00BF, 0x0000 }, /* R106 - Speaker Mixer (2) */
21266 { 0x01FF, 0x01FF, 0x0000 }, /* R107 - Speaker Mixer (3) */
21267 { 0x01FF, 0x01FF, 0x0000 }, /* R108 - Speaker Mixer (4) */
21268 { 0x00F0, 0x00F0, 0x0000 }, /* R109 - Speaker Mixer (5) */
21269 { 0x00F7, 0x00F7, 0x0000 }, /* R110 - Beep Generator (1) */
21270 { 0x0000, 0x0000, 0x0000 }, /* R111 */
21271 { 0x0000, 0x0000, 0x0000 }, /* R112 */
21272 { 0x0000, 0x0000, 0x0000 }, /* R113 */
21273 { 0x0000, 0x0000, 0x0000 }, /* R114 */
21274 { 0x001F, 0x001F, 0x0000 }, /* R115 - Oscillator Trim (3) */
21275 { 0x001F, 0x001F, 0x0000 }, /* R116 - Oscillator Trim (4) */
21276 { 0x0000, 0x0000, 0x0000 }, /* R117 */
21277 { 0x0000, 0x0000, 0x0000 }, /* R118 */
21278 { 0x00FF, 0x00FF, 0x0000 }, /* R119 - Oscillator Trim (7) */
21279 { 0x0000, 0x0000, 0x0000 }, /* R120 */
21280 { 0x0000, 0x0000, 0x0000 }, /* R121 */
21281 { 0x0000, 0x0000, 0x0000 }, /* R122 */
21282 { 0x0000, 0x0000, 0x0000 }, /* R123 */
21283 { 0x0079, 0x0079, 0x0000 }, /* R124 - Analogue Clocking1 */
21284 { 0x00DF, 0x00DF, 0x0000 }, /* R125 - Analogue Clocking2 */
21285 { 0x000D, 0x000D, 0x0000 }, /* R126 - Analogue Clocking3 */
21286 { 0x0000, 0xFFFF, 0x0000 }, /* R127 - PLL Software Reset */
21287 { 0x0000, 0x0000, 0x0000 }, /* R128 */
21288 { 0x00B0, 0x00B0, 0x0000 }, /* R129 - PLL2 */
21289 { 0x0000, 0x0000, 0x0000 }, /* R130 */
21290 { 0x0003, 0x0003, 0x0000 }, /* R131 - PLL 4 */
21291 { 0x0000, 0x0000, 0x0000 }, /* R132 */
21292 { 0x0000, 0x0000, 0x0000 }, /* R133 */
21293 { 0x0000, 0x0000, 0x0000 }, /* R134 */
21294 { 0x0000, 0x0000, 0x0000 }, /* R135 */
21295 { 0x005F, 0x005F, 0x0000 }, /* R136 - PLL 9 */
21296 { 0x00FF, 0x00FF, 0x0000 }, /* R137 - PLL 10 */
21297 { 0x00FF, 0x00FF, 0x0000 }, /* R138 - PLL 11 */
21298 { 0x00FF, 0x00FF, 0x0000 }, /* R139 - PLL 12 */
21299 { 0x005F, 0x005F, 0x0000 }, /* R140 - PLL 13 */
21300 { 0x00FF, 0x00FF, 0x0000 }, /* R141 - PLL 14 */
21301 { 0x00FF, 0x00FF, 0x0000 }, /* R142 - PLL 15 */
21302 { 0x00FF, 0x00FF, 0x0000 }, /* R143 - PLL 16 */
21303 { 0x0000, 0x0000, 0x0000 }, /* R144 */
21304 { 0x0000, 0x0000, 0x0000 }, /* R145 */
21305 { 0x0000, 0x0000, 0x0000 }, /* R146 */
21306 { 0x0000, 0x0000, 0x0000 }, /* R147 */
21307 { 0x0000, 0x0000, 0x0000 }, /* R148 */
21308 { 0x0000, 0x0000, 0x0000 }, /* R149 */
21309 { 0x0000, 0x0000, 0x0000 }, /* R150 */
21310 { 0x0000, 0x0000, 0x0000 }, /* R151 */
21311 { 0x0000, 0x0000, 0x0000 }, /* R152 */
21312 { 0x0000, 0x0000, 0x0000 }, /* R153 */
21313 { 0x0000, 0x0000, 0x0000 }, /* R154 */
21314 { 0x0067, 0x0067, 0x0000 }, /* R155 - FLL Control (1) */
21315 { 0x01FB, 0x01FB, 0x0000 }, /* R156 - FLL Control (2) */
21316 { 0x0007, 0x0007, 0x0000 }, /* R157 - FLL Control (3) */
21317 { 0x0000, 0x0000, 0x0000 }, /* R158 */
21318 { 0x007F, 0x007F, 0x0000 }, /* R159 - FLL Control (5) */
21319 { 0xFFFF, 0xFFFF, 0x0000 }, /* R160 - FLL Control (6) */
21320 { 0xFFFF, 0xFFFF, 0x0000 }, /* R161 - FLL Control (7) */
21321 { 0x03FF, 0x03FF, 0x0000 }, /* R162 - FLL Control (8) */
21322 { 0x0000, 0x0000, 0x0000 }, /* R163 */
21323 { 0x0000, 0x0000, 0x0000 }, /* R164 */
21324 { 0x0000, 0x0000, 0x0000 }, /* R165 */
21325 { 0x0000, 0x0000, 0x0000 }, /* R166 */
21326 { 0x0000, 0x0000, 0x0000 }, /* R167 */
21327 { 0x0000, 0x0000, 0x0000 }, /* R168 */
21328 { 0x0000, 0x0000, 0x0000 }, /* R169 */
21329 { 0x0000, 0x0000, 0x0000 }, /* R170 */
21330 { 0x0000, 0x0000, 0x0000 }, /* R171 */
21331 { 0x0000, 0x0000, 0x0000 }, /* R172 */
21332 { 0x0000, 0x0000, 0x0000 }, /* R173 */
21333 { 0x0000, 0x0000, 0x0000 }, /* R174 */
21334 { 0x0000, 0x0000, 0x0000 }, /* R175 */
21335 { 0x0000, 0x0000, 0x0000 }, /* R176 */
21336 { 0x0000, 0x0000, 0x0000 }, /* R177 */
21337 { 0x0000, 0x0000, 0x0000 }, /* R178 */
21338 { 0x0000, 0x0000, 0x0000 }, /* R179 */
21339 { 0x0000, 0x0000, 0x0000 }, /* R180 */
21340 { 0x0000, 0x0000, 0x0000 }, /* R181 */
21341 { 0x0000, 0x0000, 0x0000 }, /* R182 */
21342 { 0x0000, 0x0000, 0x0000 }, /* R183 */
21343 { 0x0000, 0x0000, 0x0000 }, /* R184 */
21344 { 0x0000, 0x0000, 0x0000 }, /* R185 */
21345 { 0x0000, 0x0000, 0x0000 }, /* R186 */
21346 { 0x0000, 0x0000, 0x0000 }, /* R187 */
21347 { 0x0000, 0x0000, 0x0000 }, /* R188 */
21348 { 0x0000, 0x0000, 0x0000 }, /* R189 */
21349 { 0x0000, 0x0000, 0x0000 }, /* R190 */
21350 { 0x0000, 0x0000, 0x0000 }, /* R191 */
21351 { 0x0000, 0x0000, 0x0000 }, /* R192 */
21352 { 0x0000, 0x0000, 0x0000 }, /* R193 */
21353 { 0x0000, 0x0000, 0x0000 }, /* R194 */
21354 { 0x0000, 0x0000, 0x0000 }, /* R195 */
21355 { 0x0000, 0x0000, 0x0000 }, /* R196 */
21356 { 0x0000, 0x0000, 0x0000 }, /* R197 */
21357 { 0x0000, 0x0000, 0x0000 }, /* R198 */
21358 { 0x0000, 0x0000, 0x0000 }, /* R199 */
21359 { 0x0000, 0x0000, 0x0000 }, /* R200 */
21360 { 0x0000, 0x0000, 0x0000 }, /* R201 */
21361 { 0x0000, 0x0000, 0x0000 }, /* R202 */
21362 { 0x0000, 0x0000, 0x0000 }, /* R203 */
21363 { 0x0000, 0x0000, 0x0000 }, /* R204 */
21364 { 0x0000, 0x0000, 0x0000 }, /* R205 */
21365 { 0x0000, 0x0000, 0x0000 }, /* R206 */
21366 { 0x0000, 0x0000, 0x0000 }, /* R207 */
21367 { 0x0000, 0x0000, 0x0000 }, /* R208 */
21368 { 0x0000, 0x0000, 0x0000 }, /* R209 */
21369 { 0x0000, 0x0000, 0x0000 }, /* R210 */
21370 { 0x0000, 0x0000, 0x0000 }, /* R211 */
21371 { 0x0000, 0x0000, 0x0000 }, /* R212 */
21372 { 0x0000, 0x0000, 0x0000 }, /* R213 */
21373 { 0x0000, 0x0000, 0x0000 }, /* R214 */
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21375 { 0x0000, 0x0000, 0x0000 }, /* R216 */
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21377 { 0x0000, 0x0000, 0x0000 }, /* R218 */
21378 { 0x0000, 0x0000, 0x0000 }, /* R219 */
21379 { 0x0000, 0x0000, 0x0000 }, /* R220 */
21380 { 0x0000, 0x0000, 0x0000 }, /* R221 */
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21389 { 0x0000, 0x0000, 0x0000 }, /* R230 */
21390 { 0x0000, 0x0000, 0x0000 }, /* R231 */
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21392 { 0x0000, 0x0000, 0x0000 }, /* R233 */
21393 { 0x0000, 0x0000, 0x0000 }, /* R234 */
21394 { 0x0000, 0x0000, 0x0000 }, /* R235 */
21395 { 0x0000, 0x0000, 0x0000 }, /* R236 */
21396 { 0x0000, 0x0000, 0x0000 }, /* R237 */
21397 { 0x0000, 0x0000, 0x0000 }, /* R238 */
21398 { 0x0000, 0x0000, 0x0000 }, /* R239 */
21399 { 0x0000, 0x0000, 0x0000 }, /* R240 */
21400 { 0x0000, 0x0000, 0x0000 }, /* R241 */
21401 { 0x0000, 0x0000, 0x0000 }, /* R242 */
21402 { 0x0000, 0x0000, 0x0000 }, /* R243 */
21403 { 0x0000, 0x0000, 0x0000 }, /* R244 */
21404 { 0x0000, 0x0000, 0x0000 }, /* R245 */
21405 { 0x0000, 0x0000, 0x0000 }, /* R246 */
21406 { 0x0000, 0x0000, 0x0000 }, /* R247 */
21407 { 0x0000, 0x0000, 0x0000 }, /* R248 */
21408 { 0x0000, 0x0000, 0x0000 }, /* R249 */
21409 { 0x0000, 0x0000, 0x0000 }, /* R250 */
21410 { 0x0000, 0x0000, 0x0000 }, /* R251 */
21411 { 0x0005, 0x0005, 0x0000 }, /* R252 - General test 1 */
21412 { 0x0000, 0x0000, 0x0000 }, /* R253 */
21413 { 0x0000, 0x0000, 0x0000 }, /* R254 */
21414 { 0x0000, 0x0000, 0x0000 }, /* R255 */
21415 { 0x000F, 0x000F, 0x0000 }, /* R256 - DF1 */
21416 { 0xFFFF, 0xFFFF, 0x0000 }, /* R257 - DF2 */
21417 { 0xFFFF, 0xFFFF, 0x0000 }, /* R258 - DF3 */
21418 { 0xFFFF, 0xFFFF, 0x0000 }, /* R259 - DF4 */
21419 { 0xFFFF, 0xFFFF, 0x0000 }, /* R260 - DF5 */
21420 { 0xFFFF, 0xFFFF, 0x0000 }, /* R261 - DF6 */
21421 { 0xFFFF, 0xFFFF, 0x0000 }, /* R262 - DF7 */
21422 { 0x0000, 0x0000, 0x0000 }, /* R263 */
21423 { 0x0003, 0x0003, 0x0000 }, /* R264 - LHPF1 */
21424 { 0xFFFF, 0xFFFF, 0x0000 }, /* R265 - LHPF2 */
21425 { 0x0000, 0x0000, 0x0000 }, /* R266 */
21426 { 0x0000, 0x0000, 0x0000 }, /* R267 */
21427 { 0x0077, 0x0077, 0x0000 }, /* R268 - THREED1 */
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21429 { 0xFFFF, 0xFFFF, 0x0000 }, /* R270 - THREED3 */
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42245 { 0x00FF, 0x00FF, 0x0000 }, /* R21086 - VSS_XTS6_1 */
42246 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21087 - VSS_XTS6_0 */
42247 { 0x00FF, 0x00FF, 0x0000 }, /* R21088 - VSS_XTS7_1 */
42248 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21089 - VSS_XTS7_0 */
42249 { 0x00FF, 0x00FF, 0x0000 }, /* R21090 - VSS_XTS8_1 */
42250 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21091 - VSS_XTS8_0 */
42251 { 0x00FF, 0x00FF, 0x0000 }, /* R21092 - VSS_XTS9_1 */
42252 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21093 - VSS_XTS9_0 */
42253 { 0x00FF, 0x00FF, 0x0000 }, /* R21094 - VSS_XTS10_1 */
42254 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21095 - VSS_XTS10_0 */
42255 { 0x00FF, 0x00FF, 0x0000 }, /* R21096 - VSS_XTS11_1 */
42256 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21097 - VSS_XTS11_0 */
42257 { 0x00FF, 0x00FF, 0x0000 }, /* R21098 - VSS_XTS12_1 */
42258 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21099 - VSS_XTS12_0 */
42259 { 0x00FF, 0x00FF, 0x0000 }, /* R21100 - VSS_XTS13_1 */
42260 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21101 - VSS_XTS13_0 */
42261 { 0x00FF, 0x00FF, 0x0000 }, /* R21102 - VSS_XTS14_1 */
42262 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21103 - VSS_XTS14_0 */
42263 { 0x00FF, 0x00FF, 0x0000 }, /* R21104 - VSS_XTS15_1 */
42264 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21105 - VSS_XTS15_0 */
42265 { 0x00FF, 0x00FF, 0x0000 }, /* R21106 - VSS_XTS16_1 */
42266 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21107 - VSS_XTS16_0 */
42267 { 0x00FF, 0x00FF, 0x0000 }, /* R21108 - VSS_XTS17_1 */
42268 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21109 - VSS_XTS17_0 */
42269 { 0x00FF, 0x00FF, 0x0000 }, /* R21110 - VSS_XTS18_1 */
42270 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21111 - VSS_XTS18_0 */
42271 { 0x00FF, 0x00FF, 0x0000 }, /* R21112 - VSS_XTS19_1 */
42272 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21113 - VSS_XTS19_0 */
42273 { 0x00FF, 0x00FF, 0x0000 }, /* R21114 - VSS_XTS20_1 */
42274 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21115 - VSS_XTS20_0 */
42275 { 0x00FF, 0x00FF, 0x0000 }, /* R21116 - VSS_XTS21_1 */
42276 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21117 - VSS_XTS21_0 */
42277 { 0x00FF, 0x00FF, 0x0000 }, /* R21118 - VSS_XTS22_1 */
42278 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21119 - VSS_XTS22_0 */
42279 { 0x00FF, 0x00FF, 0x0000 }, /* R21120 - VSS_XTS23_1 */
42280 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21121 - VSS_XTS23_0 */
42281 { 0x00FF, 0x00FF, 0x0000 }, /* R21122 - VSS_XTS24_1 */
42282 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21123 - VSS_XTS24_0 */
42283 { 0x00FF, 0x00FF, 0x0000 }, /* R21124 - VSS_XTS25_1 */
42284 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21125 - VSS_XTS25_0 */
42285 { 0x00FF, 0x00FF, 0x0000 }, /* R21126 - VSS_XTS26_1 */
42286 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21127 - VSS_XTS26_0 */
42287 { 0x00FF, 0x00FF, 0x0000 }, /* R21128 - VSS_XTS27_1 */
42288 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21129 - VSS_XTS27_0 */
42289 { 0x00FF, 0x00FF, 0x0000 }, /* R21130 - VSS_XTS28_1 */
42290 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21131 - VSS_XTS28_0 */
42291 { 0x00FF, 0x00FF, 0x0000 }, /* R21132 - VSS_XTS29_1 */
42292 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21133 - VSS_XTS29_0 */
42293 { 0x00FF, 0x00FF, 0x0000 }, /* R21134 - VSS_XTS30_1 */
42294 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21135 - VSS_XTS30_0 */
42295 { 0x00FF, 0x00FF, 0x0000 }, /* R21136 - VSS_XTS31_1 */
42296 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21137 - VSS_XTS31_0 */
42297 { 0x00FF, 0x00FF, 0x0000 }, /* R21138 - VSS_XTS32_1 */
42298 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21139 - VSS_XTS32_0 */
42299};
diff --git a/sound/soc/codecs/wm8962.c b/sound/soc/codecs/wm8962.c
index 6d30f3464bad..894d0cd3aa9b 100644
--- a/sound/soc/codecs/wm8962.c
+++ b/sound/soc/codecs/wm8962.c
@@ -106,6 +106,1840 @@ WM8962_REGULATOR_EVENT(5)
106WM8962_REGULATOR_EVENT(6) 106WM8962_REGULATOR_EVENT(6)
107WM8962_REGULATOR_EVENT(7) 107WM8962_REGULATOR_EVENT(7)
108 108
109static const u16 wm8962_reg[WM8962_MAX_REGISTER + 1] = {
110 [0] = 0x009F, /* R0 - Left Input volume */
111 [1] = 0x049F, /* R1 - Right Input volume */
112 [2] = 0x0000, /* R2 - HPOUTL volume */
113 [3] = 0x0000, /* R3 - HPOUTR volume */
114 [4] = 0x0020, /* R4 - Clocking1 */
115 [5] = 0x0018, /* R5 - ADC & DAC Control 1 */
116 [6] = 0x2008, /* R6 - ADC & DAC Control 2 */
117 [7] = 0x000A, /* R7 - Audio Interface 0 */
118 [8] = 0x01E4, /* R8 - Clocking2 */
119 [9] = 0x0300, /* R9 - Audio Interface 1 */
120 [10] = 0x00C0, /* R10 - Left DAC volume */
121 [11] = 0x00C0, /* R11 - Right DAC volume */
122
123 [14] = 0x0040, /* R14 - Audio Interface 2 */
124 [15] = 0x6243, /* R15 - Software Reset */
125
126 [17] = 0x007B, /* R17 - ALC1 */
127 [18] = 0x0000, /* R18 - ALC2 */
128 [19] = 0x1C32, /* R19 - ALC3 */
129 [20] = 0x3200, /* R20 - Noise Gate */
130 [21] = 0x00C0, /* R21 - Left ADC volume */
131 [22] = 0x00C0, /* R22 - Right ADC volume */
132 [23] = 0x0160, /* R23 - Additional control(1) */
133 [24] = 0x0000, /* R24 - Additional control(2) */
134 [25] = 0x0000, /* R25 - Pwr Mgmt (1) */
135 [26] = 0x0000, /* R26 - Pwr Mgmt (2) */
136 [27] = 0x0010, /* R27 - Additional Control (3) */
137 [28] = 0x0000, /* R28 - Anti-pop */
138
139 [30] = 0x005E, /* R30 - Clocking 3 */
140 [31] = 0x0000, /* R31 - Input mixer control (1) */
141 [32] = 0x0145, /* R32 - Left input mixer volume */
142 [33] = 0x0145, /* R33 - Right input mixer volume */
143 [34] = 0x0009, /* R34 - Input mixer control (2) */
144 [35] = 0x0003, /* R35 - Input bias control */
145 [37] = 0x0008, /* R37 - Left input PGA control */
146 [38] = 0x0008, /* R38 - Right input PGA control */
147
148 [40] = 0x0000, /* R40 - SPKOUTL volume */
149 [41] = 0x0000, /* R41 - SPKOUTR volume */
150
151 [47] = 0x0000, /* R47 - Thermal Shutdown Status */
152 [48] = 0x8027, /* R48 - Additional Control (4) */
153 [49] = 0x0010, /* R49 - Class D Control 1 */
154
155 [51] = 0x0003, /* R51 - Class D Control 2 */
156
157 [56] = 0x0506, /* R56 - Clocking 4 */
158 [57] = 0x0000, /* R57 - DAC DSP Mixing (1) */
159 [58] = 0x0000, /* R58 - DAC DSP Mixing (2) */
160
161 [60] = 0x0300, /* R60 - DC Servo 0 */
162 [61] = 0x0300, /* R61 - DC Servo 1 */
163
164 [64] = 0x0810, /* R64 - DC Servo 4 */
165
166 [66] = 0x0000, /* R66 - DC Servo 6 */
167
168 [68] = 0x001B, /* R68 - Analogue PGA Bias */
169 [69] = 0x0000, /* R69 - Analogue HP 0 */
170
171 [71] = 0x01FB, /* R71 - Analogue HP 2 */
172 [72] = 0x0000, /* R72 - Charge Pump 1 */
173
174 [82] = 0x0004, /* R82 - Charge Pump B */
175
176 [87] = 0x0000, /* R87 - Write Sequencer Control 1 */
177
178 [90] = 0x0000, /* R90 - Write Sequencer Control 2 */
179
180 [93] = 0x0000, /* R93 - Write Sequencer Control 3 */
181 [94] = 0x0000, /* R94 - Control Interface */
182
183 [99] = 0x0000, /* R99 - Mixer Enables */
184 [100] = 0x0000, /* R100 - Headphone Mixer (1) */
185 [101] = 0x0000, /* R101 - Headphone Mixer (2) */
186 [102] = 0x013F, /* R102 - Headphone Mixer (3) */
187 [103] = 0x013F, /* R103 - Headphone Mixer (4) */
188
189 [105] = 0x0000, /* R105 - Speaker Mixer (1) */
190 [106] = 0x0000, /* R106 - Speaker Mixer (2) */
191 [107] = 0x013F, /* R107 - Speaker Mixer (3) */
192 [108] = 0x013F, /* R108 - Speaker Mixer (4) */
193 [109] = 0x0003, /* R109 - Speaker Mixer (5) */
194 [110] = 0x0002, /* R110 - Beep Generator (1) */
195
196 [115] = 0x0006, /* R115 - Oscillator Trim (3) */
197 [116] = 0x0026, /* R116 - Oscillator Trim (4) */
198
199 [119] = 0x0000, /* R119 - Oscillator Trim (7) */
200
201 [124] = 0x0011, /* R124 - Analogue Clocking1 */
202 [125] = 0x004B, /* R125 - Analogue Clocking2 */
203 [126] = 0x000D, /* R126 - Analogue Clocking3 */
204 [127] = 0x0000, /* R127 - PLL Software Reset */
205
206 [129] = 0x0000, /* R129 - PLL2 */
207
208 [131] = 0x0000, /* R131 - PLL 4 */
209
210 [136] = 0x0067, /* R136 - PLL 9 */
211 [137] = 0x001C, /* R137 - PLL 10 */
212 [138] = 0x0071, /* R138 - PLL 11 */
213 [139] = 0x00C7, /* R139 - PLL 12 */
214 [140] = 0x0067, /* R140 - PLL 13 */
215 [141] = 0x0048, /* R141 - PLL 14 */
216 [142] = 0x0022, /* R142 - PLL 15 */
217 [143] = 0x0097, /* R143 - PLL 16 */
218
219 [155] = 0x000C, /* R155 - FLL Control (1) */
220 [156] = 0x0039, /* R156 - FLL Control (2) */
221 [157] = 0x0180, /* R157 - FLL Control (3) */
222
223 [159] = 0x0032, /* R159 - FLL Control (5) */
224 [160] = 0x0018, /* R160 - FLL Control (6) */
225 [161] = 0x007D, /* R161 - FLL Control (7) */
226 [162] = 0x0008, /* R162 - FLL Control (8) */
227
228 [252] = 0x0005, /* R252 - General test 1 */
229
230 [256] = 0x0000, /* R256 - DF1 */
231 [257] = 0x0000, /* R257 - DF2 */
232 [258] = 0x0000, /* R258 - DF3 */
233 [259] = 0x0000, /* R259 - DF4 */
234 [260] = 0x0000, /* R260 - DF5 */
235 [261] = 0x0000, /* R261 - DF6 */
236 [262] = 0x0000, /* R262 - DF7 */
237
238 [264] = 0x0000, /* R264 - LHPF1 */
239 [265] = 0x0000, /* R265 - LHPF2 */
240
241 [268] = 0x0000, /* R268 - THREED1 */
242 [269] = 0x0000, /* R269 - THREED2 */
243 [270] = 0x0000, /* R270 - THREED3 */
244 [271] = 0x0000, /* R271 - THREED4 */
245
246 [276] = 0x000C, /* R276 - DRC 1 */
247 [277] = 0x0925, /* R277 - DRC 2 */
248 [278] = 0x0000, /* R278 - DRC 3 */
249 [279] = 0x0000, /* R279 - DRC 4 */
250 [280] = 0x0000, /* R280 - DRC 5 */
251
252 [285] = 0x0000, /* R285 - Tloopback */
253
254 [335] = 0x0004, /* R335 - EQ1 */
255 [336] = 0x6318, /* R336 - EQ2 */
256 [337] = 0x6300, /* R337 - EQ3 */
257 [338] = 0x0FCA, /* R338 - EQ4 */
258 [339] = 0x0400, /* R339 - EQ5 */
259 [340] = 0x00D8, /* R340 - EQ6 */
260 [341] = 0x1EB5, /* R341 - EQ7 */
261 [342] = 0xF145, /* R342 - EQ8 */
262 [343] = 0x0B75, /* R343 - EQ9 */
263 [344] = 0x01C5, /* R344 - EQ10 */
264 [345] = 0x1C58, /* R345 - EQ11 */
265 [346] = 0xF373, /* R346 - EQ12 */
266 [347] = 0x0A54, /* R347 - EQ13 */
267 [348] = 0x0558, /* R348 - EQ14 */
268 [349] = 0x168E, /* R349 - EQ15 */
269 [350] = 0xF829, /* R350 - EQ16 */
270 [351] = 0x07AD, /* R351 - EQ17 */
271 [352] = 0x1103, /* R352 - EQ18 */
272 [353] = 0x0564, /* R353 - EQ19 */
273 [354] = 0x0559, /* R354 - EQ20 */
274 [355] = 0x4000, /* R355 - EQ21 */
275 [356] = 0x6318, /* R356 - EQ22 */
276 [357] = 0x6300, /* R357 - EQ23 */
277 [358] = 0x0FCA, /* R358 - EQ24 */
278 [359] = 0x0400, /* R359 - EQ25 */
279 [360] = 0x00D8, /* R360 - EQ26 */
280 [361] = 0x1EB5, /* R361 - EQ27 */
281 [362] = 0xF145, /* R362 - EQ28 */
282 [363] = 0x0B75, /* R363 - EQ29 */
283 [364] = 0x01C5, /* R364 - EQ30 */
284 [365] = 0x1C58, /* R365 - EQ31 */
285 [366] = 0xF373, /* R366 - EQ32 */
286 [367] = 0x0A54, /* R367 - EQ33 */
287 [368] = 0x0558, /* R368 - EQ34 */
288 [369] = 0x168E, /* R369 - EQ35 */
289 [370] = 0xF829, /* R370 - EQ36 */
290 [371] = 0x07AD, /* R371 - EQ37 */
291 [372] = 0x1103, /* R372 - EQ38 */
292 [373] = 0x0564, /* R373 - EQ39 */
293 [374] = 0x0559, /* R374 - EQ40 */
294 [375] = 0x4000, /* R375 - EQ41 */
295
296 [513] = 0x0000, /* R513 - GPIO 2 */
297 [514] = 0x0000, /* R514 - GPIO 3 */
298
299 [516] = 0x8100, /* R516 - GPIO 5 */
300 [517] = 0x8100, /* R517 - GPIO 6 */
301
302 [560] = 0x0000, /* R560 - Interrupt Status 1 */
303 [561] = 0x0000, /* R561 - Interrupt Status 2 */
304
305 [568] = 0x0030, /* R568 - Interrupt Status 1 Mask */
306 [569] = 0xFFED, /* R569 - Interrupt Status 2 Mask */
307
308 [576] = 0x0000, /* R576 - Interrupt Control */
309
310 [584] = 0x002D, /* R584 - IRQ Debounce */
311
312 [586] = 0x0000, /* R586 - MICINT Source Pol */
313
314 [768] = 0x1C00, /* R768 - DSP2 Power Management */
315
316 [1037] = 0x0000, /* R1037 - DSP2_ExecControl */
317
318 [8192] = 0x0000, /* R8192 - DSP2 Instruction RAM 0 */
319
320 [9216] = 0x0030, /* R9216 - DSP2 Address RAM 2 */
321 [9217] = 0x0000, /* R9217 - DSP2 Address RAM 1 */
322 [9218] = 0x0000, /* R9218 - DSP2 Address RAM 0 */
323
324 [12288] = 0x0000, /* R12288 - DSP2 Data1 RAM 1 */
325 [12289] = 0x0000, /* R12289 - DSP2 Data1 RAM 0 */
326
327 [13312] = 0x0000, /* R13312 - DSP2 Data2 RAM 1 */
328 [13313] = 0x0000, /* R13313 - DSP2 Data2 RAM 0 */
329
330 [14336] = 0x0000, /* R14336 - DSP2 Data3 RAM 1 */
331 [14337] = 0x0000, /* R14337 - DSP2 Data3 RAM 0 */
332
333 [15360] = 0x000A, /* R15360 - DSP2 Coeff RAM 0 */
334
335 [16384] = 0x0000, /* R16384 - RETUNEADC_SHARED_COEFF_1 */
336 [16385] = 0x0000, /* R16385 - RETUNEADC_SHARED_COEFF_0 */
337 [16386] = 0x0000, /* R16386 - RETUNEDAC_SHARED_COEFF_1 */
338 [16387] = 0x0000, /* R16387 - RETUNEDAC_SHARED_COEFF_0 */
339 [16388] = 0x0000, /* R16388 - SOUNDSTAGE_ENABLES_1 */
340 [16389] = 0x0000, /* R16389 - SOUNDSTAGE_ENABLES_0 */
341
342 [16896] = 0x0002, /* R16896 - HDBASS_AI_1 */
343 [16897] = 0xBD12, /* R16897 - HDBASS_AI_0 */
344 [16898] = 0x007C, /* R16898 - HDBASS_AR_1 */
345 [16899] = 0x586C, /* R16899 - HDBASS_AR_0 */
346 [16900] = 0x0053, /* R16900 - HDBASS_B_1 */
347 [16901] = 0x8121, /* R16901 - HDBASS_B_0 */
348 [16902] = 0x003F, /* R16902 - HDBASS_K_1 */
349 [16903] = 0x8BD8, /* R16903 - HDBASS_K_0 */
350 [16904] = 0x0032, /* R16904 - HDBASS_N1_1 */
351 [16905] = 0xF52D, /* R16905 - HDBASS_N1_0 */
352 [16906] = 0x0065, /* R16906 - HDBASS_N2_1 */
353 [16907] = 0xAC8C, /* R16907 - HDBASS_N2_0 */
354 [16908] = 0x006B, /* R16908 - HDBASS_N3_1 */
355 [16909] = 0xE087, /* R16909 - HDBASS_N3_0 */
356 [16910] = 0x0072, /* R16910 - HDBASS_N4_1 */
357 [16911] = 0x1483, /* R16911 - HDBASS_N4_0 */
358 [16912] = 0x0072, /* R16912 - HDBASS_N5_1 */
359 [16913] = 0x1483, /* R16913 - HDBASS_N5_0 */
360 [16914] = 0x0043, /* R16914 - HDBASS_X1_1 */
361 [16915] = 0x3525, /* R16915 - HDBASS_X1_0 */
362 [16916] = 0x0006, /* R16916 - HDBASS_X2_1 */
363 [16917] = 0x6A4A, /* R16917 - HDBASS_X2_0 */
364 [16918] = 0x0043, /* R16918 - HDBASS_X3_1 */
365 [16919] = 0x6079, /* R16919 - HDBASS_X3_0 */
366 [16920] = 0x0008, /* R16920 - HDBASS_ATK_1 */
367 [16921] = 0x0000, /* R16921 - HDBASS_ATK_0 */
368 [16922] = 0x0001, /* R16922 - HDBASS_DCY_1 */
369 [16923] = 0x0000, /* R16923 - HDBASS_DCY_0 */
370 [16924] = 0x0059, /* R16924 - HDBASS_PG_1 */
371 [16925] = 0x999A, /* R16925 - HDBASS_PG_0 */
372
373 [17048] = 0x0083, /* R17408 - HPF_C_1 */
374 [17049] = 0x98AD, /* R17409 - HPF_C_0 */
375
376 [17920] = 0x007F, /* R17920 - ADCL_RETUNE_C1_1 */
377 [17921] = 0xFFFF, /* R17921 - ADCL_RETUNE_C1_0 */
378 [17922] = 0x0000, /* R17922 - ADCL_RETUNE_C2_1 */
379 [17923] = 0x0000, /* R17923 - ADCL_RETUNE_C2_0 */
380 [17924] = 0x0000, /* R17924 - ADCL_RETUNE_C3_1 */
381 [17925] = 0x0000, /* R17925 - ADCL_RETUNE_C3_0 */
382 [17926] = 0x0000, /* R17926 - ADCL_RETUNE_C4_1 */
383 [17927] = 0x0000, /* R17927 - ADCL_RETUNE_C4_0 */
384 [17928] = 0x0000, /* R17928 - ADCL_RETUNE_C5_1 */
385 [17929] = 0x0000, /* R17929 - ADCL_RETUNE_C5_0 */
386 [17930] = 0x0000, /* R17930 - ADCL_RETUNE_C6_1 */
387 [17931] = 0x0000, /* R17931 - ADCL_RETUNE_C6_0 */
388 [17932] = 0x0000, /* R17932 - ADCL_RETUNE_C7_1 */
389 [17933] = 0x0000, /* R17933 - ADCL_RETUNE_C7_0 */
390 [17934] = 0x0000, /* R17934 - ADCL_RETUNE_C8_1 */
391 [17935] = 0x0000, /* R17935 - ADCL_RETUNE_C8_0 */
392 [17936] = 0x0000, /* R17936 - ADCL_RETUNE_C9_1 */
393 [17937] = 0x0000, /* R17937 - ADCL_RETUNE_C9_0 */
394 [17938] = 0x0000, /* R17938 - ADCL_RETUNE_C10_1 */
395 [17939] = 0x0000, /* R17939 - ADCL_RETUNE_C10_0 */
396 [17940] = 0x0000, /* R17940 - ADCL_RETUNE_C11_1 */
397 [17941] = 0x0000, /* R17941 - ADCL_RETUNE_C11_0 */
398 [17942] = 0x0000, /* R17942 - ADCL_RETUNE_C12_1 */
399 [17943] = 0x0000, /* R17943 - ADCL_RETUNE_C12_0 */
400 [17944] = 0x0000, /* R17944 - ADCL_RETUNE_C13_1 */
401 [17945] = 0x0000, /* R17945 - ADCL_RETUNE_C13_0 */
402 [17946] = 0x0000, /* R17946 - ADCL_RETUNE_C14_1 */
403 [17947] = 0x0000, /* R17947 - ADCL_RETUNE_C14_0 */
404 [17948] = 0x0000, /* R17948 - ADCL_RETUNE_C15_1 */
405 [17949] = 0x0000, /* R17949 - ADCL_RETUNE_C15_0 */
406 [17950] = 0x0000, /* R17950 - ADCL_RETUNE_C16_1 */
407 [17951] = 0x0000, /* R17951 - ADCL_RETUNE_C16_0 */
408 [17952] = 0x0000, /* R17952 - ADCL_RETUNE_C17_1 */
409 [17953] = 0x0000, /* R17953 - ADCL_RETUNE_C17_0 */
410 [17954] = 0x0000, /* R17954 - ADCL_RETUNE_C18_1 */
411 [17955] = 0x0000, /* R17955 - ADCL_RETUNE_C18_0 */
412 [17956] = 0x0000, /* R17956 - ADCL_RETUNE_C19_1 */
413 [17957] = 0x0000, /* R17957 - ADCL_RETUNE_C19_0 */
414 [17958] = 0x0000, /* R17958 - ADCL_RETUNE_C20_1 */
415 [17959] = 0x0000, /* R17959 - ADCL_RETUNE_C20_0 */
416 [17960] = 0x0000, /* R17960 - ADCL_RETUNE_C21_1 */
417 [17961] = 0x0000, /* R17961 - ADCL_RETUNE_C21_0 */
418 [17962] = 0x0000, /* R17962 - ADCL_RETUNE_C22_1 */
419 [17963] = 0x0000, /* R17963 - ADCL_RETUNE_C22_0 */
420 [17964] = 0x0000, /* R17964 - ADCL_RETUNE_C23_1 */
421 [17965] = 0x0000, /* R17965 - ADCL_RETUNE_C23_0 */
422 [17966] = 0x0000, /* R17966 - ADCL_RETUNE_C24_1 */
423 [17967] = 0x0000, /* R17967 - ADCL_RETUNE_C24_0 */
424 [17968] = 0x0000, /* R17968 - ADCL_RETUNE_C25_1 */
425 [17969] = 0x0000, /* R17969 - ADCL_RETUNE_C25_0 */
426 [17970] = 0x0000, /* R17970 - ADCL_RETUNE_C26_1 */
427 [17971] = 0x0000, /* R17971 - ADCL_RETUNE_C26_0 */
428 [17972] = 0x0000, /* R17972 - ADCL_RETUNE_C27_1 */
429 [17973] = 0x0000, /* R17973 - ADCL_RETUNE_C27_0 */
430 [17974] = 0x0000, /* R17974 - ADCL_RETUNE_C28_1 */
431 [17975] = 0x0000, /* R17975 - ADCL_RETUNE_C28_0 */
432 [17976] = 0x0000, /* R17976 - ADCL_RETUNE_C29_1 */
433 [17977] = 0x0000, /* R17977 - ADCL_RETUNE_C29_0 */
434 [17978] = 0x0000, /* R17978 - ADCL_RETUNE_C30_1 */
435 [17979] = 0x0000, /* R17979 - ADCL_RETUNE_C30_0 */
436 [17980] = 0x0000, /* R17980 - ADCL_RETUNE_C31_1 */
437 [17981] = 0x0000, /* R17981 - ADCL_RETUNE_C31_0 */
438 [17982] = 0x0000, /* R17982 - ADCL_RETUNE_C32_1 */
439 [17983] = 0x0000, /* R17983 - ADCL_RETUNE_C32_0 */
440
441 [18432] = 0x0020, /* R18432 - RETUNEADC_PG2_1 */
442 [18433] = 0x0000, /* R18433 - RETUNEADC_PG2_0 */
443 [18434] = 0x0040, /* R18434 - RETUNEADC_PG_1 */
444 [18435] = 0x0000, /* R18435 - RETUNEADC_PG_0 */
445
446 [18944] = 0x007F, /* R18944 - ADCR_RETUNE_C1_1 */
447 [18945] = 0xFFFF, /* R18945 - ADCR_RETUNE_C1_0 */
448 [18946] = 0x0000, /* R18946 - ADCR_RETUNE_C2_1 */
449 [18947] = 0x0000, /* R18947 - ADCR_RETUNE_C2_0 */
450 [18948] = 0x0000, /* R18948 - ADCR_RETUNE_C3_1 */
451 [18949] = 0x0000, /* R18949 - ADCR_RETUNE_C3_0 */
452 [18950] = 0x0000, /* R18950 - ADCR_RETUNE_C4_1 */
453 [18951] = 0x0000, /* R18951 - ADCR_RETUNE_C4_0 */
454 [18952] = 0x0000, /* R18952 - ADCR_RETUNE_C5_1 */
455 [18953] = 0x0000, /* R18953 - ADCR_RETUNE_C5_0 */
456 [18954] = 0x0000, /* R18954 - ADCR_RETUNE_C6_1 */
457 [18955] = 0x0000, /* R18955 - ADCR_RETUNE_C6_0 */
458 [18956] = 0x0000, /* R18956 - ADCR_RETUNE_C7_1 */
459 [18957] = 0x0000, /* R18957 - ADCR_RETUNE_C7_0 */
460 [18958] = 0x0000, /* R18958 - ADCR_RETUNE_C8_1 */
461 [18959] = 0x0000, /* R18959 - ADCR_RETUNE_C8_0 */
462 [18960] = 0x0000, /* R18960 - ADCR_RETUNE_C9_1 */
463 [18961] = 0x0000, /* R18961 - ADCR_RETUNE_C9_0 */
464 [18962] = 0x0000, /* R18962 - ADCR_RETUNE_C10_1 */
465 [18963] = 0x0000, /* R18963 - ADCR_RETUNE_C10_0 */
466 [18964] = 0x0000, /* R18964 - ADCR_RETUNE_C11_1 */
467 [18965] = 0x0000, /* R18965 - ADCR_RETUNE_C11_0 */
468 [18966] = 0x0000, /* R18966 - ADCR_RETUNE_C12_1 */
469 [18967] = 0x0000, /* R18967 - ADCR_RETUNE_C12_0 */
470 [18968] = 0x0000, /* R18968 - ADCR_RETUNE_C13_1 */
471 [18969] = 0x0000, /* R18969 - ADCR_RETUNE_C13_0 */
472 [18970] = 0x0000, /* R18970 - ADCR_RETUNE_C14_1 */
473 [18971] = 0x0000, /* R18971 - ADCR_RETUNE_C14_0 */
474 [18972] = 0x0000, /* R18972 - ADCR_RETUNE_C15_1 */
475 [18973] = 0x0000, /* R18973 - ADCR_RETUNE_C15_0 */
476 [18974] = 0x0000, /* R18974 - ADCR_RETUNE_C16_1 */
477 [18975] = 0x0000, /* R18975 - ADCR_RETUNE_C16_0 */
478 [18976] = 0x0000, /* R18976 - ADCR_RETUNE_C17_1 */
479 [18977] = 0x0000, /* R18977 - ADCR_RETUNE_C17_0 */
480 [18978] = 0x0000, /* R18978 - ADCR_RETUNE_C18_1 */
481 [18979] = 0x0000, /* R18979 - ADCR_RETUNE_C18_0 */
482 [18980] = 0x0000, /* R18980 - ADCR_RETUNE_C19_1 */
483 [18981] = 0x0000, /* R18981 - ADCR_RETUNE_C19_0 */
484 [18982] = 0x0000, /* R18982 - ADCR_RETUNE_C20_1 */
485 [18983] = 0x0000, /* R18983 - ADCR_RETUNE_C20_0 */
486 [18984] = 0x0000, /* R18984 - ADCR_RETUNE_C21_1 */
487 [18985] = 0x0000, /* R18985 - ADCR_RETUNE_C21_0 */
488 [18986] = 0x0000, /* R18986 - ADCR_RETUNE_C22_1 */
489 [18987] = 0x0000, /* R18987 - ADCR_RETUNE_C22_0 */
490 [18988] = 0x0000, /* R18988 - ADCR_RETUNE_C23_1 */
491 [18989] = 0x0000, /* R18989 - ADCR_RETUNE_C23_0 */
492 [18990] = 0x0000, /* R18990 - ADCR_RETUNE_C24_1 */
493 [18991] = 0x0000, /* R18991 - ADCR_RETUNE_C24_0 */
494 [18992] = 0x0000, /* R18992 - ADCR_RETUNE_C25_1 */
495 [18993] = 0x0000, /* R18993 - ADCR_RETUNE_C25_0 */
496 [18994] = 0x0000, /* R18994 - ADCR_RETUNE_C26_1 */
497 [18995] = 0x0000, /* R18995 - ADCR_RETUNE_C26_0 */
498 [18996] = 0x0000, /* R18996 - ADCR_RETUNE_C27_1 */
499 [18997] = 0x0000, /* R18997 - ADCR_RETUNE_C27_0 */
500 [18998] = 0x0000, /* R18998 - ADCR_RETUNE_C28_1 */
501 [18999] = 0x0000, /* R18999 - ADCR_RETUNE_C28_0 */
502 [19000] = 0x0000, /* R19000 - ADCR_RETUNE_C29_1 */
503 [19001] = 0x0000, /* R19001 - ADCR_RETUNE_C29_0 */
504 [19002] = 0x0000, /* R19002 - ADCR_RETUNE_C30_1 */
505 [19003] = 0x0000, /* R19003 - ADCR_RETUNE_C30_0 */
506 [19004] = 0x0000, /* R19004 - ADCR_RETUNE_C31_1 */
507 [19005] = 0x0000, /* R19005 - ADCR_RETUNE_C31_0 */
508 [19006] = 0x0000, /* R19006 - ADCR_RETUNE_C32_1 */
509 [19007] = 0x0000, /* R19007 - ADCR_RETUNE_C32_0 */
510
511 [19456] = 0x007F, /* R19456 - DACL_RETUNE_C1_1 */
512 [19457] = 0xFFFF, /* R19457 - DACL_RETUNE_C1_0 */
513 [19458] = 0x0000, /* R19458 - DACL_RETUNE_C2_1 */
514 [19459] = 0x0000, /* R19459 - DACL_RETUNE_C2_0 */
515 [19460] = 0x0000, /* R19460 - DACL_RETUNE_C3_1 */
516 [19461] = 0x0000, /* R19461 - DACL_RETUNE_C3_0 */
517 [19462] = 0x0000, /* R19462 - DACL_RETUNE_C4_1 */
518 [19463] = 0x0000, /* R19463 - DACL_RETUNE_C4_0 */
519 [19464] = 0x0000, /* R19464 - DACL_RETUNE_C5_1 */
520 [19465] = 0x0000, /* R19465 - DACL_RETUNE_C5_0 */
521 [19466] = 0x0000, /* R19466 - DACL_RETUNE_C6_1 */
522 [19467] = 0x0000, /* R19467 - DACL_RETUNE_C6_0 */
523 [19468] = 0x0000, /* R19468 - DACL_RETUNE_C7_1 */
524 [19469] = 0x0000, /* R19469 - DACL_RETUNE_C7_0 */
525 [19470] = 0x0000, /* R19470 - DACL_RETUNE_C8_1 */
526 [19471] = 0x0000, /* R19471 - DACL_RETUNE_C8_0 */
527 [19472] = 0x0000, /* R19472 - DACL_RETUNE_C9_1 */
528 [19473] = 0x0000, /* R19473 - DACL_RETUNE_C9_0 */
529 [19474] = 0x0000, /* R19474 - DACL_RETUNE_C10_1 */
530 [19475] = 0x0000, /* R19475 - DACL_RETUNE_C10_0 */
531 [19476] = 0x0000, /* R19476 - DACL_RETUNE_C11_1 */
532 [19477] = 0x0000, /* R19477 - DACL_RETUNE_C11_0 */
533 [19478] = 0x0000, /* R19478 - DACL_RETUNE_C12_1 */
534 [19479] = 0x0000, /* R19479 - DACL_RETUNE_C12_0 */
535 [19480] = 0x0000, /* R19480 - DACL_RETUNE_C13_1 */
536 [19481] = 0x0000, /* R19481 - DACL_RETUNE_C13_0 */
537 [19482] = 0x0000, /* R19482 - DACL_RETUNE_C14_1 */
538 [19483] = 0x0000, /* R19483 - DACL_RETUNE_C14_0 */
539 [19484] = 0x0000, /* R19484 - DACL_RETUNE_C15_1 */
540 [19485] = 0x0000, /* R19485 - DACL_RETUNE_C15_0 */
541 [19486] = 0x0000, /* R19486 - DACL_RETUNE_C16_1 */
542 [19487] = 0x0000, /* R19487 - DACL_RETUNE_C16_0 */
543 [19488] = 0x0000, /* R19488 - DACL_RETUNE_C17_1 */
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545 [19490] = 0x0000, /* R19490 - DACL_RETUNE_C18_1 */
546 [19491] = 0x0000, /* R19491 - DACL_RETUNE_C18_0 */
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550 [19495] = 0x0000, /* R19495 - DACL_RETUNE_C20_0 */
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558 [19503] = 0x0000, /* R19503 - DACL_RETUNE_C24_0 */
559 [19504] = 0x0000, /* R19504 - DACL_RETUNE_C25_1 */
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562 [19507] = 0x0000, /* R19507 - DACL_RETUNE_C26_0 */
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566 [19511] = 0x0000, /* R19511 - DACL_RETUNE_C28_0 */
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570 [19515] = 0x0000, /* R19515 - DACL_RETUNE_C30_0 */
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572 [19517] = 0x0000, /* R19517 - DACL_RETUNE_C31_0 */
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575
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577 [19969] = 0x0000, /* R19969 - RETUNEDAC_PG2_0 */
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579 [19971] = 0x0000, /* R19971 - RETUNEDAC_PG_0 */
580
581 [20480] = 0x007F, /* R20480 - DACR_RETUNE_C1_1 */
582 [20481] = 0xFFFF, /* R20481 - DACR_RETUNE_C1_0 */
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642 [20541] = 0x0000, /* R20541 - DACR_RETUNE_C31_0 */
643 [20542] = 0x0000, /* R20542 - DACR_RETUNE_C32_1 */
644 [20543] = 0x0000, /* R20543 - DACR_RETUNE_C32_0 */
645
646 [20992] = 0x008C, /* R20992 - VSS_XHD2_1 */
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649 [20995] = 0x0700, /* R20995 - VSS_XHD3_0 */
650 [20996] = 0x003A, /* R20996 - VSS_XHN1_1 */
651 [20997] = 0x4100, /* R20997 - VSS_XHN1_0 */
652 [20998] = 0x008B, /* R20998 - VSS_XHN2_1 */
653 [20999] = 0x7D00, /* R20999 - VSS_XHN2_0 */
654 [21000] = 0x003A, /* R21000 - VSS_XHN3_1 */
655 [21001] = 0x4100, /* R21001 - VSS_XHN3_0 */
656 [21002] = 0x008C, /* R21002 - VSS_XLA_1 */
657 [21003] = 0xFEE8, /* R21003 - VSS_XLA_0 */
658 [21004] = 0x0078, /* R21004 - VSS_XLB_1 */
659 [21005] = 0x0000, /* R21005 - VSS_XLB_0 */
660 [21006] = 0x003F, /* R21006 - VSS_XLG_1 */
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664 [21010] = 0x0020, /* R21010 - VSS_PG_1 */
665 [21011] = 0x0000, /* R21011 - VSS_PG_0 */
666 [21012] = 0x00F1, /* R21012 - VSS_XTD1_1 */
667 [21013] = 0x8340, /* R21013 - VSS_XTD1_0 */
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673 [21019] = 0xAC40, /* R21019 - VSS_XTD4_0 */
674 [21020] = 0x00F1, /* R21020 - VSS_XTD5_1 */
675 [21021] = 0x7F80, /* R21021 - VSS_XTD5_0 */
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680 [21026] = 0x00EA, /* R21026 - VSS_XTD8_1 */
681 [21027] = 0x10C0, /* R21027 - VSS_XTD8_0 */
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684 [21030] = 0x00E2, /* R21030 - VSS_XTD10_1 */
685 [21031] = 0x75C0, /* R21031 - VSS_XTD10_0 */
686 [21032] = 0x0004, /* R21032 - VSS_XTD11_1 */
687 [21033] = 0xB480, /* R21033 - VSS_XTD11_0 */
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694 [21040] = 0x0002, /* R21040 - VSS_XTD15_1 */
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699 [21045] = 0x0600, /* R21045 - VSS_XTD17_0 */
700 [21046] = 0x00F2, /* R21046 - VSS_XTD18_1 */
701 [21047] = 0xDAC0, /* R21047 - VSS_XTD18_0 */
702 [21048] = 0x00BA, /* R21048 - VSS_XTD19_1 */
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704 [21050] = 0x000A, /* R21050 - VSS_XTD20_1 */
705 [21051] = 0x7940, /* R21051 - VSS_XTD20_0 */
706 [21052] = 0x001C, /* R21052 - VSS_XTD21_1 */
707 [21053] = 0x0680, /* R21053 - VSS_XTD21_0 */
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711 [21057] = 0xE840, /* R21057 - VSS_XTD23_0 */
712 [21058] = 0x000D, /* R21058 - VSS_XTD24_1 */
713 [21059] = 0xDC40, /* R21059 - VSS_XTD24_0 */
714 [21060] = 0x00FC, /* R21060 - VSS_XTD25_1 */
715 [21061] = 0x9D00, /* R21061 - VSS_XTD25_0 */
716 [21062] = 0x0009, /* R21062 - VSS_XTD26_1 */
717 [21063] = 0x5580, /* R21063 - VSS_XTD26_0 */
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732 [21078] = 0x0000, /* R21078 - VSS_XTS2_1 */
733 [21079] = 0x8700, /* R21079 - VSS_XTS2_0 */
734 [21080] = 0x00FA, /* R21080 - VSS_XTS3_1 */
735 [21081] = 0xE4C0, /* R21081 - VSS_XTS3_0 */
736 [21082] = 0x0000, /* R21082 - VSS_XTS4_1 */
737 [21083] = 0x0B40, /* R21083 - VSS_XTS4_0 */
738 [21084] = 0x0004, /* R21084 - VSS_XTS5_1 */
739 [21085] = 0xE180, /* R21085 - VSS_XTS5_0 */
740 [21086] = 0x0001, /* R21086 - VSS_XTS6_1 */
741 [21087] = 0x1F40, /* R21087 - VSS_XTS6_0 */
742 [21088] = 0x00F8, /* R21088 - VSS_XTS7_1 */
743 [21089] = 0xB000, /* R21089 - VSS_XTS7_0 */
744 [21090] = 0x00FB, /* R21090 - VSS_XTS8_1 */
745 [21091] = 0xCBC0, /* R21091 - VSS_XTS8_0 */
746 [21092] = 0x0004, /* R21092 - VSS_XTS9_1 */
747 [21093] = 0xF380, /* R21093 - VSS_XTS9_0 */
748 [21094] = 0x0007, /* R21094 - VSS_XTS10_1 */
749 [21095] = 0xDF40, /* R21095 - VSS_XTS10_0 */
750 [21096] = 0x00FF, /* R21096 - VSS_XTS11_1 */
751 [21097] = 0x0700, /* R21097 - VSS_XTS11_0 */
752 [21098] = 0x00EF, /* R21098 - VSS_XTS12_1 */
753 [21099] = 0xD700, /* R21099 - VSS_XTS12_0 */
754 [21100] = 0x00FB, /* R21100 - VSS_XTS13_1 */
755 [21101] = 0xAF40, /* R21101 - VSS_XTS13_0 */
756 [21102] = 0x0010, /* R21102 - VSS_XTS14_1 */
757 [21103] = 0x8A80, /* R21103 - VSS_XTS14_0 */
758 [21104] = 0x0011, /* R21104 - VSS_XTS15_1 */
759 [21105] = 0x07C0, /* R21105 - VSS_XTS15_0 */
760 [21106] = 0x00E0, /* R21106 - VSS_XTS16_1 */
761 [21107] = 0x0800, /* R21107 - VSS_XTS16_0 */
762 [21108] = 0x00D2, /* R21108 - VSS_XTS17_1 */
763 [21109] = 0x7600, /* R21109 - VSS_XTS17_0 */
764 [21110] = 0x0020, /* R21110 - VSS_XTS18_1 */
765 [21111] = 0xCF40, /* R21111 - VSS_XTS18_0 */
766 [21112] = 0x0030, /* R21112 - VSS_XTS19_1 */
767 [21113] = 0x2340, /* R21113 - VSS_XTS19_0 */
768 [21114] = 0x00FD, /* R21114 - VSS_XTS20_1 */
769 [21115] = 0x69C0, /* R21115 - VSS_XTS20_0 */
770 [21116] = 0x0028, /* R21116 - VSS_XTS21_1 */
771 [21117] = 0x3500, /* R21117 - VSS_XTS21_0 */
772 [21118] = 0x0006, /* R21118 - VSS_XTS22_1 */
773 [21119] = 0x3300, /* R21119 - VSS_XTS22_0 */
774 [21120] = 0x00D9, /* R21120 - VSS_XTS23_1 */
775 [21121] = 0xF6C0, /* R21121 - VSS_XTS23_0 */
776 [21122] = 0x00F3, /* R21122 - VSS_XTS24_1 */
777 [21123] = 0x3340, /* R21123 - VSS_XTS24_0 */
778 [21124] = 0x000F, /* R21124 - VSS_XTS25_1 */
779 [21125] = 0x4200, /* R21125 - VSS_XTS25_0 */
780 [21126] = 0x0004, /* R21126 - VSS_XTS26_1 */
781 [21127] = 0x0C80, /* R21127 - VSS_XTS26_0 */
782 [21128] = 0x00FB, /* R21128 - VSS_XTS27_1 */
783 [21129] = 0x3F80, /* R21129 - VSS_XTS27_0 */
784 [21130] = 0x00F7, /* R21130 - VSS_XTS28_1 */
785 [21131] = 0x57C0, /* R21131 - VSS_XTS28_0 */
786 [21132] = 0x0003, /* R21132 - VSS_XTS29_1 */
787 [21133] = 0x5400, /* R21133 - VSS_XTS29_0 */
788 [21134] = 0x0000, /* R21134 - VSS_XTS30_1 */
789 [21135] = 0xC6C0, /* R21135 - VSS_XTS30_0 */
790 [21136] = 0x0003, /* R21136 - VSS_XTS31_1 */
791 [21137] = 0x12C0, /* R21137 - VSS_XTS31_0 */
792 [21138] = 0x00FD, /* R21138 - VSS_XTS32_1 */
793 [21139] = 0x8580, /* R21139 - VSS_XTS32_0 */
794};
795
796static const struct wm8962_reg_access {
797 u16 read;
798 u16 write;
799 u16 vol;
800} wm8962_reg_access[WM8962_MAX_REGISTER + 1] = {
801 [0] = { 0x00FF, 0x01FF, 0x0000 }, /* R0 - Left Input volume */
802 [1] = { 0xFEFF, 0x01FF, 0xFFFF }, /* R1 - Right Input volume */
803 [2] = { 0x00FF, 0x01FF, 0x0000 }, /* R2 - HPOUTL volume */
804 [3] = { 0x00FF, 0x01FF, 0x0000 }, /* R3 - HPOUTR volume */
805 [4] = { 0x07FE, 0x07FE, 0xFFFF }, /* R4 - Clocking1 */
806 [5] = { 0x007F, 0x007F, 0x0000 }, /* R5 - ADC & DAC Control 1 */
807 [6] = { 0x37ED, 0x37ED, 0x0000 }, /* R6 - ADC & DAC Control 2 */
808 [7] = { 0x1FFF, 0x1FFF, 0x0000 }, /* R7 - Audio Interface 0 */
809 [8] = { 0x0FEF, 0x0FEF, 0xFFFF }, /* R8 - Clocking2 */
810 [9] = { 0x0B9F, 0x039F, 0x0000 }, /* R9 - Audio Interface 1 */
811 [10] = { 0x00FF, 0x01FF, 0x0000 }, /* R10 - Left DAC volume */
812 [11] = { 0x00FF, 0x01FF, 0x0000 }, /* R11 - Right DAC volume */
813 [14] = { 0x07FF, 0x07FF, 0x0000 }, /* R14 - Audio Interface 2 */
814 [15] = { 0xFFFF, 0xFFFF, 0xFFFF }, /* R15 - Software Reset */
815 [17] = { 0x07FF, 0x07FF, 0x0000 }, /* R17 - ALC1 */
816 [18] = { 0xF8FF, 0x00FF, 0xFFFF }, /* R18 - ALC2 */
817 [19] = { 0x1DFF, 0x1DFF, 0x0000 }, /* R19 - ALC3 */
818 [20] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R20 - Noise Gate */
819 [21] = { 0x00FF, 0x01FF, 0x0000 }, /* R21 - Left ADC volume */
820 [22] = { 0x00FF, 0x01FF, 0x0000 }, /* R22 - Right ADC volume */
821 [23] = { 0x0161, 0x0161, 0x0000 }, /* R23 - Additional control(1) */
822 [24] = { 0x0008, 0x0008, 0x0000 }, /* R24 - Additional control(2) */
823 [25] = { 0x07FE, 0x07FE, 0x0000 }, /* R25 - Pwr Mgmt (1) */
824 [26] = { 0x01FB, 0x01FB, 0x0000 }, /* R26 - Pwr Mgmt (2) */
825 [27] = { 0x0017, 0x0017, 0x0000 }, /* R27 - Additional Control (3) */
826 [28] = { 0x001C, 0x001C, 0x0000 }, /* R28 - Anti-pop */
827
828 [30] = { 0xFFFE, 0xFFFE, 0x0000 }, /* R30 - Clocking 3 */
829 [31] = { 0x000F, 0x000F, 0x0000 }, /* R31 - Input mixer control (1) */
830 [32] = { 0x01FF, 0x01FF, 0x0000 }, /* R32 - Left input mixer volume */
831 [33] = { 0x01FF, 0x01FF, 0x0000 }, /* R33 - Right input mixer volume */
832 [34] = { 0x003F, 0x003F, 0x0000 }, /* R34 - Input mixer control (2) */
833 [35] = { 0x003F, 0x003F, 0x0000 }, /* R35 - Input bias control */
834 [37] = { 0x001F, 0x001F, 0x0000 }, /* R37 - Left input PGA control */
835 [38] = { 0x001F, 0x001F, 0x0000 }, /* R38 - Right input PGA control */
836 [40] = { 0x00FF, 0x01FF, 0x0000 }, /* R40 - SPKOUTL volume */
837 [41] = { 0x00FF, 0x01FF, 0x0000 }, /* R41 - SPKOUTR volume */
838
839 [47] = { 0x000F, 0x0000, 0x0000 }, /* R47 - Thermal Shutdown Status */
840 [48] = { 0x7EC7, 0x7E07, 0xFFFF }, /* R48 - Additional Control (4) */
841 [49] = { 0x00D3, 0x00D7, 0xFFFF }, /* R49 - Class D Control 1 */
842 [51] = { 0x0047, 0x0047, 0x0000 }, /* R51 - Class D Control 2 */
843 [56] = { 0x001E, 0x001E, 0x0000 }, /* R56 - Clocking 4 */
844 [57] = { 0x02FC, 0x02FC, 0x0000 }, /* R57 - DAC DSP Mixing (1) */
845 [58] = { 0x00FC, 0x00FC, 0x0000 }, /* R58 - DAC DSP Mixing (2) */
846 [60] = { 0x00CC, 0x00CC, 0x0000 }, /* R60 - DC Servo 0 */
847 [61] = { 0x00DD, 0x00DD, 0x0000 }, /* R61 - DC Servo 1 */
848 [64] = { 0x3F80, 0x3F80, 0x0000 }, /* R64 - DC Servo 4 */
849 [66] = { 0x0780, 0x0000, 0xFFFF }, /* R66 - DC Servo 6 */
850 [68] = { 0x0007, 0x0007, 0x0000 }, /* R68 - Analogue PGA Bias */
851 [69] = { 0x00FF, 0x00FF, 0x0000 }, /* R69 - Analogue HP 0 */
852 [71] = { 0x01FF, 0x01FF, 0x0000 }, /* R71 - Analogue HP 2 */
853 [72] = { 0x0001, 0x0001, 0x0000 }, /* R72 - Charge Pump 1 */
854 [82] = { 0x0001, 0x0001, 0x0000 }, /* R82 - Charge Pump B */
855 [87] = { 0x00A0, 0x00A0, 0x0000 }, /* R87 - Write Sequencer Control 1 */
856 [90] = { 0x007F, 0x01FF, 0x0000 }, /* R90 - Write Sequencer Control 2 */
857 [93] = { 0x03F9, 0x0000, 0x0000 }, /* R93 - Write Sequencer Control 3 */
858 [94] = { 0x0070, 0x0070, 0x0000 }, /* R94 - Control Interface */
859 [99] = { 0x000F, 0x000F, 0x0000 }, /* R99 - Mixer Enables */
860 [100] = { 0x00BF, 0x00BF, 0x0000 }, /* R100 - Headphone Mixer (1) */
861 [101] = { 0x00BF, 0x00BF, 0x0000 }, /* R101 - Headphone Mixer (2) */
862 [102] = { 0x01FF, 0x01FF, 0x0000 }, /* R102 - Headphone Mixer (3) */
863 [103] = { 0x01FF, 0x01FF, 0x0000 }, /* R103 - Headphone Mixer (4) */
864 [105] = { 0x00BF, 0x00BF, 0x0000 }, /* R105 - Speaker Mixer (1) */
865 [106] = { 0x00BF, 0x00BF, 0x0000 }, /* R106 - Speaker Mixer (2) */
866 [107] = { 0x01FF, 0x01FF, 0x0000 }, /* R107 - Speaker Mixer (3) */
867 [108] = { 0x01FF, 0x01FF, 0x0000 }, /* R108 - Speaker Mixer (4) */
868 [109] = { 0x00F0, 0x00F0, 0x0000 }, /* R109 - Speaker Mixer (5) */
869 [110] = { 0x00F7, 0x00F7, 0x0000 }, /* R110 - Beep Generator (1) */
870 [115] = { 0x001F, 0x001F, 0x0000 }, /* R115 - Oscillator Trim (3) */
871 [116] = { 0x001F, 0x001F, 0x0000 }, /* R116 - Oscillator Trim (4) */
872 [119] = { 0x00FF, 0x00FF, 0x0000 }, /* R119 - Oscillator Trim (7) */
873 [124] = { 0x0079, 0x0079, 0x0000 }, /* R124 - Analogue Clocking1 */
874 [125] = { 0x00DF, 0x00DF, 0x0000 }, /* R125 - Analogue Clocking2 */
875 [126] = { 0x000D, 0x000D, 0x0000 }, /* R126 - Analogue Clocking3 */
876 [127] = { 0x0000, 0xFFFF, 0x0000 }, /* R127 - PLL Software Reset */
877 [129] = { 0x00B0, 0x00B0, 0x0000 }, /* R129 - PLL2 */
878 [131] = { 0x0003, 0x0003, 0x0000 }, /* R131 - PLL 4 */
879 [136] = { 0x005F, 0x005F, 0x0000 }, /* R136 - PLL 9 */
880 [137] = { 0x00FF, 0x00FF, 0x0000 }, /* R137 - PLL 10 */
881 [138] = { 0x00FF, 0x00FF, 0x0000 }, /* R138 - PLL 11 */
882 [139] = { 0x00FF, 0x00FF, 0x0000 }, /* R139 - PLL 12 */
883 [140] = { 0x005F, 0x005F, 0x0000 }, /* R140 - PLL 13 */
884 [141] = { 0x00FF, 0x00FF, 0x0000 }, /* R141 - PLL 14 */
885 [142] = { 0x00FF, 0x00FF, 0x0000 }, /* R142 - PLL 15 */
886 [143] = { 0x00FF, 0x00FF, 0x0000 }, /* R143 - PLL 16 */
887 [155] = { 0x0067, 0x0067, 0x0000 }, /* R155 - FLL Control (1) */
888 [156] = { 0x01FB, 0x01FB, 0x0000 }, /* R156 - FLL Control (2) */
889 [157] = { 0x0007, 0x0007, 0x0000 }, /* R157 - FLL Control (3) */
890 [159] = { 0x007F, 0x007F, 0x0000 }, /* R159 - FLL Control (5) */
891 [160] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R160 - FLL Control (6) */
892 [161] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R161 - FLL Control (7) */
893 [162] = { 0x03FF, 0x03FF, 0x0000 }, /* R162 - FLL Control (8) */
894 [252] = { 0x0005, 0x0005, 0x0000 }, /* R252 - General test 1 */
895 [256] = { 0x000F, 0x000F, 0x0000 }, /* R256 - DF1 */
896 [257] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R257 - DF2 */
897 [258] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R258 - DF3 */
898 [259] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R259 - DF4 */
899 [260] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R260 - DF5 */
900 [261] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R261 - DF6 */
901 [262] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R262 - DF7 */
902 [264] = { 0x0003, 0x0003, 0x0000 }, /* R264 - LHPF1 */
903 [265] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R265 - LHPF2 */
904 [268] = { 0x0077, 0x0077, 0x0000 }, /* R268 - THREED1 */
905 [269] = { 0xFFFC, 0xFFFC, 0x0000 }, /* R269 - THREED2 */
906 [270] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R270 - THREED3 */
907 [271] = { 0xFFFC, 0xFFFC, 0x0000 }, /* R271 - THREED4 */
908 [276] = { 0x7FFF, 0x7FFF, 0x0000 }, /* R276 - DRC 1 */
909 [277] = { 0x1FFF, 0x1FFF, 0x0000 }, /* R277 - DRC 2 */
910 [278] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R278 - DRC 3 */
911 [279] = { 0x07FF, 0x07FF, 0x0000 }, /* R279 - DRC 4 */
912 [280] = { 0x03FF, 0x03FF, 0x0000 }, /* R280 - DRC 5 */
913 [285] = { 0x0003, 0x0003, 0x0000 }, /* R285 - Tloopback */
914 [335] = { 0x0007, 0x0007, 0x0000 }, /* R335 - EQ1 */
915 [336] = { 0xFFFE, 0xFFFE, 0x0000 }, /* R336 - EQ2 */
916 [337] = { 0xFFC0, 0xFFC0, 0x0000 }, /* R337 - EQ3 */
917 [338] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R338 - EQ4 */
918 [339] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R339 - EQ5 */
919 [340] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R340 - EQ6 */
920 [341] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R341 - EQ7 */
921 [342] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R342 - EQ8 */
922 [343] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R343 - EQ9 */
923 [344] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R344 - EQ10 */
924 [345] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R345 - EQ11 */
925 [346] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R346 - EQ12 */
926 [347] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R347 - EQ13 */
927 [348] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R348 - EQ14 */
928 [349] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R349 - EQ15 */
929 [350] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R350 - EQ16 */
930 [351] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R351 - EQ17 */
931 [352] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R352 - EQ18 */
932 [353] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R353 - EQ19 */
933 [354] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R354 - EQ20 */
934 [355] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R355 - EQ21 */
935 [356] = { 0xFFFE, 0xFFFE, 0x0000 }, /* R356 - EQ22 */
936 [357] = { 0xFFC0, 0xFFC0, 0x0000 }, /* R357 - EQ23 */
937 [358] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R358 - EQ24 */
938 [359] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R359 - EQ25 */
939 [360] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R360 - EQ26 */
940 [361] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R361 - EQ27 */
941 [362] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R362 - EQ28 */
942 [363] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R363 - EQ29 */
943 [364] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R364 - EQ30 */
944 [365] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R365 - EQ31 */
945 [366] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R366 - EQ32 */
946 [367] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R367 - EQ33 */
947 [368] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R368 - EQ34 */
948 [369] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R369 - EQ35 */
949 [370] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R370 - EQ36 */
950 [371] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R371 - EQ37 */
951 [372] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R372 - EQ38 */
952 [373] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R373 - EQ39 */
953 [374] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R374 - EQ40 */
954 [375] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R375 - EQ41 */
955 [513] = { 0x045F, 0x045F, 0x0000 }, /* R513 - GPIO 2 */
956 [514] = { 0x045F, 0x045F, 0x0000 }, /* R514 - GPIO 3 */
957 [516] = { 0xE75F, 0xE75F, 0x0000 }, /* R516 - GPIO 5 */
958 [517] = { 0xE75F, 0xE75F, 0x0000 }, /* R517 - GPIO 6 */
959 [560] = { 0x0030, 0x0030, 0xFFFF }, /* R560 - Interrupt Status 1 */
960 [561] = { 0xFFED, 0xFFED, 0xFFFF }, /* R561 - Interrupt Status 2 */
961 [568] = { 0x0030, 0x0030, 0x0000 }, /* R568 - Interrupt Status 1 Mask */
962 [569] = { 0xFFED, 0xFFED, 0x0000 }, /* R569 - Interrupt Status 2 Mask */
963 [576] = { 0x0001, 0x0001, 0x0000 }, /* R576 - Interrupt Control */
964 [584] = { 0x002D, 0x002D, 0x0000 }, /* R584 - IRQ Debounce */
965 [586] = { 0xC000, 0xC000, 0x0000 }, /* R586 - MICINT Source Pol */
966 [768] = { 0x0001, 0x0001, 0x0000 }, /* R768 - DSP2 Power Management */
967 [1037] = { 0x0000, 0x003F, 0x0000 }, /* R1037 - DSP2_ExecControl */
968 [4096] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4096 - Write Sequencer 0 */
969 [4097] = { 0x00FF, 0x00FF, 0x0000 }, /* R4097 - Write Sequencer 1 */
970 [4098] = { 0x070F, 0x070F, 0x0000 }, /* R4098 - Write Sequencer 2 */
971 [4099] = { 0x010F, 0x010F, 0x0000 }, /* R4099 - Write Sequencer 3 */
972 [4100] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4100 - Write Sequencer 4 */
973 [4101] = { 0x00FF, 0x00FF, 0x0000 }, /* R4101 - Write Sequencer 5 */
974 [4102] = { 0x070F, 0x070F, 0x0000 }, /* R4102 - Write Sequencer 6 */
975 [4103] = { 0x010F, 0x010F, 0x0000 }, /* R4103 - Write Sequencer 7 */
976 [4104] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4104 - Write Sequencer 8 */
977 [4105] = { 0x00FF, 0x00FF, 0x0000 }, /* R4105 - Write Sequencer 9 */
978 [4106] = { 0x070F, 0x070F, 0x0000 }, /* R4106 - Write Sequencer 10 */
979 [4107] = { 0x010F, 0x010F, 0x0000 }, /* R4107 - Write Sequencer 11 */
980 [4108] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4108 - Write Sequencer 12 */
981 [4109] = { 0x00FF, 0x00FF, 0x0000 }, /* R4109 - Write Sequencer 13 */
982 [4110] = { 0x070F, 0x070F, 0x0000 }, /* R4110 - Write Sequencer 14 */
983 [4111] = { 0x010F, 0x010F, 0x0000 }, /* R4111 - Write Sequencer 15 */
984 [4112] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4112 - Write Sequencer 16 */
985 [4113] = { 0x00FF, 0x00FF, 0x0000 }, /* R4113 - Write Sequencer 17 */
986 [4114] = { 0x070F, 0x070F, 0x0000 }, /* R4114 - Write Sequencer 18 */
987 [4115] = { 0x010F, 0x010F, 0x0000 }, /* R4115 - Write Sequencer 19 */
988 [4116] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4116 - Write Sequencer 20 */
989 [4117] = { 0x00FF, 0x00FF, 0x0000 }, /* R4117 - Write Sequencer 21 */
990 [4118] = { 0x070F, 0x070F, 0x0000 }, /* R4118 - Write Sequencer 22 */
991 [4119] = { 0x010F, 0x010F, 0x0000 }, /* R4119 - Write Sequencer 23 */
992 [4120] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4120 - Write Sequencer 24 */
993 [4121] = { 0x00FF, 0x00FF, 0x0000 }, /* R4121 - Write Sequencer 25 */
994 [4122] = { 0x070F, 0x070F, 0x0000 }, /* R4122 - Write Sequencer 26 */
995 [4123] = { 0x010F, 0x010F, 0x0000 }, /* R4123 - Write Sequencer 27 */
996 [4124] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4124 - Write Sequencer 28 */
997 [4125] = { 0x00FF, 0x00FF, 0x0000 }, /* R4125 - Write Sequencer 29 */
998 [4126] = { 0x070F, 0x070F, 0x0000 }, /* R4126 - Write Sequencer 30 */
999 [4127] = { 0x010F, 0x010F, 0x0000 }, /* R4127 - Write Sequencer 31 */
1000 [4128] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4128 - Write Sequencer 32 */
1001 [4129] = { 0x00FF, 0x00FF, 0x0000 }, /* R4129 - Write Sequencer 33 */
1002 [4130] = { 0x070F, 0x070F, 0x0000 }, /* R4130 - Write Sequencer 34 */
1003 [4131] = { 0x010F, 0x010F, 0x0000 }, /* R4131 - Write Sequencer 35 */
1004 [4132] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4132 - Write Sequencer 36 */
1005 [4133] = { 0x00FF, 0x00FF, 0x0000 }, /* R4133 - Write Sequencer 37 */
1006 [4134] = { 0x070F, 0x070F, 0x0000 }, /* R4134 - Write Sequencer 38 */
1007 [4135] = { 0x010F, 0x010F, 0x0000 }, /* R4135 - Write Sequencer 39 */
1008 [4136] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4136 - Write Sequencer 40 */
1009 [4137] = { 0x00FF, 0x00FF, 0x0000 }, /* R4137 - Write Sequencer 41 */
1010 [4138] = { 0x070F, 0x070F, 0x0000 }, /* R4138 - Write Sequencer 42 */
1011 [4139] = { 0x010F, 0x010F, 0x0000 }, /* R4139 - Write Sequencer 43 */
1012 [4140] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4140 - Write Sequencer 44 */
1013 [4141] = { 0x00FF, 0x00FF, 0x0000 }, /* R4141 - Write Sequencer 45 */
1014 [4142] = { 0x070F, 0x070F, 0x0000 }, /* R4142 - Write Sequencer 46 */
1015 [4143] = { 0x010F, 0x010F, 0x0000 }, /* R4143 - Write Sequencer 47 */
1016 [4144] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4144 - Write Sequencer 48 */
1017 [4145] = { 0x00FF, 0x00FF, 0x0000 }, /* R4145 - Write Sequencer 49 */
1018 [4146] = { 0x070F, 0x070F, 0x0000 }, /* R4146 - Write Sequencer 50 */
1019 [4147] = { 0x010F, 0x010F, 0x0000 }, /* R4147 - Write Sequencer 51 */
1020 [4148] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4148 - Write Sequencer 52 */
1021 [4149] = { 0x00FF, 0x00FF, 0x0000 }, /* R4149 - Write Sequencer 53 */
1022 [4150] = { 0x070F, 0x070F, 0x0000 }, /* R4150 - Write Sequencer 54 */
1023 [4151] = { 0x010F, 0x010F, 0x0000 }, /* R4151 - Write Sequencer 55 */
1024 [4152] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4152 - Write Sequencer 56 */
1025 [4153] = { 0x00FF, 0x00FF, 0x0000 }, /* R4153 - Write Sequencer 57 */
1026 [4154] = { 0x070F, 0x070F, 0x0000 }, /* R4154 - Write Sequencer 58 */
1027 [4155] = { 0x010F, 0x010F, 0x0000 }, /* R4155 - Write Sequencer 59 */
1028 [4156] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4156 - Write Sequencer 60 */
1029 [4157] = { 0x00FF, 0x00FF, 0x0000 }, /* R4157 - Write Sequencer 61 */
1030 [4158] = { 0x070F, 0x070F, 0x0000 }, /* R4158 - Write Sequencer 62 */
1031 [4159] = { 0x010F, 0x010F, 0x0000 }, /* R4159 - Write Sequencer 63 */
1032 [4160] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4160 - Write Sequencer 64 */
1033 [4161] = { 0x00FF, 0x00FF, 0x0000 }, /* R4161 - Write Sequencer 65 */
1034 [4162] = { 0x070F, 0x070F, 0x0000 }, /* R4162 - Write Sequencer 66 */
1035 [4163] = { 0x010F, 0x010F, 0x0000 }, /* R4163 - Write Sequencer 67 */
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1068 [4196] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4196 - Write Sequencer 100 */
1069 [4197] = { 0x00FF, 0x00FF, 0x0000 }, /* R4197 - Write Sequencer 101 */
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1072 [4200] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4200 - Write Sequencer 104 */
1073 [4201] = { 0x00FF, 0x00FF, 0x0000 }, /* R4201 - Write Sequencer 105 */
1074 [4202] = { 0x070F, 0x070F, 0x0000 }, /* R4202 - Write Sequencer 106 */
1075 [4203] = { 0x010F, 0x010F, 0x0000 }, /* R4203 - Write Sequencer 107 */
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1079 [4207] = { 0x010F, 0x010F, 0x0000 }, /* R4207 - Write Sequencer 111 */
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1084 [4212] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4212 - Write Sequencer 116 */
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1086 [4214] = { 0x070F, 0x070F, 0x0000 }, /* R4214 - Write Sequencer 118 */
1087 [4215] = { 0x010F, 0x010F, 0x0000 }, /* R4215 - Write Sequencer 119 */
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1089 [4217] = { 0x00FF, 0x00FF, 0x0000 }, /* R4217 - Write Sequencer 121 */
1090 [4218] = { 0x070F, 0x070F, 0x0000 }, /* R4218 - Write Sequencer 122 */
1091 [4219] = { 0x010F, 0x010F, 0x0000 }, /* R4219 - Write Sequencer 123 */
1092 [4220] = { 0x3FFF, 0x3FFF, 0x0000 }, /* R4220 - Write Sequencer 124 */
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1486 [13312] = { 0x00FF, 0x00FF, 0x0000 }, /* R13312 - DSP2 Data2 RAM 1 */
1487 [13313] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R13313 - DSP2 Data2 RAM 0 */
1488 [14336] = { 0x00FF, 0x00FF, 0x0000 }, /* R14336 - DSP2 Data3 RAM 1 */
1489 [14337] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R14337 - DSP2 Data3 RAM 0 */
1490 [15360] = { 0x07FF, 0x07FF, 0x0000 }, /* R15360 - DSP2 Coeff RAM 0 */
1491 [16384] = { 0x00FF, 0x00FF, 0x0000 }, /* R16384 - RETUNEADC_SHARED_COEFF_1 */
1492 [16385] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R16385 - RETUNEADC_SHARED_COEFF_0 */
1493 [16386] = { 0x00FF, 0x00FF, 0x0000 }, /* R16386 - RETUNEDAC_SHARED_COEFF_1 */
1494 [16387] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R16387 - RETUNEDAC_SHARED_COEFF_0 */
1495 [16388] = { 0x00FF, 0x00FF, 0x0000 }, /* R16388 - SOUNDSTAGE_ENABLES_1 */
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1699 [19494] = { 0x00FF, 0x00FF, 0x0000 }, /* R19494 - DACL_RETUNE_C20_1 */
1700 [19495] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19495 - DACL_RETUNE_C20_0 */
1701 [19496] = { 0x00FF, 0x00FF, 0x0000 }, /* R19496 - DACL_RETUNE_C21_1 */
1702 [19497] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19497 - DACL_RETUNE_C21_0 */
1703 [19498] = { 0x00FF, 0x00FF, 0x0000 }, /* R19498 - DACL_RETUNE_C22_1 */
1704 [19499] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19499 - DACL_RETUNE_C22_0 */
1705 [19500] = { 0x00FF, 0x00FF, 0x0000 }, /* R19500 - DACL_RETUNE_C23_1 */
1706 [19501] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19501 - DACL_RETUNE_C23_0 */
1707 [19502] = { 0x00FF, 0x00FF, 0x0000 }, /* R19502 - DACL_RETUNE_C24_1 */
1708 [19503] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19503 - DACL_RETUNE_C24_0 */
1709 [19504] = { 0x00FF, 0x00FF, 0x0000 }, /* R19504 - DACL_RETUNE_C25_1 */
1710 [19505] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19505 - DACL_RETUNE_C25_0 */
1711 [19506] = { 0x00FF, 0x00FF, 0x0000 }, /* R19506 - DACL_RETUNE_C26_1 */
1712 [19507] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19507 - DACL_RETUNE_C26_0 */
1713 [19508] = { 0x00FF, 0x00FF, 0x0000 }, /* R19508 - DACL_RETUNE_C27_1 */
1714 [19509] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19509 - DACL_RETUNE_C27_0 */
1715 [19510] = { 0x00FF, 0x00FF, 0x0000 }, /* R19510 - DACL_RETUNE_C28_1 */
1716 [19511] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19511 - DACL_RETUNE_C28_0 */
1717 [19512] = { 0x00FF, 0x00FF, 0x0000 }, /* R19512 - DACL_RETUNE_C29_1 */
1718 [19513] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19513 - DACL_RETUNE_C29_0 */
1719 [19514] = { 0x00FF, 0x00FF, 0x0000 }, /* R19514 - DACL_RETUNE_C30_1 */
1720 [19515] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19515 - DACL_RETUNE_C30_0 */
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1722 [19517] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19517 - DACL_RETUNE_C31_0 */
1723 [19518] = { 0x00FF, 0x00FF, 0x0000 }, /* R19518 - DACL_RETUNE_C32_1 */
1724 [19519] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19519 - DACL_RETUNE_C32_0 */
1725 [19968] = { 0x00FF, 0x00FF, 0x0000 }, /* R19968 - RETUNEDAC_PG2_1 */
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1727 [19970] = { 0x00FF, 0x00FF, 0x0000 }, /* R19970 - RETUNEDAC_PG_1 */
1728 [19971] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R19971 - RETUNEDAC_PG_0 */
1729 [20480] = { 0x00FF, 0x00FF, 0x0000 }, /* R20480 - DACR_RETUNE_C1_1 */
1730 [20481] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R20481 - DACR_RETUNE_C1_0 */
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1732 [20483] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R20483 - DACR_RETUNE_C2_0 */
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1742 [20493] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R20493 - DACR_RETUNE_C7_0 */
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1745 [20496] = { 0x00FF, 0x00FF, 0x0000 }, /* R20496 - DACR_RETUNE_C9_1 */
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1747 [20498] = { 0x00FF, 0x00FF, 0x0000 }, /* R20498 - DACR_RETUNE_C10_1 */
1748 [20499] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R20499 - DACR_RETUNE_C10_0 */
1749 [20500] = { 0x00FF, 0x00FF, 0x0000 }, /* R20500 - DACR_RETUNE_C11_1 */
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1751 [20502] = { 0x00FF, 0x00FF, 0x0000 }, /* R20502 - DACR_RETUNE_C12_1 */
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1757 [20508] = { 0x00FF, 0x00FF, 0x0000 }, /* R20508 - DACR_RETUNE_C15_1 */
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1761 [20512] = { 0x00FF, 0x00FF, 0x0000 }, /* R20512 - DACR_RETUNE_C17_1 */
1762 [20513] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R20513 - DACR_RETUNE_C17_0 */
1763 [20514] = { 0x00FF, 0x00FF, 0x0000 }, /* R20514 - DACR_RETUNE_C18_1 */
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1765 [20516] = { 0x00FF, 0x00FF, 0x0000 }, /* R20516 - DACR_RETUNE_C19_1 */
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1767 [20518] = { 0x00FF, 0x00FF, 0x0000 }, /* R20518 - DACR_RETUNE_C20_1 */
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1771 [20522] = { 0x00FF, 0x00FF, 0x0000 }, /* R20522 - DACR_RETUNE_C22_1 */
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1787 [20538] = { 0x00FF, 0x00FF, 0x0000 }, /* R20538 - DACR_RETUNE_C30_1 */
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1789 [20540] = { 0x00FF, 0x00FF, 0x0000 }, /* R20540 - DACR_RETUNE_C31_1 */
1790 [20541] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R20541 - DACR_RETUNE_C31_0 */
1791 [20542] = { 0x00FF, 0x00FF, 0x0000 }, /* R20542 - DACR_RETUNE_C32_1 */
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1851 [21050] = { 0x00FF, 0x00FF, 0x0000 }, /* R21050 - VSS_XTD20_1 */
1852 [21051] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21051 - VSS_XTD20_0 */
1853 [21052] = { 0x00FF, 0x00FF, 0x0000 }, /* R21052 - VSS_XTD21_1 */
1854 [21053] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21053 - VSS_XTD21_0 */
1855 [21054] = { 0x00FF, 0x00FF, 0x0000 }, /* R21054 - VSS_XTD22_1 */
1856 [21055] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21055 - VSS_XTD22_0 */
1857 [21056] = { 0x00FF, 0x00FF, 0x0000 }, /* R21056 - VSS_XTD23_1 */
1858 [21057] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21057 - VSS_XTD23_0 */
1859 [21058] = { 0x00FF, 0x00FF, 0x0000 }, /* R21058 - VSS_XTD24_1 */
1860 [21059] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21059 - VSS_XTD24_0 */
1861 [21060] = { 0x00FF, 0x00FF, 0x0000 }, /* R21060 - VSS_XTD25_1 */
1862 [21061] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21061 - VSS_XTD25_0 */
1863 [21062] = { 0x00FF, 0x00FF, 0x0000 }, /* R21062 - VSS_XTD26_1 */
1864 [21063] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21063 - VSS_XTD26_0 */
1865 [21064] = { 0x00FF, 0x00FF, 0x0000 }, /* R21064 - VSS_XTD27_1 */
1866 [21065] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21065 - VSS_XTD27_0 */
1867 [21066] = { 0x00FF, 0x00FF, 0x0000 }, /* R21066 - VSS_XTD28_1 */
1868 [21067] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21067 - VSS_XTD28_0 */
1869 [21068] = { 0x00FF, 0x00FF, 0x0000 }, /* R21068 - VSS_XTD29_1 */
1870 [21069] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21069 - VSS_XTD29_0 */
1871 [21070] = { 0x00FF, 0x00FF, 0x0000 }, /* R21070 - VSS_XTD30_1 */
1872 [21071] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21071 - VSS_XTD30_0 */
1873 [21072] = { 0x00FF, 0x00FF, 0x0000 }, /* R21072 - VSS_XTD31_1 */
1874 [21073] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21073 - VSS_XTD31_0 */
1875 [21074] = { 0x00FF, 0x00FF, 0x0000 }, /* R21074 - VSS_XTD32_1 */
1876 [21075] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21075 - VSS_XTD32_0 */
1877 [21076] = { 0x00FF, 0x00FF, 0x0000 }, /* R21076 - VSS_XTS1_1 */
1878 [21077] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21077 - VSS_XTS1_0 */
1879 [21078] = { 0x00FF, 0x00FF, 0x0000 }, /* R21078 - VSS_XTS2_1 */
1880 [21079] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21079 - VSS_XTS2_0 */
1881 [21080] = { 0x00FF, 0x00FF, 0x0000 }, /* R21080 - VSS_XTS3_1 */
1882 [21081] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21081 - VSS_XTS3_0 */
1883 [21082] = { 0x00FF, 0x00FF, 0x0000 }, /* R21082 - VSS_XTS4_1 */
1884 [21083] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21083 - VSS_XTS4_0 */
1885 [21084] = { 0x00FF, 0x00FF, 0x0000 }, /* R21084 - VSS_XTS5_1 */
1886 [21085] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21085 - VSS_XTS5_0 */
1887 [21086] = { 0x00FF, 0x00FF, 0x0000 }, /* R21086 - VSS_XTS6_1 */
1888 [21087] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21087 - VSS_XTS6_0 */
1889 [21088] = { 0x00FF, 0x00FF, 0x0000 }, /* R21088 - VSS_XTS7_1 */
1890 [21089] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21089 - VSS_XTS7_0 */
1891 [21090] = { 0x00FF, 0x00FF, 0x0000 }, /* R21090 - VSS_XTS8_1 */
1892 [21091] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21091 - VSS_XTS8_0 */
1893 [21092] = { 0x00FF, 0x00FF, 0x0000 }, /* R21092 - VSS_XTS9_1 */
1894 [21093] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21093 - VSS_XTS9_0 */
1895 [21094] = { 0x00FF, 0x00FF, 0x0000 }, /* R21094 - VSS_XTS10_1 */
1896 [21095] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21095 - VSS_XTS10_0 */
1897 [21096] = { 0x00FF, 0x00FF, 0x0000 }, /* R21096 - VSS_XTS11_1 */
1898 [21097] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21097 - VSS_XTS11_0 */
1899 [21098] = { 0x00FF, 0x00FF, 0x0000 }, /* R21098 - VSS_XTS12_1 */
1900 [21099] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21099 - VSS_XTS12_0 */
1901 [21100] = { 0x00FF, 0x00FF, 0x0000 }, /* R21100 - VSS_XTS13_1 */
1902 [21101] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21101 - VSS_XTS13_0 */
1903 [21102] = { 0x00FF, 0x00FF, 0x0000 }, /* R21102 - VSS_XTS14_1 */
1904 [21103] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21103 - VSS_XTS14_0 */
1905 [21104] = { 0x00FF, 0x00FF, 0x0000 }, /* R21104 - VSS_XTS15_1 */
1906 [21105] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21105 - VSS_XTS15_0 */
1907 [21106] = { 0x00FF, 0x00FF, 0x0000 }, /* R21106 - VSS_XTS16_1 */
1908 [21107] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21107 - VSS_XTS16_0 */
1909 [21108] = { 0x00FF, 0x00FF, 0x0000 }, /* R21108 - VSS_XTS17_1 */
1910 [21109] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21109 - VSS_XTS17_0 */
1911 [21110] = { 0x00FF, 0x00FF, 0x0000 }, /* R21110 - VSS_XTS18_1 */
1912 [21111] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21111 - VSS_XTS18_0 */
1913 [21112] = { 0x00FF, 0x00FF, 0x0000 }, /* R21112 - VSS_XTS19_1 */
1914 [21113] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21113 - VSS_XTS19_0 */
1915 [21114] = { 0x00FF, 0x00FF, 0x0000 }, /* R21114 - VSS_XTS20_1 */
1916 [21115] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21115 - VSS_XTS20_0 */
1917 [21116] = { 0x00FF, 0x00FF, 0x0000 }, /* R21116 - VSS_XTS21_1 */
1918 [21117] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21117 - VSS_XTS21_0 */
1919 [21118] = { 0x00FF, 0x00FF, 0x0000 }, /* R21118 - VSS_XTS22_1 */
1920 [21119] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21119 - VSS_XTS22_0 */
1921 [21120] = { 0x00FF, 0x00FF, 0x0000 }, /* R21120 - VSS_XTS23_1 */
1922 [21121] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21121 - VSS_XTS23_0 */
1923 [21122] = { 0x00FF, 0x00FF, 0x0000 }, /* R21122 - VSS_XTS24_1 */
1924 [21123] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21123 - VSS_XTS24_0 */
1925 [21124] = { 0x00FF, 0x00FF, 0x0000 }, /* R21124 - VSS_XTS25_1 */
1926 [21125] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21125 - VSS_XTS25_0 */
1927 [21126] = { 0x00FF, 0x00FF, 0x0000 }, /* R21126 - VSS_XTS26_1 */
1928 [21127] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21127 - VSS_XTS26_0 */
1929 [21128] = { 0x00FF, 0x00FF, 0x0000 }, /* R21128 - VSS_XTS27_1 */
1930 [21129] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21129 - VSS_XTS27_0 */
1931 [21130] = { 0x00FF, 0x00FF, 0x0000 }, /* R21130 - VSS_XTS28_1 */
1932 [21131] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21131 - VSS_XTS28_0 */
1933 [21132] = { 0x00FF, 0x00FF, 0x0000 }, /* R21132 - VSS_XTS29_1 */
1934 [21133] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21133 - VSS_XTS29_0 */
1935 [21134] = { 0x00FF, 0x00FF, 0x0000 }, /* R21134 - VSS_XTS30_1 */
1936 [21135] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21135 - VSS_XTS30_0 */
1937 [21136] = { 0x00FF, 0x00FF, 0x0000 }, /* R21136 - VSS_XTS31_1 */
1938 [21137] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21137 - VSS_XTS31_0 */
1939 [21138] = { 0x00FF, 0x00FF, 0x0000 }, /* R21138 - VSS_XTS32_1 */
1940 [21139] = { 0xFFFF, 0xFFFF, 0x0000 }, /* R21139 - VSS_XTS32_0 */
1941};
1942
109static int wm8962_volatile_register(unsigned int reg) 1943static int wm8962_volatile_register(unsigned int reg)
110{ 1944{
111 if (wm8962_reg_access[reg].vol) 1945 if (wm8962_reg_access[reg].vol)
@@ -732,6 +2566,8 @@ static const struct snd_soc_dapm_route wm8962_intercon[] = {
732 { "MIXINR", "IN3R Switch", "IN3R" }, 2566 { "MIXINR", "IN3R Switch", "IN3R" },
733 { "MIXINR", "PGA Switch", "INPGAR" }, 2567 { "MIXINR", "PGA Switch", "INPGAR" },
734 2568
2569 { "MICBIAS", NULL, "SYSCLK" },
2570
735 { "ADCL", NULL, "SYSCLK" }, 2571 { "ADCL", NULL, "SYSCLK" },
736 { "ADCL", NULL, "TOCLK" }, 2572 { "ADCL", NULL, "TOCLK" },
737 { "ADCL", NULL, "MIXINL" }, 2573 { "ADCL", NULL, "MIXINL" },
diff --git a/sound/soc/codecs/wm8962.h b/sound/soc/codecs/wm8962.h
index 2af6c9371fcc..a1a5d5294c19 100644
--- a/sound/soc/codecs/wm8962.h
+++ b/sound/soc/codecs/wm8962.h
@@ -3775,17 +3775,6 @@
3775#define WM8962_VSS_ENA_SHIFT 0 /* VSS_ENA */ 3775#define WM8962_VSS_ENA_SHIFT 0 /* VSS_ENA */
3776#define WM8962_VSS_ENA_WIDTH 1 /* VSS_ENA */ 3776#define WM8962_VSS_ENA_WIDTH 1 /* VSS_ENA */
3777 3777
3778extern const u16 wm8962_reg[WM8962_MAX_REGISTER + 1];
3779
3780struct wm8962_reg_access {
3781 u16 read;
3782 u16 write;
3783 u16 vol;
3784};
3785
3786extern
3787const struct wm8962_reg_access wm8962_reg_access[WM8962_MAX_REGISTER + 1];
3788
3789int wm8962_mic_detect(struct snd_soc_codec *codec, struct snd_soc_jack *jack); 3778int wm8962_mic_detect(struct snd_soc_codec *codec, struct snd_soc_jack *jack);
3790 3779
3791#endif 3780#endif
diff --git a/sound/soc/codecs/wm8985.c b/sound/soc/codecs/wm8985.c
index ae9020a2a195..fd2e7cca1228 100644
--- a/sound/soc/codecs/wm8985.c
+++ b/sound/soc/codecs/wm8985.c
@@ -1079,8 +1079,8 @@ static int __devinit wm8985_spi_probe(struct spi_device *spi)
1079 int ret; 1079 int ret;
1080 1080
1081 wm8985 = kzalloc(sizeof *wm8985, GFP_KERNEL); 1081 wm8985 = kzalloc(sizeof *wm8985, GFP_KERNEL);
1082 if (IS_ERR(wm8985)) 1082 if (!wm8985)
1083 return PTR_ERR(wm8985); 1083 return -ENOMEM;
1084 1084
1085 wm8985->control_type = SND_SOC_SPI; 1085 wm8985->control_type = SND_SOC_SPI;
1086 spi_set_drvdata(spi, wm8985); 1086 spi_set_drvdata(spi, wm8985);
@@ -1117,8 +1117,8 @@ static __devinit int wm8985_i2c_probe(struct i2c_client *i2c,
1117 int ret; 1117 int ret;
1118 1118
1119 wm8985 = kzalloc(sizeof *wm8985, GFP_KERNEL); 1119 wm8985 = kzalloc(sizeof *wm8985, GFP_KERNEL);
1120 if (IS_ERR(wm8985)) 1120 if (!wm8985)
1121 return PTR_ERR(wm8985); 1121 return -ENOMEM;
1122 1122
1123 wm8985->control_type = SND_SOC_I2C; 1123 wm8985->control_type = SND_SOC_I2C;
1124 i2c_set_clientdata(i2c, wm8985); 1124 i2c_set_clientdata(i2c, wm8985);
diff --git a/sound/soc/codecs/wm8994.c b/sound/soc/codecs/wm8994.c
index 218bcd2fc615..0db59c3aa5d4 100644
--- a/sound/soc/codecs/wm8994.c
+++ b/sound/soc/codecs/wm8994.c
@@ -98,1581 +98,1580 @@ struct wm8994_priv {
98 struct wm8994_pdata *pdata; 98 struct wm8994_pdata *pdata;
99}; 99};
100 100
101static struct { 101static const struct {
102 unsigned short readable; /* Mask of readable bits */ 102 unsigned short readable; /* Mask of readable bits */
103 unsigned short writable; /* Mask of writable bits */ 103 unsigned short writable; /* Mask of writable bits */
104 unsigned short vol; /* Mask of volatile bits */
105} access_masks[] = { 104} access_masks[] = {
106 { 0xFFFF, 0xFFFF, 0x0000 }, /* R0 - Software Reset */ 105 { 0xFFFF, 0xFFFF }, /* R0 - Software Reset */
107 { 0x3B37, 0x3B37, 0x0000 }, /* R1 - Power Management (1) */ 106 { 0x3B37, 0x3B37 }, /* R1 - Power Management (1) */
108 { 0x6BF0, 0x6BF0, 0x0000 }, /* R2 - Power Management (2) */ 107 { 0x6BF0, 0x6BF0 }, /* R2 - Power Management (2) */
109 { 0x3FF0, 0x3FF0, 0x0000 }, /* R3 - Power Management (3) */ 108 { 0x3FF0, 0x3FF0 }, /* R3 - Power Management (3) */
110 { 0x3F3F, 0x3F3F, 0x0000 }, /* R4 - Power Management (4) */ 109 { 0x3F3F, 0x3F3F }, /* R4 - Power Management (4) */
111 { 0x3F0F, 0x3F0F, 0x0000 }, /* R5 - Power Management (5) */ 110 { 0x3F0F, 0x3F0F }, /* R5 - Power Management (5) */
112 { 0x003F, 0x003F, 0x0000 }, /* R6 - Power Management (6) */ 111 { 0x003F, 0x003F }, /* R6 - Power Management (6) */
113 { 0x0000, 0x0000, 0x0000 }, /* R7 */ 112 { 0x0000, 0x0000 }, /* R7 */
114 { 0x0000, 0x0000, 0x0000 }, /* R8 */ 113 { 0x0000, 0x0000 }, /* R8 */
115 { 0x0000, 0x0000, 0x0000 }, /* R9 */ 114 { 0x0000, 0x0000 }, /* R9 */
116 { 0x0000, 0x0000, 0x0000 }, /* R10 */ 115 { 0x0000, 0x0000 }, /* R10 */
117 { 0x0000, 0x0000, 0x0000 }, /* R11 */ 116 { 0x0000, 0x0000 }, /* R11 */
118 { 0x0000, 0x0000, 0x0000 }, /* R12 */ 117 { 0x0000, 0x0000 }, /* R12 */
119 { 0x0000, 0x0000, 0x0000 }, /* R13 */ 118 { 0x0000, 0x0000 }, /* R13 */
120 { 0x0000, 0x0000, 0x0000 }, /* R14 */ 119 { 0x0000, 0x0000 }, /* R14 */
121 { 0x0000, 0x0000, 0x0000 }, /* R15 */ 120 { 0x0000, 0x0000 }, /* R15 */
122 { 0x0000, 0x0000, 0x0000 }, /* R16 */ 121 { 0x0000, 0x0000 }, /* R16 */
123 { 0x0000, 0x0000, 0x0000 }, /* R17 */ 122 { 0x0000, 0x0000 }, /* R17 */
124 { 0x0000, 0x0000, 0x0000 }, /* R18 */ 123 { 0x0000, 0x0000 }, /* R18 */
125 { 0x0000, 0x0000, 0x0000 }, /* R19 */ 124 { 0x0000, 0x0000 }, /* R19 */
126 { 0x0000, 0x0000, 0x0000 }, /* R20 */ 125 { 0x0000, 0x0000 }, /* R20 */
127 { 0x01C0, 0x01C0, 0x0000 }, /* R21 - Input Mixer (1) */ 126 { 0x01C0, 0x01C0 }, /* R21 - Input Mixer (1) */
128 { 0x0000, 0x0000, 0x0000 }, /* R22 */ 127 { 0x0000, 0x0000 }, /* R22 */
129 { 0x0000, 0x0000, 0x0000 }, /* R23 */ 128 { 0x0000, 0x0000 }, /* R23 */
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131 { 0x00DF, 0x01DF, 0x0000 }, /* R25 - Left Line Input 3&4 Volume */ 130 { 0x00DF, 0x01DF }, /* R25 - Left Line Input 3&4 Volume */
132 { 0x00DF, 0x01DF, 0x0000 }, /* R26 - Right Line Input 1&2 Volume */ 131 { 0x00DF, 0x01DF }, /* R26 - Right Line Input 1&2 Volume */
133 { 0x00DF, 0x01DF, 0x0000 }, /* R27 - Right Line Input 3&4 Volume */ 132 { 0x00DF, 0x01DF }, /* R27 - Right Line Input 3&4 Volume */
134 { 0x00FF, 0x01FF, 0x0000 }, /* R28 - Left Output Volume */ 133 { 0x00FF, 0x01FF }, /* R28 - Left Output Volume */
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137 { 0x0030, 0x0030, 0x0000 }, /* R31 - HPOUT2 Volume */ 136 { 0x0030, 0x0030 }, /* R31 - HPOUT2 Volume */
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155 { 0x0FFF, 0x0FFF, 0x0000 }, /* R49 - Output Mixer (5) */ 154 { 0x0FFF, 0x0FFF }, /* R49 - Output Mixer (5) */
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1677 1676
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3564 }, 3564 },
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@@ -3582,6 +3583,7 @@ static struct snd_soc_dai_driver wm8994_dai[] = {
3582 }, 3583 },
3583 { 3584 {
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3587 .channels_min = 2, 3589 .channels_min = 2,
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index c8e97dcbfff4..86918ee12419 100644
--- a/sound/soc/davinci/davinci-mcasp.c
+++ b/sound/soc/davinci/davinci-mcasp.c
@@ -898,6 +898,7 @@ static int davinci_mcasp_probe(struct platform_device *pdev)
898 res = platform_get_resource(pdev, IORESOURCE_DMA, 0); 898 res = platform_get_resource(pdev, IORESOURCE_DMA, 0);
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901 ret = -ENODEV;
901 goto err_release_region; 902 goto err_release_region;
902 } 903 }
903 904
@@ -912,6 +913,7 @@ static int davinci_mcasp_probe(struct platform_device *pdev)
912 res = platform_get_resource(pdev, IORESOURCE_DMA, 1); 913 res = platform_get_resource(pdev, IORESOURCE_DMA, 1);
913 if (!res) { 914 if (!res) {
914 dev_err(&pdev->dev, "no DMA resource\n"); 915 dev_err(&pdev->dev, "no DMA resource\n");
916 ret = -ENODEV;
915 goto err_release_region; 917 goto err_release_region;
916 } 918 }
917 919
diff --git a/sound/soc/ep93xx/Kconfig b/sound/soc/ep93xx/Kconfig
index f617f560f46b..57429041189c 100644
--- a/sound/soc/ep93xx/Kconfig
+++ b/sound/soc/ep93xx/Kconfig
@@ -3,11 +3,16 @@ config SND_EP93XX_SOC
3 depends on ARCH_EP93XX && SND_SOC 3 depends on ARCH_EP93XX && SND_SOC
4 help 4 help
5 Say Y or M if you want to add support for codecs attached to 5 Say Y or M if you want to add support for codecs attached to
6 the EP93xx I2S interface. 6 the EP93xx I2S or AC97 interfaces.
7 7
8config SND_EP93XX_SOC_I2S 8config SND_EP93XX_SOC_I2S
9 tristate 9 tristate
10 10
11config SND_EP93XX_SOC_AC97
12 tristate
13 select AC97_BUS
14 select SND_SOC_AC97_BUS
15
11config SND_EP93XX_SOC_SNAPPERCL15 16config SND_EP93XX_SOC_SNAPPERCL15
12 tristate "SoC Audio support for Bluewater Systems Snapper CL15 module" 17 tristate "SoC Audio support for Bluewater Systems Snapper CL15 module"
13 depends on SND_EP93XX_SOC && MACH_SNAPPER_CL15 18 depends on SND_EP93XX_SOC && MACH_SNAPPER_CL15
@@ -16,3 +21,12 @@ config SND_EP93XX_SOC_SNAPPERCL15
16 help 21 help
17 Say Y or M here if you want to add support for I2S audio on the 22 Say Y or M here if you want to add support for I2S audio on the
18 Bluewater Systems Snapper CL15 module. 23 Bluewater Systems Snapper CL15 module.
24
25config SND_EP93XX_SOC_SIMONE
26 tristate "SoC Audio support for Simplemachines Sim.One board"
27 depends on SND_EP93XX_SOC && MACH_SIM_ONE
28 select SND_EP93XX_SOC_AC97
29 select SND_SOC_AC97_CODEC
30 help
31 Say Y or M here if you want to add support for AC97 audio on the
32 Simplemachines Sim.One board.
diff --git a/sound/soc/ep93xx/Makefile b/sound/soc/ep93xx/Makefile
index 272e60f57b9a..8e7977fb6b7d 100644
--- a/sound/soc/ep93xx/Makefile
+++ b/sound/soc/ep93xx/Makefile
@@ -1,11 +1,15 @@
1# EP93xx Platform Support 1# EP93xx Platform Support
2snd-soc-ep93xx-objs := ep93xx-pcm.o 2snd-soc-ep93xx-objs := ep93xx-pcm.o
3snd-soc-ep93xx-i2s-objs := ep93xx-i2s.o 3snd-soc-ep93xx-i2s-objs := ep93xx-i2s.o
4snd-soc-ep93xx-ac97-objs := ep93xx-ac97.o
4 5
5obj-$(CONFIG_SND_EP93XX_SOC) += snd-soc-ep93xx.o 6obj-$(CONFIG_SND_EP93XX_SOC) += snd-soc-ep93xx.o
6obj-$(CONFIG_SND_EP93XX_SOC_I2S) += snd-soc-ep93xx-i2s.o 7obj-$(CONFIG_SND_EP93XX_SOC_I2S) += snd-soc-ep93xx-i2s.o
8obj-$(CONFIG_SND_EP93XX_SOC_AC97) += snd-soc-ep93xx-ac97.o
7 9
8# EP93XX Machine Support 10# EP93XX Machine Support
9snd-soc-snappercl15-objs := snappercl15.o 11snd-soc-snappercl15-objs := snappercl15.o
12snd-soc-simone-objs := simone.o
10 13
11obj-$(CONFIG_SND_EP93XX_SOC_SNAPPERCL15) += snd-soc-snappercl15.o 14obj-$(CONFIG_SND_EP93XX_SOC_SNAPPERCL15) += snd-soc-snappercl15.o
15obj-$(CONFIG_SND_EP93XX_SOC_SIMONE) += snd-soc-simone.o
diff --git a/sound/soc/ep93xx/ep93xx-ac97.c b/sound/soc/ep93xx/ep93xx-ac97.c
new file mode 100644
index 000000000000..68a0bae1208a
--- /dev/null
+++ b/sound/soc/ep93xx/ep93xx-ac97.c
@@ -0,0 +1,468 @@
1/*
2 * ASoC driver for Cirrus Logic EP93xx AC97 controller.
3 *
4 * Copyright (c) 2010 Mika Westerberg
5 *
6 * Based on s3c-ac97 ASoC driver by Jaswinder Singh.
7 *
8 * This program is free software; you can redistribute it and/or modify
9 * it under the terms of the GNU General Public License version 2 as
10 * published by the Free Software Foundation.
11 */
12
13#include <linux/delay.h>
14#include <linux/io.h>
15#include <linux/init.h>
16#include <linux/module.h>
17#include <linux/platform_device.h>
18#include <linux/slab.h>
19
20#include <sound/core.h>
21#include <sound/ac97_codec.h>
22#include <sound/soc.h>
23
24#include <mach/dma.h>
25#include "ep93xx-pcm.h"
26
27/*
28 * Per channel (1-4) registers.
29 */
30#define AC97CH(n) (((n) - 1) * 0x20)
31
32#define AC97DR(n) (AC97CH(n) + 0x0000)
33
34#define AC97RXCR(n) (AC97CH(n) + 0x0004)
35#define AC97RXCR_REN BIT(0)
36#define AC97RXCR_RX3 BIT(3)
37#define AC97RXCR_RX4 BIT(4)
38#define AC97RXCR_CM BIT(15)
39
40#define AC97TXCR(n) (AC97CH(n) + 0x0008)
41#define AC97TXCR_TEN BIT(0)
42#define AC97TXCR_TX3 BIT(3)
43#define AC97TXCR_TX4 BIT(4)
44#define AC97TXCR_CM BIT(15)
45
46#define AC97SR(n) (AC97CH(n) + 0x000c)
47#define AC97SR_TXFE BIT(1)
48#define AC97SR_TXUE BIT(6)
49
50#define AC97RISR(n) (AC97CH(n) + 0x0010)
51#define AC97ISR(n) (AC97CH(n) + 0x0014)
52#define AC97IE(n) (AC97CH(n) + 0x0018)
53
54/*
55 * Global AC97 controller registers.
56 */
57#define AC97S1DATA 0x0080
58#define AC97S2DATA 0x0084
59#define AC97S12DATA 0x0088
60
61#define AC97RGIS 0x008c
62#define AC97GIS 0x0090
63#define AC97IM 0x0094
64/*
65 * Common bits for RGIS, GIS and IM registers.
66 */
67#define AC97_SLOT2RXVALID BIT(1)
68#define AC97_CODECREADY BIT(5)
69#define AC97_SLOT2TXCOMPLETE BIT(6)
70
71#define AC97EOI 0x0098
72#define AC97EOI_WINT BIT(0)
73#define AC97EOI_CODECREADY BIT(1)
74
75#define AC97GCR 0x009c
76#define AC97GCR_AC97IFE BIT(0)
77
78#define AC97RESET 0x00a0
79#define AC97RESET_TIMEDRESET BIT(0)
80
81#define AC97SYNC 0x00a4
82#define AC97SYNC_TIMEDSYNC BIT(0)
83
84#define AC97_TIMEOUT msecs_to_jiffies(5)
85
86/**
87 * struct ep93xx_ac97_info - EP93xx AC97 controller info structure
88 * @lock: mutex serializing access to the bus (slot 1 & 2 ops)
89 * @dev: pointer to the platform device dev structure
90 * @mem: physical memory resource for the registers
91 * @regs: mapped AC97 controller registers
92 * @irq: AC97 interrupt number
93 * @done: bus ops wait here for an interrupt
94 */
95struct ep93xx_ac97_info {
96 struct mutex lock;
97 struct device *dev;
98 struct resource *mem;
99 void __iomem *regs;
100 int irq;
101 struct completion done;
102};
103
104/* currently ALSA only supports a single AC97 device */
105static struct ep93xx_ac97_info *ep93xx_ac97_info;
106
107static struct ep93xx_pcm_dma_params ep93xx_ac97_pcm_out = {
108 .name = "ac97-pcm-out",
109 .dma_port = EP93XX_DMA_M2P_PORT_AAC1,
110};
111
112static struct ep93xx_pcm_dma_params ep93xx_ac97_pcm_in = {
113 .name = "ac97-pcm-in",
114 .dma_port = EP93XX_DMA_M2P_PORT_AAC1,
115};
116
117static inline unsigned ep93xx_ac97_read_reg(struct ep93xx_ac97_info *info,
118 unsigned reg)
119{
120 return __raw_readl(info->regs + reg);
121}
122
123static inline void ep93xx_ac97_write_reg(struct ep93xx_ac97_info *info,
124 unsigned reg, unsigned val)
125{
126 __raw_writel(val, info->regs + reg);
127}
128
129static unsigned short ep93xx_ac97_read(struct snd_ac97 *ac97,
130 unsigned short reg)
131{
132 struct ep93xx_ac97_info *info = ep93xx_ac97_info;
133 unsigned short val;
134
135 mutex_lock(&info->lock);
136
137 ep93xx_ac97_write_reg(info, AC97S1DATA, reg);
138 ep93xx_ac97_write_reg(info, AC97IM, AC97_SLOT2RXVALID);
139 if (!wait_for_completion_timeout(&info->done, AC97_TIMEOUT)) {
140 dev_warn(info->dev, "timeout reading register %x\n", reg);
141 mutex_unlock(&info->lock);
142 return -ETIMEDOUT;
143 }
144 val = (unsigned short)ep93xx_ac97_read_reg(info, AC97S2DATA);
145
146 mutex_unlock(&info->lock);
147 return val;
148}
149
150static void ep93xx_ac97_write(struct snd_ac97 *ac97,
151 unsigned short reg,
152 unsigned short val)
153{
154 struct ep93xx_ac97_info *info = ep93xx_ac97_info;
155
156 mutex_lock(&info->lock);
157
158 /*
159 * Writes to the codec need to be done so that slot 2 is filled in
160 * before slot 1.
161 */
162 ep93xx_ac97_write_reg(info, AC97S2DATA, val);
163 ep93xx_ac97_write_reg(info, AC97S1DATA, reg);
164
165 ep93xx_ac97_write_reg(info, AC97IM, AC97_SLOT2TXCOMPLETE);
166 if (!wait_for_completion_timeout(&info->done, AC97_TIMEOUT))
167 dev_warn(info->dev, "timeout writing register %x\n", reg);
168
169 mutex_unlock(&info->lock);
170}
171
172static void ep93xx_ac97_warm_reset(struct snd_ac97 *ac97)
173{
174 struct ep93xx_ac97_info *info = ep93xx_ac97_info;
175
176 mutex_lock(&info->lock);
177
178 /*
179 * We are assuming that before this functions gets called, the codec
180 * BIT_CLK is stopped by forcing the codec into powerdown mode. We can
181 * control the SYNC signal directly via AC97SYNC register. Using
182 * TIMEDSYNC the controller will keep the SYNC high > 1us.
183 */
184 ep93xx_ac97_write_reg(info, AC97SYNC, AC97SYNC_TIMEDSYNC);
185 ep93xx_ac97_write_reg(info, AC97IM, AC97_CODECREADY);
186 if (!wait_for_completion_timeout(&info->done, AC97_TIMEOUT))
187 dev_warn(info->dev, "codec warm reset timeout\n");
188
189 mutex_unlock(&info->lock);
190}
191
192static void ep93xx_ac97_cold_reset(struct snd_ac97 *ac97)
193{
194 struct ep93xx_ac97_info *info = ep93xx_ac97_info;
195
196 mutex_lock(&info->lock);
197
198 /*
199 * For doing cold reset, we disable the AC97 controller interface, clear
200 * WINT and CODECREADY bits, and finally enable the interface again.
201 */
202 ep93xx_ac97_write_reg(info, AC97GCR, 0);
203 ep93xx_ac97_write_reg(info, AC97EOI, AC97EOI_CODECREADY | AC97EOI_WINT);
204 ep93xx_ac97_write_reg(info, AC97GCR, AC97GCR_AC97IFE);
205
206 /*
207 * Now, assert the reset and wait for the codec to become ready.
208 */
209 ep93xx_ac97_write_reg(info, AC97RESET, AC97RESET_TIMEDRESET);
210 ep93xx_ac97_write_reg(info, AC97IM, AC97_CODECREADY);
211 if (!wait_for_completion_timeout(&info->done, AC97_TIMEOUT))
212 dev_warn(info->dev, "codec cold reset timeout\n");
213
214 /*
215 * Give the codec some time to come fully out from the reset. This way
216 * we ensure that the subsequent reads/writes will work.
217 */
218 usleep_range(15000, 20000);
219
220 mutex_unlock(&info->lock);
221}
222
223static irqreturn_t ep93xx_ac97_interrupt(int irq, void *dev_id)
224{
225 struct ep93xx_ac97_info *info = dev_id;
226 unsigned status, mask;
227
228 /*
229 * Just mask out the interrupt and wake up the waiting thread.
230 * Interrupts are cleared via reading/writing to slot 1 & 2 registers by
231 * the waiting thread.
232 */
233 status = ep93xx_ac97_read_reg(info, AC97GIS);
234 mask = ep93xx_ac97_read_reg(info, AC97IM);
235 mask &= ~status;
236 ep93xx_ac97_write_reg(info, AC97IM, mask);
237
238 complete(&info->done);
239 return IRQ_HANDLED;
240}
241
242struct snd_ac97_bus_ops soc_ac97_ops = {
243 .read = ep93xx_ac97_read,
244 .write = ep93xx_ac97_write,
245 .reset = ep93xx_ac97_cold_reset,
246 .warm_reset = ep93xx_ac97_warm_reset,
247};
248EXPORT_SYMBOL_GPL(soc_ac97_ops);
249
250static int ep93xx_ac97_trigger(struct snd_pcm_substream *substream,
251 int cmd, struct snd_soc_dai *dai)
252{
253 struct ep93xx_ac97_info *info = snd_soc_dai_get_drvdata(dai);
254 unsigned v = 0;
255
256
257 switch (cmd) {
258 case SNDRV_PCM_TRIGGER_START:
259 case SNDRV_PCM_TRIGGER_RESUME:
260 case SNDRV_PCM_TRIGGER_PAUSE_RELEASE:
261 if (substream->stream == SNDRV_PCM_STREAM_PLAYBACK) {
262 /*
263 * Enable compact mode, TX slots 3 & 4, and the TX FIFO
264 * itself.
265 */
266 v |= AC97TXCR_CM;
267 v |= AC97TXCR_TX3 | AC97TXCR_TX4;
268 v |= AC97TXCR_TEN;
269 ep93xx_ac97_write_reg(info, AC97TXCR(1), v);
270 } else {
271 /*
272 * Enable compact mode, RX slots 3 & 4, and the RX FIFO
273 * itself.
274 */
275 v |= AC97RXCR_CM;
276 v |= AC97RXCR_RX3 | AC97RXCR_RX4;
277 v |= AC97RXCR_REN;
278 ep93xx_ac97_write_reg(info, AC97RXCR(1), v);
279 }
280 break;
281
282 case SNDRV_PCM_TRIGGER_STOP:
283 case SNDRV_PCM_TRIGGER_SUSPEND:
284 case SNDRV_PCM_TRIGGER_PAUSE_PUSH:
285 if (substream->stream == SNDRV_PCM_STREAM_PLAYBACK) {
286 /*
287 * As per Cirrus EP93xx errata described below:
288 *
289 * http://www.cirrus.com/en/pubs/errata/ER667E2B.pdf
290 *
291 * we will wait for the TX FIFO to be empty before
292 * clearing the TEN bit.
293 */
294 unsigned long timeout = jiffies + AC97_TIMEOUT;
295
296 do {
297 v = ep93xx_ac97_read_reg(info, AC97SR(1));
298 if (time_after(jiffies, timeout)) {
299 dev_warn(info->dev, "TX timeout\n");
300 break;
301 }
302 } while (!(v & (AC97SR_TXFE | AC97SR_TXUE)));
303
304 /* disable the TX FIFO */
305 ep93xx_ac97_write_reg(info, AC97TXCR(1), 0);
306 } else {
307 /* disable the RX FIFO */
308 ep93xx_ac97_write_reg(info, AC97RXCR(1), 0);
309 }
310 break;
311
312 default:
313 dev_warn(info->dev, "unknown command %d\n", cmd);
314 return -EINVAL;
315 }
316
317 return 0;
318}
319
320static int ep93xx_ac97_startup(struct snd_pcm_substream *substream,
321 struct snd_soc_dai *dai)
322{
323 struct ep93xx_pcm_dma_params *dma_data;
324
325 if (substream->stream == SNDRV_PCM_STREAM_PLAYBACK)
326 dma_data = &ep93xx_ac97_pcm_out;
327 else
328 dma_data = &ep93xx_ac97_pcm_in;
329
330 snd_soc_dai_set_dma_data(dai, substream, dma_data);
331 return 0;
332}
333
334static struct snd_soc_dai_ops ep93xx_ac97_dai_ops = {
335 .startup = ep93xx_ac97_startup,
336 .trigger = ep93xx_ac97_trigger,
337};
338
339struct snd_soc_dai_driver ep93xx_ac97_dai = {
340 .name = "ep93xx-ac97",
341 .id = 0,
342 .ac97_control = 1,
343 .playback = {
344 .stream_name = "AC97 Playback",
345 .channels_min = 2,
346 .channels_max = 2,
347 .rates = SNDRV_PCM_RATE_8000_48000,
348 .formats = SNDRV_PCM_FMTBIT_S16_LE,
349 },
350 .capture = {
351 .stream_name = "AC97 Capture",
352 .channels_min = 2,
353 .channels_max = 2,
354 .rates = SNDRV_PCM_RATE_8000_48000,
355 .formats = SNDRV_PCM_FMTBIT_S16_LE,
356 },
357 .ops = &ep93xx_ac97_dai_ops,
358};
359
360static int __devinit ep93xx_ac97_probe(struct platform_device *pdev)
361{
362 struct ep93xx_ac97_info *info;
363 int ret;
364
365 info = kzalloc(sizeof(struct ep93xx_ac97_info), GFP_KERNEL);
366 if (!info)
367 return -ENOMEM;
368
369 dev_set_drvdata(&pdev->dev, info);
370
371 mutex_init(&info->lock);
372 init_completion(&info->done);
373 info->dev = &pdev->dev;
374
375 info->mem = platform_get_resource(pdev, IORESOURCE_MEM, 0);
376 if (!info->mem) {
377 ret = -ENXIO;
378 goto fail_free_info;
379 }
380
381 info->irq = platform_get_irq(pdev, 0);
382 if (!info->irq) {
383 ret = -ENXIO;
384 goto fail_free_info;
385 }
386
387 if (!request_mem_region(info->mem->start, resource_size(info->mem),
388 pdev->name)) {
389 ret = -EBUSY;
390 goto fail_free_info;
391 }
392
393 info->regs = ioremap(info->mem->start, resource_size(info->mem));
394 if (!info->regs) {
395 ret = -ENOMEM;
396 goto fail_release_mem;
397 }
398
399 ret = request_irq(info->irq, ep93xx_ac97_interrupt, IRQF_TRIGGER_HIGH,
400 pdev->name, info);
401 if (ret)
402 goto fail_unmap_mem;
403
404 ep93xx_ac97_info = info;
405 platform_set_drvdata(pdev, info);
406
407 ret = snd_soc_register_dai(&pdev->dev, &ep93xx_ac97_dai);
408 if (ret)
409 goto fail_free_irq;
410
411 return 0;
412
413fail_free_irq:
414 platform_set_drvdata(pdev, NULL);
415 free_irq(info->irq, info);
416fail_unmap_mem:
417 iounmap(info->regs);
418fail_release_mem:
419 release_mem_region(info->mem->start, resource_size(info->mem));
420fail_free_info:
421 kfree(info);
422
423 return ret;
424}
425
426static int __devexit ep93xx_ac97_remove(struct platform_device *pdev)
427{
428 struct ep93xx_ac97_info *info = platform_get_drvdata(pdev);
429
430 snd_soc_unregister_dai(&pdev->dev);
431
432 /* disable the AC97 controller */
433 ep93xx_ac97_write_reg(info, AC97GCR, 0);
434
435 free_irq(info->irq, info);
436 iounmap(info->regs);
437 release_mem_region(info->mem->start, resource_size(info->mem));
438 platform_set_drvdata(pdev, NULL);
439 kfree(info);
440
441 return 0;
442}
443
444static struct platform_driver ep93xx_ac97_driver = {
445 .probe = ep93xx_ac97_probe,
446 .remove = __devexit_p(ep93xx_ac97_remove),
447 .driver = {
448 .name = "ep93xx-ac97",
449 .owner = THIS_MODULE,
450 },
451};
452
453static int __init ep93xx_ac97_init(void)
454{
455 return platform_driver_register(&ep93xx_ac97_driver);
456}
457module_init(ep93xx_ac97_init);
458
459static void __exit ep93xx_ac97_exit(void)
460{
461 platform_driver_unregister(&ep93xx_ac97_driver);
462}
463module_exit(ep93xx_ac97_exit);
464
465MODULE_DESCRIPTION("EP93xx AC97 ASoC Driver");
466MODULE_AUTHOR("Mika Westerberg <mika.westerberg@iki.fi>");
467MODULE_LICENSE("GPL");
468MODULE_ALIAS("platform:ep93xx-ac97");
diff --git a/sound/soc/ep93xx/simone.c b/sound/soc/ep93xx/simone.c
new file mode 100644
index 000000000000..4b0d19913728
--- /dev/null
+++ b/sound/soc/ep93xx/simone.c
@@ -0,0 +1,89 @@
1/*
2 * simone.c -- ASoC audio for Simplemachines Sim.One board
3 *
4 * Copyright (c) 2010 Mika Westerberg
5 *
6 * Based on snappercl15 machine driver by Ryan Mallon.
7 *
8 * This program is free software; you can redistribute it and/or modify
9 * it under the terms of the GNU General Public License version 2 as
10 * published by the Free Software Foundation.
11 */
12
13#include <linux/init.h>
14#include <linux/module.h>
15#include <linux/platform_device.h>
16
17#include <sound/core.h>
18#include <sound/pcm.h>
19#include <sound/soc.h>
20
21#include <asm/mach-types.h>
22#include <mach/hardware.h>
23
24#include "ep93xx-pcm.h"
25
26static struct snd_soc_dai_link simone_dai = {
27 .name = "AC97",
28 .stream_name = "AC97 HiFi",
29 .cpu_dai_name = "ep93xx-ac97",
30 .codec_dai_name = "ac97-hifi",
31 .codec_name = "ac97-codec",
32 .platform_name = "ep93xx-pcm-audio",
33};
34
35static struct snd_soc_card snd_soc_simone = {
36 .name = "Sim.One",
37 .dai_link = &simone_dai,
38 .num_links = 1,
39};
40
41static struct platform_device *simone_snd_ac97_device;
42static struct platform_device *simone_snd_device;
43
44static int __init simone_init(void)
45{
46 int ret;
47
48 if (!machine_is_sim_one())
49 return -ENODEV;
50
51 simone_snd_ac97_device = platform_device_alloc("ac97-codec", -1);
52 if (!simone_snd_ac97_device)
53 return -ENOMEM;
54
55 ret = platform_device_add(simone_snd_ac97_device);
56 if (ret)
57 goto fail;
58
59 simone_snd_device = platform_device_alloc("soc-audio", -1);
60 if (!simone_snd_device) {
61 ret = -ENOMEM;
62 goto fail;
63 }
64
65 platform_set_drvdata(simone_snd_device, &snd_soc_simone);
66 ret = platform_device_add(simone_snd_device);
67 if (ret) {
68 platform_device_put(simone_snd_device);
69 goto fail;
70 }
71
72 return ret;
73
74fail:
75 platform_device_put(simone_snd_ac97_device);
76 return ret;
77}
78module_init(simone_init);
79
80static void __exit simone_exit(void)
81{
82 platform_device_unregister(simone_snd_device);
83 platform_device_unregister(simone_snd_ac97_device);
84}
85module_exit(simone_exit);
86
87MODULE_DESCRIPTION("ALSA SoC Simplemachines Sim.One");
88MODULE_AUTHOR("Mika Westerberg <mika.westerberg@iki.fi>");
89MODULE_LICENSE("GPL");
diff --git a/sound/soc/s3c24xx/Kconfig b/sound/soc/s3c24xx/Kconfig
index 7d8235de549e..8a6b53ccd203 100644
--- a/sound/soc/s3c24xx/Kconfig
+++ b/sound/soc/s3c24xx/Kconfig
@@ -36,6 +36,10 @@ config SND_S3C_SOC_AC97
36 tristate 36 tristate
37 select SND_SOC_AC97_BUS 37 select SND_SOC_AC97_BUS
38 38
39config SND_S5P_SOC_SPDIF
40 tristate
41 select SND_SOC_SPDIF
42
39config SND_S3C24XX_SOC_NEO1973_WM8753 43config SND_S3C24XX_SOC_NEO1973_WM8753
40 tristate "SoC I2S Audio support for NEO1973 - WM8753" 44 tristate "SoC I2S Audio support for NEO1973 - WM8753"
41 depends on SND_S3C24XX_SOC && MACH_NEO1973_GTA01 45 depends on SND_S3C24XX_SOC && MACH_NEO1973_GTA01
@@ -157,3 +161,10 @@ config SND_S5PV210_SOC_GONI_WM8994
157 help 161 help
158 Say Y if you want to add support for SoC audio on goni 162 Say Y if you want to add support for SoC audio on goni
159 with the WM8994. 163 with the WM8994.
164
165config SND_SOC_SMDK_SPDIF
166 tristate "SoC S/PDIF Audio support for SMDK"
167 depends on SND_S3C24XX_SOC && (MACH_SMDKC100 || MACH_SMDKC110 || MACH_SMDKV210)
168 select SND_S5P_SOC_SPDIF
169 help
170 Say Y if you want to add support for SoC S/PDIF audio on the SMDK.
diff --git a/sound/soc/s3c24xx/Makefile b/sound/soc/s3c24xx/Makefile
index dd412a9e88c3..ee8f41d6df99 100644
--- a/sound/soc/s3c24xx/Makefile
+++ b/sound/soc/s3c24xx/Makefile
@@ -7,6 +7,7 @@ snd-soc-s3c-ac97-objs := s3c-ac97.o
7snd-soc-s3c64xx-i2s-v4-objs := s3c64xx-i2s-v4.o 7snd-soc-s3c64xx-i2s-v4-objs := s3c64xx-i2s-v4.o
8snd-soc-s3c-i2s-v2-objs := s3c-i2s-v2.o 8snd-soc-s3c-i2s-v2-objs := s3c-i2s-v2.o
9snd-soc-s3c-pcm-objs := s3c-pcm.o 9snd-soc-s3c-pcm-objs := s3c-pcm.o
10snd-soc-samsung-spdif-objs := spdif.o
10 11
11obj-$(CONFIG_SND_S3C24XX_SOC) += snd-soc-s3c24xx.o 12obj-$(CONFIG_SND_S3C24XX_SOC) += snd-soc-s3c24xx.o
12obj-$(CONFIG_SND_S3C24XX_SOC_I2S) += snd-soc-s3c24xx-i2s.o 13obj-$(CONFIG_SND_S3C24XX_SOC_I2S) += snd-soc-s3c24xx-i2s.o
@@ -16,6 +17,7 @@ obj-$(CONFIG_SND_S3C64XX_SOC_I2S) += snd-soc-s3c64xx-i2s.o
16obj-$(CONFIG_SND_S3C64XX_SOC_I2S_V4) += snd-soc-s3c64xx-i2s-v4.o 17obj-$(CONFIG_SND_S3C64XX_SOC_I2S_V4) += snd-soc-s3c64xx-i2s-v4.o
17obj-$(CONFIG_SND_S3C_I2SV2_SOC) += snd-soc-s3c-i2s-v2.o 18obj-$(CONFIG_SND_S3C_I2SV2_SOC) += snd-soc-s3c-i2s-v2.o
18obj-$(CONFIG_SND_S3C_SOC_PCM) += snd-soc-s3c-pcm.o 19obj-$(CONFIG_SND_S3C_SOC_PCM) += snd-soc-s3c-pcm.o
20obj-$(CONFIG_SND_S5P_SOC_SPDIF) += snd-soc-samsung-spdif.o
19 21
20# S3C24XX Machine Support 22# S3C24XX Machine Support
21snd-soc-jive-wm8750-objs := jive_wm8750.o 23snd-soc-jive-wm8750-objs := jive_wm8750.o
@@ -33,6 +35,7 @@ snd-soc-smdk-wm9713-objs := smdk_wm9713.o
33snd-soc-s3c64xx-smartq-wm8987-objs := smartq_wm8987.o 35snd-soc-s3c64xx-smartq-wm8987-objs := smartq_wm8987.o
34snd-soc-aquila-wm8994-objs := aquila_wm8994.o 36snd-soc-aquila-wm8994-objs := aquila_wm8994.o
35snd-soc-goni-wm8994-objs := goni_wm8994.o 37snd-soc-goni-wm8994-objs := goni_wm8994.o
38snd-soc-smdk-spdif-objs := smdk_spdif.o
36 39
37obj-$(CONFIG_SND_S3C24XX_SOC_JIVE_WM8750) += snd-soc-jive-wm8750.o 40obj-$(CONFIG_SND_S3C24XX_SOC_JIVE_WM8750) += snd-soc-jive-wm8750.o
38obj-$(CONFIG_SND_S3C24XX_SOC_NEO1973_WM8753) += snd-soc-neo1973-wm8753.o 41obj-$(CONFIG_SND_S3C24XX_SOC_NEO1973_WM8753) += snd-soc-neo1973-wm8753.o
@@ -49,3 +52,4 @@ obj-$(CONFIG_SND_SOC_SMDK_WM9713) += snd-soc-smdk-wm9713.o
49obj-$(CONFIG_SND_S3C64XX_SOC_SMARTQ) += snd-soc-s3c64xx-smartq-wm8987.o 52obj-$(CONFIG_SND_S3C64XX_SOC_SMARTQ) += snd-soc-s3c64xx-smartq-wm8987.o
50obj-$(CONFIG_SND_S5PC110_SOC_AQUILA_WM8994) += snd-soc-aquila-wm8994.o 53obj-$(CONFIG_SND_S5PC110_SOC_AQUILA_WM8994) += snd-soc-aquila-wm8994.o
51obj-$(CONFIG_SND_S5PV210_SOC_GONI_WM8994) += snd-soc-goni-wm8994.o 54obj-$(CONFIG_SND_S5PV210_SOC_GONI_WM8994) += snd-soc-goni-wm8994.o
55obj-$(CONFIG_SND_SOC_SMDK_SPDIF) += snd-soc-smdk-spdif.o
diff --git a/sound/soc/s3c24xx/smdk_spdif.c b/sound/soc/s3c24xx/smdk_spdif.c
new file mode 100644
index 000000000000..f31d22ad7c88
--- /dev/null
+++ b/sound/soc/s3c24xx/smdk_spdif.c
@@ -0,0 +1,223 @@
1/*
2 * smdk_spdif.c -- S/PDIF audio for SMDK
3 *
4 * Copyright 2010 Samsung Electronics Co. Ltd.
5 *
6 * This program is free software; you can redistribute it and/or
7 * modify it under the terms of the GNU General Public License as
8 * published by the Free Software Foundation; either version 2 of the
9 * License, or (at your option) any later version.
10 *
11 */
12
13#include <linux/module.h>
14#include <linux/device.h>
15#include <linux/clk.h>
16
17#include <plat/devs.h>
18
19#include <sound/soc.h>
20
21#include "s3c-dma.h"
22#include "spdif.h"
23
24/* Audio clock settings are belonged to board specific part. Every
25 * board can set audio source clock setting which is matched with H/W
26 * like this function-'set_audio_clock_heirachy'.
27 */
28static int set_audio_clock_heirachy(struct platform_device *pdev)
29{
30 struct clk *fout_epll, *mout_epll, *sclk_audio0, *sclk_spdif;
31 int ret;
32
33 fout_epll = clk_get(NULL, "fout_epll");
34 if (IS_ERR(fout_epll)) {
35 printk(KERN_WARNING "%s: Cannot find fout_epll.\n",
36 __func__);
37 return -EINVAL;
38 }
39
40 mout_epll = clk_get(NULL, "mout_epll");
41 if (IS_ERR(fout_epll)) {
42 printk(KERN_WARNING "%s: Cannot find mout_epll.\n",
43 __func__);
44 ret = -EINVAL;
45 goto out1;
46 }
47
48 sclk_audio0 = clk_get(&pdev->dev, "sclk_audio");
49 if (IS_ERR(sclk_audio0)) {
50 printk(KERN_WARNING "%s: Cannot find sclk_audio.\n",
51 __func__);
52 ret = -EINVAL;
53 goto out2;
54 }
55
56 sclk_spdif = clk_get(NULL, "sclk_spdif");
57 if (IS_ERR(fout_epll)) {
58 printk(KERN_WARNING "%s: Cannot find sclk_spdif.\n",
59 __func__);
60 ret = -EINVAL;
61 goto out3;
62 }
63
64 /* Set audio clock heirachy for S/PDIF */
65 clk_set_parent(mout_epll, fout_epll);
66 clk_set_parent(sclk_audio0, mout_epll);
67 clk_set_parent(sclk_spdif, sclk_audio0);
68
69 clk_put(sclk_spdif);
70out3:
71 clk_put(sclk_audio0);
72out2:
73 clk_put(mout_epll);
74out1:
75 clk_put(fout_epll);
76
77 return ret;
78}
79
80/* We should haved to set clock directly on this part because of clock
81 * scheme of Samsudng SoCs did not support to set rates from abstrct
82 * clock of it's heirachy.
83 */
84static int set_audio_clock_rate(unsigned long epll_rate,
85 unsigned long audio_rate)
86{
87 struct clk *fout_epll, *sclk_spdif;
88
89 fout_epll = clk_get(NULL, "fout_epll");
90 if (IS_ERR(fout_epll)) {
91 printk(KERN_ERR "%s: failed to get fout_epll\n", __func__);
92 return -ENOENT;
93 }
94
95 clk_set_rate(fout_epll, epll_rate);
96 clk_put(fout_epll);
97
98 sclk_spdif = clk_get(NULL, "sclk_spdif");
99 if (IS_ERR(sclk_spdif)) {
100 printk(KERN_ERR "%s: failed to get sclk_spdif\n", __func__);
101 return -ENOENT;
102 }
103
104 clk_set_rate(sclk_spdif, audio_rate);
105 clk_put(sclk_spdif);
106
107 return 0;
108}
109
110static int smdk_hw_params(struct snd_pcm_substream *substream,
111 struct snd_pcm_hw_params *params)
112{
113 struct snd_soc_pcm_runtime *rtd = substream->private_data;
114 struct snd_soc_dai *cpu_dai = rtd->cpu_dai;
115 unsigned long pll_out, rclk_rate;
116 int ret, ratio;
117
118 switch (params_rate(params)) {
119 case 44100:
120 pll_out = 45158400;
121 break;
122 case 32000:
123 case 48000:
124 case 96000:
125 pll_out = 49152000;
126 break;
127 default:
128 return -EINVAL;
129 }
130
131 /* Setting ratio to 512fs helps to use S/PDIF with HDMI without
132 * modify S/PDIF ASoC machine driver.
133 */
134 ratio = 512;
135 rclk_rate = params_rate(params) * ratio;
136
137 /* Set audio source clock rates */
138 ret = set_audio_clock_rate(pll_out, rclk_rate);
139 if (ret < 0)
140 return ret;
141
142 /* Set S/PDIF uses internal source clock */
143 ret = snd_soc_dai_set_sysclk(cpu_dai, SND_SOC_SPDIF_INT_MCLK,
144 rclk_rate, SND_SOC_CLOCK_IN);
145 if (ret < 0)
146 return ret;
147
148 return ret;
149}
150
151static struct snd_soc_ops smdk_spdif_ops = {
152 .hw_params = smdk_hw_params,
153};
154
155static struct snd_soc_card smdk;
156
157static struct snd_soc_dai_link smdk_dai = {
158 .name = "S/PDIF",
159 .stream_name = "S/PDIF PCM Playback",
160 .platform_name = "s3c24xx-pcm-audio",
161 .cpu_dai_name = "samsung-spdif",
162 .codec_dai_name = "dit-hifi",
163 .codec_name = "spdif-dit",
164 .ops = &smdk_spdif_ops,
165};
166
167static struct snd_soc_card smdk = {
168 .name = "SMDK-S/PDIF",
169 .dai_link = &smdk_dai,
170 .num_links = 1,
171};
172
173static struct platform_device *smdk_snd_spdif_dit_device;
174static struct platform_device *smdk_snd_spdif_device;
175
176static int __init smdk_init(void)
177{
178 int ret;
179
180 smdk_snd_spdif_dit_device = platform_device_alloc("spdif-dit", -1);
181 if (!smdk_snd_spdif_dit_device)
182 return -ENOMEM;
183
184 ret = platform_device_add(smdk_snd_spdif_dit_device);
185 if (ret)
186 goto err2;
187
188 smdk_snd_spdif_device = platform_device_alloc("soc-audio", -1);
189 if (!smdk_snd_spdif_device) {
190 ret = -ENOMEM;
191 goto err2;
192 }
193
194 platform_set_drvdata(smdk_snd_spdif_device, &smdk);
195
196 ret = platform_device_add(smdk_snd_spdif_device);
197 if (ret)
198 goto err1;
199
200 /* Set audio clock heirachy manually */
201 ret = set_audio_clock_heirachy(smdk_snd_spdif_device);
202 if (ret)
203 goto err1;
204
205 return 0;
206err1:
207 platform_device_put(smdk_snd_spdif_device);
208err2:
209 platform_device_put(smdk_snd_spdif_dit_device);
210 return ret;
211}
212
213static void __exit smdk_exit(void)
214{
215 platform_device_unregister(smdk_snd_spdif_device);
216}
217
218module_init(smdk_init);
219module_exit(smdk_exit);
220
221MODULE_AUTHOR("Seungwhan Youn, <sw.youn@samsung.com>");
222MODULE_DESCRIPTION("ALSA SoC SMDK+S/PDIF");
223MODULE_LICENSE("GPL");
diff --git a/sound/soc/s3c24xx/spdif.c b/sound/soc/s3c24xx/spdif.c
new file mode 100644
index 000000000000..ce554e9cabcc
--- /dev/null
+++ b/sound/soc/s3c24xx/spdif.c
@@ -0,0 +1,501 @@
1/* sound/soc/s3c24xx/spdif.c
2 *
3 * ALSA SoC Audio Layer - Samsung S/PDIF Controller driver
4 *
5 * Copyright (c) 2010 Samsung Electronics Co. Ltd
6 * http://www.samsung.com/
7 *
8 * This program is free software; you can redistribute it and/or modify
9 * it under the terms of the GNU General Public License version 2 as
10 * published by the Free Software Foundation.
11 */
12
13#include <linux/clk.h>
14#include <linux/io.h>
15
16#include <sound/pcm.h>
17#include <sound/pcm_params.h>
18#include <sound/soc.h>
19
20#include <plat/audio.h>
21#include <mach/dma.h>
22
23#include "s3c-dma.h"
24#include "spdif.h"
25
26/* Registers */
27#define CLKCON 0x00
28#define CON 0x04
29#define BSTAS 0x08
30#define CSTAS 0x0C
31#define DATA_OUTBUF 0x10
32#define DCNT 0x14
33#define BSTAS_S 0x18
34#define DCNT_S 0x1C
35
36#define CLKCTL_MASK 0x7
37#define CLKCTL_MCLK_EXT (0x1 << 2)
38#define CLKCTL_PWR_ON (0x1 << 0)
39
40#define CON_MASK 0x3ffffff
41#define CON_FIFO_TH_SHIFT 19
42#define CON_FIFO_TH_MASK (0x7 << 19)
43#define CON_USERDATA_23RDBIT (0x1 << 12)
44
45#define CON_SW_RESET (0x1 << 5)
46
47#define CON_MCLKDIV_MASK (0x3 << 3)
48#define CON_MCLKDIV_256FS (0x0 << 3)
49#define CON_MCLKDIV_384FS (0x1 << 3)
50#define CON_MCLKDIV_512FS (0x2 << 3)
51
52#define CON_PCM_MASK (0x3 << 1)
53#define CON_PCM_16BIT (0x0 << 1)
54#define CON_PCM_20BIT (0x1 << 1)
55#define CON_PCM_24BIT (0x2 << 1)
56
57#define CON_PCM_DATA (0x1 << 0)
58
59#define CSTAS_MASK 0x3fffffff
60#define CSTAS_SAMP_FREQ_MASK (0xF << 24)
61#define CSTAS_SAMP_FREQ_44 (0x0 << 24)
62#define CSTAS_SAMP_FREQ_48 (0x2 << 24)
63#define CSTAS_SAMP_FREQ_32 (0x3 << 24)
64#define CSTAS_SAMP_FREQ_96 (0xA << 24)
65
66#define CSTAS_CATEGORY_MASK (0xFF << 8)
67#define CSTAS_CATEGORY_CODE_CDP (0x01 << 8)
68
69#define CSTAS_NO_COPYRIGHT (0x1 << 2)
70
71/**
72 * struct samsung_spdif_info - Samsung S/PDIF Controller information
73 * @lock: Spin lock for S/PDIF.
74 * @dev: The parent device passed to use from the probe.
75 * @regs: The pointer to the device register block.
76 * @clk_rate: Current clock rate for calcurate ratio.
77 * @pclk: The peri-clock pointer for spdif master operation.
78 * @sclk: The source clock pointer for making sync signals.
79 * @save_clkcon: Backup clkcon reg. in suspend.
80 * @save_con: Backup con reg. in suspend.
81 * @save_cstas: Backup cstas reg. in suspend.
82 * @dma_playback: DMA information for playback channel.
83 */
84struct samsung_spdif_info {
85 spinlock_t lock;
86 struct device *dev;
87 void __iomem *regs;
88 unsigned long clk_rate;
89 struct clk *pclk;
90 struct clk *sclk;
91 u32 saved_clkcon;
92 u32 saved_con;
93 u32 saved_cstas;
94 struct s3c_dma_params *dma_playback;
95};
96
97static struct s3c2410_dma_client spdif_dma_client_out = {
98 .name = "S/PDIF Stereo out",
99};
100
101static struct s3c_dma_params spdif_stereo_out;
102static struct samsung_spdif_info spdif_info;
103
104static inline struct samsung_spdif_info *to_info(struct snd_soc_dai *cpu_dai)
105{
106 return snd_soc_dai_get_drvdata(cpu_dai);
107}
108
109static void spdif_snd_txctrl(struct samsung_spdif_info *spdif, int on)
110{
111 void __iomem *regs = spdif->regs;
112 u32 clkcon;
113
114 dev_dbg(spdif->dev, "Entered %s\n", __func__);
115
116 clkcon = readl(regs + CLKCON) & CLKCTL_MASK;
117 if (on)
118 writel(clkcon | CLKCTL_PWR_ON, regs + CLKCON);
119 else
120 writel(clkcon & ~CLKCTL_PWR_ON, regs + CLKCON);
121}
122
123static int spdif_set_sysclk(struct snd_soc_dai *cpu_dai,
124 int clk_id, unsigned int freq, int dir)
125{
126 struct samsung_spdif_info *spdif = to_info(cpu_dai);
127 u32 clkcon;
128
129 dev_dbg(spdif->dev, "Entered %s\n", __func__);
130
131 clkcon = readl(spdif->regs + CLKCON);
132
133 if (clk_id == SND_SOC_SPDIF_INT_MCLK)
134 clkcon &= ~CLKCTL_MCLK_EXT;
135 else
136 clkcon |= CLKCTL_MCLK_EXT;
137
138 writel(clkcon, spdif->regs + CLKCON);
139
140 spdif->clk_rate = freq;
141
142 return 0;
143}
144
145static int spdif_trigger(struct snd_pcm_substream *substream, int cmd,
146 struct snd_soc_dai *dai)
147{
148 struct snd_soc_pcm_runtime *rtd = substream->private_data;
149 struct samsung_spdif_info *spdif = to_info(rtd->cpu_dai);
150 unsigned long flags;
151
152 dev_dbg(spdif->dev, "Entered %s\n", __func__);
153
154 switch (cmd) {
155 case SNDRV_PCM_TRIGGER_START:
156 case SNDRV_PCM_TRIGGER_RESUME:
157 case SNDRV_PCM_TRIGGER_PAUSE_RELEASE:
158 spin_lock_irqsave(&spdif->lock, flags);
159 spdif_snd_txctrl(spdif, 1);
160 spin_unlock_irqrestore(&spdif->lock, flags);
161 break;
162 case SNDRV_PCM_TRIGGER_STOP:
163 case SNDRV_PCM_TRIGGER_SUSPEND:
164 case SNDRV_PCM_TRIGGER_PAUSE_PUSH:
165 spin_lock_irqsave(&spdif->lock, flags);
166 spdif_snd_txctrl(spdif, 0);
167 spin_unlock_irqrestore(&spdif->lock, flags);
168 break;
169 default:
170 return -EINVAL;
171 }
172
173 return 0;
174}
175
176static int spdif_sysclk_ratios[] = {
177 512, 384, 256,
178};
179
180static int spdif_hw_params(struct snd_pcm_substream *substream,
181 struct snd_pcm_hw_params *params,
182 struct snd_soc_dai *socdai)
183{
184 struct snd_soc_pcm_runtime *rtd = substream->private_data;
185 struct samsung_spdif_info *spdif = to_info(rtd->cpu_dai);
186 void __iomem *regs = spdif->regs;
187 struct s3c_dma_params *dma_data;
188 u32 con, clkcon, cstas;
189 unsigned long flags;
190 int i, ratio;
191
192 dev_dbg(spdif->dev, "Entered %s\n", __func__);
193
194 if (substream->stream == SNDRV_PCM_STREAM_PLAYBACK)
195 dma_data = spdif->dma_playback;
196 else {
197 dev_err(spdif->dev, "Capture is not supported\n");
198 return -EINVAL;
199 }
200
201 snd_soc_dai_set_dma_data(rtd->cpu_dai, substream, dma_data);
202
203 spin_lock_irqsave(&spdif->lock, flags);
204
205 con = readl(regs + CON) & CON_MASK;
206 cstas = readl(regs + CSTAS) & CSTAS_MASK;
207 clkcon = readl(regs + CLKCON) & CLKCTL_MASK;
208
209 con &= ~CON_FIFO_TH_MASK;
210 con |= (0x7 << CON_FIFO_TH_SHIFT);
211 con |= CON_USERDATA_23RDBIT;
212 con |= CON_PCM_DATA;
213
214 con &= ~CON_PCM_MASK;
215 switch (params_format(params)) {
216 case SNDRV_PCM_FORMAT_S16_LE:
217 con |= CON_PCM_16BIT;
218 break;
219 default:
220 dev_err(spdif->dev, "Unsupported data size.\n");
221 goto err;
222 }
223
224 ratio = spdif->clk_rate / params_rate(params);
225 for (i = 0; i < ARRAY_SIZE(spdif_sysclk_ratios); i++)
226 if (ratio == spdif_sysclk_ratios[i])
227 break;
228 if (i == ARRAY_SIZE(spdif_sysclk_ratios)) {
229 dev_err(spdif->dev, "Invalid clock ratio %ld/%d\n",
230 spdif->clk_rate, params_rate(params));
231 goto err;
232 }
233
234 con &= ~CON_MCLKDIV_MASK;
235 switch (ratio) {
236 case 256:
237 con |= CON_MCLKDIV_256FS;
238 break;
239 case 384:
240 con |= CON_MCLKDIV_384FS;
241 break;
242 case 512:
243 con |= CON_MCLKDIV_512FS;
244 break;
245 }
246
247 cstas &= ~CSTAS_SAMP_FREQ_MASK;
248 switch (params_rate(params)) {
249 case 44100:
250 cstas |= CSTAS_SAMP_FREQ_44;
251 break;
252 case 48000:
253 cstas |= CSTAS_SAMP_FREQ_48;
254 break;
255 case 32000:
256 cstas |= CSTAS_SAMP_FREQ_32;
257 break;
258 case 96000:
259 cstas |= CSTAS_SAMP_FREQ_96;
260 break;
261 default:
262 dev_err(spdif->dev, "Invalid sampling rate %d\n",
263 params_rate(params));
264 goto err;
265 }
266
267 cstas &= ~CSTAS_CATEGORY_MASK;
268 cstas |= CSTAS_CATEGORY_CODE_CDP;
269 cstas |= CSTAS_NO_COPYRIGHT;
270
271 writel(con, regs + CON);
272 writel(cstas, regs + CSTAS);
273 writel(clkcon, regs + CLKCON);
274
275 spin_unlock_irqrestore(&spdif->lock, flags);
276
277 return 0;
278err:
279 spin_unlock_irqrestore(&spdif->lock, flags);
280 return -EINVAL;
281}
282
283static void spdif_shutdown(struct snd_pcm_substream *substream,
284 struct snd_soc_dai *dai)
285{
286 struct snd_soc_pcm_runtime *rtd = substream->private_data;
287 struct samsung_spdif_info *spdif = to_info(rtd->cpu_dai);
288 void __iomem *regs = spdif->regs;
289 u32 con, clkcon;
290
291 dev_dbg(spdif->dev, "Entered %s\n", __func__);
292
293 con = readl(regs + CON) & CON_MASK;
294 clkcon = readl(regs + CLKCON) & CLKCTL_MASK;
295
296 writel(con | CON_SW_RESET, regs + CON);
297 cpu_relax();
298
299 writel(clkcon & ~CLKCTL_PWR_ON, regs + CLKCON);
300}
301
302#ifdef CONFIG_PM
303static int spdif_suspend(struct snd_soc_dai *cpu_dai)
304{
305 struct samsung_spdif_info *spdif = to_info(cpu_dai);
306 u32 con = spdif->saved_con;
307
308 dev_dbg(spdif->dev, "Entered %s\n", __func__);
309
310 spdif->saved_clkcon = readl(spdif->regs + CLKCON) & CLKCTL_MASK;
311 spdif->saved_con = readl(spdif->regs + CON) & CON_MASK;
312 spdif->saved_cstas = readl(spdif->regs + CSTAS) & CSTAS_MASK;
313
314 writel(con | CON_SW_RESET, spdif->regs + CON);
315 cpu_relax();
316
317 return 0;
318}
319
320static int spdif_resume(struct snd_soc_dai *cpu_dai)
321{
322 struct samsung_spdif_info *spdif = to_info(cpu_dai);
323
324 dev_dbg(spdif->dev, "Entered %s\n", __func__);
325
326 writel(spdif->saved_clkcon, spdif->regs + CLKCON);
327 writel(spdif->saved_con, spdif->regs + CON);
328 writel(spdif->saved_cstas, spdif->regs + CSTAS);
329
330 return 0;
331}
332#else
333#define spdif_suspend NULL
334#define spdif_resume NULL
335#endif
336
337static struct snd_soc_dai_ops spdif_dai_ops = {
338 .set_sysclk = spdif_set_sysclk,
339 .trigger = spdif_trigger,
340 .hw_params = spdif_hw_params,
341 .shutdown = spdif_shutdown,
342};
343
344struct snd_soc_dai_driver samsung_spdif_dai = {
345 .name = "samsung-spdif",
346 .playback = {
347 .stream_name = "S/PDIF Playback",
348 .channels_min = 2,
349 .channels_max = 2,
350 .rates = (SNDRV_PCM_RATE_32000 |
351 SNDRV_PCM_RATE_44100 |
352 SNDRV_PCM_RATE_48000 |
353 SNDRV_PCM_RATE_96000),
354 .formats = SNDRV_PCM_FMTBIT_S16_LE, },
355 .ops = &spdif_dai_ops,
356 .suspend = spdif_suspend,
357 .resume = spdif_resume,
358};
359
360static __devinit int spdif_probe(struct platform_device *pdev)
361{
362 struct s3c_audio_pdata *spdif_pdata;
363 struct resource *mem_res, *dma_res;
364 struct samsung_spdif_info *spdif;
365 int ret;
366
367 spdif_pdata = pdev->dev.platform_data;
368
369 dev_dbg(&pdev->dev, "Entered %s\n", __func__);
370
371 dma_res = platform_get_resource(pdev, IORESOURCE_DMA, 0);
372 if (!dma_res) {
373 dev_err(&pdev->dev, "Unable to get dma resource.\n");
374 return -ENXIO;
375 }
376
377 mem_res = platform_get_resource(pdev, IORESOURCE_MEM, 0);
378 if (!mem_res) {
379 dev_err(&pdev->dev, "Unable to get register resource.\n");
380 return -ENXIO;
381 }
382
383 if (spdif_pdata && spdif_pdata->cfg_gpio
384 && spdif_pdata->cfg_gpio(pdev)) {
385 dev_err(&pdev->dev, "Unable to configure GPIO pins\n");
386 return -EINVAL;
387 }
388
389 spdif = &spdif_info;
390 spdif->dev = &pdev->dev;
391
392 spin_lock_init(&spdif->lock);
393
394 spdif->pclk = clk_get(&pdev->dev, "spdif");
395 if (IS_ERR(spdif->pclk)) {
396 dev_err(&pdev->dev, "failed to get peri-clock\n");
397 ret = -ENOENT;
398 goto err0;
399 }
400 clk_enable(spdif->pclk);
401
402 spdif->sclk = clk_get(&pdev->dev, "sclk_spdif");
403 if (IS_ERR(spdif->sclk)) {
404 dev_err(&pdev->dev, "failed to get internal source clock\n");
405 ret = -ENOENT;
406 goto err1;
407 }
408 clk_enable(spdif->sclk);
409
410 /* Request S/PDIF Register's memory region */
411 if (!request_mem_region(mem_res->start,
412 resource_size(mem_res), "samsung-spdif")) {
413 dev_err(&pdev->dev, "Unable to request register region\n");
414 ret = -EBUSY;
415 goto err2;
416 }
417
418 spdif->regs = ioremap(mem_res->start, 0x100);
419 if (spdif->regs == NULL) {
420 dev_err(&pdev->dev, "Cannot ioremap registers\n");
421 ret = -ENXIO;
422 goto err3;
423 }
424
425 dev_set_drvdata(&pdev->dev, spdif);
426
427 ret = snd_soc_register_dai(&pdev->dev, &samsung_spdif_dai);
428 if (ret != 0) {
429 dev_err(&pdev->dev, "fail to register dai\n");
430 goto err4;
431 }
432
433 spdif_stereo_out.dma_size = 2;
434 spdif_stereo_out.client = &spdif_dma_client_out;
435 spdif_stereo_out.dma_addr = mem_res->start + DATA_OUTBUF;
436 spdif_stereo_out.channel = dma_res->start;
437
438 spdif->dma_playback = &spdif_stereo_out;
439
440 return 0;
441
442err4:
443 iounmap(spdif->regs);
444err3:
445 release_mem_region(mem_res->start, resource_size(mem_res));
446err2:
447 clk_disable(spdif->sclk);
448 clk_put(spdif->sclk);
449err1:
450 clk_disable(spdif->pclk);
451 clk_put(spdif->pclk);
452err0:
453 return ret;
454}
455
456static __devexit int spdif_remove(struct platform_device *pdev)
457{
458 struct samsung_spdif_info *spdif = &spdif_info;
459 struct resource *mem_res;
460
461 snd_soc_unregister_dai(&pdev->dev);
462
463 iounmap(spdif->regs);
464
465 mem_res = platform_get_resource(pdev, IORESOURCE_MEM, 0);
466 if (mem_res)
467 release_mem_region(mem_res->start, resource_size(mem_res));
468
469 clk_disable(spdif->sclk);
470 clk_put(spdif->sclk);
471 clk_disable(spdif->pclk);
472 clk_put(spdif->pclk);
473
474 return 0;
475}
476
477static struct platform_driver samsung_spdif_driver = {
478 .probe = spdif_probe,
479 .remove = spdif_remove,
480 .driver = {
481 .name = "samsung-spdif",
482 .owner = THIS_MODULE,
483 },
484};
485
486static int __init spdif_init(void)
487{
488 return platform_driver_register(&samsung_spdif_driver);
489}
490module_init(spdif_init);
491
492static void __exit spdif_exit(void)
493{
494 platform_driver_unregister(&samsung_spdif_driver);
495}
496module_exit(spdif_exit);
497
498MODULE_AUTHOR("Seungwhan Youn, <sw.youn@samsung.com>");
499MODULE_DESCRIPTION("Samsung S/PDIF Controller Driver");
500MODULE_LICENSE("GPL");
501MODULE_ALIAS("platform:samsung-spdif");
diff --git a/sound/soc/s3c24xx/spdif.h b/sound/soc/s3c24xx/spdif.h
new file mode 100644
index 000000000000..3ed55592710f
--- /dev/null
+++ b/sound/soc/s3c24xx/spdif.h
@@ -0,0 +1,19 @@
1/* sound/soc/s3c24xx/spdif.h
2 *
3 * ALSA SoC Audio Layer - Samsung S/PDIF Controller driver
4 *
5 * Copyright (c) 2010 Samsung Electronics Co. Ltd
6 * http://www.samsung.com/
7 *
8 * This program is free software; you can redistribute it and/or modify
9 * it under the terms of the GNU General Public License version 2 as
10 * published by the Free Software Foundation.
11 */
12
13#ifndef __SND_SOC_SAMSUNG_SPDIF_H
14#define __SND_SOC_SAMSUNG_SPDIF_H __FILE__
15
16#define SND_SOC_SPDIF_INT_MCLK 0
17#define SND_SOC_SPDIF_EXT_MCLK 1
18
19#endif /* __SND_SOC_SAMSUNG_SPDIF_H */
diff --git a/sound/soc/sh/fsi.c b/sound/soc/sh/fsi.c
index dd9963345b93..507e709f2807 100644
--- a/sound/soc/sh/fsi.c
+++ b/sound/soc/sh/fsi.c
@@ -80,11 +80,12 @@
80#define B_CLK 0x00000010 80#define B_CLK 0x00000010
81#define A_CLK 0x00000001 81#define A_CLK 0x00000001
82 82
83/* INT_ST */ 83/* IO SHIFT / MACRO */
84#define INT_B_IN (1 << 12) 84#define BI_SHIFT 12
85#define INT_B_OUT (1 << 8) 85#define BO_SHIFT 8
86#define INT_A_IN (1 << 4) 86#define AI_SHIFT 4
87#define INT_A_OUT (1 << 0) 87#define AO_SHIFT 0
88#define AB_IO(param, shift) (param << shift)
88 89
89/* SOFT_RST */ 90/* SOFT_RST */
90#define PBSR (1 << 12) /* Port B Software Reset */ 91#define PBSR (1 << 12) /* Port B Software Reset */
@@ -93,9 +94,7 @@
93#define FSISR (1 << 0) /* Software Reset */ 94#define FSISR (1 << 0) /* Software Reset */
94 95
95/* FIFO_SZ */ 96/* FIFO_SZ */
96#define OUT_SZ_MASK 0x7 97#define FIFO_SZ_MASK 0x7
97#define BO_SZ_SHIFT 8
98#define AO_SZ_SHIFT 0
99 98
100#define FSI_RATES SNDRV_PCM_RATE_8000_96000 99#define FSI_RATES SNDRV_PCM_RATE_8000_96000
101 100
@@ -114,10 +113,8 @@
114 * struct 113 * struct
115 */ 114 */
116 115
117struct fsi_priv { 116struct fsi_stream {
118 void __iomem *base;
119 struct snd_pcm_substream *substream; 117 struct snd_pcm_substream *substream;
120 struct fsi_master *master;
121 118
122 int fifo_max_num; 119 int fifo_max_num;
123 int chan_num; 120 int chan_num;
@@ -126,6 +123,14 @@ struct fsi_priv {
126 int buff_len; 123 int buff_len;
127 int period_len; 124 int period_len;
128 int period_num; 125 int period_num;
126};
127
128struct fsi_priv {
129 void __iomem *base;
130 struct fsi_master *master;
131
132 struct fsi_stream playback;
133 struct fsi_stream capture;
129 134
130 u32 mst_ctrl; 135 u32 mst_ctrl;
131}; 136};
@@ -295,6 +300,22 @@ static u32 fsi_get_info_flags(struct fsi_priv *fsi)
295 master->info->portb_flags; 300 master->info->portb_flags;
296} 301}
297 302
303static inline int fsi_stream_is_play(int stream)
304{
305 return stream == SNDRV_PCM_STREAM_PLAYBACK;
306}
307
308static inline int fsi_is_play(struct snd_pcm_substream *substream)
309{
310 return fsi_stream_is_play(substream->stream);
311}
312
313static inline struct fsi_stream *fsi_get_stream(struct fsi_priv *fsi,
314 int is_play)
315{
316 return is_play ? &fsi->playback : &fsi->capture;
317}
318
298static int fsi_is_master_mode(struct fsi_priv *fsi, int is_play) 319static int fsi_is_master_mode(struct fsi_priv *fsi, int is_play)
299{ 320{
300 u32 mode; 321 u32 mode;
@@ -310,49 +331,55 @@ static int fsi_is_master_mode(struct fsi_priv *fsi, int is_play)
310 return (mode & flags) != mode; 331 return (mode & flags) != mode;
311} 332}
312 333
313static u32 fsi_port_ab_io_bit(struct fsi_priv *fsi, int is_play) 334static u32 fsi_get_port_shift(struct fsi_priv *fsi, int is_play)
314{ 335{
315 int is_porta = fsi_is_port_a(fsi); 336 int is_porta = fsi_is_port_a(fsi);
316 u32 data; 337 u32 shift;
317 338
318 if (is_porta) 339 if (is_porta)
319 data = is_play ? (1 << 0) : (1 << 4); 340 shift = is_play ? AO_SHIFT : AI_SHIFT;
320 else 341 else
321 data = is_play ? (1 << 8) : (1 << 12); 342 shift = is_play ? BO_SHIFT : BI_SHIFT;
322 343
323 return data; 344 return shift;
324} 345}
325 346
326static void fsi_stream_push(struct fsi_priv *fsi, 347static void fsi_stream_push(struct fsi_priv *fsi,
348 int is_play,
327 struct snd_pcm_substream *substream, 349 struct snd_pcm_substream *substream,
328 u32 buffer_len, 350 u32 buffer_len,
329 u32 period_len) 351 u32 period_len)
330{ 352{
331 fsi->substream = substream; 353 struct fsi_stream *io = fsi_get_stream(fsi, is_play);
332 fsi->buff_len = buffer_len; 354
333 fsi->buff_offset = 0; 355 io->substream = substream;
334 fsi->period_len = period_len; 356 io->buff_len = buffer_len;
335 fsi->period_num = 0; 357 io->buff_offset = 0;
358 io->period_len = period_len;
359 io->period_num = 0;
336} 360}
337 361
338static void fsi_stream_pop(struct fsi_priv *fsi) 362static void fsi_stream_pop(struct fsi_priv *fsi, int is_play)
339{ 363{
340 fsi->substream = NULL; 364 struct fsi_stream *io = fsi_get_stream(fsi, is_play);
341 fsi->buff_len = 0; 365
342 fsi->buff_offset = 0; 366 io->substream = NULL;
343 fsi->period_len = 0; 367 io->buff_len = 0;
344 fsi->period_num = 0; 368 io->buff_offset = 0;
369 io->period_len = 0;
370 io->period_num = 0;
345} 371}
346 372
347static int fsi_get_fifo_data_num(struct fsi_priv *fsi, int is_play) 373static int fsi_get_fifo_data_num(struct fsi_priv *fsi, int is_play)
348{ 374{
349 u32 status; 375 u32 status;
350 u32 reg = is_play ? DOFF_ST : DIFF_ST; 376 u32 reg = is_play ? DOFF_ST : DIFF_ST;
377 struct fsi_stream *io = fsi_get_stream(fsi, is_play);
351 int data_num; 378 int data_num;
352 379
353 status = fsi_reg_read(fsi, reg); 380 status = fsi_reg_read(fsi, reg);
354 data_num = 0x1ff & (status >> 8); 381 data_num = 0x1ff & (status >> 8);
355 data_num *= fsi->chan_num; 382 data_num *= io->chan_num;
356 383
357 return data_num; 384 return data_num;
358} 385}
@@ -368,13 +395,25 @@ static int fsi_num2len(int num, int width)
368 return num * width; 395 return num * width;
369} 396}
370 397
398static int fsi_get_frame_width(struct fsi_priv *fsi, int is_play)
399{
400 struct fsi_stream *io = fsi_get_stream(fsi, is_play);
401 struct snd_pcm_substream *substream = io->substream;
402 struct snd_pcm_runtime *runtime = substream->runtime;
403
404 return frames_to_bytes(runtime, 1) / io->chan_num;
405}
406
371/* 407/*
372 * dma function 408 * dma function
373 */ 409 */
374 410
375static u8 *fsi_dma_get_area(struct fsi_priv *fsi) 411static u8 *fsi_dma_get_area(struct fsi_priv *fsi, int stream)
376{ 412{
377 return fsi->substream->runtime->dma_area + fsi->buff_offset; 413 int is_play = fsi_stream_is_play(stream);
414 struct fsi_stream *io = fsi_get_stream(fsi, is_play);
415
416 return io->substream->runtime->dma_area + io->buff_offset;
378} 417}
379 418
380static void fsi_dma_soft_push16(struct fsi_priv *fsi, int num) 419static void fsi_dma_soft_push16(struct fsi_priv *fsi, int num)
@@ -382,7 +421,7 @@ static void fsi_dma_soft_push16(struct fsi_priv *fsi, int num)
382 u16 *start; 421 u16 *start;
383 int i; 422 int i;
384 423
385 start = (u16 *)fsi_dma_get_area(fsi); 424 start = (u16 *)fsi_dma_get_area(fsi, SNDRV_PCM_STREAM_PLAYBACK);
386 425
387 for (i = 0; i < num; i++) 426 for (i = 0; i < num; i++)
388 fsi_reg_write(fsi, DODT, ((u32)*(start + i) << 8)); 427 fsi_reg_write(fsi, DODT, ((u32)*(start + i) << 8));
@@ -393,7 +432,8 @@ static void fsi_dma_soft_pop16(struct fsi_priv *fsi, int num)
393 u16 *start; 432 u16 *start;
394 int i; 433 int i;
395 434
396 start = (u16 *)fsi_dma_get_area(fsi); 435 start = (u16 *)fsi_dma_get_area(fsi, SNDRV_PCM_STREAM_CAPTURE);
436
397 437
398 for (i = 0; i < num; i++) 438 for (i = 0; i < num; i++)
399 *(start + i) = (u16)(fsi_reg_read(fsi, DIDT) >> 8); 439 *(start + i) = (u16)(fsi_reg_read(fsi, DIDT) >> 8);
@@ -404,7 +444,8 @@ static void fsi_dma_soft_push32(struct fsi_priv *fsi, int num)
404 u32 *start; 444 u32 *start;
405 int i; 445 int i;
406 446
407 start = (u32 *)fsi_dma_get_area(fsi); 447 start = (u32 *)fsi_dma_get_area(fsi, SNDRV_PCM_STREAM_PLAYBACK);
448
408 449
409 for (i = 0; i < num; i++) 450 for (i = 0; i < num; i++)
410 fsi_reg_write(fsi, DODT, *(start + i)); 451 fsi_reg_write(fsi, DODT, *(start + i));
@@ -415,7 +456,7 @@ static void fsi_dma_soft_pop32(struct fsi_priv *fsi, int num)
415 u32 *start; 456 u32 *start;
416 int i; 457 int i;
417 458
418 start = (u32 *)fsi_dma_get_area(fsi); 459 start = (u32 *)fsi_dma_get_area(fsi, SNDRV_PCM_STREAM_CAPTURE);
419 460
420 for (i = 0; i < num; i++) 461 for (i = 0; i < num; i++)
421 *(start + i) = fsi_reg_read(fsi, DIDT); 462 *(start + i) = fsi_reg_read(fsi, DIDT);
@@ -427,7 +468,7 @@ static void fsi_dma_soft_pop32(struct fsi_priv *fsi, int num)
427 468
428static void fsi_irq_enable(struct fsi_priv *fsi, int is_play) 469static void fsi_irq_enable(struct fsi_priv *fsi, int is_play)
429{ 470{
430 u32 data = fsi_port_ab_io_bit(fsi, is_play); 471 u32 data = AB_IO(1, fsi_get_port_shift(fsi, is_play));
431 struct fsi_master *master = fsi_get_master(fsi); 472 struct fsi_master *master = fsi_get_master(fsi);
432 473
433 fsi_master_mask_set(master, master->core->imsk, data, data); 474 fsi_master_mask_set(master, master->core->imsk, data, data);
@@ -436,7 +477,7 @@ static void fsi_irq_enable(struct fsi_priv *fsi, int is_play)
436 477
437static void fsi_irq_disable(struct fsi_priv *fsi, int is_play) 478static void fsi_irq_disable(struct fsi_priv *fsi, int is_play)
438{ 479{
439 u32 data = fsi_port_ab_io_bit(fsi, is_play); 480 u32 data = AB_IO(1, fsi_get_port_shift(fsi, is_play));
440 struct fsi_master *master = fsi_get_master(fsi); 481 struct fsi_master *master = fsi_get_master(fsi);
441 482
442 fsi_master_mask_set(master, master->core->imsk, data, 0); 483 fsi_master_mask_set(master, master->core->imsk, data, 0);
@@ -458,8 +499,8 @@ static void fsi_irq_clear_status(struct fsi_priv *fsi)
458 u32 data = 0; 499 u32 data = 0;
459 struct fsi_master *master = fsi_get_master(fsi); 500 struct fsi_master *master = fsi_get_master(fsi);
460 501
461 data |= fsi_port_ab_io_bit(fsi, 0); 502 data |= AB_IO(1, fsi_get_port_shift(fsi, 0));
462 data |= fsi_port_ab_io_bit(fsi, 1); 503 data |= AB_IO(1, fsi_get_port_shift(fsi, 1));
463 504
464 /* clear interrupt factor */ 505 /* clear interrupt factor */
465 fsi_master_mask_set(master, master->core->int_st, data, 0); 506 fsi_master_mask_set(master, master->core->int_st, data, 0);
@@ -506,14 +547,15 @@ static void fsi_fifo_init(struct fsi_priv *fsi,
506 struct snd_soc_dai *dai) 547 struct snd_soc_dai *dai)
507{ 548{
508 struct fsi_master *master = fsi_get_master(fsi); 549 struct fsi_master *master = fsi_get_master(fsi);
550 struct fsi_stream *io = fsi_get_stream(fsi, is_play);
509 u32 ctrl, shift, i; 551 u32 ctrl, shift, i;
510 552
511 /* get on-chip RAM capacity */ 553 /* get on-chip RAM capacity */
512 shift = fsi_master_read(master, FIFO_SZ); 554 shift = fsi_master_read(master, FIFO_SZ);
513 shift >>= fsi_is_port_a(fsi) ? AO_SZ_SHIFT : BO_SZ_SHIFT; 555 shift >>= fsi_get_port_shift(fsi, is_play);
514 shift &= OUT_SZ_MASK; 556 shift &= FIFO_SZ_MASK;
515 fsi->fifo_max_num = 256 << shift; 557 io->fifo_max_num = 256 << shift;
516 dev_dbg(dai->dev, "fifo = %d words\n", fsi->fifo_max_num); 558 dev_dbg(dai->dev, "fifo = %d words\n", io->fifo_max_num);
517 559
518 /* 560 /*
519 * The maximum number of sample data varies depending 561 * The maximum number of sample data varies depending
@@ -534,10 +576,10 @@ static void fsi_fifo_init(struct fsi_priv *fsi,
534 * 7 channels: 32 ( 32 x 7 = 224) 576 * 7 channels: 32 ( 32 x 7 = 224)
535 * 8 channels: 32 ( 32 x 8 = 256) 577 * 8 channels: 32 ( 32 x 8 = 256)
536 */ 578 */
537 for (i = 1; i < fsi->chan_num; i <<= 1) 579 for (i = 1; i < io->chan_num; i <<= 1)
538 fsi->fifo_max_num >>= 1; 580 io->fifo_max_num >>= 1;
539 dev_dbg(dai->dev, "%d channel %d store\n", 581 dev_dbg(dai->dev, "%d channel %d store\n",
540 fsi->chan_num, fsi->fifo_max_num); 582 io->chan_num, io->fifo_max_num);
541 583
542 ctrl = is_play ? DOFF_CTL : DIFF_CTL; 584 ctrl = is_play ? DOFF_CTL : DIFF_CTL;
543 585
@@ -560,11 +602,12 @@ static void fsi_soft_all_reset(struct fsi_master *master)
560 mdelay(10); 602 mdelay(10);
561} 603}
562 604
563static int fsi_fifo_data_ctrl(struct fsi_priv *fsi, int startup, int is_play) 605static int fsi_fifo_data_ctrl(struct fsi_priv *fsi, int startup, int stream)
564{ 606{
565 struct snd_pcm_runtime *runtime; 607 struct snd_pcm_runtime *runtime;
566 struct snd_pcm_substream *substream = NULL; 608 struct snd_pcm_substream *substream = NULL;
567 u32 status; 609 int is_play = fsi_stream_is_play(stream);
610 struct fsi_stream *io = fsi_get_stream(fsi, is_play);
568 u32 status_reg = is_play ? DOFF_ST : DIFF_ST; 611 u32 status_reg = is_play ? DOFF_ST : DIFF_ST;
569 int data_residue_num; 612 int data_residue_num;
570 int data_num; 613 int data_num;
@@ -574,32 +617,32 @@ static int fsi_fifo_data_ctrl(struct fsi_priv *fsi, int startup, int is_play)
574 void (*fn)(struct fsi_priv *fsi, int size); 617 void (*fn)(struct fsi_priv *fsi, int size);
575 618
576 if (!fsi || 619 if (!fsi ||
577 !fsi->substream || 620 !io->substream ||
578 !fsi->substream->runtime) 621 !io->substream->runtime)
579 return -EINVAL; 622 return -EINVAL;
580 623
581 over_period = 0; 624 over_period = 0;
582 substream = fsi->substream; 625 substream = io->substream;
583 runtime = substream->runtime; 626 runtime = substream->runtime;
584 627
585 /* FSI FIFO has limit. 628 /* FSI FIFO has limit.
586 * So, this driver can not send periods data at a time 629 * So, this driver can not send periods data at a time
587 */ 630 */
588 if (fsi->buff_offset >= 631 if (io->buff_offset >=
589 fsi_num2offset(fsi->period_num + 1, fsi->period_len)) { 632 fsi_num2offset(io->period_num + 1, io->period_len)) {
590 633
591 over_period = 1; 634 over_period = 1;
592 fsi->period_num = (fsi->period_num + 1) % runtime->periods; 635 io->period_num = (io->period_num + 1) % runtime->periods;
593 636
594 if (0 == fsi->period_num) 637 if (0 == io->period_num)
595 fsi->buff_offset = 0; 638 io->buff_offset = 0;
596 } 639 }
597 640
598 /* get 1 channel data width */ 641 /* get 1 channel data width */
599 ch_width = frames_to_bytes(runtime, 1) / fsi->chan_num; 642 ch_width = fsi_get_frame_width(fsi, is_play);
600 643
601 /* get residue data number of alsa */ 644 /* get residue data number of alsa */
602 data_residue_num = fsi_len2num(fsi->buff_len - fsi->buff_offset, 645 data_residue_num = fsi_len2num(io->buff_len - io->buff_offset,
603 ch_width); 646 ch_width);
604 647
605 if (is_play) { 648 if (is_play) {
@@ -609,7 +652,7 @@ static int fsi_fifo_data_ctrl(struct fsi_priv *fsi, int startup, int is_play)
609 * data_num_max : number of FSI fifo free space 652 * data_num_max : number of FSI fifo free space
610 * data_num : number of ALSA residue data 653 * data_num : number of ALSA residue data
611 */ 654 */
612 data_num_max = fsi->fifo_max_num * fsi->chan_num; 655 data_num_max = io->fifo_max_num * io->chan_num;
613 data_num_max -= fsi_get_fifo_data_num(fsi, is_play); 656 data_num_max -= fsi_get_fifo_data_num(fsi, is_play);
614 657
615 data_num = data_residue_num; 658 data_num = data_residue_num;
@@ -651,12 +694,12 @@ static int fsi_fifo_data_ctrl(struct fsi_priv *fsi, int startup, int is_play)
651 fn(fsi, data_num); 694 fn(fsi, data_num);
652 695
653 /* update buff_offset */ 696 /* update buff_offset */
654 fsi->buff_offset += fsi_num2offset(data_num, ch_width); 697 io->buff_offset += fsi_num2offset(data_num, ch_width);
655 698
656 /* check fifo status */ 699 /* check fifo status */
657 status = fsi_reg_read(fsi, status_reg);
658 if (!startup) { 700 if (!startup) {
659 struct snd_soc_dai *dai = fsi_get_dai(substream); 701 struct snd_soc_dai *dai = fsi_get_dai(substream);
702 u32 status = fsi_reg_read(fsi, status_reg);
660 703
661 if (status & ERR_OVER) 704 if (status & ERR_OVER)
662 dev_err(dai->dev, "over run\n"); 705 dev_err(dai->dev, "over run\n");
@@ -676,12 +719,12 @@ static int fsi_fifo_data_ctrl(struct fsi_priv *fsi, int startup, int is_play)
676 719
677static int fsi_data_pop(struct fsi_priv *fsi, int startup) 720static int fsi_data_pop(struct fsi_priv *fsi, int startup)
678{ 721{
679 return fsi_fifo_data_ctrl(fsi, startup, 0); 722 return fsi_fifo_data_ctrl(fsi, startup, SNDRV_PCM_STREAM_CAPTURE);
680} 723}
681 724
682static int fsi_data_push(struct fsi_priv *fsi, int startup) 725static int fsi_data_push(struct fsi_priv *fsi, int startup)
683{ 726{
684 return fsi_fifo_data_ctrl(fsi, startup, 1); 727 return fsi_fifo_data_ctrl(fsi, startup, SNDRV_PCM_STREAM_PLAYBACK);
685} 728}
686 729
687static irqreturn_t fsi_interrupt(int irq, void *data) 730static irqreturn_t fsi_interrupt(int irq, void *data)
@@ -693,13 +736,13 @@ static irqreturn_t fsi_interrupt(int irq, void *data)
693 fsi_master_mask_set(master, SOFT_RST, IR, 0); 736 fsi_master_mask_set(master, SOFT_RST, IR, 0);
694 fsi_master_mask_set(master, SOFT_RST, IR, IR); 737 fsi_master_mask_set(master, SOFT_RST, IR, IR);
695 738
696 if (int_st & INT_A_OUT) 739 if (int_st & AB_IO(1, AO_SHIFT))
697 fsi_data_push(&master->fsia, 0); 740 fsi_data_push(&master->fsia, 0);
698 if (int_st & INT_B_OUT) 741 if (int_st & AB_IO(1, BO_SHIFT))
699 fsi_data_push(&master->fsib, 0); 742 fsi_data_push(&master->fsib, 0);
700 if (int_st & INT_A_IN) 743 if (int_st & AB_IO(1, AI_SHIFT))
701 fsi_data_pop(&master->fsia, 0); 744 fsi_data_pop(&master->fsia, 0);
702 if (int_st & INT_B_IN) 745 if (int_st & AB_IO(1, BI_SHIFT))
703 fsi_data_pop(&master->fsib, 0); 746 fsi_data_pop(&master->fsib, 0);
704 747
705 fsi_irq_clear_all_status(master); 748 fsi_irq_clear_all_status(master);
@@ -715,14 +758,16 @@ static int fsi_dai_startup(struct snd_pcm_substream *substream,
715 struct snd_soc_dai *dai) 758 struct snd_soc_dai *dai)
716{ 759{
717 struct fsi_priv *fsi = fsi_get_priv(substream); 760 struct fsi_priv *fsi = fsi_get_priv(substream);
718 u32 flags = fsi_get_info_flags(fsi);
719 struct fsi_master *master = fsi_get_master(fsi); 761 struct fsi_master *master = fsi_get_master(fsi);
762 struct fsi_stream *io;
763 u32 flags = fsi_get_info_flags(fsi);
720 u32 fmt; 764 u32 fmt;
721 u32 reg; 765 u32 reg;
722 u32 data; 766 u32 data;
723 int is_play = (substream->stream == SNDRV_PCM_STREAM_PLAYBACK); 767 int is_play = fsi_is_play(substream);
724 int is_master; 768 int is_master;
725 int ret = 0; 769
770 io = fsi_get_stream(fsi, is_play);
726 771
727 pm_runtime_get_sync(dai->dev); 772 pm_runtime_get_sync(dai->dev);
728 773
@@ -754,29 +799,29 @@ static int fsi_dai_startup(struct snd_pcm_substream *substream,
754 switch (fmt) { 799 switch (fmt) {
755 case SH_FSI_FMT_MONO: 800 case SH_FSI_FMT_MONO:
756 data = CR_MONO; 801 data = CR_MONO;
757 fsi->chan_num = 1; 802 io->chan_num = 1;
758 break; 803 break;
759 case SH_FSI_FMT_MONO_DELAY: 804 case SH_FSI_FMT_MONO_DELAY:
760 data = CR_MONO_D; 805 data = CR_MONO_D;
761 fsi->chan_num = 1; 806 io->chan_num = 1;
762 break; 807 break;
763 case SH_FSI_FMT_PCM: 808 case SH_FSI_FMT_PCM:
764 data = CR_PCM; 809 data = CR_PCM;
765 fsi->chan_num = 2; 810 io->chan_num = 2;
766 break; 811 break;
767 case SH_FSI_FMT_I2S: 812 case SH_FSI_FMT_I2S:
768 data = CR_I2S; 813 data = CR_I2S;
769 fsi->chan_num = 2; 814 io->chan_num = 2;
770 break; 815 break;
771 case SH_FSI_FMT_TDM: 816 case SH_FSI_FMT_TDM:
772 fsi->chan_num = is_play ? 817 io->chan_num = is_play ?
773 SH_FSI_GET_CH_O(flags) : SH_FSI_GET_CH_I(flags); 818 SH_FSI_GET_CH_O(flags) : SH_FSI_GET_CH_I(flags);
774 data = CR_TDM | (fsi->chan_num - 1); 819 data = CR_TDM | (io->chan_num - 1);
775 break; 820 break;
776 case SH_FSI_FMT_TDM_DELAY: 821 case SH_FSI_FMT_TDM_DELAY:
777 fsi->chan_num = is_play ? 822 io->chan_num = is_play ?
778 SH_FSI_GET_CH_O(flags) : SH_FSI_GET_CH_I(flags); 823 SH_FSI_GET_CH_O(flags) : SH_FSI_GET_CH_I(flags);
779 data = CR_TDM_D | (fsi->chan_num - 1); 824 data = CR_TDM_D | (io->chan_num - 1);
780 break; 825 break;
781 case SH_FSI_FMT_SPDIF: 826 case SH_FSI_FMT_SPDIF:
782 if (master->core->ver < 2) { 827 if (master->core->ver < 2) {
@@ -784,7 +829,7 @@ static int fsi_dai_startup(struct snd_pcm_substream *substream,
784 return -EINVAL; 829 return -EINVAL;
785 } 830 }
786 data = CR_SPDIF; 831 data = CR_SPDIF;
787 fsi->chan_num = 2; 832 io->chan_num = 2;
788 fsi_spdif_clk_ctrl(fsi, 1); 833 fsi_spdif_clk_ctrl(fsi, 1);
789 fsi_reg_mask_set(fsi, OUT_SEL, 0x0010, 0x0010); 834 fsi_reg_mask_set(fsi, OUT_SEL, 0x0010, 0x0010);
790 break; 835 break;
@@ -801,14 +846,14 @@ static int fsi_dai_startup(struct snd_pcm_substream *substream,
801 /* fifo init */ 846 /* fifo init */
802 fsi_fifo_init(fsi, is_play, dai); 847 fsi_fifo_init(fsi, is_play, dai);
803 848
804 return ret; 849 return 0;
805} 850}
806 851
807static void fsi_dai_shutdown(struct snd_pcm_substream *substream, 852static void fsi_dai_shutdown(struct snd_pcm_substream *substream,
808 struct snd_soc_dai *dai) 853 struct snd_soc_dai *dai)
809{ 854{
810 struct fsi_priv *fsi = fsi_get_priv(substream); 855 struct fsi_priv *fsi = fsi_get_priv(substream);
811 int is_play = substream->stream == SNDRV_PCM_STREAM_PLAYBACK; 856 int is_play = fsi_is_play(substream);
812 857
813 fsi_irq_disable(fsi, is_play); 858 fsi_irq_disable(fsi, is_play);
814 fsi_clk_ctrl(fsi, 0); 859 fsi_clk_ctrl(fsi, 0);
@@ -821,19 +866,19 @@ static int fsi_dai_trigger(struct snd_pcm_substream *substream, int cmd,
821{ 866{
822 struct fsi_priv *fsi = fsi_get_priv(substream); 867 struct fsi_priv *fsi = fsi_get_priv(substream);
823 struct snd_pcm_runtime *runtime = substream->runtime; 868 struct snd_pcm_runtime *runtime = substream->runtime;
824 int is_play = substream->stream == SNDRV_PCM_STREAM_PLAYBACK; 869 int is_play = fsi_is_play(substream);
825 int ret = 0; 870 int ret = 0;
826 871
827 switch (cmd) { 872 switch (cmd) {
828 case SNDRV_PCM_TRIGGER_START: 873 case SNDRV_PCM_TRIGGER_START:
829 fsi_stream_push(fsi, substream, 874 fsi_stream_push(fsi, is_play, substream,
830 frames_to_bytes(runtime, runtime->buffer_size), 875 frames_to_bytes(runtime, runtime->buffer_size),
831 frames_to_bytes(runtime, runtime->period_size)); 876 frames_to_bytes(runtime, runtime->period_size));
832 ret = is_play ? fsi_data_push(fsi, 1) : fsi_data_pop(fsi, 1); 877 ret = is_play ? fsi_data_push(fsi, 1) : fsi_data_pop(fsi, 1);
833 break; 878 break;
834 case SNDRV_PCM_TRIGGER_STOP: 879 case SNDRV_PCM_TRIGGER_STOP:
835 fsi_irq_disable(fsi, is_play); 880 fsi_irq_disable(fsi, is_play);
836 fsi_stream_pop(fsi); 881 fsi_stream_pop(fsi, is_play);
837 break; 882 break;
838 } 883 }
839 884
@@ -848,7 +893,7 @@ static int fsi_dai_hw_params(struct snd_pcm_substream *substream,
848 struct fsi_master *master = fsi_get_master(fsi); 893 struct fsi_master *master = fsi_get_master(fsi);
849 int (*set_rate)(int is_porta, int rate) = master->info->set_rate; 894 int (*set_rate)(int is_porta, int rate) = master->info->set_rate;
850 int fsi_ver = master->core->ver; 895 int fsi_ver = master->core->ver;
851 int is_play = (substream->stream == SNDRV_PCM_STREAM_PLAYBACK); 896 int is_play = fsi_is_play(substream);
852 int ret; 897 int ret;
853 898
854 /* if slave mode, set_rate is not needed */ 899 /* if slave mode, set_rate is not needed */
@@ -981,9 +1026,10 @@ static snd_pcm_uframes_t fsi_pointer(struct snd_pcm_substream *substream)
981{ 1026{
982 struct snd_pcm_runtime *runtime = substream->runtime; 1027 struct snd_pcm_runtime *runtime = substream->runtime;
983 struct fsi_priv *fsi = fsi_get_priv(substream); 1028 struct fsi_priv *fsi = fsi_get_priv(substream);
1029 struct fsi_stream *io = fsi_get_stream(fsi, fsi_is_play(substream));
984 long location; 1030 long location;
985 1031
986 location = (fsi->buff_offset - 1); 1032 location = (io->buff_offset - 1);
987 if (location < 0) 1033 if (location < 0)
988 location = 0; 1034 location = 0;
989 1035
diff --git a/sound/soc/soc-core.c b/sound/soc/soc-core.c
index 8751efdea119..70d9a7394b2b 100644
--- a/sound/soc/soc-core.c
+++ b/sound/soc/soc-core.c
@@ -274,15 +274,22 @@ static ssize_t codec_list_read_file(struct file *file, char __user *user_buf,
274 size_t count, loff_t *ppos) 274 size_t count, loff_t *ppos)
275{ 275{
276 char *buf = kmalloc(PAGE_SIZE, GFP_KERNEL); 276 char *buf = kmalloc(PAGE_SIZE, GFP_KERNEL);
277 ssize_t ret = 0; 277 ssize_t len, ret = 0;
278 struct snd_soc_codec *codec; 278 struct snd_soc_codec *codec;
279 279
280 if (!buf) 280 if (!buf)
281 return -ENOMEM; 281 return -ENOMEM;
282 282
283 list_for_each_entry(codec, &codec_list, list) 283 list_for_each_entry(codec, &codec_list, list) {
284 ret += snprintf(buf + ret, PAGE_SIZE - ret, "%s\n", 284 len = snprintf(buf + ret, PAGE_SIZE - ret, "%s\n",
285 codec->name); 285 codec->name);
286 if (len >= 0)
287 ret += len;
288 if (ret > PAGE_SIZE) {
289 ret = PAGE_SIZE;
290 break;
291 }
292 }
286 293
287 if (ret >= 0) 294 if (ret >= 0)
288 ret = simple_read_from_buffer(user_buf, count, ppos, buf, ret); 295 ret = simple_read_from_buffer(user_buf, count, ppos, buf, ret);
@@ -301,17 +308,23 @@ static ssize_t dai_list_read_file(struct file *file, char __user *user_buf,
301 size_t count, loff_t *ppos) 308 size_t count, loff_t *ppos)
302{ 309{
303 char *buf = kmalloc(PAGE_SIZE, GFP_KERNEL); 310 char *buf = kmalloc(PAGE_SIZE, GFP_KERNEL);
304 ssize_t ret = 0; 311 ssize_t len, ret = 0;
305 struct snd_soc_dai *dai; 312 struct snd_soc_dai *dai;
306 313
307 if (!buf) 314 if (!buf)
308 return -ENOMEM; 315 return -ENOMEM;
309 316
310 list_for_each_entry(dai, &dai_list, list) 317 list_for_each_entry(dai, &dai_list, list) {
311 ret += snprintf(buf + ret, PAGE_SIZE - ret, "%s\n", dai->name); 318 len = snprintf(buf + ret, PAGE_SIZE - ret, "%s\n", dai->name);
319 if (len >= 0)
320 ret += len;
321 if (ret > PAGE_SIZE) {
322 ret = PAGE_SIZE;
323 break;
324 }
325 }
312 326
313 if (ret >= 0) 327 ret = simple_read_from_buffer(user_buf, count, ppos, buf, ret);
314 ret = simple_read_from_buffer(user_buf, count, ppos, buf, ret);
315 328
316 kfree(buf); 329 kfree(buf);
317 330
@@ -328,18 +341,24 @@ static ssize_t platform_list_read_file(struct file *file,
328 size_t count, loff_t *ppos) 341 size_t count, loff_t *ppos)
329{ 342{
330 char *buf = kmalloc(PAGE_SIZE, GFP_KERNEL); 343 char *buf = kmalloc(PAGE_SIZE, GFP_KERNEL);
331 ssize_t ret = 0; 344 ssize_t len, ret = 0;
332 struct snd_soc_platform *platform; 345 struct snd_soc_platform *platform;
333 346
334 if (!buf) 347 if (!buf)
335 return -ENOMEM; 348 return -ENOMEM;
336 349
337 list_for_each_entry(platform, &platform_list, list) 350 list_for_each_entry(platform, &platform_list, list) {
338 ret += snprintf(buf + ret, PAGE_SIZE - ret, "%s\n", 351 len = snprintf(buf + ret, PAGE_SIZE - ret, "%s\n",
339 platform->name); 352 platform->name);
353 if (len >= 0)
354 ret += len;
355 if (ret > PAGE_SIZE) {
356 ret = PAGE_SIZE;
357 break;
358 }
359 }
340 360
341 if (ret >= 0) 361 ret = simple_read_from_buffer(user_buf, count, ppos, buf, ret);
342 ret = simple_read_from_buffer(user_buf, count, ppos, buf, ret);
343 362
344 kfree(buf); 363 kfree(buf);
345 364
@@ -1497,6 +1516,16 @@ static int soc_register_ac97_dai_link(struct snd_soc_pcm_runtime *rtd)
1497 * for the generic AC97 subsystem. 1516 * for the generic AC97 subsystem.
1498 */ 1517 */
1499 if (rtd->codec_dai->driver->ac97_control && !rtd->codec->ac97_registered) { 1518 if (rtd->codec_dai->driver->ac97_control && !rtd->codec->ac97_registered) {
1519 /*
1520 * It is possible that the AC97 device is already registered to
1521 * the device subsystem. This happens when the device is created
1522 * via snd_ac97_mixer(). Currently only SoC codec that does so
1523 * is the generic AC97 glue but others migh emerge.
1524 *
1525 * In those cases we don't try to register the device again.
1526 */
1527 if (!rtd->codec->ac97_created)
1528 return 0;
1500 1529
1501 ret = soc_ac97_dev_register(rtd->codec); 1530 ret = soc_ac97_dev_register(rtd->codec);
1502 if (ret < 0) { 1531 if (ret < 0) {
@@ -1812,6 +1841,13 @@ int snd_soc_new_ac97_codec(struct snd_soc_codec *codec,
1812 1841
1813 codec->ac97->bus->ops = ops; 1842 codec->ac97->bus->ops = ops;
1814 codec->ac97->num = num; 1843 codec->ac97->num = num;
1844
1845 /*
1846 * Mark the AC97 device to be created by us. This way we ensure that the
1847 * device will be registered with the device subsystem later on.
1848 */
1849 codec->ac97_created = 1;
1850
1815 mutex_unlock(&codec->mutex); 1851 mutex_unlock(&codec->mutex);
1816 return 0; 1852 return 0;
1817} 1853}
@@ -1832,6 +1868,7 @@ void snd_soc_free_ac97_codec(struct snd_soc_codec *codec)
1832 kfree(codec->ac97->bus); 1868 kfree(codec->ac97->bus);
1833 kfree(codec->ac97); 1869 kfree(codec->ac97);
1834 codec->ac97 = NULL; 1870 codec->ac97 = NULL;
1871 codec->ac97_created = 0;
1835 mutex_unlock(&codec->mutex); 1872 mutex_unlock(&codec->mutex);
1836} 1873}
1837EXPORT_SYMBOL_GPL(snd_soc_free_ac97_codec); 1874EXPORT_SYMBOL_GPL(snd_soc_free_ac97_codec);
@@ -2892,7 +2929,7 @@ static inline char *fmt_single_name(struct device *dev, int *id)
2892 char tmp[NAME_SIZE]; 2929 char tmp[NAME_SIZE];
2893 2930
2894 /* create unique ID number from I2C addr and bus */ 2931 /* create unique ID number from I2C addr and bus */
2895 *id = ((id1 && 0xffff) << 16) + id2; 2932 *id = ((id1 & 0xffff) << 16) + id2;
2896 2933
2897 /* sanitize component name for DAI link creation */ 2934 /* sanitize component name for DAI link creation */
2898 snprintf(tmp, NAME_SIZE, "%s.%s", dev->driver->name, name); 2935 snprintf(tmp, NAME_SIZE, "%s.%s", dev->driver->name, name);
@@ -3014,8 +3051,11 @@ int snd_soc_register_dais(struct device *dev,
3014 } 3051 }
3015 3052
3016 dai->dev = dev; 3053 dai->dev = dev;
3017 dai->id = i;
3018 dai->driver = &dai_drv[i]; 3054 dai->driver = &dai_drv[i];
3055 if (dai->driver->id)
3056 dai->id = dai->driver->id;
3057 else
3058 dai->id = i;
3019 if (!dai->driver->ops) 3059 if (!dai->driver->ops)
3020 dai->driver->ops = &null_dai_ops; 3060 dai->driver->ops = &null_dai_ops;
3021 3061
@@ -3259,6 +3299,7 @@ found:
3259 3299
3260 if (codec->reg_cache) 3300 if (codec->reg_cache)
3261 kfree(codec->reg_cache); 3301 kfree(codec->reg_cache);
3302 kfree(codec->name);
3262 kfree(codec); 3303 kfree(codec);
3263} 3304}
3264EXPORT_SYMBOL_GPL(snd_soc_unregister_codec); 3305EXPORT_SYMBOL_GPL(snd_soc_unregister_codec);
@@ -3288,6 +3329,7 @@ static int __init snd_soc_init(void)
3288 3329
3289 return platform_driver_register(&soc_driver); 3330 return platform_driver_register(&soc_driver);
3290} 3331}
3332module_init(snd_soc_init);
3291 3333
3292static void __exit snd_soc_exit(void) 3334static void __exit snd_soc_exit(void)
3293{ 3335{
@@ -3296,8 +3338,6 @@ static void __exit snd_soc_exit(void)
3296#endif 3338#endif
3297 platform_driver_unregister(&soc_driver); 3339 platform_driver_unregister(&soc_driver);
3298} 3340}
3299
3300module_init(snd_soc_init);
3301module_exit(snd_soc_exit); 3341module_exit(snd_soc_exit);
3302 3342
3303/* Module information */ 3343/* Module information */
diff --git a/sound/soc/soc-jack.c b/sound/soc/soc-jack.c
index 8862770aa221..8a0a9205b1e7 100644
--- a/sound/soc/soc-jack.c
+++ b/sound/soc/soc-jack.c
@@ -188,9 +188,6 @@ static void snd_soc_jack_gpio_detect(struct snd_soc_jack_gpio *gpio)
188 int enable; 188 int enable;
189 int report; 189 int report;
190 190
191 if (gpio->debounce_time > 0)
192 mdelay(gpio->debounce_time);
193
194 enable = gpio_get_value(gpio->gpio); 191 enable = gpio_get_value(gpio->gpio);
195 if (gpio->invert) 192 if (gpio->invert)
196 enable = !enable; 193 enable = !enable;
@@ -211,7 +208,8 @@ static irqreturn_t gpio_handler(int irq, void *data)
211{ 208{
212 struct snd_soc_jack_gpio *gpio = data; 209 struct snd_soc_jack_gpio *gpio = data;
213 210
214 schedule_work(&gpio->work); 211 schedule_delayed_work(&gpio->work,
212 msecs_to_jiffies(gpio->debounce_time));
215 213
216 return IRQ_HANDLED; 214 return IRQ_HANDLED;
217} 215}
@@ -221,7 +219,7 @@ static void gpio_work(struct work_struct *work)
221{ 219{
222 struct snd_soc_jack_gpio *gpio; 220 struct snd_soc_jack_gpio *gpio;
223 221
224 gpio = container_of(work, struct snd_soc_jack_gpio, work); 222 gpio = container_of(work, struct snd_soc_jack_gpio, work.work);
225 snd_soc_jack_gpio_detect(gpio); 223 snd_soc_jack_gpio_detect(gpio);
226} 224}
227 225
@@ -262,7 +260,7 @@ int snd_soc_jack_add_gpios(struct snd_soc_jack *jack, int count,
262 if (ret) 260 if (ret)
263 goto err; 261 goto err;
264 262
265 INIT_WORK(&gpios[i].work, gpio_work); 263 INIT_DELAYED_WORK(&gpios[i].work, gpio_work);
266 gpios[i].jack = jack; 264 gpios[i].jack = jack;
267 265
268 ret = request_irq(gpio_to_irq(gpios[i].gpio), 266 ret = request_irq(gpio_to_irq(gpios[i].gpio),
@@ -312,6 +310,7 @@ void snd_soc_jack_free_gpios(struct snd_soc_jack *jack, int count,
312 gpio_unexport(gpios[i].gpio); 310 gpio_unexport(gpios[i].gpio);
313#endif 311#endif
314 free_irq(gpio_to_irq(gpios[i].gpio), &gpios[i]); 312 free_irq(gpio_to_irq(gpios[i].gpio), &gpios[i]);
313 cancel_delayed_work_sync(&gpios[i].work);
315 gpio_free(gpios[i].gpio); 314 gpio_free(gpios[i].gpio);
316 gpios[i].jack = NULL; 315 gpios[i].jack = NULL;
317 } 316 }
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