diff options
author | Mark Brown <broonie@opensource.wolfsonmicro.com> | 2010-11-16 15:11:40 -0500 |
---|---|---|
committer | Mark Brown <broonie@opensource.wolfsonmicro.com> | 2010-11-19 06:44:41 -0500 |
commit | 7b306dae22ca377ea0020261ef13aea85b8f5f3f (patch) | |
tree | 5c051b696712cc6be085466de285418784da5cdf /sound | |
parent | 96b101efae0ab68b6510fdbb30384849d211da2c (diff) |
ASoC: Move WM8994 read/write access data into separate file
Makes the WM8994 driver file itself substantially smaller.
Signed-off-by: Mark Brown <broonie@opensource.wolfsonmicro.com>
Acked-by: Liam Girdwood <lrg@slimlogic.co.uk>
Diffstat (limited to 'sound')
-rw-r--r-- | sound/soc/codecs/Makefile | 2 | ||||
-rw-r--r-- | sound/soc/codecs/wm8994-tables.c | 1575 | ||||
-rw-r--r-- | sound/soc/codecs/wm8994.c | 1582 | ||||
-rw-r--r-- | sound/soc/codecs/wm8994.h | 9 |
4 files changed, 1588 insertions, 1580 deletions
diff --git a/sound/soc/codecs/Makefile b/sound/soc/codecs/Makefile index 42f185d233f3..3469fab2863a 100644 --- a/sound/soc/codecs/Makefile +++ b/sound/soc/codecs/Makefile | |||
@@ -60,7 +60,7 @@ snd-soc-wm8985-objs := wm8985.o | |||
60 | snd-soc-wm8988-objs := wm8988.o | 60 | snd-soc-wm8988-objs := wm8988.o |
61 | snd-soc-wm8990-objs := wm8990.o | 61 | snd-soc-wm8990-objs := wm8990.o |
62 | snd-soc-wm8993-objs := wm8993.o | 62 | snd-soc-wm8993-objs := wm8993.o |
63 | snd-soc-wm8994-objs := wm8994.o | 63 | snd-soc-wm8994-objs := wm8994.o wm8994-tables.o |
64 | snd-soc-wm9081-objs := wm9081.o | 64 | snd-soc-wm9081-objs := wm9081.o |
65 | snd-soc-wm9705-objs := wm9705.o | 65 | snd-soc-wm9705-objs := wm9705.o |
66 | snd-soc-wm9712-objs := wm9712.o | 66 | snd-soc-wm9712-objs := wm9712.o |
diff --git a/sound/soc/codecs/wm8994-tables.c b/sound/soc/codecs/wm8994-tables.c new file mode 100644 index 000000000000..7b935387aeef --- /dev/null +++ b/sound/soc/codecs/wm8994-tables.c | |||
@@ -0,0 +1,1575 @@ | |||
1 | #include "wm8994.h" | ||
2 | |||
3 | const struct wm8994_access_mask wm8994_access_masks[WM8994_CACHE_SIZE] = { | ||
4 | { 0xFFFF, 0xFFFF }, /* R0 - Software Reset */ | ||
5 | { 0x3B37, 0x3B37 }, /* R1 - Power Management (1) */ | ||
6 | { 0x6BF0, 0x6BF0 }, /* R2 - Power Management (2) */ | ||
7 | { 0x3FF0, 0x3FF0 }, /* R3 - Power Management (3) */ | ||
8 | { 0x3F3F, 0x3F3F }, /* R4 - Power Management (4) */ | ||
9 | { 0x3F0F, 0x3F0F }, /* R5 - Power Management (5) */ | ||
10 | { 0x003F, 0x003F }, /* R6 - Power Management (6) */ | ||
11 | { 0x0000, 0x0000 }, /* R7 */ | ||
12 | { 0x0000, 0x0000 }, /* R8 */ | ||
13 | { 0x0000, 0x0000 }, /* R9 */ | ||
14 | { 0x0000, 0x0000 }, /* R10 */ | ||
15 | { 0x0000, 0x0000 }, /* R11 */ | ||
16 | { 0x0000, 0x0000 }, /* R12 */ | ||
17 | { 0x0000, 0x0000 }, /* R13 */ | ||
18 | { 0x0000, 0x0000 }, /* R14 */ | ||
19 | { 0x0000, 0x0000 }, /* R15 */ | ||
20 | { 0x0000, 0x0000 }, /* R16 */ | ||
21 | { 0x0000, 0x0000 }, /* R17 */ | ||
22 | { 0x0000, 0x0000 }, /* R18 */ | ||
23 | { 0x0000, 0x0000 }, /* R19 */ | ||
24 | { 0x0000, 0x0000 }, /* R20 */ | ||
25 | { 0x01C0, 0x01C0 }, /* R21 - Input Mixer (1) */ | ||
26 | { 0x0000, 0x0000 }, /* R22 */ | ||
27 | { 0x0000, 0x0000 }, /* R23 */ | ||
28 | { 0x00DF, 0x01DF }, /* R24 - Left Line Input 1&2 Volume */ | ||
29 | { 0x00DF, 0x01DF }, /* R25 - Left Line Input 3&4 Volume */ | ||
30 | { 0x00DF, 0x01DF }, /* R26 - Right Line Input 1&2 Volume */ | ||
31 | { 0x00DF, 0x01DF }, /* R27 - Right Line Input 3&4 Volume */ | ||
32 | { 0x00FF, 0x01FF }, /* R28 - Left Output Volume */ | ||
33 | { 0x00FF, 0x01FF }, /* R29 - Right Output Volume */ | ||
34 | { 0x0077, 0x0077 }, /* R30 - Line Outputs Volume */ | ||
35 | { 0x0030, 0x0030 }, /* R31 - HPOUT2 Volume */ | ||
36 | { 0x00FF, 0x01FF }, /* R32 - Left OPGA Volume */ | ||
37 | { 0x00FF, 0x01FF }, /* R33 - Right OPGA Volume */ | ||
38 | { 0x007F, 0x007F }, /* R34 - SPKMIXL Attenuation */ | ||
39 | { 0x017F, 0x017F }, /* R35 - SPKMIXR Attenuation */ | ||
40 | { 0x003F, 0x003F }, /* R36 - SPKOUT Mixers */ | ||
41 | { 0x003F, 0x003F }, /* R37 - ClassD */ | ||
42 | { 0x00FF, 0x01FF }, /* R38 - Speaker Volume Left */ | ||
43 | { 0x00FF, 0x01FF }, /* R39 - Speaker Volume Right */ | ||
44 | { 0x00FF, 0x00FF }, /* R40 - Input Mixer (2) */ | ||
45 | { 0x01B7, 0x01B7 }, /* R41 - Input Mixer (3) */ | ||
46 | { 0x01B7, 0x01B7 }, /* R42 - Input Mixer (4) */ | ||
47 | { 0x01C7, 0x01C7 }, /* R43 - Input Mixer (5) */ | ||
48 | { 0x01C7, 0x01C7 }, /* R44 - Input Mixer (6) */ | ||
49 | { 0x01FF, 0x01FF }, /* R45 - Output Mixer (1) */ | ||
50 | { 0x01FF, 0x01FF }, /* R46 - Output Mixer (2) */ | ||
51 | { 0x0FFF, 0x0FFF }, /* R47 - Output Mixer (3) */ | ||
52 | { 0x0FFF, 0x0FFF }, /* R48 - Output Mixer (4) */ | ||
53 | { 0x0FFF, 0x0FFF }, /* R49 - Output Mixer (5) */ | ||
54 | { 0x0FFF, 0x0FFF }, /* R50 - Output Mixer (6) */ | ||
55 | { 0x0038, 0x0038 }, /* R51 - HPOUT2 Mixer */ | ||
56 | { 0x0077, 0x0077 }, /* R52 - Line Mixer (1) */ | ||
57 | { 0x0077, 0x0077 }, /* R53 - Line Mixer (2) */ | ||
58 | { 0x03FF, 0x03FF }, /* R54 - Speaker Mixer */ | ||
59 | { 0x00C1, 0x00C1 }, /* R55 - Additional Control */ | ||
60 | { 0x00F0, 0x00F0 }, /* R56 - AntiPOP (1) */ | ||
61 | { 0x01EF, 0x01EF }, /* R57 - AntiPOP (2) */ | ||
62 | { 0x00FF, 0x00FF }, /* R58 - MICBIAS */ | ||
63 | { 0x000F, 0x000F }, /* R59 - LDO 1 */ | ||
64 | { 0x0007, 0x0007 }, /* R60 - LDO 2 */ | ||
65 | { 0x0000, 0x0000 }, /* R61 */ | ||
66 | { 0x0000, 0x0000 }, /* R62 */ | ||
67 | { 0x0000, 0x0000 }, /* R63 */ | ||
68 | { 0x0000, 0x0000 }, /* R64 */ | ||
69 | { 0x0000, 0x0000 }, /* R65 */ | ||
70 | { 0x0000, 0x0000 }, /* R66 */ | ||
71 | { 0x0000, 0x0000 }, /* R67 */ | ||
72 | { 0x0000, 0x0000 }, /* R68 */ | ||
73 | { 0x0000, 0x0000 }, /* R69 */ | ||
74 | { 0x0000, 0x0000 }, /* R70 */ | ||
75 | { 0x0000, 0x0000 }, /* R71 */ | ||
76 | { 0x0000, 0x0000 }, /* R72 */ | ||
77 | { 0x0000, 0x0000 }, /* R73 */ | ||
78 | { 0x0000, 0x0000 }, /* R74 */ | ||
79 | { 0x0000, 0x0000 }, /* R75 */ | ||
80 | { 0x8000, 0x8000 }, /* R76 - Charge Pump (1) */ | ||
81 | { 0x0000, 0x0000 }, /* R77 */ | ||
82 | { 0x0000, 0x0000 }, /* R78 */ | ||
83 | { 0x0000, 0x0000 }, /* R79 */ | ||
84 | { 0x0000, 0x0000 }, /* R80 */ | ||
85 | { 0x0301, 0x0301 }, /* R81 - Class W (1) */ | ||
86 | { 0x0000, 0x0000 }, /* R82 */ | ||
87 | { 0x0000, 0x0000 }, /* R83 */ | ||
88 | { 0x333F, 0x333F }, /* R84 - DC Servo (1) */ | ||
89 | { 0x0FEF, 0x0FEF }, /* R85 - DC Servo (2) */ | ||
90 | { 0x0000, 0x0000 }, /* R86 */ | ||
91 | { 0xFFFF, 0xFFFF }, /* R87 - DC Servo (4) */ | ||
92 | { 0x0333, 0x0000 }, /* R88 - DC Servo Readback */ | ||
93 | { 0x0000, 0x0000 }, /* R89 */ | ||
94 | { 0x0000, 0x0000 }, /* R90 */ | ||
95 | { 0x0000, 0x0000 }, /* R91 */ | ||
96 | { 0x0000, 0x0000 }, /* R92 */ | ||
97 | { 0x0000, 0x0000 }, /* R93 */ | ||
98 | { 0x0000, 0x0000 }, /* R94 */ | ||
99 | { 0x0000, 0x0000 }, /* R95 */ | ||
100 | { 0x00EE, 0x00EE }, /* R96 - Analogue HP (1) */ | ||
101 | { 0x0000, 0x0000 }, /* R97 */ | ||
102 | { 0x0000, 0x0000 }, /* R98 */ | ||
103 | { 0x0000, 0x0000 }, /* R99 */ | ||
104 | { 0x0000, 0x0000 }, /* R100 */ | ||
105 | { 0x0000, 0x0000 }, /* R101 */ | ||
106 | { 0x0000, 0x0000 }, /* R102 */ | ||
107 | { 0x0000, 0x0000 }, /* R103 */ | ||
108 | { 0x0000, 0x0000 }, /* R104 */ | ||
109 | { 0x0000, 0x0000 }, /* R105 */ | ||
110 | { 0x0000, 0x0000 }, /* R106 */ | ||
111 | { 0x0000, 0x0000 }, /* R107 */ | ||
112 | { 0x0000, 0x0000 }, /* R108 */ | ||
113 | { 0x0000, 0x0000 }, /* R109 */ | ||
114 | { 0x0000, 0x0000 }, /* R110 */ | ||
115 | { 0x0000, 0x0000 }, /* R111 */ | ||
116 | { 0x0000, 0x0000 }, /* R112 */ | ||
117 | { 0x0000, 0x0000 }, /* R113 */ | ||
118 | { 0x0000, 0x0000 }, /* R114 */ | ||
119 | { 0x0000, 0x0000 }, /* R115 */ | ||
120 | { 0x0000, 0x0000 }, /* R116 */ | ||
121 | { 0x0000, 0x0000 }, /* R117 */ | ||
122 | { 0x0000, 0x0000 }, /* R118 */ | ||
123 | { 0x0000, 0x0000 }, /* R119 */ | ||
124 | { 0x0000, 0x0000 }, /* R120 */ | ||
125 | { 0x0000, 0x0000 }, /* R121 */ | ||
126 | { 0x0000, 0x0000 }, /* R122 */ | ||
127 | { 0x0000, 0x0000 }, /* R123 */ | ||
128 | { 0x0000, 0x0000 }, /* R124 */ | ||
129 | { 0x0000, 0x0000 }, /* R125 */ | ||
130 | { 0x0000, 0x0000 }, /* R126 */ | ||
131 | { 0x0000, 0x0000 }, /* R127 */ | ||
132 | { 0x0000, 0x0000 }, /* R128 */ | ||
133 | { 0x0000, 0x0000 }, /* R129 */ | ||
134 | { 0x0000, 0x0000 }, /* R130 */ | ||
135 | { 0x0000, 0x0000 }, /* R131 */ | ||
136 | { 0x0000, 0x0000 }, /* R132 */ | ||
137 | { 0x0000, 0x0000 }, /* R133 */ | ||
138 | { 0x0000, 0x0000 }, /* R134 */ | ||
139 | { 0x0000, 0x0000 }, /* R135 */ | ||
140 | { 0x0000, 0x0000 }, /* R136 */ | ||
141 | { 0x0000, 0x0000 }, /* R137 */ | ||
142 | { 0x0000, 0x0000 }, /* R138 */ | ||
143 | { 0x0000, 0x0000 }, /* R139 */ | ||
144 | { 0x0000, 0x0000 }, /* R140 */ | ||
145 | { 0x0000, 0x0000 }, /* R141 */ | ||
146 | { 0x0000, 0x0000 }, /* R142 */ | ||
147 | { 0x0000, 0x0000 }, /* R143 */ | ||
148 | { 0x0000, 0x0000 }, /* R144 */ | ||
149 | { 0x0000, 0x0000 }, /* R145 */ | ||
150 | { 0x0000, 0x0000 }, /* R146 */ | ||
151 | { 0x0000, 0x0000 }, /* R147 */ | ||
152 | { 0x0000, 0x0000 }, /* R148 */ | ||
153 | { 0x0000, 0x0000 }, /* R149 */ | ||
154 | { 0x0000, 0x0000 }, /* R150 */ | ||
155 | { 0x0000, 0x0000 }, /* R151 */ | ||
156 | { 0x0000, 0x0000 }, /* R152 */ | ||
157 | { 0x0000, 0x0000 }, /* R153 */ | ||
158 | { 0x0000, 0x0000 }, /* R154 */ | ||
159 | { 0x0000, 0x0000 }, /* R155 */ | ||
160 | { 0x0000, 0x0000 }, /* R156 */ | ||
161 | { 0x0000, 0x0000 }, /* R157 */ | ||
162 | { 0x0000, 0x0000 }, /* R158 */ | ||
163 | { 0x0000, 0x0000 }, /* R159 */ | ||
164 | { 0x0000, 0x0000 }, /* R160 */ | ||
165 | { 0x0000, 0x0000 }, /* R161 */ | ||
166 | { 0x0000, 0x0000 }, /* R162 */ | ||
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168 | { 0x0000, 0x0000 }, /* R164 */ | ||
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170 | { 0x0000, 0x0000 }, /* R166 */ | ||
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179 | { 0x0000, 0x0000 }, /* R175 */ | ||
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521 | { 0x003F, 0x003F }, /* R517 - AIF2 Clocking (2) */ | ||
522 | { 0x0000, 0x0000 }, /* R518 */ | ||
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524 | { 0x001F, 0x001F }, /* R520 - Clocking (1) */ | ||
525 | { 0x0777, 0x0777 }, /* R521 - Clocking (2) */ | ||
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534 | { 0x000F, 0x0000 }, /* R530 - Rate Status */ | ||
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539 | { 0x0000, 0x0000 }, /* R535 */ | ||
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546 | { 0x0000, 0x0000 }, /* R542 */ | ||
547 | { 0x0000, 0x0000 }, /* R543 */ | ||
548 | { 0x0007, 0x0007 }, /* R544 - FLL1 Control (1) */ | ||
549 | { 0x3F77, 0x3F77 }, /* R545 - FLL1 Control (2) */ | ||
550 | { 0xFFFF, 0xFFFF }, /* R546 - FLL1 Control (3) */ | ||
551 | { 0x7FEF, 0x7FEF }, /* R547 - FLL1 Control (4) */ | ||
552 | { 0x1FDB, 0x1FDB }, /* R548 - FLL1 Control (5) */ | ||
553 | { 0x0000, 0x0000 }, /* R549 */ | ||
554 | { 0x0000, 0x0000 }, /* R550 */ | ||
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557 | { 0x0000, 0x0000 }, /* R553 */ | ||
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559 | { 0x0000, 0x0000 }, /* R555 */ | ||
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577 | { 0x0000, 0x0000 }, /* R573 */ | ||
578 | { 0x0000, 0x0000 }, /* R574 */ | ||
579 | { 0x0000, 0x0000 }, /* R575 */ | ||
580 | { 0x0007, 0x0007 }, /* R576 - FLL2 Control (1) */ | ||
581 | { 0x3F77, 0x3F77 }, /* R577 - FLL2 Control (2) */ | ||
582 | { 0xFFFF, 0xFFFF }, /* R578 - FLL2 Control (3) */ | ||
583 | { 0x7FEF, 0x7FEF }, /* R579 - FLL2 Control (4) */ | ||
584 | { 0x1FDB, 0x1FDB }, /* R580 - FLL2 Control (5) */ | ||
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1162 | { 0xFFFF, 0xFFFF }, /* R1158 - AIF1 DAC1 EQ Band 2 B */ | ||
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1175 | { 0xFFFF, 0xFFFF }, /* R1171 - AIF1 DAC1 EQ Band 5 PG */ | ||
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1189 | { 0xFFC0, 0xFFC0 }, /* R1185 - AIF1 DAC2 EQ Gains (2) */ | ||
1190 | { 0xFFFF, 0xFFFF }, /* R1186 - AIF1 DAC2 EQ Band 1 A */ | ||
1191 | { 0xFFFF, 0xFFFF }, /* R1187 - AIF1 DAC2 EQ Band 1 B */ | ||
1192 | { 0xFFFF, 0xFFFF }, /* R1188 - AIF1 DAC2 EQ Band 1 PG */ | ||
1193 | { 0xFFFF, 0xFFFF }, /* R1189 - AIF1 DAC2 EQ Band 2 A */ | ||
1194 | { 0xFFFF, 0xFFFF }, /* R1190 - AIF1 DAC2 EQ Band 2 B */ | ||
1195 | { 0xFFFF, 0xFFFF }, /* R1191 - AIF1 DAC2 EQ Band 2 C */ | ||
1196 | { 0xFFFF, 0xFFFF }, /* R1192 - AIF1 DAC2 EQ Band 2 PG */ | ||
1197 | { 0xFFFF, 0xFFFF }, /* R1193 - AIF1 DAC2 EQ Band 3 A */ | ||
1198 | { 0xFFFF, 0xFFFF }, /* R1194 - AIF1 DAC2 EQ Band 3 B */ | ||
1199 | { 0xFFFF, 0xFFFF }, /* R1195 - AIF1 DAC2 EQ Band 3 C */ | ||
1200 | { 0xFFFF, 0xFFFF }, /* R1196 - AIF1 DAC2 EQ Band 3 PG */ | ||
1201 | { 0xFFFF, 0xFFFF }, /* R1197 - AIF1 DAC2 EQ Band 4 A */ | ||
1202 | { 0xFFFF, 0xFFFF }, /* R1198 - AIF1 DAC2 EQ Band 4 B */ | ||
1203 | { 0xFFFF, 0xFFFF }, /* R1199 - AIF1 DAC2 EQ Band 4 C */ | ||
1204 | { 0xFFFF, 0xFFFF }, /* R1200 - AIF1 DAC2 EQ Band 4 PG */ | ||
1205 | { 0xFFFF, 0xFFFF }, /* R1201 - AIF1 DAC2 EQ Band 5 A */ | ||
1206 | { 0xFFFF, 0xFFFF }, /* R1202 - AIF1 DAC2 EQ Band 5 B */ | ||
1207 | { 0xFFFF, 0xFFFF }, /* R1203 - AIF1 DAC2 EQ Band 5 PG */ | ||
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1348 | { 0xFFFF, 0xFFFF }, /* R1344 - AIF2 DRC (1) */ | ||
1349 | { 0x1FFF, 0x1FFF }, /* R1345 - AIF2 DRC (2) */ | ||
1350 | { 0xFFFF, 0xFFFF }, /* R1346 - AIF2 DRC (3) */ | ||
1351 | { 0x07FF, 0x07FF }, /* R1347 - AIF2 DRC (4) */ | ||
1352 | { 0x03FF, 0x03FF }, /* R1348 - AIF2 DRC (5) */ | ||
1353 | { 0x0000, 0x0000 }, /* R1349 */ | ||
1354 | { 0x0000, 0x0000 }, /* R1350 */ | ||
1355 | { 0x0000, 0x0000 }, /* R1351 */ | ||
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1357 | { 0x0000, 0x0000 }, /* R1353 */ | ||
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1360 | { 0x0000, 0x0000 }, /* R1356 */ | ||
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1410 | { 0x0000, 0x0000 }, /* R1406 */ | ||
1411 | { 0x0000, 0x0000 }, /* R1407 */ | ||
1412 | { 0xFFFF, 0xFFFF }, /* R1408 - AIF2 EQ Gains (1) */ | ||
1413 | { 0xFFC0, 0xFFC0 }, /* R1409 - AIF2 EQ Gains (2) */ | ||
1414 | { 0xFFFF, 0xFFFF }, /* R1410 - AIF2 EQ Band 1 A */ | ||
1415 | { 0xFFFF, 0xFFFF }, /* R1411 - AIF2 EQ Band 1 B */ | ||
1416 | { 0xFFFF, 0xFFFF }, /* R1412 - AIF2 EQ Band 1 PG */ | ||
1417 | { 0xFFFF, 0xFFFF }, /* R1413 - AIF2 EQ Band 2 A */ | ||
1418 | { 0xFFFF, 0xFFFF }, /* R1414 - AIF2 EQ Band 2 B */ | ||
1419 | { 0xFFFF, 0xFFFF }, /* R1415 - AIF2 EQ Band 2 C */ | ||
1420 | { 0xFFFF, 0xFFFF }, /* R1416 - AIF2 EQ Band 2 PG */ | ||
1421 | { 0xFFFF, 0xFFFF }, /* R1417 - AIF2 EQ Band 3 A */ | ||
1422 | { 0xFFFF, 0xFFFF }, /* R1418 - AIF2 EQ Band 3 B */ | ||
1423 | { 0xFFFF, 0xFFFF }, /* R1419 - AIF2 EQ Band 3 C */ | ||
1424 | { 0xFFFF, 0xFFFF }, /* R1420 - AIF2 EQ Band 3 PG */ | ||
1425 | { 0xFFFF, 0xFFFF }, /* R1421 - AIF2 EQ Band 4 A */ | ||
1426 | { 0xFFFF, 0xFFFF }, /* R1422 - AIF2 EQ Band 4 B */ | ||
1427 | { 0xFFFF, 0xFFFF }, /* R1423 - AIF2 EQ Band 4 C */ | ||
1428 | { 0xFFFF, 0xFFFF }, /* R1424 - AIF2 EQ Band 4 PG */ | ||
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1430 | { 0xFFFF, 0xFFFF }, /* R1426 - AIF2 EQ Band 5 B */ | ||
1431 | { 0xFFFF, 0xFFFF }, /* R1427 - AIF2 EQ Band 5 PG */ | ||
1432 | { 0x0000, 0x0000 }, /* R1428 */ | ||
1433 | { 0x0000, 0x0000 }, /* R1429 */ | ||
1434 | { 0x0000, 0x0000 }, /* R1430 */ | ||
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1443 | { 0x0000, 0x0000 }, /* R1439 */ | ||
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1445 | { 0x0000, 0x0000 }, /* R1441 */ | ||
1446 | { 0x0000, 0x0000 }, /* R1442 */ | ||
1447 | { 0x0000, 0x0000 }, /* R1443 */ | ||
1448 | { 0x0000, 0x0000 }, /* R1444 */ | ||
1449 | { 0x0000, 0x0000 }, /* R1445 */ | ||
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1503 | { 0x0000, 0x0000 }, /* R1499 */ | ||
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1519 | { 0x0000, 0x0000 }, /* R1515 */ | ||
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1524 | { 0x0000, 0x0000 }, /* R1520 */ | ||
1525 | { 0x0000, 0x0000 }, /* R1521 */ | ||
1526 | { 0x0000, 0x0000 }, /* R1522 */ | ||
1527 | { 0x0000, 0x0000 }, /* R1523 */ | ||
1528 | { 0x0000, 0x0000 }, /* R1524 */ | ||
1529 | { 0x0000, 0x0000 }, /* R1525 */ | ||
1530 | { 0x0000, 0x0000 }, /* R1526 */ | ||
1531 | { 0x0000, 0x0000 }, /* R1527 */ | ||
1532 | { 0x0000, 0x0000 }, /* R1528 */ | ||
1533 | { 0x0000, 0x0000 }, /* R1529 */ | ||
1534 | { 0x0000, 0x0000 }, /* R1530 */ | ||
1535 | { 0x0000, 0x0000 }, /* R1531 */ | ||
1536 | { 0x0000, 0x0000 }, /* R1532 */ | ||
1537 | { 0x0000, 0x0000 }, /* R1533 */ | ||
1538 | { 0x0000, 0x0000 }, /* R1534 */ | ||
1539 | { 0x0000, 0x0000 }, /* R1535 */ | ||
1540 | { 0x01EF, 0x01EF }, /* R1536 - DAC1 Mixer Volumes */ | ||
1541 | { 0x0037, 0x0037 }, /* R1537 - DAC1 Left Mixer Routing */ | ||
1542 | { 0x0037, 0x0037 }, /* R1538 - DAC1 Right Mixer Routing */ | ||
1543 | { 0x01EF, 0x01EF }, /* R1539 - DAC2 Mixer Volumes */ | ||
1544 | { 0x0037, 0x0037 }, /* R1540 - DAC2 Left Mixer Routing */ | ||
1545 | { 0x0037, 0x0037 }, /* R1541 - DAC2 Right Mixer Routing */ | ||
1546 | { 0x0003, 0x0003 }, /* R1542 - AIF1 ADC1 Left Mixer Routing */ | ||
1547 | { 0x0003, 0x0003 }, /* R1543 - AIF1 ADC1 Right Mixer Routing */ | ||
1548 | { 0x0003, 0x0003 }, /* R1544 - AIF1 ADC2 Left Mixer Routing */ | ||
1549 | { 0x0003, 0x0003 }, /* R1545 - AIF1 ADC2 Right mixer Routing */ | ||
1550 | { 0x0000, 0x0000 }, /* R1546 */ | ||
1551 | { 0x0000, 0x0000 }, /* R1547 */ | ||
1552 | { 0x0000, 0x0000 }, /* R1548 */ | ||
1553 | { 0x0000, 0x0000 }, /* R1549 */ | ||
1554 | { 0x0000, 0x0000 }, /* R1550 */ | ||
1555 | { 0x0000, 0x0000 }, /* R1551 */ | ||
1556 | { 0x02FF, 0x03FF }, /* R1552 - DAC1 Left Volume */ | ||
1557 | { 0x02FF, 0x03FF }, /* R1553 - DAC1 Right Volume */ | ||
1558 | { 0x02FF, 0x03FF }, /* R1554 - DAC2 Left Volume */ | ||
1559 | { 0x02FF, 0x03FF }, /* R1555 - DAC2 Right Volume */ | ||
1560 | { 0x0003, 0x0003 }, /* R1556 - DAC Softmute */ | ||
1561 | { 0x0000, 0x0000 }, /* R1557 */ | ||
1562 | { 0x0000, 0x0000 }, /* R1558 */ | ||
1563 | { 0x0000, 0x0000 }, /* R1559 */ | ||
1564 | { 0x0000, 0x0000 }, /* R1560 */ | ||
1565 | { 0x0000, 0x0000 }, /* R1561 */ | ||
1566 | { 0x0000, 0x0000 }, /* R1562 */ | ||
1567 | { 0x0000, 0x0000 }, /* R1563 */ | ||
1568 | { 0x0000, 0x0000 }, /* R1564 */ | ||
1569 | { 0x0000, 0x0000 }, /* R1565 */ | ||
1570 | { 0x0000, 0x0000 }, /* R1566 */ | ||
1571 | { 0x0000, 0x0000 }, /* R1567 */ | ||
1572 | { 0x0003, 0x0003 }, /* R1568 - Oversampling */ | ||
1573 | { 0x03C3, 0x03C3 }, /* R1569 - Sidetone */ | ||
1574 | }; | ||
1575 | |||
diff --git a/sound/soc/codecs/wm8994.c b/sound/soc/codecs/wm8994.c index 7d2f488de6a7..189f00079d31 100644 --- a/sound/soc/codecs/wm8994.c +++ b/sound/soc/codecs/wm8994.c | |||
@@ -98,1582 +98,6 @@ struct wm8994_priv { | |||
98 | struct wm8994_pdata *pdata; | 98 | struct wm8994_pdata *pdata; |
99 | }; | 99 | }; |
100 | 100 | ||
101 | static const struct { | ||
102 | unsigned short readable; /* Mask of readable bits */ | ||
103 | unsigned short writable; /* Mask of writable bits */ | ||
104 | } access_masks[] = { | ||
105 | { 0xFFFF, 0xFFFF }, /* R0 - Software Reset */ | ||
106 | { 0x3B37, 0x3B37 }, /* R1 - Power Management (1) */ | ||
107 | { 0x6BF0, 0x6BF0 }, /* R2 - Power Management (2) */ | ||
108 | { 0x3FF0, 0x3FF0 }, /* R3 - Power Management (3) */ | ||
109 | { 0x3F3F, 0x3F3F }, /* R4 - Power Management (4) */ | ||
110 | { 0x3F0F, 0x3F0F }, /* R5 - Power Management (5) */ | ||
111 | { 0x003F, 0x003F }, /* R6 - Power Management (6) */ | ||
112 | { 0x0000, 0x0000 }, /* R7 */ | ||
113 | { 0x0000, 0x0000 }, /* R8 */ | ||
114 | { 0x0000, 0x0000 }, /* R9 */ | ||
115 | { 0x0000, 0x0000 }, /* R10 */ | ||
116 | { 0x0000, 0x0000 }, /* R11 */ | ||
117 | { 0x0000, 0x0000 }, /* R12 */ | ||
118 | { 0x0000, 0x0000 }, /* R13 */ | ||
119 | { 0x0000, 0x0000 }, /* R14 */ | ||
120 | { 0x0000, 0x0000 }, /* R15 */ | ||
121 | { 0x0000, 0x0000 }, /* R16 */ | ||
122 | { 0x0000, 0x0000 }, /* R17 */ | ||
123 | { 0x0000, 0x0000 }, /* R18 */ | ||
124 | { 0x0000, 0x0000 }, /* R19 */ | ||
125 | { 0x0000, 0x0000 }, /* R20 */ | ||
126 | { 0x01C0, 0x01C0 }, /* R21 - Input Mixer (1) */ | ||
127 | { 0x0000, 0x0000 }, /* R22 */ | ||
128 | { 0x0000, 0x0000 }, /* R23 */ | ||
129 | { 0x00DF, 0x01DF }, /* R24 - Left Line Input 1&2 Volume */ | ||
130 | { 0x00DF, 0x01DF }, /* R25 - Left Line Input 3&4 Volume */ | ||
131 | { 0x00DF, 0x01DF }, /* R26 - Right Line Input 1&2 Volume */ | ||
132 | { 0x00DF, 0x01DF }, /* R27 - Right Line Input 3&4 Volume */ | ||
133 | { 0x00FF, 0x01FF }, /* R28 - Left Output Volume */ | ||
134 | { 0x00FF, 0x01FF }, /* R29 - Right Output Volume */ | ||
135 | { 0x0077, 0x0077 }, /* R30 - Line Outputs Volume */ | ||
136 | { 0x0030, 0x0030 }, /* R31 - HPOUT2 Volume */ | ||
137 | { 0x00FF, 0x01FF }, /* R32 - Left OPGA Volume */ | ||
138 | { 0x00FF, 0x01FF }, /* R33 - Right OPGA Volume */ | ||
139 | { 0x007F, 0x007F }, /* R34 - SPKMIXL Attenuation */ | ||
140 | { 0x017F, 0x017F }, /* R35 - SPKMIXR Attenuation */ | ||
141 | { 0x003F, 0x003F }, /* R36 - SPKOUT Mixers */ | ||
142 | { 0x003F, 0x003F }, /* R37 - ClassD */ | ||
143 | { 0x00FF, 0x01FF }, /* R38 - Speaker Volume Left */ | ||
144 | { 0x00FF, 0x01FF }, /* R39 - Speaker Volume Right */ | ||
145 | { 0x00FF, 0x00FF }, /* R40 - Input Mixer (2) */ | ||
146 | { 0x01B7, 0x01B7 }, /* R41 - Input Mixer (3) */ | ||
147 | { 0x01B7, 0x01B7 }, /* R42 - Input Mixer (4) */ | ||
148 | { 0x01C7, 0x01C7 }, /* R43 - Input Mixer (5) */ | ||
149 | { 0x01C7, 0x01C7 }, /* R44 - Input Mixer (6) */ | ||
150 | { 0x01FF, 0x01FF }, /* R45 - Output Mixer (1) */ | ||
151 | { 0x01FF, 0x01FF }, /* R46 - Output Mixer (2) */ | ||
152 | { 0x0FFF, 0x0FFF }, /* R47 - Output Mixer (3) */ | ||
153 | { 0x0FFF, 0x0FFF }, /* R48 - Output Mixer (4) */ | ||
154 | { 0x0FFF, 0x0FFF }, /* R49 - Output Mixer (5) */ | ||
155 | { 0x0FFF, 0x0FFF }, /* R50 - Output Mixer (6) */ | ||
156 | { 0x0038, 0x0038 }, /* R51 - HPOUT2 Mixer */ | ||
157 | { 0x0077, 0x0077 }, /* R52 - Line Mixer (1) */ | ||
158 | { 0x0077, 0x0077 }, /* R53 - Line Mixer (2) */ | ||
159 | { 0x03FF, 0x03FF }, /* R54 - Speaker Mixer */ | ||
160 | { 0x00C1, 0x00C1 }, /* R55 - Additional Control */ | ||
161 | { 0x00F0, 0x00F0 }, /* R56 - AntiPOP (1) */ | ||
162 | { 0x01EF, 0x01EF }, /* R57 - AntiPOP (2) */ | ||
163 | { 0x00FF, 0x00FF }, /* R58 - MICBIAS */ | ||
164 | { 0x000F, 0x000F }, /* R59 - LDO 1 */ | ||
165 | { 0x0007, 0x0007 }, /* R60 - LDO 2 */ | ||
166 | { 0x0000, 0x0000 }, /* R61 */ | ||
167 | { 0x0000, 0x0000 }, /* R62 */ | ||
168 | { 0x0000, 0x0000 }, /* R63 */ | ||
169 | { 0x0000, 0x0000 }, /* R64 */ | ||
170 | { 0x0000, 0x0000 }, /* R65 */ | ||
171 | { 0x0000, 0x0000 }, /* R66 */ | ||
172 | { 0x0000, 0x0000 }, /* R67 */ | ||
173 | { 0x0000, 0x0000 }, /* R68 */ | ||
174 | { 0x0000, 0x0000 }, /* R69 */ | ||
175 | { 0x0000, 0x0000 }, /* R70 */ | ||
176 | { 0x0000, 0x0000 }, /* R71 */ | ||
177 | { 0x0000, 0x0000 }, /* R72 */ | ||
178 | { 0x0000, 0x0000 }, /* R73 */ | ||
179 | { 0x0000, 0x0000 }, /* R74 */ | ||
180 | { 0x0000, 0x0000 }, /* R75 */ | ||
181 | { 0x8000, 0x8000 }, /* R76 - Charge Pump (1) */ | ||
182 | { 0x0000, 0x0000 }, /* R77 */ | ||
183 | { 0x0000, 0x0000 }, /* R78 */ | ||
184 | { 0x0000, 0x0000 }, /* R79 */ | ||
185 | { 0x0000, 0x0000 }, /* R80 */ | ||
186 | { 0x0301, 0x0301 }, /* R81 - Class W (1) */ | ||
187 | { 0x0000, 0x0000 }, /* R82 */ | ||
188 | { 0x0000, 0x0000 }, /* R83 */ | ||
189 | { 0x333F, 0x333F }, /* R84 - DC Servo (1) */ | ||
190 | { 0x0FEF, 0x0FEF }, /* R85 - DC Servo (2) */ | ||
191 | { 0x0000, 0x0000 }, /* R86 */ | ||
192 | { 0xFFFF, 0xFFFF }, /* R87 - DC Servo (4) */ | ||
193 | { 0x0333, 0x0000 }, /* R88 - DC Servo Readback */ | ||
194 | { 0x0000, 0x0000 }, /* R89 */ | ||
195 | { 0x0000, 0x0000 }, /* R90 */ | ||
196 | { 0x0000, 0x0000 }, /* R91 */ | ||
197 | { 0x0000, 0x0000 }, /* R92 */ | ||
198 | { 0x0000, 0x0000 }, /* R93 */ | ||
199 | { 0x0000, 0x0000 }, /* R94 */ | ||
200 | { 0x0000, 0x0000 }, /* R95 */ | ||
201 | { 0x00EE, 0x00EE }, /* R96 - Analogue HP (1) */ | ||
202 | { 0x0000, 0x0000 }, /* R97 */ | ||
203 | { 0x0000, 0x0000 }, /* R98 */ | ||
204 | { 0x0000, 0x0000 }, /* R99 */ | ||
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206 | { 0x0000, 0x0000 }, /* R101 */ | ||
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621 | { 0x001F, 0x001F }, /* R516 - AIF2 Clocking (1) */ | ||
622 | { 0x003F, 0x003F }, /* R517 - AIF2 Clocking (2) */ | ||
623 | { 0x0000, 0x0000 }, /* R518 */ | ||
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635 | { 0x000F, 0x0000 }, /* R530 - Rate Status */ | ||
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640 | { 0x0000, 0x0000 }, /* R535 */ | ||
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645 | { 0x0000, 0x0000 }, /* R540 */ | ||
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647 | { 0x0000, 0x0000 }, /* R542 */ | ||
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650 | { 0x3F77, 0x3F77 }, /* R545 - FLL1 Control (2) */ | ||
651 | { 0xFFFF, 0xFFFF }, /* R546 - FLL1 Control (3) */ | ||
652 | { 0x7FEF, 0x7FEF }, /* R547 - FLL1 Control (4) */ | ||
653 | { 0x1FDB, 0x1FDB }, /* R548 - FLL1 Control (5) */ | ||
654 | { 0x0000, 0x0000 }, /* R549 */ | ||
655 | { 0x0000, 0x0000 }, /* R550 */ | ||
656 | { 0x0000, 0x0000 }, /* R551 */ | ||
657 | { 0x0000, 0x0000 }, /* R552 */ | ||
658 | { 0x0000, 0x0000 }, /* R553 */ | ||
659 | { 0x0000, 0x0000 }, /* R554 */ | ||
660 | { 0x0000, 0x0000 }, /* R555 */ | ||
661 | { 0x0000, 0x0000 }, /* R556 */ | ||
662 | { 0x0000, 0x0000 }, /* R557 */ | ||
663 | { 0x0000, 0x0000 }, /* R558 */ | ||
664 | { 0x0000, 0x0000 }, /* R559 */ | ||
665 | { 0x0000, 0x0000 }, /* R560 */ | ||
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667 | { 0x0000, 0x0000 }, /* R562 */ | ||
668 | { 0x0000, 0x0000 }, /* R563 */ | ||
669 | { 0x0000, 0x0000 }, /* R564 */ | ||
670 | { 0x0000, 0x0000 }, /* R565 */ | ||
671 | { 0x0000, 0x0000 }, /* R566 */ | ||
672 | { 0x0000, 0x0000 }, /* R567 */ | ||
673 | { 0x0000, 0x0000 }, /* R568 */ | ||
674 | { 0x0000, 0x0000 }, /* R569 */ | ||
675 | { 0x0000, 0x0000 }, /* R570 */ | ||
676 | { 0x0000, 0x0000 }, /* R571 */ | ||
677 | { 0x0000, 0x0000 }, /* R572 */ | ||
678 | { 0x0000, 0x0000 }, /* R573 */ | ||
679 | { 0x0000, 0x0000 }, /* R574 */ | ||
680 | { 0x0000, 0x0000 }, /* R575 */ | ||
681 | { 0x0007, 0x0007 }, /* R576 - FLL2 Control (1) */ | ||
682 | { 0x3F77, 0x3F77 }, /* R577 - FLL2 Control (2) */ | ||
683 | { 0xFFFF, 0xFFFF }, /* R578 - FLL2 Control (3) */ | ||
684 | { 0x7FEF, 0x7FEF }, /* R579 - FLL2 Control (4) */ | ||
685 | { 0x1FDB, 0x1FDB }, /* R580 - FLL2 Control (5) */ | ||
686 | { 0x0000, 0x0000 }, /* R581 */ | ||
687 | { 0x0000, 0x0000 }, /* R582 */ | ||
688 | { 0x0000, 0x0000 }, /* R583 */ | ||
689 | { 0x0000, 0x0000 }, /* R584 */ | ||
690 | { 0x0000, 0x0000 }, /* R585 */ | ||
691 | { 0x0000, 0x0000 }, /* R586 */ | ||
692 | { 0x0000, 0x0000 }, /* R587 */ | ||
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694 | { 0x0000, 0x0000 }, /* R589 */ | ||
695 | { 0x0000, 0x0000 }, /* R590 */ | ||
696 | { 0x0000, 0x0000 }, /* R591 */ | ||
697 | { 0x0000, 0x0000 }, /* R592 */ | ||
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699 | { 0x0000, 0x0000 }, /* R594 */ | ||
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706 | { 0x0000, 0x0000 }, /* R601 */ | ||
707 | { 0x0000, 0x0000 }, /* R602 */ | ||
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1134 | { 0x00FF, 0x01FF }, /* R1029 - AIF1 ADC2 Right Volume */ | ||
1135 | { 0x00FF, 0x01FF }, /* R1030 - AIF1 DAC2 Left Volume */ | ||
1136 | { 0x00FF, 0x01FF }, /* R1031 - AIF1 DAC2 Right Volume */ | ||
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1141 | { 0x0000, 0x0000 }, /* R1036 */ | ||
1142 | { 0x0000, 0x0000 }, /* R1037 */ | ||
1143 | { 0x0000, 0x0000 }, /* R1038 */ | ||
1144 | { 0x0000, 0x0000 }, /* R1039 */ | ||
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1149 | { 0x0000, 0x0000 }, /* R1044 */ | ||
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1151 | { 0x0000, 0x0000 }, /* R1046 */ | ||
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1156 | { 0x0000, 0x0000 }, /* R1051 */ | ||
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1160 | { 0x0000, 0x0000 }, /* R1055 */ | ||
1161 | { 0x02B6, 0x02B6 }, /* R1056 - AIF1 DAC1 Filters (1) */ | ||
1162 | { 0x3F00, 0x3F00 }, /* R1057 - AIF1 DAC1 Filters (2) */ | ||
1163 | { 0x02B6, 0x02B6 }, /* R1058 - AIF1 DAC2 Filters (1) */ | ||
1164 | { 0x3F00, 0x3F00 }, /* R1059 - AIF1 DAC2 Filters (2) */ | ||
1165 | { 0x0000, 0x0000 }, /* R1060 */ | ||
1166 | { 0x0000, 0x0000 }, /* R1061 */ | ||
1167 | { 0x0000, 0x0000 }, /* R1062 */ | ||
1168 | { 0x0000, 0x0000 }, /* R1063 */ | ||
1169 | { 0x0000, 0x0000 }, /* R1064 */ | ||
1170 | { 0x0000, 0x0000 }, /* R1065 */ | ||
1171 | { 0x0000, 0x0000 }, /* R1066 */ | ||
1172 | { 0x0000, 0x0000 }, /* R1067 */ | ||
1173 | { 0x0000, 0x0000 }, /* R1068 */ | ||
1174 | { 0x0000, 0x0000 }, /* R1069 */ | ||
1175 | { 0x0000, 0x0000 }, /* R1070 */ | ||
1176 | { 0x0000, 0x0000 }, /* R1071 */ | ||
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1178 | { 0x0000, 0x0000 }, /* R1073 */ | ||
1179 | { 0x0000, 0x0000 }, /* R1074 */ | ||
1180 | { 0x0000, 0x0000 }, /* R1075 */ | ||
1181 | { 0x0000, 0x0000 }, /* R1076 */ | ||
1182 | { 0x0000, 0x0000 }, /* R1077 */ | ||
1183 | { 0x0000, 0x0000 }, /* R1078 */ | ||
1184 | { 0x0000, 0x0000 }, /* R1079 */ | ||
1185 | { 0x0000, 0x0000 }, /* R1080 */ | ||
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1192 | { 0x0000, 0x0000 }, /* R1087 */ | ||
1193 | { 0xFFFF, 0xFFFF }, /* R1088 - AIF1 DRC1 (1) */ | ||
1194 | { 0x1FFF, 0x1FFF }, /* R1089 - AIF1 DRC1 (2) */ | ||
1195 | { 0xFFFF, 0xFFFF }, /* R1090 - AIF1 DRC1 (3) */ | ||
1196 | { 0x07FF, 0x07FF }, /* R1091 - AIF1 DRC1 (4) */ | ||
1197 | { 0x03FF, 0x03FF }, /* R1092 - AIF1 DRC1 (5) */ | ||
1198 | { 0x0000, 0x0000 }, /* R1093 */ | ||
1199 | { 0x0000, 0x0000 }, /* R1094 */ | ||
1200 | { 0x0000, 0x0000 }, /* R1095 */ | ||
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1212 | { 0x07FF, 0x07FF }, /* R1107 - AIF1 DRC2 (4) */ | ||
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1261 | { 0xFFFF, 0xFFFF }, /* R1156 - AIF1 DAC1 EQ Band 1 PG */ | ||
1262 | { 0xFFFF, 0xFFFF }, /* R1157 - AIF1 DAC1 EQ Band 2 A */ | ||
1263 | { 0xFFFF, 0xFFFF }, /* R1158 - AIF1 DAC1 EQ Band 2 B */ | ||
1264 | { 0xFFFF, 0xFFFF }, /* R1159 - AIF1 DAC1 EQ Band 2 C */ | ||
1265 | { 0xFFFF, 0xFFFF }, /* R1160 - AIF1 DAC1 EQ Band 2 PG */ | ||
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1268 | { 0xFFFF, 0xFFFF }, /* R1163 - AIF1 DAC1 EQ Band 3 C */ | ||
1269 | { 0xFFFF, 0xFFFF }, /* R1164 - AIF1 DAC1 EQ Band 3 PG */ | ||
1270 | { 0xFFFF, 0xFFFF }, /* R1165 - AIF1 DAC1 EQ Band 4 A */ | ||
1271 | { 0xFFFF, 0xFFFF }, /* R1166 - AIF1 DAC1 EQ Band 4 B */ | ||
1272 | { 0xFFFF, 0xFFFF }, /* R1167 - AIF1 DAC1 EQ Band 4 C */ | ||
1273 | { 0xFFFF, 0xFFFF }, /* R1168 - AIF1 DAC1 EQ Band 4 PG */ | ||
1274 | { 0xFFFF, 0xFFFF }, /* R1169 - AIF1 DAC1 EQ Band 5 A */ | ||
1275 | { 0xFFFF, 0xFFFF }, /* R1170 - AIF1 DAC1 EQ Band 5 B */ | ||
1276 | { 0xFFFF, 0xFFFF }, /* R1171 - AIF1 DAC1 EQ Band 5 PG */ | ||
1277 | { 0x0000, 0x0000 }, /* R1172 */ | ||
1278 | { 0x0000, 0x0000 }, /* R1173 */ | ||
1279 | { 0x0000, 0x0000 }, /* R1174 */ | ||
1280 | { 0x0000, 0x0000 }, /* R1175 */ | ||
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1289 | { 0xFFFF, 0xFFFF }, /* R1184 - AIF1 DAC2 EQ Gains (1) */ | ||
1290 | { 0xFFC0, 0xFFC0 }, /* R1185 - AIF1 DAC2 EQ Gains (2) */ | ||
1291 | { 0xFFFF, 0xFFFF }, /* R1186 - AIF1 DAC2 EQ Band 1 A */ | ||
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1293 | { 0xFFFF, 0xFFFF }, /* R1188 - AIF1 DAC2 EQ Band 1 PG */ | ||
1294 | { 0xFFFF, 0xFFFF }, /* R1189 - AIF1 DAC2 EQ Band 2 A */ | ||
1295 | { 0xFFFF, 0xFFFF }, /* R1190 - AIF1 DAC2 EQ Band 2 B */ | ||
1296 | { 0xFFFF, 0xFFFF }, /* R1191 - AIF1 DAC2 EQ Band 2 C */ | ||
1297 | { 0xFFFF, 0xFFFF }, /* R1192 - AIF1 DAC2 EQ Band 2 PG */ | ||
1298 | { 0xFFFF, 0xFFFF }, /* R1193 - AIF1 DAC2 EQ Band 3 A */ | ||
1299 | { 0xFFFF, 0xFFFF }, /* R1194 - AIF1 DAC2 EQ Band 3 B */ | ||
1300 | { 0xFFFF, 0xFFFF }, /* R1195 - AIF1 DAC2 EQ Band 3 C */ | ||
1301 | { 0xFFFF, 0xFFFF }, /* R1196 - AIF1 DAC2 EQ Band 3 PG */ | ||
1302 | { 0xFFFF, 0xFFFF }, /* R1197 - AIF1 DAC2 EQ Band 4 A */ | ||
1303 | { 0xFFFF, 0xFFFF }, /* R1198 - AIF1 DAC2 EQ Band 4 B */ | ||
1304 | { 0xFFFF, 0xFFFF }, /* R1199 - AIF1 DAC2 EQ Band 4 C */ | ||
1305 | { 0xFFFF, 0xFFFF }, /* R1200 - AIF1 DAC2 EQ Band 4 PG */ | ||
1306 | { 0xFFFF, 0xFFFF }, /* R1201 - AIF1 DAC2 EQ Band 5 A */ | ||
1307 | { 0xFFFF, 0xFFFF }, /* R1202 - AIF1 DAC2 EQ Band 5 B */ | ||
1308 | { 0xFFFF, 0xFFFF }, /* R1203 - AIF1 DAC2 EQ Band 5 PG */ | ||
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1388 | { 0x00FF, 0x01FF }, /* R1283 - AIF2 DAC Right Volume */ | ||
1389 | { 0x0000, 0x0000 }, /* R1284 */ | ||
1390 | { 0x0000, 0x0000 }, /* R1285 */ | ||
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1395 | { 0x0000, 0x0000 }, /* R1290 */ | ||
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1398 | { 0x0000, 0x0000 }, /* R1293 */ | ||
1399 | { 0x0000, 0x0000 }, /* R1294 */ | ||
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1418 | { 0x3F00, 0x3F00 }, /* R1313 - AIF2 DAC Filters (2) */ | ||
1419 | { 0x0000, 0x0000 }, /* R1314 */ | ||
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1667 | { 0x0000, 0x0000 }, /* R1562 */ | ||
1668 | { 0x0000, 0x0000 }, /* R1563 */ | ||
1669 | { 0x0000, 0x0000 }, /* R1564 */ | ||
1670 | { 0x0000, 0x0000 }, /* R1565 */ | ||
1671 | { 0x0000, 0x0000 }, /* R1566 */ | ||
1672 | { 0x0000, 0x0000 }, /* R1567 */ | ||
1673 | { 0x0003, 0x0003 }, /* R1568 - Oversampling */ | ||
1674 | { 0x03C3, 0x03C3 }, /* R1569 - Sidetone */ | ||
1675 | }; | ||
1676 | |||
1677 | static int wm8994_readable(unsigned int reg) | 101 | static int wm8994_readable(unsigned int reg) |
1678 | { | 102 | { |
1679 | switch (reg) { | 103 | switch (reg) { |
@@ -1696,9 +120,9 @@ static int wm8994_readable(unsigned int reg) | |||
1696 | break; | 120 | break; |
1697 | } | 121 | } |
1698 | 122 | ||
1699 | if (reg >= ARRAY_SIZE(access_masks)) | 123 | if (reg >= WM8994_CACHE_SIZE) |
1700 | return 0; | 124 | return 0; |
1701 | return access_masks[reg].readable != 0; | 125 | return wm8994_access_masks[reg].readable != 0; |
1702 | } | 126 | } |
1703 | 127 | ||
1704 | static int wm8994_volatile(unsigned int reg) | 128 | static int wm8994_volatile(unsigned int reg) |
@@ -3658,7 +2082,7 @@ static int wm8994_resume(struct snd_soc_codec *codec) | |||
3658 | break; | 2082 | break; |
3659 | } | 2083 | } |
3660 | 2084 | ||
3661 | if (!access_masks[i].writable) | 2085 | if (!wm8994_access_masks[i].writable) |
3662 | continue; | 2086 | continue; |
3663 | 2087 | ||
3664 | wm8994_reg_write(codec->control_data, i, reg_cache[i]); | 2088 | wm8994_reg_write(codec->control_data, i, reg_cache[i]); |
diff --git a/sound/soc/codecs/wm8994.h b/sound/soc/codecs/wm8994.h index d8dce260c430..b8b3166e1f03 100644 --- a/sound/soc/codecs/wm8994.h +++ b/sound/soc/codecs/wm8994.h | |||
@@ -31,4 +31,13 @@ | |||
31 | int wm8994_mic_detect(struct snd_soc_codec *codec, struct snd_soc_jack *jack, | 31 | int wm8994_mic_detect(struct snd_soc_codec *codec, struct snd_soc_jack *jack, |
32 | int micbias, int det, int shrt); | 32 | int micbias, int det, int shrt); |
33 | 33 | ||
34 | #define WM8994_CACHE_SIZE 1570 | ||
35 | |||
36 | struct wm8994_access_mask { | ||
37 | unsigned short readable; /* Mask of readable bits */ | ||
38 | unsigned short writable; /* Mask of writable bits */ | ||
39 | }; | ||
40 | |||
41 | extern const struct wm8994_access_mask wm8994_access_masks[WM8994_CACHE_SIZE]; | ||
42 | |||
34 | #endif | 43 | #endif |