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path: root/sound/soc/codecs
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authorMark Brown <broonie@opensource.wolfsonmicro.com>2010-08-05 08:20:59 -0400
committerMark Brown <broonie@opensource.wolfsonmicro.com>2010-08-05 08:38:57 -0400
commit9a76f1ff6e299fbb04149fe15aff061351fd0dab (patch)
treea9101f20804588022dd6f3307663f58104ceb150 /sound/soc/codecs
parentbda7d2a862e6b788bca2d02d38a07966a9c92e48 (diff)
ASoC: Add initial WM8962 CODEC driver
The WM8962 is a low power, high performance stereo CODEC designed for portable digital audio applications. This initial driver release supports the key audio paths of the WM8962. Extended functionality, such as microphone detection, digital microphones and the advanced DSP signal enhancements provided by the device are not yet supported. Signed-off-by: Mark Brown <broonie@opensource.wolfsonmicro.com>
Diffstat (limited to 'sound/soc/codecs')
-rw-r--r--sound/soc/codecs/Kconfig4
-rw-r--r--sound/soc/codecs/Makefile2
-rw-r--r--sound/soc/codecs/wm8962-tables.c42299
-rw-r--r--sound/soc/codecs/wm8962.c1933
-rw-r--r--sound/soc/codecs/wm8962.h3790
5 files changed, 48028 insertions, 0 deletions
diff --git a/sound/soc/codecs/Kconfig b/sound/soc/codecs/Kconfig
index 83f5c67d3c41..bfdd92b78fb6 100644
--- a/sound/soc/codecs/Kconfig
+++ b/sound/soc/codecs/Kconfig
@@ -61,6 +61,7 @@ config SND_SOC_ALL_CODECS
61 select SND_SOC_WM8955 if I2C 61 select SND_SOC_WM8955 if I2C
62 select SND_SOC_WM8960 if I2C 62 select SND_SOC_WM8960 if I2C
63 select SND_SOC_WM8961 if I2C 63 select SND_SOC_WM8961 if I2C
64 select SND_SOC_WM8962 if I2C
64 select SND_SOC_WM8971 if I2C 65 select SND_SOC_WM8971 if I2C
65 select SND_SOC_WM8974 if I2C 66 select SND_SOC_WM8974 if I2C
66 select SND_SOC_WM8978 if I2C 67 select SND_SOC_WM8978 if I2C
@@ -248,6 +249,9 @@ config SND_SOC_WM8960
248config SND_SOC_WM8961 249config SND_SOC_WM8961
249 tristate 250 tristate
250 251
252config SND_SOC_WM8962
253 tristate
254
251config SND_SOC_WM8971 255config SND_SOC_WM8971
252 tristate 256 tristate
253 257
diff --git a/sound/soc/codecs/Makefile b/sound/soc/codecs/Makefile
index 53524095759c..9c3c39fd99ad 100644
--- a/sound/soc/codecs/Makefile
+++ b/sound/soc/codecs/Makefile
@@ -46,6 +46,7 @@ snd-soc-wm8940-objs := wm8940.o
46snd-soc-wm8955-objs := wm8955.o 46snd-soc-wm8955-objs := wm8955.o
47snd-soc-wm8960-objs := wm8960.o 47snd-soc-wm8960-objs := wm8960.o
48snd-soc-wm8961-objs := wm8961.o 48snd-soc-wm8961-objs := wm8961.o
49snd-soc-wm8962-objs := wm8962.o wm8962-tables.o
49snd-soc-wm8971-objs := wm8971.o 50snd-soc-wm8971-objs := wm8971.o
50snd-soc-wm8974-objs := wm8974.o 51snd-soc-wm8974-objs := wm8974.o
51snd-soc-wm8978-objs := wm8978.o 52snd-soc-wm8978-objs := wm8978.o
@@ -115,6 +116,7 @@ obj-$(CONFIG_SND_SOC_WM8940) += snd-soc-wm8940.o
115obj-$(CONFIG_SND_SOC_WM8955) += snd-soc-wm8955.o 116obj-$(CONFIG_SND_SOC_WM8955) += snd-soc-wm8955.o
116obj-$(CONFIG_SND_SOC_WM8960) += snd-soc-wm8960.o 117obj-$(CONFIG_SND_SOC_WM8960) += snd-soc-wm8960.o
117obj-$(CONFIG_SND_SOC_WM8961) += snd-soc-wm8961.o 118obj-$(CONFIG_SND_SOC_WM8961) += snd-soc-wm8961.o
119obj-$(CONFIG_SND_SOC_WM8962) += snd-soc-wm8962.o
118obj-$(CONFIG_SND_SOC_WM8971) += snd-soc-wm8971.o 120obj-$(CONFIG_SND_SOC_WM8971) += snd-soc-wm8971.o
119obj-$(CONFIG_SND_SOC_WM8974) += snd-soc-wm8974.o 121obj-$(CONFIG_SND_SOC_WM8974) += snd-soc-wm8974.o
120obj-$(CONFIG_SND_SOC_WM8978) += snd-soc-wm8978.o 122obj-$(CONFIG_SND_SOC_WM8978) += snd-soc-wm8978.o
diff --git a/sound/soc/codecs/wm8962-tables.c b/sound/soc/codecs/wm8962-tables.c
new file mode 100644
index 000000000000..f21a8c1b9d47
--- /dev/null
+++ b/sound/soc/codecs/wm8962-tables.c
@@ -0,0 +1,42299 @@
1/*
2 * wm8962-tables.c -- WM8962 ASoC driver
3 *
4 * Copyright 2010 Wolfson Microelectronics, plc
5 *
6 * Author: Mark Brown <broonie@opensource.wolfsonmicro.com>
7 *
8 * This program is free software; you can redistribute it and/or modify
9 * it under the terms of the GNU General Public License version 2 as
10 * published by the Free Software Foundation.
11 */
12
13#include "wm8962.h"
14
15const u16 wm8962_reg[WM8962_MAX_REGISTER + 1] = {
16 0x009F, /* R0 - Left Input volume */
17 0x049F, /* R1 - Right Input volume */
18 0x0000, /* R2 - HPOUTL volume */
19 0x0000, /* R3 - HPOUTR volume */
20 0x0020, /* R4 - Clocking1 */
21 0x0018, /* R5 - ADC & DAC Control 1 */
22 0x2008, /* R6 - ADC & DAC Control 2 */
23 0x000A, /* R7 - Audio Interface 0 */
24 0x01E4, /* R8 - Clocking2 */
25 0x0300, /* R9 - Audio Interface 1 */
26 0x00C0, /* R10 - Left DAC volume */
27 0x00C0, /* R11 - Right DAC volume */
28 0x0000, /* R12 */
29 0x0000, /* R13 */
30 0x0040, /* R14 - Audio Interface 2 */
31 0x6243, /* R15 - Software Reset */
32 0x0000, /* R16 */
33 0x007B, /* R17 - ALC1 */
34 0x0000, /* R18 - ALC2 */
35 0x1C32, /* R19 - ALC3 */
36 0x3200, /* R20 - Noise Gate */
37 0x00C0, /* R21 - Left ADC volume */
38 0x00C0, /* R22 - Right ADC volume */
39 0x0160, /* R23 - Additional control(1) */
40 0x0000, /* R24 - Additional control(2) */
41 0x0000, /* R25 - Pwr Mgmt (1) */
42 0x0000, /* R26 - Pwr Mgmt (2) */
43 0x0010, /* R27 - Additional Control (3) */
44 0x0000, /* R28 - Anti-pop */
45 0x0000, /* R29 */
46 0x005E, /* R30 - Clocking 3 */
47 0x0000, /* R31 - Input mixer control (1) */
48 0x0145, /* R32 - Left input mixer volume */
49 0x0145, /* R33 - Right input mixer volume */
50 0x0009, /* R34 - Input mixer control (2) */
51 0x0003, /* R35 - Input bias control */
52 0x0000, /* R36 */
53 0x0008, /* R37 - Left input PGA control */
54 0x0008, /* R38 - Right input PGA control */
55 0x0000, /* R39 */
56 0x0000, /* R40 - SPKOUTL volume */
57 0x0000, /* R41 - SPKOUTR volume */
58 0x0000, /* R42 */
59 0x0000, /* R43 */
60 0x0000, /* R44 */
61 0x0000, /* R45 */
62 0x0000, /* R46 */
63 0x0000, /* R47 - Thermal Shutdown Status */
64 0x8027, /* R48 - Additional Control (4) */
65 0x0010, /* R49 - Class D Control 1 */
66 0x0000, /* R50 */
67 0x0003, /* R51 - Class D Control 2 */
68 0x0000, /* R52 */
69 0x0000, /* R53 */
70 0x0000, /* R54 */
71 0x0000, /* R55 */
72 0x0506, /* R56 - Clocking 4 */
73 0x0000, /* R57 - DAC DSP Mixing (1) */
74 0x0000, /* R58 - DAC DSP Mixing (2) */
75 0x0000, /* R59 */
76 0x0300, /* R60 - DC Servo 0 */
77 0x0300, /* R61 - DC Servo 1 */
78 0x0000, /* R62 */
79 0x0000, /* R63 */
80 0x0810, /* R64 - DC Servo 4 */
81 0x0000, /* R65 */
82 0x0000, /* R66 - DC Servo 6 */
83 0x0000, /* R67 */
84 0x001B, /* R68 - Analogue PGA Bias */
85 0x0000, /* R69 - Analogue HP 0 */
86 0x0000, /* R70 */
87 0x01FB, /* R71 - Analogue HP 2 */
88 0x0000, /* R72 - Charge Pump 1 */
89 0x0000, /* R73 */
90 0x0000, /* R74 */
91 0x0000, /* R75 */
92 0x0000, /* R76 */
93 0x0000, /* R77 */
94 0x0000, /* R78 */
95 0x0000, /* R79 */
96 0x0000, /* R80 */
97 0x0000, /* R81 */
98 0x0004, /* R82 - Charge Pump B */
99 0x0000, /* R83 */
100 0x0000, /* R84 */
101 0x0000, /* R85 */
102 0x0000, /* R86 */
103 0x0000, /* R87 - Write Sequencer Control 1 */
104 0x0000, /* R88 */
105 0x0000, /* R89 */
106 0x0000, /* R90 - Write Sequencer Control 2 */
107 0x0000, /* R91 */
108 0x0000, /* R92 */
109 0x0000, /* R93 - Write Sequencer Control 3 */
110 0x0000, /* R94 - Control Interface */
111 0x0000, /* R95 */
112 0x0000, /* R96 */
113 0x0000, /* R97 */
114 0x0000, /* R98 */
115 0x0000, /* R99 - Mixer Enables */
116 0x0000, /* R100 - Headphone Mixer (1) */
117 0x0000, /* R101 - Headphone Mixer (2) */
118 0x013F, /* R102 - Headphone Mixer (3) */
119 0x013F, /* R103 - Headphone Mixer (4) */
120 0x0000, /* R104 */
121 0x0000, /* R105 - Speaker Mixer (1) */
122 0x0000, /* R106 - Speaker Mixer (2) */
123 0x013F, /* R107 - Speaker Mixer (3) */
124 0x013F, /* R108 - Speaker Mixer (4) */
125 0x0003, /* R109 - Speaker Mixer (5) */
126 0x0002, /* R110 - Beep Generator (1) */
127 0x0000, /* R111 */
128 0x0000, /* R112 */
129 0x0000, /* R113 */
130 0x0000, /* R114 */
131 0x0006, /* R115 - Oscillator Trim (3) */
132 0x0026, /* R116 - Oscillator Trim (4) */
133 0x0000, /* R117 */
134 0x0000, /* R118 */
135 0x0000, /* R119 - Oscillator Trim (7) */
136 0x0000, /* R120 */
137 0x0000, /* R121 */
138 0x0000, /* R122 */
139 0x0000, /* R123 */
140 0x0011, /* R124 - Analogue Clocking1 */
141 0x004B, /* R125 - Analogue Clocking2 */
142 0x000D, /* R126 - Analogue Clocking3 */
143 0x0000, /* R127 - PLL Software Reset */
144 0x0000, /* R128 */
145 0x0000, /* R129 - PLL2 */
146 0x0000, /* R130 */
147 0x0000, /* R131 - PLL 4 */
148 0x0000, /* R132 */
149 0x0000, /* R133 */
150 0x0000, /* R134 */
151 0x0000, /* R135 */
152 0x0067, /* R136 - PLL 9 */
153 0x001C, /* R137 - PLL 10 */
154 0x0071, /* R138 - PLL 11 */
155 0x00C7, /* R139 - PLL 12 */
156 0x0067, /* R140 - PLL 13 */
157 0x0048, /* R141 - PLL 14 */
158 0x0022, /* R142 - PLL 15 */
159 0x0097, /* R143 - PLL 16 */
160 0x0000, /* R144 */
161 0x0000, /* R145 */
162 0x0000, /* R146 */
163 0x0000, /* R147 */
164 0x0000, /* R148 */
165 0x0000, /* R149 */
166 0x0000, /* R150 */
167 0x0000, /* R151 */
168 0x0000, /* R152 */
169 0x0000, /* R153 */
170 0x0000, /* R154 */
171 0x000C, /* R155 - FLL Control (1) */
172 0x0039, /* R156 - FLL Control (2) */
173 0x0180, /* R157 - FLL Control (3) */
174 0x0000, /* R158 */
175 0x0032, /* R159 - FLL Control (5) */
176 0x0018, /* R160 - FLL Control (6) */
177 0x007D, /* R161 - FLL Control (7) */
178 0x0008, /* R162 - FLL Control (8) */
179 0x0000, /* R163 */
180 0x0000, /* R164 */
181 0x0000, /* R165 */
182 0x0000, /* R166 */
183 0x0000, /* R167 */
184 0x0000, /* R168 */
185 0x0000, /* R169 */
186 0x0000, /* R170 */
187 0x0000, /* R171 */
188 0x0000, /* R172 */
189 0x0000, /* R173 */
190 0x0000, /* R174 */
191 0x0000, /* R175 */
192 0x0000, /* R176 */
193 0x0000, /* R177 */
194 0x0000, /* R178 */
195 0x0000, /* R179 */
196 0x0000, /* R180 */
197 0x0000, /* R181 */
198 0x0000, /* R182 */
199 0x0000, /* R183 */
200 0x0000, /* R184 */
201 0x0000, /* R185 */
202 0x0000, /* R186 */
203 0x0000, /* R187 */
204 0x0000, /* R188 */
205 0x0000, /* R189 */
206 0x0000, /* R190 */
207 0x0000, /* R191 */
208 0x0000, /* R192 */
209 0x0000, /* R193 */
210 0x0000, /* R194 */
211 0x0000, /* R195 */
212 0x0000, /* R196 */
213 0x0000, /* R197 */
214 0x0000, /* R198 */
215 0x0000, /* R199 */
216 0x0000, /* R200 */
217 0x0000, /* R201 */
218 0x0000, /* R202 */
219 0x0000, /* R203 */
220 0x0000, /* R204 */
221 0x0000, /* R205 */
222 0x0000, /* R206 */
223 0x0000, /* R207 */
224 0x0000, /* R208 */
225 0x0000, /* R209 */
226 0x0000, /* R210 */
227 0x0000, /* R211 */
228 0x0000, /* R212 */
229 0x0000, /* R213 */
230 0x0000, /* R214 */
231 0x0000, /* R215 */
232 0x0000, /* R216 */
233 0x0000, /* R217 */
234 0x0000, /* R218 */
235 0x0000, /* R219 */
236 0x0000, /* R220 */
237 0x0000, /* R221 */
238 0x0000, /* R222 */
239 0x0000, /* R223 */
240 0x0000, /* R224 */
241 0x0000, /* R225 */
242 0x0000, /* R226 */
243 0x0000, /* R227 */
244 0x0000, /* R228 */
245 0x0000, /* R229 */
246 0x0000, /* R230 */
247 0x0000, /* R231 */
248 0x0000, /* R232 */
249 0x0000, /* R233 */
250 0x0000, /* R234 */
251 0x0000, /* R235 */
252 0x0000, /* R236 */
253 0x0000, /* R237 */
254 0x0000, /* R238 */
255 0x0000, /* R239 */
256 0x0000, /* R240 */
257 0x0000, /* R241 */
258 0x0000, /* R242 */
259 0x0000, /* R243 */
260 0x0000, /* R244 */
261 0x0000, /* R245 */
262 0x0000, /* R246 */
263 0x0000, /* R247 */
264 0x0000, /* R248 */
265 0x0000, /* R249 */
266 0x0000, /* R250 */
267 0x0000, /* R251 */
268 0x0005, /* R252 - General test 1 */
269 0x0000, /* R253 */
270 0x0000, /* R254 */
271 0x0000, /* R255 */
272 0x0000, /* R256 - DF1 */
273 0x0000, /* R257 - DF2 */
274 0x0000, /* R258 - DF3 */
275 0x0000, /* R259 - DF4 */
276 0x0000, /* R260 - DF5 */
277 0x0000, /* R261 - DF6 */
278 0x0000, /* R262 - DF7 */
279 0x0000, /* R263 */
280 0x0000, /* R264 - LHPF1 */
281 0x0000, /* R265 - LHPF2 */
282 0x0000, /* R266 */
283 0x0000, /* R267 */
284 0x0000, /* R268 - THREED1 */
285 0x0000, /* R269 - THREED2 */
286 0x0000, /* R270 - THREED3 */
287 0x0000, /* R271 - THREED4 */
288 0x0000, /* R272 */
289 0x0000, /* R273 */
290 0x0000, /* R274 */
291 0x0000, /* R275 */
292 0x000C, /* R276 - DRC 1 */
293 0x0925, /* R277 - DRC 2 */
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21132 0x0028, /* R21116 - VSS_XTS21_1 */
21133 0x3500, /* R21117 - VSS_XTS21_0 */
21134 0x0006, /* R21118 - VSS_XTS22_1 */
21135 0x3300, /* R21119 - VSS_XTS22_0 */
21136 0x00D9, /* R21120 - VSS_XTS23_1 */
21137 0xF6C0, /* R21121 - VSS_XTS23_0 */
21138 0x00F3, /* R21122 - VSS_XTS24_1 */
21139 0x3340, /* R21123 - VSS_XTS24_0 */
21140 0x000F, /* R21124 - VSS_XTS25_1 */
21141 0x4200, /* R21125 - VSS_XTS25_0 */
21142 0x0004, /* R21126 - VSS_XTS26_1 */
21143 0x0C80, /* R21127 - VSS_XTS26_0 */
21144 0x00FB, /* R21128 - VSS_XTS27_1 */
21145 0x3F80, /* R21129 - VSS_XTS27_0 */
21146 0x00F7, /* R21130 - VSS_XTS28_1 */
21147 0x57C0, /* R21131 - VSS_XTS28_0 */
21148 0x0003, /* R21132 - VSS_XTS29_1 */
21149 0x5400, /* R21133 - VSS_XTS29_0 */
21150 0x0000, /* R21134 - VSS_XTS30_1 */
21151 0xC6C0, /* R21135 - VSS_XTS30_0 */
21152 0x0003, /* R21136 - VSS_XTS31_1 */
21153 0x12C0, /* R21137 - VSS_XTS31_0 */
21154 0x00FD, /* R21138 - VSS_XTS32_1 */
21155 0x8580, /* R21139 - VSS_XTS32_0 */
21156};
21157
21158const struct wm8962_reg_access wm8962_reg_access[WM8962_MAX_REGISTER + 1] = {
21159 { 0x00FF, 0x01FF, 0x0000 }, /* R0 - Left Input volume */
21160 { 0xFEFF, 0x01FF, 0xFFFF }, /* R1 - Right Input volume */
21161 { 0x00FF, 0x01FF, 0x0000 }, /* R2 - HPOUTL volume */
21162 { 0x00FF, 0x01FF, 0x0000 }, /* R3 - HPOUTR volume */
21163 { 0x07FE, 0x07FE, 0xFFFF }, /* R4 - Clocking1 */
21164 { 0x007F, 0x007F, 0x0000 }, /* R5 - ADC & DAC Control 1 */
21165 { 0x37ED, 0x37ED, 0x0000 }, /* R6 - ADC & DAC Control 2 */
21166 { 0x1FFF, 0x1FFF, 0x0000 }, /* R7 - Audio Interface 0 */
21167 { 0x0FEF, 0x0FEF, 0xFFFF }, /* R8 - Clocking2 */
21168 { 0x0B9F, 0x039F, 0x0000 }, /* R9 - Audio Interface 1 */
21169 { 0x00FF, 0x01FF, 0x0000 }, /* R10 - Left DAC volume */
21170 { 0x00FF, 0x01FF, 0x0000 }, /* R11 - Right DAC volume */
21171 { 0x0000, 0x0000, 0x0000 }, /* R12 */
21172 { 0x0000, 0x0000, 0x0000 }, /* R13 */
21173 { 0x07FF, 0x07FF, 0x0000 }, /* R14 - Audio Interface 2 */
21174 { 0xFFFF, 0xFFFF, 0xFFFF }, /* R15 - Software Reset */
21175 { 0x0000, 0x0000, 0x0000 }, /* R16 */
21176 { 0x07FF, 0x07FF, 0x0000 }, /* R17 - ALC1 */
21177 { 0xF8FF, 0x00FF, 0xFFFF }, /* R18 - ALC2 */
21178 { 0x1DFF, 0x1DFF, 0x0000 }, /* R19 - ALC3 */
21179 { 0xFFFF, 0xFFFF, 0x0000 }, /* R20 - Noise Gate */
21180 { 0x00FF, 0x01FF, 0x0000 }, /* R21 - Left ADC volume */
21181 { 0x00FF, 0x01FF, 0x0000 }, /* R22 - Right ADC volume */
21182 { 0x0161, 0x0161, 0x0000 }, /* R23 - Additional control(1) */
21183 { 0x0008, 0x0008, 0x0000 }, /* R24 - Additional control(2) */
21184 { 0x07FE, 0x07FE, 0x0000 }, /* R25 - Pwr Mgmt (1) */
21185 { 0x01FB, 0x01FB, 0x0000 }, /* R26 - Pwr Mgmt (2) */
21186 { 0x0017, 0x0017, 0x0000 }, /* R27 - Additional Control (3) */
21187 { 0x001C, 0x001C, 0x0000 }, /* R28 - Anti-pop */
21188 { 0x0000, 0x0000, 0x0000 }, /* R29 */
21189 { 0xFFFE, 0xFFFE, 0x0000 }, /* R30 - Clocking 3 */
21190 { 0x000F, 0x000F, 0x0000 }, /* R31 - Input mixer control (1) */
21191 { 0x01FF, 0x01FF, 0x0000 }, /* R32 - Left input mixer volume */
21192 { 0x01FF, 0x01FF, 0x0000 }, /* R33 - Right input mixer volume */
21193 { 0x003F, 0x003F, 0x0000 }, /* R34 - Input mixer control (2) */
21194 { 0x003F, 0x003F, 0x0000 }, /* R35 - Input bias control */
21195 { 0x0000, 0x0000, 0x0000 }, /* R36 */
21196 { 0x001F, 0x001F, 0x0000 }, /* R37 - Left input PGA control */
21197 { 0x001F, 0x001F, 0x0000 }, /* R38 - Right input PGA control */
21198 { 0x0000, 0x0000, 0x0000 }, /* R39 */
21199 { 0x00FF, 0x01FF, 0x0000 }, /* R40 - SPKOUTL volume */
21200 { 0x00FF, 0x01FF, 0x0000 }, /* R41 - SPKOUTR volume */
21201 { 0x0000, 0x0000, 0x0000 }, /* R42 */
21202 { 0x0000, 0x0000, 0x0000 }, /* R43 */
21203 { 0x0000, 0x0000, 0x0000 }, /* R44 */
21204 { 0x0000, 0x0000, 0x0000 }, /* R45 */
21205 { 0x0000, 0x0000, 0x0000 }, /* R46 */
21206 { 0x000F, 0x0000, 0x0000 }, /* R47 - Thermal Shutdown Status */
21207 { 0x7EC7, 0x7E07, 0x0000 }, /* R48 - Additional Control (4) */
21208 { 0x00D3, 0x00D7, 0xFFFF }, /* R49 - Class D Control 1 */
21209 { 0x0000, 0x0000, 0x0000 }, /* R50 */
21210 { 0x0047, 0x0047, 0x0000 }, /* R51 - Class D Control 2 */
21211 { 0x0000, 0x0000, 0x0000 }, /* R52 */
21212 { 0x0000, 0x0000, 0x0000 }, /* R53 */
21213 { 0x0000, 0x0000, 0x0000 }, /* R54 */
21214 { 0x0000, 0x0000, 0x0000 }, /* R55 */
21215 { 0x001E, 0x001E, 0x0000 }, /* R56 - Clocking 4 */
21216 { 0x02FC, 0x02FC, 0x0000 }, /* R57 - DAC DSP Mixing (1) */
21217 { 0x00FC, 0x00FC, 0x0000 }, /* R58 - DAC DSP Mixing (2) */
21218 { 0x0000, 0x0000, 0x0000 }, /* R59 */
21219 { 0x00CC, 0x00CC, 0x0000 }, /* R60 - DC Servo 0 */
21220 { 0x00DD, 0x00DD, 0x0000 }, /* R61 - DC Servo 1 */
21221 { 0x0000, 0x0000, 0x0000 }, /* R62 */
21222 { 0x0000, 0x0000, 0x0000 }, /* R63 */
21223 { 0x3F80, 0x3F80, 0x0000 }, /* R64 - DC Servo 4 */
21224 { 0x0000, 0x0000, 0x0000 }, /* R65 */
21225 { 0x0780, 0x0000, 0xFFFF }, /* R66 - DC Servo 6 */
21226 { 0x0000, 0x0000, 0x0000 }, /* R67 */
21227 { 0x0007, 0x0007, 0x0000 }, /* R68 - Analogue PGA Bias */
21228 { 0x00FF, 0x00FF, 0x0000 }, /* R69 - Analogue HP 0 */
21229 { 0x0000, 0x0000, 0x0000 }, /* R70 */
21230 { 0x01FF, 0x01FF, 0x0000 }, /* R71 - Analogue HP 2 */
21231 { 0x0001, 0x0001, 0x0000 }, /* R72 - Charge Pump 1 */
21232 { 0x0000, 0x0000, 0x0000 }, /* R73 */
21233 { 0x0000, 0x0000, 0x0000 }, /* R74 */
21234 { 0x0000, 0x0000, 0x0000 }, /* R75 */
21235 { 0x0000, 0x0000, 0x0000 }, /* R76 */
21236 { 0x0000, 0x0000, 0x0000 }, /* R77 */
21237 { 0x0000, 0x0000, 0x0000 }, /* R78 */
21238 { 0x0000, 0x0000, 0x0000 }, /* R79 */
21239 { 0x0000, 0x0000, 0x0000 }, /* R80 */
21240 { 0x0000, 0x0000, 0x0000 }, /* R81 */
21241 { 0x0001, 0x0001, 0x0000 }, /* R82 - Charge Pump B */
21242 { 0x0000, 0x0000, 0x0000 }, /* R83 */
21243 { 0x0000, 0x0000, 0x0000 }, /* R84 */
21244 { 0x0000, 0x0000, 0x0000 }, /* R85 */
21245 { 0x0000, 0x0000, 0x0000 }, /* R86 */
21246 { 0x00A0, 0x00A0, 0x0000 }, /* R87 - Write Sequencer Control 1 */
21247 { 0x0000, 0x0000, 0x0000 }, /* R88 */
21248 { 0x0000, 0x0000, 0x0000 }, /* R89 */
21249 { 0x007F, 0x01FF, 0x0000 }, /* R90 - Write Sequencer Control 2 */
21250 { 0x0000, 0x0000, 0x0000 }, /* R91 */
21251 { 0x0000, 0x0000, 0x0000 }, /* R92 */
21252 { 0x03F9, 0x0000, 0x0000 }, /* R93 - Write Sequencer Control 3 */
21253 { 0x0070, 0x0070, 0x0000 }, /* R94 - Control Interface */
21254 { 0x0000, 0x0000, 0x0000 }, /* R95 */
21255 { 0x0000, 0x0000, 0x0000 }, /* R96 */
21256 { 0x0000, 0x0000, 0x0000 }, /* R97 */
21257 { 0x0000, 0x0000, 0x0000 }, /* R98 */
21258 { 0x000F, 0x000F, 0x0000 }, /* R99 - Mixer Enables */
21259 { 0x00BF, 0x00BF, 0x0000 }, /* R100 - Headphone Mixer (1) */
21260 { 0x00BF, 0x00BF, 0x0000 }, /* R101 - Headphone Mixer (2) */
21261 { 0x01FF, 0x01FF, 0x0000 }, /* R102 - Headphone Mixer (3) */
21262 { 0x01FF, 0x01FF, 0x0000 }, /* R103 - Headphone Mixer (4) */
21263 { 0x0000, 0x0000, 0x0000 }, /* R104 */
21264 { 0x00BF, 0x00BF, 0x0000 }, /* R105 - Speaker Mixer (1) */
21265 { 0x00BF, 0x00BF, 0x0000 }, /* R106 - Speaker Mixer (2) */
21266 { 0x01FF, 0x01FF, 0x0000 }, /* R107 - Speaker Mixer (3) */
21267 { 0x01FF, 0x01FF, 0x0000 }, /* R108 - Speaker Mixer (4) */
21268 { 0x00F0, 0x00F0, 0x0000 }, /* R109 - Speaker Mixer (5) */
21269 { 0x00F7, 0x00F7, 0x0000 }, /* R110 - Beep Generator (1) */
21270 { 0x0000, 0x0000, 0x0000 }, /* R111 */
21271 { 0x0000, 0x0000, 0x0000 }, /* R112 */
21272 { 0x0000, 0x0000, 0x0000 }, /* R113 */
21273 { 0x0000, 0x0000, 0x0000 }, /* R114 */
21274 { 0x001F, 0x001F, 0x0000 }, /* R115 - Oscillator Trim (3) */
21275 { 0x001F, 0x001F, 0x0000 }, /* R116 - Oscillator Trim (4) */
21276 { 0x0000, 0x0000, 0x0000 }, /* R117 */
21277 { 0x0000, 0x0000, 0x0000 }, /* R118 */
21278 { 0x00FF, 0x00FF, 0x0000 }, /* R119 - Oscillator Trim (7) */
21279 { 0x0000, 0x0000, 0x0000 }, /* R120 */
21280 { 0x0000, 0x0000, 0x0000 }, /* R121 */
21281 { 0x0000, 0x0000, 0x0000 }, /* R122 */
21282 { 0x0000, 0x0000, 0x0000 }, /* R123 */
21283 { 0x0079, 0x0079, 0x0000 }, /* R124 - Analogue Clocking1 */
21284 { 0x00DF, 0x00DF, 0x0000 }, /* R125 - Analogue Clocking2 */
21285 { 0x000D, 0x000D, 0x0000 }, /* R126 - Analogue Clocking3 */
21286 { 0x0000, 0xFFFF, 0x0000 }, /* R127 - PLL Software Reset */
21287 { 0x0000, 0x0000, 0x0000 }, /* R128 */
21288 { 0x00B0, 0x00B0, 0x0000 }, /* R129 - PLL2 */
21289 { 0x0000, 0x0000, 0x0000 }, /* R130 */
21290 { 0x0003, 0x0003, 0x0000 }, /* R131 - PLL 4 */
21291 { 0x0000, 0x0000, 0x0000 }, /* R132 */
21292 { 0x0000, 0x0000, 0x0000 }, /* R133 */
21293 { 0x0000, 0x0000, 0x0000 }, /* R134 */
21294 { 0x0000, 0x0000, 0x0000 }, /* R135 */
21295 { 0x005F, 0x005F, 0x0000 }, /* R136 - PLL 9 */
21296 { 0x00FF, 0x00FF, 0x0000 }, /* R137 - PLL 10 */
21297 { 0x00FF, 0x00FF, 0x0000 }, /* R138 - PLL 11 */
21298 { 0x00FF, 0x00FF, 0x0000 }, /* R139 - PLL 12 */
21299 { 0x005F, 0x005F, 0x0000 }, /* R140 - PLL 13 */
21300 { 0x00FF, 0x00FF, 0x0000 }, /* R141 - PLL 14 */
21301 { 0x00FF, 0x00FF, 0x0000 }, /* R142 - PLL 15 */
21302 { 0x00FF, 0x00FF, 0x0000 }, /* R143 - PLL 16 */
21303 { 0x0000, 0x0000, 0x0000 }, /* R144 */
21304 { 0x0000, 0x0000, 0x0000 }, /* R145 */
21305 { 0x0000, 0x0000, 0x0000 }, /* R146 */
21306 { 0x0000, 0x0000, 0x0000 }, /* R147 */
21307 { 0x0000, 0x0000, 0x0000 }, /* R148 */
21308 { 0x0000, 0x0000, 0x0000 }, /* R149 */
21309 { 0x0000, 0x0000, 0x0000 }, /* R150 */
21310 { 0x0000, 0x0000, 0x0000 }, /* R151 */
21311 { 0x0000, 0x0000, 0x0000 }, /* R152 */
21312 { 0x0000, 0x0000, 0x0000 }, /* R153 */
21313 { 0x0000, 0x0000, 0x0000 }, /* R154 */
21314 { 0x0067, 0x0067, 0x0000 }, /* R155 - FLL Control (1) */
21315 { 0x01FB, 0x01FB, 0x0000 }, /* R156 - FLL Control (2) */
21316 { 0x0007, 0x0007, 0x0000 }, /* R157 - FLL Control (3) */
21317 { 0x0000, 0x0000, 0x0000 }, /* R158 */
21318 { 0x007F, 0x007F, 0x0000 }, /* R159 - FLL Control (5) */
21319 { 0xFFFF, 0xFFFF, 0x0000 }, /* R160 - FLL Control (6) */
21320 { 0xFFFF, 0xFFFF, 0x0000 }, /* R161 - FLL Control (7) */
21321 { 0x03FF, 0x03FF, 0x0000 }, /* R162 - FLL Control (8) */
21322 { 0x0000, 0x0000, 0x0000 }, /* R163 */
21323 { 0x0000, 0x0000, 0x0000 }, /* R164 */
21324 { 0x0000, 0x0000, 0x0000 }, /* R165 */
21325 { 0x0000, 0x0000, 0x0000 }, /* R166 */
21326 { 0x0000, 0x0000, 0x0000 }, /* R167 */
21327 { 0x0000, 0x0000, 0x0000 }, /* R168 */
21328 { 0x0000, 0x0000, 0x0000 }, /* R169 */
21329 { 0x0000, 0x0000, 0x0000 }, /* R170 */
21330 { 0x0000, 0x0000, 0x0000 }, /* R171 */
21331 { 0x0000, 0x0000, 0x0000 }, /* R172 */
21332 { 0x0000, 0x0000, 0x0000 }, /* R173 */
21333 { 0x0000, 0x0000, 0x0000 }, /* R174 */
21334 { 0x0000, 0x0000, 0x0000 }, /* R175 */
21335 { 0x0000, 0x0000, 0x0000 }, /* R176 */
21336 { 0x0000, 0x0000, 0x0000 }, /* R177 */
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42170 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21011 - VSS_PG_0 */
42171 { 0x00FF, 0x00FF, 0x0000 }, /* R21012 - VSS_XTD1_1 */
42172 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21013 - VSS_XTD1_0 */
42173 { 0x00FF, 0x00FF, 0x0000 }, /* R21014 - VSS_XTD2_1 */
42174 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21015 - VSS_XTD2_0 */
42175 { 0x00FF, 0x00FF, 0x0000 }, /* R21016 - VSS_XTD3_1 */
42176 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21017 - VSS_XTD3_0 */
42177 { 0x00FF, 0x00FF, 0x0000 }, /* R21018 - VSS_XTD4_1 */
42178 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21019 - VSS_XTD4_0 */
42179 { 0x00FF, 0x00FF, 0x0000 }, /* R21020 - VSS_XTD5_1 */
42180 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21021 - VSS_XTD5_0 */
42181 { 0x00FF, 0x00FF, 0x0000 }, /* R21022 - VSS_XTD6_1 */
42182 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21023 - VSS_XTD6_0 */
42183 { 0x00FF, 0x00FF, 0x0000 }, /* R21024 - VSS_XTD7_1 */
42184 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21025 - VSS_XTD7_0 */
42185 { 0x00FF, 0x00FF, 0x0000 }, /* R21026 - VSS_XTD8_1 */
42186 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21027 - VSS_XTD8_0 */
42187 { 0x00FF, 0x00FF, 0x0000 }, /* R21028 - VSS_XTD9_1 */
42188 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21029 - VSS_XTD9_0 */
42189 { 0x00FF, 0x00FF, 0x0000 }, /* R21030 - VSS_XTD10_1 */
42190 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21031 - VSS_XTD10_0 */
42191 { 0x00FF, 0x00FF, 0x0000 }, /* R21032 - VSS_XTD11_1 */
42192 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21033 - VSS_XTD11_0 */
42193 { 0x00FF, 0x00FF, 0x0000 }, /* R21034 - VSS_XTD12_1 */
42194 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21035 - VSS_XTD12_0 */
42195 { 0x00FF, 0x00FF, 0x0000 }, /* R21036 - VSS_XTD13_1 */
42196 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21037 - VSS_XTD13_0 */
42197 { 0x00FF, 0x00FF, 0x0000 }, /* R21038 - VSS_XTD14_1 */
42198 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21039 - VSS_XTD14_0 */
42199 { 0x00FF, 0x00FF, 0x0000 }, /* R21040 - VSS_XTD15_1 */
42200 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21041 - VSS_XTD15_0 */
42201 { 0x00FF, 0x00FF, 0x0000 }, /* R21042 - VSS_XTD16_1 */
42202 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21043 - VSS_XTD16_0 */
42203 { 0x00FF, 0x00FF, 0x0000 }, /* R21044 - VSS_XTD17_1 */
42204 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21045 - VSS_XTD17_0 */
42205 { 0x00FF, 0x00FF, 0x0000 }, /* R21046 - VSS_XTD18_1 */
42206 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21047 - VSS_XTD18_0 */
42207 { 0x00FF, 0x00FF, 0x0000 }, /* R21048 - VSS_XTD19_1 */
42208 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21049 - VSS_XTD19_0 */
42209 { 0x00FF, 0x00FF, 0x0000 }, /* R21050 - VSS_XTD20_1 */
42210 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21051 - VSS_XTD20_0 */
42211 { 0x00FF, 0x00FF, 0x0000 }, /* R21052 - VSS_XTD21_1 */
42212 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21053 - VSS_XTD21_0 */
42213 { 0x00FF, 0x00FF, 0x0000 }, /* R21054 - VSS_XTD22_1 */
42214 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21055 - VSS_XTD22_0 */
42215 { 0x00FF, 0x00FF, 0x0000 }, /* R21056 - VSS_XTD23_1 */
42216 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21057 - VSS_XTD23_0 */
42217 { 0x00FF, 0x00FF, 0x0000 }, /* R21058 - VSS_XTD24_1 */
42218 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21059 - VSS_XTD24_0 */
42219 { 0x00FF, 0x00FF, 0x0000 }, /* R21060 - VSS_XTD25_1 */
42220 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21061 - VSS_XTD25_0 */
42221 { 0x00FF, 0x00FF, 0x0000 }, /* R21062 - VSS_XTD26_1 */
42222 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21063 - VSS_XTD26_0 */
42223 { 0x00FF, 0x00FF, 0x0000 }, /* R21064 - VSS_XTD27_1 */
42224 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21065 - VSS_XTD27_0 */
42225 { 0x00FF, 0x00FF, 0x0000 }, /* R21066 - VSS_XTD28_1 */
42226 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21067 - VSS_XTD28_0 */
42227 { 0x00FF, 0x00FF, 0x0000 }, /* R21068 - VSS_XTD29_1 */
42228 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21069 - VSS_XTD29_0 */
42229 { 0x00FF, 0x00FF, 0x0000 }, /* R21070 - VSS_XTD30_1 */
42230 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21071 - VSS_XTD30_0 */
42231 { 0x00FF, 0x00FF, 0x0000 }, /* R21072 - VSS_XTD31_1 */
42232 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21073 - VSS_XTD31_0 */
42233 { 0x00FF, 0x00FF, 0x0000 }, /* R21074 - VSS_XTD32_1 */
42234 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21075 - VSS_XTD32_0 */
42235 { 0x00FF, 0x00FF, 0x0000 }, /* R21076 - VSS_XTS1_1 */
42236 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21077 - VSS_XTS1_0 */
42237 { 0x00FF, 0x00FF, 0x0000 }, /* R21078 - VSS_XTS2_1 */
42238 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21079 - VSS_XTS2_0 */
42239 { 0x00FF, 0x00FF, 0x0000 }, /* R21080 - VSS_XTS3_1 */
42240 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21081 - VSS_XTS3_0 */
42241 { 0x00FF, 0x00FF, 0x0000 }, /* R21082 - VSS_XTS4_1 */
42242 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21083 - VSS_XTS4_0 */
42243 { 0x00FF, 0x00FF, 0x0000 }, /* R21084 - VSS_XTS5_1 */
42244 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21085 - VSS_XTS5_0 */
42245 { 0x00FF, 0x00FF, 0x0000 }, /* R21086 - VSS_XTS6_1 */
42246 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21087 - VSS_XTS6_0 */
42247 { 0x00FF, 0x00FF, 0x0000 }, /* R21088 - VSS_XTS7_1 */
42248 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21089 - VSS_XTS7_0 */
42249 { 0x00FF, 0x00FF, 0x0000 }, /* R21090 - VSS_XTS8_1 */
42250 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21091 - VSS_XTS8_0 */
42251 { 0x00FF, 0x00FF, 0x0000 }, /* R21092 - VSS_XTS9_1 */
42252 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21093 - VSS_XTS9_0 */
42253 { 0x00FF, 0x00FF, 0x0000 }, /* R21094 - VSS_XTS10_1 */
42254 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21095 - VSS_XTS10_0 */
42255 { 0x00FF, 0x00FF, 0x0000 }, /* R21096 - VSS_XTS11_1 */
42256 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21097 - VSS_XTS11_0 */
42257 { 0x00FF, 0x00FF, 0x0000 }, /* R21098 - VSS_XTS12_1 */
42258 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21099 - VSS_XTS12_0 */
42259 { 0x00FF, 0x00FF, 0x0000 }, /* R21100 - VSS_XTS13_1 */
42260 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21101 - VSS_XTS13_0 */
42261 { 0x00FF, 0x00FF, 0x0000 }, /* R21102 - VSS_XTS14_1 */
42262 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21103 - VSS_XTS14_0 */
42263 { 0x00FF, 0x00FF, 0x0000 }, /* R21104 - VSS_XTS15_1 */
42264 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21105 - VSS_XTS15_0 */
42265 { 0x00FF, 0x00FF, 0x0000 }, /* R21106 - VSS_XTS16_1 */
42266 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21107 - VSS_XTS16_0 */
42267 { 0x00FF, 0x00FF, 0x0000 }, /* R21108 - VSS_XTS17_1 */
42268 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21109 - VSS_XTS17_0 */
42269 { 0x00FF, 0x00FF, 0x0000 }, /* R21110 - VSS_XTS18_1 */
42270 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21111 - VSS_XTS18_0 */
42271 { 0x00FF, 0x00FF, 0x0000 }, /* R21112 - VSS_XTS19_1 */
42272 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21113 - VSS_XTS19_0 */
42273 { 0x00FF, 0x00FF, 0x0000 }, /* R21114 - VSS_XTS20_1 */
42274 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21115 - VSS_XTS20_0 */
42275 { 0x00FF, 0x00FF, 0x0000 }, /* R21116 - VSS_XTS21_1 */
42276 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21117 - VSS_XTS21_0 */
42277 { 0x00FF, 0x00FF, 0x0000 }, /* R21118 - VSS_XTS22_1 */
42278 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21119 - VSS_XTS22_0 */
42279 { 0x00FF, 0x00FF, 0x0000 }, /* R21120 - VSS_XTS23_1 */
42280 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21121 - VSS_XTS23_0 */
42281 { 0x00FF, 0x00FF, 0x0000 }, /* R21122 - VSS_XTS24_1 */
42282 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21123 - VSS_XTS24_0 */
42283 { 0x00FF, 0x00FF, 0x0000 }, /* R21124 - VSS_XTS25_1 */
42284 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21125 - VSS_XTS25_0 */
42285 { 0x00FF, 0x00FF, 0x0000 }, /* R21126 - VSS_XTS26_1 */
42286 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21127 - VSS_XTS26_0 */
42287 { 0x00FF, 0x00FF, 0x0000 }, /* R21128 - VSS_XTS27_1 */
42288 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21129 - VSS_XTS27_0 */
42289 { 0x00FF, 0x00FF, 0x0000 }, /* R21130 - VSS_XTS28_1 */
42290 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21131 - VSS_XTS28_0 */
42291 { 0x00FF, 0x00FF, 0x0000 }, /* R21132 - VSS_XTS29_1 */
42292 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21133 - VSS_XTS29_0 */
42293 { 0x00FF, 0x00FF, 0x0000 }, /* R21134 - VSS_XTS30_1 */
42294 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21135 - VSS_XTS30_0 */
42295 { 0x00FF, 0x00FF, 0x0000 }, /* R21136 - VSS_XTS31_1 */
42296 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21137 - VSS_XTS31_0 */
42297 { 0x00FF, 0x00FF, 0x0000 }, /* R21138 - VSS_XTS32_1 */
42298 { 0xFFFF, 0xFFFF, 0x0000 }, /* R21139 - VSS_XTS32_0 */
42299};
diff --git a/sound/soc/codecs/wm8962.c b/sound/soc/codecs/wm8962.c
new file mode 100644
index 000000000000..ea8940e80263
--- /dev/null
+++ b/sound/soc/codecs/wm8962.c
@@ -0,0 +1,1933 @@
1/*
2 * wm8962.c -- WM8962 ALSA SoC Audio driver
3 *
4 * Copyright 2010 Wolfson Microelectronics plc
5 *
6 * Author: Mark Brown <broonie@opensource.wolfsonmicro.com>
7 *
8 *
9 * This program is free software; you can redistribute it and/or modify
10 * it under the terms of the GNU General Public License version 2 as
11 * published by the Free Software Foundation.
12 */
13
14#include <linux/module.h>
15#include <linux/moduleparam.h>
16#include <linux/init.h>
17#include <linux/delay.h>
18#include <linux/pm.h>
19#include <linux/gcd.h>
20#include <linux/i2c.h>
21#include <linux/input.h>
22#include <linux/platform_device.h>
23#include <linux/regulator/consumer.h>
24#include <linux/slab.h>
25#include <linux/workqueue.h>
26#include <sound/core.h>
27#include <sound/pcm.h>
28#include <sound/pcm_params.h>
29#include <sound/soc.h>
30#include <sound/soc-dapm.h>
31#include <sound/initval.h>
32#include <sound/tlv.h>
33#include <sound/wm8962.h>
34
35#include "wm8962.h"
36
37static struct snd_soc_codec *wm8962_codec;
38struct snd_soc_codec_device soc_codec_dev_wm8962;
39
40#define WM8962_NUM_SUPPLIES 8
41static const char *wm8962_supply_names[WM8962_NUM_SUPPLIES] = {
42 "DCVDD",
43 "DBVDD",
44 "AVDD",
45 "CPVDD",
46 "MICVDD",
47 "PLLVDD",
48 "SPKVDD1",
49 "SPKVDD2",
50};
51
52/* codec private data */
53struct wm8962_priv {
54 struct snd_soc_codec codec;
55 u16 reg_cache[WM8962_MAX_REGISTER + 1];
56
57 int sysclk;
58 int sysclk_rate;
59
60 int bclk; /* Desired BCLK */
61 int lrclk;
62
63 int fll_src;
64 int fll_fref;
65 int fll_fout;
66
67 struct regulator_bulk_data supplies[WM8962_NUM_SUPPLIES];
68 struct notifier_block disable_nb[WM8962_NUM_SUPPLIES];
69
70#if defined(CONFIG_INPUT) || defined(CONFIG_INPUT_MODULE)
71 struct input_dev *beep;
72 struct work_struct beep_work;
73 int beep_rate;
74#endif
75};
76
77/* We can't use the same notifier block for more than one supply and
78 * there's no way I can see to get from a callback to the caller
79 * except container_of().
80 */
81#define WM8962_REGULATOR_EVENT(n) \
82static int wm8962_regulator_event_##n(struct notifier_block *nb, \
83 unsigned long event, void *data) \
84{ \
85 struct wm8962_priv *wm8962 = container_of(nb, struct wm8962_priv, \
86 disable_nb[n]); \
87 if (event & REGULATOR_EVENT_DISABLE) { \
88 wm8962->codec.cache_sync = 1; \
89 } \
90 return 0; \
91}
92
93WM8962_REGULATOR_EVENT(0)
94WM8962_REGULATOR_EVENT(1)
95WM8962_REGULATOR_EVENT(2)
96WM8962_REGULATOR_EVENT(3)
97WM8962_REGULATOR_EVENT(4)
98WM8962_REGULATOR_EVENT(5)
99WM8962_REGULATOR_EVENT(6)
100WM8962_REGULATOR_EVENT(7)
101
102static int wm8962_volatile_register(unsigned int reg)
103{
104 if (wm8962_reg_access[reg].vol)
105 return 1;
106 else
107 return 0;
108}
109
110static int wm8962_readable(unsigned int reg)
111{
112 if (wm8962_reg_access[reg].read)
113 return 1;
114 else
115 return 0;
116}
117
118static int wm8962_reset(struct snd_soc_codec *codec)
119{
120 return snd_soc_write(codec, WM8962_SOFTWARE_RESET, 0);
121}
122
123static const DECLARE_TLV_DB_SCALE(inpga_tlv, -2325, 75, 0);
124static const DECLARE_TLV_DB_SCALE(mixin_tlv, -1500, 300, 0);
125static const unsigned int mixinpga_tlv[] = {
126 TLV_DB_RANGE_HEAD(7),
127 0, 1, TLV_DB_SCALE_ITEM(0, 600, 0),
128 2, 2, TLV_DB_SCALE_ITEM(1300, 1300, 0),
129 3, 4, TLV_DB_SCALE_ITEM(1800, 200, 0),
130 5, 5, TLV_DB_SCALE_ITEM(2400, 0, 0),
131 6, 7, TLV_DB_SCALE_ITEM(2700, 300, 0),
132};
133static const DECLARE_TLV_DB_SCALE(beep_tlv, -9600, 600, 1);
134static const DECLARE_TLV_DB_SCALE(digital_tlv, -7200, 75, 1);
135static const DECLARE_TLV_DB_SCALE(st_tlv, -3600, 300, 0);
136static const DECLARE_TLV_DB_SCALE(inmix_tlv, -600, 600, 0);
137static const DECLARE_TLV_DB_SCALE(bypass_tlv, -1500, 300, 0);
138static const DECLARE_TLV_DB_SCALE(out_tlv, -12100, 100, 1);
139static const DECLARE_TLV_DB_SCALE(hp_tlv, -700, 100, 0);
140static const unsigned int classd_tlv[] = {
141 TLV_DB_RANGE_HEAD(7),
142 0, 6, TLV_DB_SCALE_ITEM(0, 150, 0),
143 7, 7, TLV_DB_SCALE_ITEM(1200, 0, 0),
144};
145
146/* The VU bits for the headphones are in a different register to the mute
147 * bits and only take effect on the PGA if it is actually powered.
148 */
149static int wm8962_put_hp_sw(struct snd_kcontrol *kcontrol,
150 struct snd_ctl_elem_value *ucontrol)
151{
152 struct snd_soc_codec *codec = snd_kcontrol_chip(kcontrol);
153 u16 *reg_cache = codec->reg_cache;
154 int ret;
155
156 /* Apply the update (if any) */
157 ret = snd_soc_put_volsw(kcontrol, ucontrol);
158 if (ret == 0)
159 return 0;
160
161 /* If the left PGA is enabled hit that VU bit... */
162 if (reg_cache[WM8962_PWR_MGMT_2] & WM8962_HPOUTL_PGA_ENA)
163 return snd_soc_write(codec, WM8962_HPOUTL_VOLUME,
164 reg_cache[WM8962_HPOUTL_VOLUME]);
165
166 /* ...otherwise the right. The VU is stereo. */
167 if (reg_cache[WM8962_PWR_MGMT_2] & WM8962_HPOUTR_PGA_ENA)
168 return snd_soc_write(codec, WM8962_HPOUTR_VOLUME,
169 reg_cache[WM8962_HPOUTR_VOLUME]);
170
171 return 0;
172}
173
174/* The VU bits for the speakers are in a different register to the mute
175 * bits and only take effect on the PGA if it is actually powered.
176 */
177static int wm8962_put_spk_sw(struct snd_kcontrol *kcontrol,
178 struct snd_ctl_elem_value *ucontrol)
179{
180 struct snd_soc_codec *codec = snd_kcontrol_chip(kcontrol);
181 u16 *reg_cache = codec->reg_cache;
182 int ret;
183
184 /* Apply the update (if any) */
185 ret = snd_soc_put_volsw(kcontrol, ucontrol);
186 if (ret == 0)
187 return 0;
188
189 /* If the left PGA is enabled hit that VU bit... */
190 if (reg_cache[WM8962_PWR_MGMT_2] & WM8962_SPKOUTL_PGA_ENA)
191 return snd_soc_write(codec, WM8962_SPKOUTL_VOLUME,
192 reg_cache[WM8962_SPKOUTL_VOLUME]);
193
194 /* ...otherwise the right. The VU is stereo. */
195 if (reg_cache[WM8962_PWR_MGMT_2] & WM8962_SPKOUTR_PGA_ENA)
196 return snd_soc_write(codec, WM8962_SPKOUTR_VOLUME,
197 reg_cache[WM8962_SPKOUTR_VOLUME]);
198
199 return 0;
200}
201
202static const struct snd_kcontrol_new wm8962_snd_controls[] = {
203SOC_DOUBLE("Input Mixer Switch", WM8962_INPUT_MIXER_CONTROL_1, 3, 2, 1, 1),
204
205SOC_SINGLE_TLV("MIXINL IN2L Volume", WM8962_LEFT_INPUT_MIXER_VOLUME, 6, 7, 0,
206 mixin_tlv),
207SOC_SINGLE_TLV("MIXINL PGA Volume", WM8962_LEFT_INPUT_MIXER_VOLUME, 3, 7, 0,
208 mixinpga_tlv),
209SOC_SINGLE_TLV("MIXINL IN3L Volume", WM8962_LEFT_INPUT_MIXER_VOLUME, 0, 7, 0,
210 mixin_tlv),
211
212SOC_SINGLE_TLV("MIXINR IN2R Volume", WM8962_RIGHT_INPUT_MIXER_VOLUME, 6, 7, 0,
213 mixin_tlv),
214SOC_SINGLE_TLV("MIXINR PGA Volume", WM8962_RIGHT_INPUT_MIXER_VOLUME, 3, 7, 0,
215 mixinpga_tlv),
216SOC_SINGLE_TLV("MIXINR IN3R Volume", WM8962_RIGHT_INPUT_MIXER_VOLUME, 0, 7, 0,
217 mixin_tlv),
218
219SOC_DOUBLE_R_TLV("Digital Capture Volume", WM8962_LEFT_ADC_VOLUME,
220 WM8962_RIGHT_ADC_VOLUME, 1, 127, 0, digital_tlv),
221SOC_DOUBLE_R_TLV("Capture Volume", WM8962_LEFT_INPUT_VOLUME,
222 WM8962_RIGHT_INPUT_VOLUME, 0, 63, 0, inpga_tlv),
223SOC_DOUBLE_R("Capture Switch", WM8962_LEFT_INPUT_VOLUME,
224 WM8962_RIGHT_INPUT_VOLUME, 7, 1, 1),
225SOC_DOUBLE_R("Capture ZC Switch", WM8962_LEFT_INPUT_VOLUME,
226 WM8962_RIGHT_INPUT_VOLUME, 6, 1, 1),
227
228SOC_DOUBLE_R_TLV("Sidetone Volume", WM8962_DAC_DSP_MIXING_1,
229 WM8962_DAC_DSP_MIXING_2, 4, 12, 0, st_tlv),
230
231SOC_DOUBLE_R_TLV("Digital Playback Volume", WM8962_LEFT_DAC_VOLUME,
232 WM8962_RIGHT_DAC_VOLUME, 1, 127, 0, digital_tlv),
233SOC_SINGLE("DAC High Performance Switch", WM8962_ADC_DAC_CONTROL_2, 0, 1, 0),
234
235SOC_SINGLE("ADC High Performance Switch", WM8962_ADDITIONAL_CONTROL_1,
236 5, 1, 0),
237
238SOC_SINGLE_TLV("Beep Volume", WM8962_BEEP_GENERATOR_1, 4, 15, 0, beep_tlv),
239
240SOC_DOUBLE_R_TLV("Headphone Volume", WM8962_HPOUTL_VOLUME,
241 WM8962_HPOUTR_VOLUME, 0, 127, 0, out_tlv),
242SOC_DOUBLE_EXT("Headphone Switch", WM8962_PWR_MGMT_2, 1, 0, 1, 1,
243 snd_soc_get_volsw, wm8962_put_hp_sw),
244SOC_DOUBLE_R("Headphone ZC Switch", WM8962_HPOUTL_VOLUME, WM8962_HPOUTR_VOLUME,
245 7, 1, 0),
246SOC_DOUBLE_TLV("Headphone Aux Volume", WM8962_ANALOGUE_HP_2, 3, 6, 7, 0,
247 hp_tlv),
248
249SOC_DOUBLE_R("Headphone Mixer Switch", WM8962_HEADPHONE_MIXER_3,
250 WM8962_HEADPHONE_MIXER_4, 8, 1, 1),
251
252SOC_SINGLE_TLV("HPMIXL IN4L Volume", WM8962_HEADPHONE_MIXER_3,
253 3, 7, 0, bypass_tlv),
254SOC_SINGLE_TLV("HPMIXL IN4R Volume", WM8962_HEADPHONE_MIXER_3,
255 0, 7, 0, bypass_tlv),
256SOC_SINGLE_TLV("HPMIXL MIXINL Volume", WM8962_HEADPHONE_MIXER_3,
257 7, 1, 1, inmix_tlv),
258SOC_SINGLE_TLV("HPMIXL MIXINR Volume", WM8962_HEADPHONE_MIXER_3,
259 6, 1, 1, inmix_tlv),
260
261SOC_SINGLE_TLV("HPMIXR IN4L Volume", WM8962_HEADPHONE_MIXER_4,
262 3, 7, 0, bypass_tlv),
263SOC_SINGLE_TLV("HPMIXR IN4R Volume", WM8962_HEADPHONE_MIXER_4,
264 0, 7, 0, bypass_tlv),
265SOC_SINGLE_TLV("HPMIXR MIXINL Volume", WM8962_HEADPHONE_MIXER_4,
266 7, 1, 1, inmix_tlv),
267SOC_SINGLE_TLV("HPMIXR MIXINR Volume", WM8962_HEADPHONE_MIXER_4,
268 6, 1, 1, inmix_tlv),
269
270SOC_SINGLE_TLV("Speaker Boost Volume", WM8962_CLASS_D_CONTROL_2, 0, 7, 0,
271 classd_tlv),
272};
273
274static const struct snd_kcontrol_new wm8962_spk_mono_controls[] = {
275SOC_SINGLE_TLV("Speaker Volume", WM8962_SPKOUTL_VOLUME, 0, 127, 0, out_tlv),
276SOC_SINGLE_EXT("Speaker Switch", WM8962_CLASS_D_CONTROL_1, 1, 1, 1,
277 snd_soc_get_volsw, wm8962_put_spk_sw),
278SOC_SINGLE("Speaker ZC Switch", WM8962_SPKOUTL_VOLUME, 7, 1, 0),
279
280SOC_SINGLE("Speaker Mixer Switch", WM8962_SPEAKER_MIXER_3, 8, 1, 1),
281SOC_SINGLE_TLV("Speaker Mixer IN4L Volume", WM8962_SPEAKER_MIXER_3,
282 3, 7, 0, bypass_tlv),
283SOC_SINGLE_TLV("Speaker Mixer IN4R Volume", WM8962_SPEAKER_MIXER_3,
284 0, 7, 0, bypass_tlv),
285SOC_SINGLE_TLV("Speaker Mixer MIXINL Volume", WM8962_SPEAKER_MIXER_3,
286 7, 1, 1, inmix_tlv),
287SOC_SINGLE_TLV("Speaker Mixer MIXINR Volume", WM8962_SPEAKER_MIXER_3,
288 6, 1, 1, inmix_tlv),
289SOC_SINGLE_TLV("Speaker Mixer DACL Volume", WM8962_SPEAKER_MIXER_5,
290 7, 1, 0, inmix_tlv),
291SOC_SINGLE_TLV("Speaker Mixer DACR Volume", WM8962_SPEAKER_MIXER_5,
292 6, 1, 0, inmix_tlv),
293};
294
295static const struct snd_kcontrol_new wm8962_spk_stereo_controls[] = {
296SOC_DOUBLE_R_TLV("Speaker Volume", WM8962_SPKOUTL_VOLUME,
297 WM8962_SPKOUTR_VOLUME, 0, 127, 0, out_tlv),
298SOC_DOUBLE_EXT("Speaker Switch", WM8962_CLASS_D_CONTROL_1, 1, 0, 1, 1,
299 snd_soc_get_volsw, wm8962_put_spk_sw),
300SOC_DOUBLE_R("Speaker ZC Switch", WM8962_SPKOUTL_VOLUME, WM8962_SPKOUTR_VOLUME,
301 7, 1, 0),
302
303SOC_DOUBLE_R("Speaker Mixer Switch", WM8962_SPEAKER_MIXER_3,
304 WM8962_SPEAKER_MIXER_4, 8, 1, 1),
305
306SOC_SINGLE_TLV("SPKOUTL Mixer IN4L Volume", WM8962_SPEAKER_MIXER_3,
307 3, 7, 0, bypass_tlv),
308SOC_SINGLE_TLV("SPKOUTL Mixer IN4R Volume", WM8962_SPEAKER_MIXER_3,
309 0, 7, 0, bypass_tlv),
310SOC_SINGLE_TLV("SPKOUTL Mixer MIXINL Volume", WM8962_SPEAKER_MIXER_3,
311 7, 1, 1, inmix_tlv),
312SOC_SINGLE_TLV("SPKOUTL Mixer MIXINR Volume", WM8962_SPEAKER_MIXER_3,
313 6, 1, 1, inmix_tlv),
314SOC_SINGLE_TLV("SPKOUTL Mixer DACL Volume", WM8962_SPEAKER_MIXER_5,
315 7, 1, 0, inmix_tlv),
316SOC_SINGLE_TLV("SPKOUTL Mixer DACR Volume", WM8962_SPEAKER_MIXER_5,
317 6, 1, 0, inmix_tlv),
318
319SOC_SINGLE_TLV("SPKOUTR Mixer IN4L Volume", WM8962_SPEAKER_MIXER_4,
320 3, 7, 0, bypass_tlv),
321SOC_SINGLE_TLV("SPKOUTR Mixer IN4R Volume", WM8962_SPEAKER_MIXER_4,
322 0, 7, 0, bypass_tlv),
323SOC_SINGLE_TLV("SPKOUTR Mixer MIXINL Volume", WM8962_SPEAKER_MIXER_4,
324 7, 1, 1, inmix_tlv),
325SOC_SINGLE_TLV("SPKOUTR Mixer MIXINR Volume", WM8962_SPEAKER_MIXER_4,
326 6, 1, 1, inmix_tlv),
327SOC_SINGLE_TLV("SPKOUTR Mixer DACL Volume", WM8962_SPEAKER_MIXER_5,
328 5, 1, 0, inmix_tlv),
329SOC_SINGLE_TLV("SPKOUTR Mixer DACR Volume", WM8962_SPEAKER_MIXER_5,
330 4, 1, 0, inmix_tlv),
331};
332
333static int sysclk_event(struct snd_soc_dapm_widget *w,
334 struct snd_kcontrol *kcontrol, int event)
335{
336 struct snd_soc_codec *codec = w->codec;
337 int src;
338 int fll;
339
340 src = snd_soc_read(codec, WM8962_CLOCKING2) & WM8962_SYSCLK_SRC_MASK;
341
342 switch (src) {
343 case 0: /* MCLK */
344 fll = 0;
345 break;
346 case 0x200: /* FLL */
347 fll = 1;
348 break;
349 default:
350 dev_err(codec->dev, "Unknown SYSCLK source %x\n", src);
351 return -EINVAL;
352 }
353
354 switch (event) {
355 case SND_SOC_DAPM_PRE_PMU:
356 if (fll)
357 snd_soc_update_bits(codec, WM8962_FLL_CONTROL_1,
358 WM8962_FLL_ENA, WM8962_FLL_ENA);
359 break;
360
361 case SND_SOC_DAPM_POST_PMD:
362 if (fll)
363 snd_soc_update_bits(codec, WM8962_FLL_CONTROL_1,
364 WM8962_FLL_ENA, 0);
365 break;
366
367 default:
368 BUG();
369 return -EINVAL;
370 }
371
372 return 0;
373}
374
375static int cp_event(struct snd_soc_dapm_widget *w,
376 struct snd_kcontrol *kcontrol, int event)
377{
378 switch (event) {
379 case SND_SOC_DAPM_POST_PMU:
380 msleep(5);
381 break;
382
383 default:
384 BUG();
385 return -EINVAL;
386 }
387
388 return 0;
389}
390
391static int hp_event(struct snd_soc_dapm_widget *w,
392 struct snd_kcontrol *kcontrol, int event)
393{
394 struct snd_soc_codec *codec = w->codec;
395 int timeout;
396 int reg;
397 int expected = (WM8962_DCS_STARTUP_DONE_HP1L |
398 WM8962_DCS_STARTUP_DONE_HP1R);
399
400 switch (event) {
401 case SND_SOC_DAPM_POST_PMU:
402 snd_soc_update_bits(codec, WM8962_ANALOGUE_HP_0,
403 WM8962_HP1L_ENA | WM8962_HP1R_ENA,
404 WM8962_HP1L_ENA | WM8962_HP1R_ENA);
405 udelay(20);
406
407 snd_soc_update_bits(codec, WM8962_ANALOGUE_HP_0,
408 WM8962_HP1L_ENA_DLY | WM8962_HP1R_ENA_DLY,
409 WM8962_HP1L_ENA_DLY | WM8962_HP1R_ENA_DLY);
410
411 /* Start the DC servo */
412 snd_soc_update_bits(codec, WM8962_DC_SERVO_1,
413 WM8962_HP1L_DCS_ENA | WM8962_HP1R_DCS_ENA |
414 WM8962_HP1L_DCS_STARTUP |
415 WM8962_HP1R_DCS_STARTUP,
416 WM8962_HP1L_DCS_ENA | WM8962_HP1R_DCS_ENA |
417 WM8962_HP1L_DCS_STARTUP |
418 WM8962_HP1R_DCS_STARTUP);
419
420 /* Wait for it to complete, should be well under 100ms */
421 timeout = 0;
422 do {
423 msleep(1);
424 reg = snd_soc_read(codec, WM8962_DC_SERVO_6);
425 if (reg < 0) {
426 dev_err(codec->dev,
427 "Failed to read DCS status: %d\n",
428 reg);
429 continue;
430 }
431 dev_dbg(codec->dev, "DCS status: %x\n", reg);
432 } while (++timeout < 200 && (reg & expected) != expected);
433
434 if ((reg & expected) != expected)
435 dev_err(codec->dev, "DC servo timed out\n");
436 else
437 dev_dbg(codec->dev, "DC servo complete after %dms\n",
438 timeout);
439
440 snd_soc_update_bits(codec, WM8962_ANALOGUE_HP_0,
441 WM8962_HP1L_ENA_OUTP |
442 WM8962_HP1R_ENA_OUTP,
443 WM8962_HP1L_ENA_OUTP |
444 WM8962_HP1R_ENA_OUTP);
445 udelay(20);
446
447 snd_soc_update_bits(codec, WM8962_ANALOGUE_HP_0,
448 WM8962_HP1L_RMV_SHORT |
449 WM8962_HP1R_RMV_SHORT,
450 WM8962_HP1L_RMV_SHORT |
451 WM8962_HP1R_RMV_SHORT);
452 break;
453
454 case SND_SOC_DAPM_PRE_PMD:
455 snd_soc_update_bits(codec, WM8962_ANALOGUE_HP_0,
456 WM8962_HP1L_RMV_SHORT |
457 WM8962_HP1R_RMV_SHORT, 0);
458
459 udelay(20);
460
461 snd_soc_update_bits(codec, WM8962_DC_SERVO_1,
462 WM8962_HP1L_DCS_ENA | WM8962_HP1R_DCS_ENA |
463 WM8962_HP1L_DCS_STARTUP |
464 WM8962_HP1R_DCS_STARTUP,
465 0);
466
467 snd_soc_update_bits(codec, WM8962_ANALOGUE_HP_0,
468 WM8962_HP1L_ENA | WM8962_HP1R_ENA |
469 WM8962_HP1L_ENA_DLY | WM8962_HP1R_ENA_DLY |
470 WM8962_HP1L_ENA_OUTP |
471 WM8962_HP1R_ENA_OUTP, 0);
472
473 break;
474
475 default:
476 BUG();
477 return -EINVAL;
478
479 }
480
481 return 0;
482}
483
484/* VU bits for the output PGAs only take effect while the PGA is powered */
485static int out_pga_event(struct snd_soc_dapm_widget *w,
486 struct snd_kcontrol *kcontrol, int event)
487{
488 struct snd_soc_codec *codec = w->codec;
489 u16 *reg_cache = codec->reg_cache;
490 int reg;
491
492 switch (w->shift) {
493 case WM8962_HPOUTR_PGA_ENA_SHIFT:
494 reg = WM8962_HPOUTR_VOLUME;
495 break;
496 case WM8962_HPOUTL_PGA_ENA_SHIFT:
497 reg = WM8962_HPOUTL_VOLUME;
498 break;
499 case WM8962_SPKOUTR_PGA_ENA_SHIFT:
500 reg = WM8962_SPKOUTR_VOLUME;
501 break;
502 case WM8962_SPKOUTL_PGA_ENA_SHIFT:
503 reg = WM8962_SPKOUTL_VOLUME;
504 break;
505 default:
506 BUG();
507 return -EINVAL;
508 }
509
510 switch (event) {
511 case SND_SOC_DAPM_POST_PMU:
512 return snd_soc_write(codec, reg, reg_cache[reg]);
513 default:
514 BUG();
515 return -EINVAL;
516 }
517}
518
519static const char *st_text[] = { "None", "Right", "Left" };
520
521static const struct soc_enum str_enum =
522 SOC_ENUM_SINGLE(WM8962_DAC_DSP_MIXING_1, 2, 3, st_text);
523
524static const struct snd_kcontrol_new str_mux =
525 SOC_DAPM_ENUM("Right Sidetone", str_enum);
526
527static const struct soc_enum stl_enum =
528 SOC_ENUM_SINGLE(WM8962_DAC_DSP_MIXING_2, 2, 3, st_text);
529
530static const struct snd_kcontrol_new stl_mux =
531 SOC_DAPM_ENUM("Left Sidetone", stl_enum);
532
533static const char *outmux_text[] = { "DAC", "Mixer" };
534
535static const struct soc_enum spkoutr_enum =
536 SOC_ENUM_SINGLE(WM8962_SPEAKER_MIXER_2, 7, 2, outmux_text);
537
538static const struct snd_kcontrol_new spkoutr_mux =
539 SOC_DAPM_ENUM("SPKOUTR Mux", spkoutr_enum);
540
541static const struct soc_enum spkoutl_enum =
542 SOC_ENUM_SINGLE(WM8962_SPEAKER_MIXER_1, 7, 2, outmux_text);
543
544static const struct snd_kcontrol_new spkoutl_mux =
545 SOC_DAPM_ENUM("SPKOUTL Mux", spkoutl_enum);
546
547static const struct soc_enum hpoutr_enum =
548 SOC_ENUM_SINGLE(WM8962_HEADPHONE_MIXER_2, 7, 2, outmux_text);
549
550static const struct snd_kcontrol_new hpoutr_mux =
551 SOC_DAPM_ENUM("HPOUTR Mux", hpoutr_enum);
552
553static const struct soc_enum hpoutl_enum =
554 SOC_ENUM_SINGLE(WM8962_HEADPHONE_MIXER_1, 7, 2, outmux_text);
555
556static const struct snd_kcontrol_new hpoutl_mux =
557 SOC_DAPM_ENUM("HPOUTL Mux", hpoutl_enum);
558
559static const struct snd_kcontrol_new inpgal[] = {
560SOC_DAPM_SINGLE("IN1L Switch", WM8962_LEFT_INPUT_PGA_CONTROL, 3, 1, 0),
561SOC_DAPM_SINGLE("IN2L Switch", WM8962_LEFT_INPUT_PGA_CONTROL, 2, 1, 0),
562SOC_DAPM_SINGLE("IN3L Switch", WM8962_LEFT_INPUT_PGA_CONTROL, 1, 1, 0),
563SOC_DAPM_SINGLE("IN4L Switch", WM8962_LEFT_INPUT_PGA_CONTROL, 0, 1, 0),
564};
565
566static const struct snd_kcontrol_new inpgar[] = {
567SOC_DAPM_SINGLE("IN1R Switch", WM8962_RIGHT_INPUT_PGA_CONTROL, 3, 1, 0),
568SOC_DAPM_SINGLE("IN2R Switch", WM8962_RIGHT_INPUT_PGA_CONTROL, 2, 1, 0),
569SOC_DAPM_SINGLE("IN3R Switch", WM8962_RIGHT_INPUT_PGA_CONTROL, 1, 1, 0),
570SOC_DAPM_SINGLE("IN4R Switch", WM8962_RIGHT_INPUT_PGA_CONTROL, 0, 1, 0),
571};
572
573static const struct snd_kcontrol_new mixinl[] = {
574SOC_DAPM_SINGLE("IN2L Switch", WM8962_INPUT_MIXER_CONTROL_2, 5, 1, 0),
575SOC_DAPM_SINGLE("IN3L Switch", WM8962_INPUT_MIXER_CONTROL_2, 4, 1, 0),
576SOC_DAPM_SINGLE("PGA Switch", WM8962_INPUT_MIXER_CONTROL_2, 3, 1, 0),
577};
578
579static const struct snd_kcontrol_new mixinr[] = {
580SOC_DAPM_SINGLE("IN2R Switch", WM8962_INPUT_MIXER_CONTROL_2, 2, 1, 0),
581SOC_DAPM_SINGLE("IN3R Switch", WM8962_INPUT_MIXER_CONTROL_2, 1, 1, 0),
582SOC_DAPM_SINGLE("PGA Switch", WM8962_INPUT_MIXER_CONTROL_2, 0, 1, 0),
583};
584
585static const struct snd_kcontrol_new hpmixl[] = {
586SOC_DAPM_SINGLE("DACL Switch", WM8962_HEADPHONE_MIXER_1, 5, 1, 0),
587SOC_DAPM_SINGLE("DACR Switch", WM8962_HEADPHONE_MIXER_1, 4, 1, 0),
588SOC_DAPM_SINGLE("MIXINL Switch", WM8962_HEADPHONE_MIXER_1, 3, 1, 0),
589SOC_DAPM_SINGLE("MIXINR Switch", WM8962_HEADPHONE_MIXER_1, 2, 1, 0),
590SOC_DAPM_SINGLE("IN4L Switch", WM8962_HEADPHONE_MIXER_1, 1, 1, 0),
591SOC_DAPM_SINGLE("IN4R Switch", WM8962_HEADPHONE_MIXER_1, 0, 1, 0),
592};
593
594static const struct snd_kcontrol_new hpmixr[] = {
595SOC_DAPM_SINGLE("DACL Switch", WM8962_HEADPHONE_MIXER_2, 5, 1, 0),
596SOC_DAPM_SINGLE("DACR Switch", WM8962_HEADPHONE_MIXER_2, 4, 1, 0),
597SOC_DAPM_SINGLE("MIXINL Switch", WM8962_HEADPHONE_MIXER_2, 3, 1, 0),
598SOC_DAPM_SINGLE("MIXINR Switch", WM8962_HEADPHONE_MIXER_2, 2, 1, 0),
599SOC_DAPM_SINGLE("IN4L Switch", WM8962_HEADPHONE_MIXER_2, 1, 1, 0),
600SOC_DAPM_SINGLE("IN4R Switch", WM8962_HEADPHONE_MIXER_2, 0, 1, 0),
601};
602
603static const struct snd_kcontrol_new spkmixl[] = {
604SOC_DAPM_SINGLE("DACL Switch", WM8962_SPEAKER_MIXER_1, 5, 1, 0),
605SOC_DAPM_SINGLE("DACR Switch", WM8962_SPEAKER_MIXER_1, 4, 1, 0),
606SOC_DAPM_SINGLE("MIXINL Switch", WM8962_SPEAKER_MIXER_1, 3, 1, 0),
607SOC_DAPM_SINGLE("MIXINR Switch", WM8962_SPEAKER_MIXER_1, 2, 1, 0),
608SOC_DAPM_SINGLE("IN4L Switch", WM8962_SPEAKER_MIXER_1, 1, 1, 0),
609SOC_DAPM_SINGLE("IN4R Switch", WM8962_SPEAKER_MIXER_1, 0, 1, 0),
610};
611
612static const struct snd_kcontrol_new spkmixr[] = {
613SOC_DAPM_SINGLE("DACL Switch", WM8962_SPEAKER_MIXER_2, 5, 1, 0),
614SOC_DAPM_SINGLE("DACR Switch", WM8962_SPEAKER_MIXER_2, 4, 1, 0),
615SOC_DAPM_SINGLE("MIXINL Switch", WM8962_SPEAKER_MIXER_2, 3, 1, 0),
616SOC_DAPM_SINGLE("MIXINR Switch", WM8962_SPEAKER_MIXER_2, 2, 1, 0),
617SOC_DAPM_SINGLE("IN4L Switch", WM8962_SPEAKER_MIXER_2, 1, 1, 0),
618SOC_DAPM_SINGLE("IN4R Switch", WM8962_SPEAKER_MIXER_2, 0, 1, 0),
619};
620
621static const struct snd_soc_dapm_widget wm8962_dapm_widgets[] = {
622SND_SOC_DAPM_INPUT("IN1L"),
623SND_SOC_DAPM_INPUT("IN1R"),
624SND_SOC_DAPM_INPUT("IN2L"),
625SND_SOC_DAPM_INPUT("IN2R"),
626SND_SOC_DAPM_INPUT("IN3L"),
627SND_SOC_DAPM_INPUT("IN3R"),
628SND_SOC_DAPM_INPUT("IN4L"),
629SND_SOC_DAPM_INPUT("IN4R"),
630SND_SOC_DAPM_INPUT("Beep"),
631
632SND_SOC_DAPM_SUPPLY("Class G", WM8962_CHARGE_PUMP_B, 0, 1, NULL, 0),
633SND_SOC_DAPM_SUPPLY("SYSCLK", WM8962_CLOCKING2, 5, 0, sysclk_event,
634 SND_SOC_DAPM_PRE_PMU | SND_SOC_DAPM_POST_PMD),
635SND_SOC_DAPM_SUPPLY("Charge Pump", WM8962_CHARGE_PUMP_1, 0, 0, cp_event,
636 SND_SOC_DAPM_POST_PMU),
637SND_SOC_DAPM_SUPPLY("TOCLK", WM8962_ADDITIONAL_CONTROL_1, 0, 0, NULL, 0),
638
639SND_SOC_DAPM_MIXER("INPGAL", WM8962_LEFT_INPUT_PGA_CONTROL, 4, 0,
640 inpgal, ARRAY_SIZE(inpgal)),
641SND_SOC_DAPM_MIXER("INPGAR", WM8962_RIGHT_INPUT_PGA_CONTROL, 4, 0,
642 inpgar, ARRAY_SIZE(inpgar)),
643SND_SOC_DAPM_MIXER("MIXINL", WM8962_PWR_MGMT_1, 5, 0,
644 mixinl, ARRAY_SIZE(mixinl)),
645SND_SOC_DAPM_MIXER("MIXINR", WM8962_PWR_MGMT_1, 4, 0,
646 mixinr, ARRAY_SIZE(mixinr)),
647
648SND_SOC_DAPM_ADC("ADCL", "Capture", WM8962_PWR_MGMT_1, 3, 0),
649SND_SOC_DAPM_ADC("ADCR", "Capture", WM8962_PWR_MGMT_1, 2, 0),
650
651SND_SOC_DAPM_MUX("STL", SND_SOC_NOPM, 0, 0, &stl_mux),
652SND_SOC_DAPM_MUX("STR", SND_SOC_NOPM, 0, 0, &str_mux),
653
654SND_SOC_DAPM_DAC("DACL", "Playback", WM8962_PWR_MGMT_2, 8, 0),
655SND_SOC_DAPM_DAC("DACR", "Playback", WM8962_PWR_MGMT_2, 7, 0),
656
657SND_SOC_DAPM_PGA("Left Bypass", SND_SOC_NOPM, 0, 0, NULL, 0),
658SND_SOC_DAPM_PGA("Right Bypass", SND_SOC_NOPM, 0, 0, NULL, 0),
659
660SND_SOC_DAPM_MIXER("HPMIXL", WM8962_MIXER_ENABLES, 3, 0,
661 hpmixl, ARRAY_SIZE(hpmixl)),
662SND_SOC_DAPM_MIXER("HPMIXR", WM8962_MIXER_ENABLES, 2, 0,
663 hpmixr, ARRAY_SIZE(hpmixr)),
664
665SND_SOC_DAPM_MUX_E("HPOUTL PGA", WM8962_PWR_MGMT_2, 6, 0, &hpoutl_mux,
666 out_pga_event, SND_SOC_DAPM_POST_PMU),
667SND_SOC_DAPM_MUX_E("HPOUTR PGA", WM8962_PWR_MGMT_2, 5, 0, &hpoutr_mux,
668 out_pga_event, SND_SOC_DAPM_POST_PMU),
669
670SND_SOC_DAPM_PGA_E("HPOUT", SND_SOC_NOPM, 0, 0, NULL, 0, hp_event,
671 SND_SOC_DAPM_POST_PMU | SND_SOC_DAPM_PRE_PMD),
672
673SND_SOC_DAPM_OUTPUT("HPOUTL"),
674SND_SOC_DAPM_OUTPUT("HPOUTR"),
675};
676
677static const struct snd_soc_dapm_widget wm8962_dapm_spk_mono_widgets[] = {
678SND_SOC_DAPM_MIXER("Speaker Mixer", WM8962_MIXER_ENABLES, 1, 0,
679 spkmixl, ARRAY_SIZE(spkmixl)),
680SND_SOC_DAPM_MUX_E("Speaker PGA", WM8962_PWR_MGMT_2, 4, 0, &spkoutl_mux,
681 out_pga_event, SND_SOC_DAPM_POST_PMU),
682SND_SOC_DAPM_PGA("Speaker Output", WM8962_CLASS_D_CONTROL_1, 7, 0, NULL, 0),
683SND_SOC_DAPM_OUTPUT("SPKOUT"),
684};
685
686static const struct snd_soc_dapm_widget wm8962_dapm_spk_stereo_widgets[] = {
687SND_SOC_DAPM_MIXER("SPKOUTL Mixer", WM8962_MIXER_ENABLES, 1, 0,
688 spkmixl, ARRAY_SIZE(spkmixl)),
689SND_SOC_DAPM_MIXER("SPKOUTR Mixer", WM8962_MIXER_ENABLES, 0, 0,
690 spkmixr, ARRAY_SIZE(spkmixr)),
691
692SND_SOC_DAPM_MUX_E("SPKOUTL PGA", WM8962_PWR_MGMT_2, 4, 0, &spkoutl_mux,
693 out_pga_event, SND_SOC_DAPM_POST_PMU),
694SND_SOC_DAPM_MUX_E("SPKOUTR PGA", WM8962_PWR_MGMT_2, 3, 0, &spkoutr_mux,
695 out_pga_event, SND_SOC_DAPM_POST_PMU),
696
697SND_SOC_DAPM_PGA("SPKOUTR Output", WM8962_CLASS_D_CONTROL_1, 7, 0, NULL, 0),
698SND_SOC_DAPM_PGA("SPKOUTL Output", WM8962_CLASS_D_CONTROL_1, 6, 0, NULL, 0),
699
700SND_SOC_DAPM_OUTPUT("SPKOUTL"),
701SND_SOC_DAPM_OUTPUT("SPKOUTR"),
702};
703
704static const struct snd_soc_dapm_route wm8962_intercon[] = {
705 { "INPGAL", "IN1L Switch", "IN1L" },
706 { "INPGAL", "IN2L Switch", "IN2L" },
707 { "INPGAL", "IN3L Switch", "IN3L" },
708 { "INPGAL", "IN4L Switch", "IN4L" },
709
710 { "INPGAR", "IN1R Switch", "IN1R" },
711 { "INPGAR", "IN2R Switch", "IN2R" },
712 { "INPGAR", "IN3R Switch", "IN3R" },
713 { "INPGAR", "IN4R Switch", "IN4R" },
714
715 { "MIXINL", "IN2L Switch", "IN2L" },
716 { "MIXINL", "IN3L Switch", "IN3L" },
717 { "MIXINL", "PGA Switch", "INPGAL" },
718
719 { "MIXINR", "IN2R Switch", "IN2R" },
720 { "MIXINR", "IN3R Switch", "IN3R" },
721 { "MIXINR", "PGA Switch", "INPGAR" },
722
723 { "ADCL", NULL, "SYSCLK" },
724 { "ADCL", NULL, "TOCLK" },
725 { "ADCL", NULL, "MIXINL" },
726
727 { "ADCR", NULL, "SYSCLK" },
728 { "ADCR", NULL, "TOCLK" },
729 { "ADCR", NULL, "MIXINR" },
730
731 { "STL", "Left", "ADCL" },
732 { "STL", "Right", "ADCR" },
733
734 { "STR", "Left", "ADCL" },
735 { "STR", "Right", "ADCR" },
736
737 { "DACL", NULL, "SYSCLK" },
738 { "DACL", NULL, "TOCLK" },
739 { "DACL", NULL, "Beep" },
740 { "DACL", NULL, "STL" },
741
742 { "DACR", NULL, "SYSCLK" },
743 { "DACR", NULL, "TOCLK" },
744 { "DACR", NULL, "Beep" },
745 { "DACR", NULL, "STR" },
746
747 { "HPMIXL", "IN4L Switch", "IN4L" },
748 { "HPMIXL", "IN4R Switch", "IN4R" },
749 { "HPMIXL", "DACL Switch", "DACL" },
750 { "HPMIXL", "DACR Switch", "DACR" },
751 { "HPMIXL", "MIXINL Switch", "MIXINL" },
752 { "HPMIXL", "MIXINR Switch", "MIXINR" },
753
754 { "HPMIXR", "IN4L Switch", "IN4L" },
755 { "HPMIXR", "IN4R Switch", "IN4R" },
756 { "HPMIXR", "DACL Switch", "DACL" },
757 { "HPMIXR", "DACR Switch", "DACR" },
758 { "HPMIXR", "MIXINL Switch", "MIXINL" },
759 { "HPMIXR", "MIXINR Switch", "MIXINR" },
760
761 { "Left Bypass", NULL, "HPMIXL" },
762 { "Left Bypass", NULL, "Class G" },
763
764 { "Right Bypass", NULL, "HPMIXR" },
765 { "Right Bypass", NULL, "Class G" },
766
767 { "HPOUTL PGA", "Mixer", "Left Bypass" },
768 { "HPOUTL PGA", "DAC", "DACL" },
769
770 { "HPOUTR PGA", "Mixer", "Right Bypass" },
771 { "HPOUTR PGA", "DAC", "DACR" },
772
773 { "HPOUT", NULL, "HPOUTL PGA" },
774 { "HPOUT", NULL, "HPOUTR PGA" },
775 { "HPOUT", NULL, "Charge Pump" },
776 { "HPOUT", NULL, "SYSCLK" },
777 { "HPOUT", NULL, "TOCLK" },
778
779 { "HPOUTL", NULL, "HPOUT" },
780 { "HPOUTR", NULL, "HPOUT" },
781};
782
783static const struct snd_soc_dapm_route wm8962_spk_mono_intercon[] = {
784 { "Speaker Mixer", "IN4L Switch", "IN4L" },
785 { "Speaker Mixer", "IN4R Switch", "IN4R" },
786 { "Speaker Mixer", "DACL Switch", "DACL" },
787 { "Speaker Mixer", "DACR Switch", "DACR" },
788 { "Speaker Mixer", "MIXINL Switch", "MIXINL" },
789 { "Speaker Mixer", "MIXINR Switch", "MIXINR" },
790
791 { "Speaker PGA", "Mixer", "Speaker Mixer" },
792 { "Speaker PGA", "DAC", "DACL" },
793
794 { "Speaker Output", NULL, "Speaker PGA" },
795 { "Speaker Output", NULL, "SYSCLK" },
796 { "Speaker Output", NULL, "TOCLK" },
797
798 { "SPKOUT", NULL, "Speaker Output" },
799};
800
801static const struct snd_soc_dapm_route wm8962_spk_stereo_intercon[] = {
802 { "SPKOUTL Mixer", "IN4L Switch", "IN4L" },
803 { "SPKOUTL Mixer", "IN4R Switch", "IN4R" },
804 { "SPKOUTL Mixer", "DACL Switch", "DACL" },
805 { "SPKOUTL Mixer", "DACR Switch", "DACR" },
806 { "SPKOUTL Mixer", "MIXINL Switch", "MIXINL" },
807 { "SPKOUTL Mixer", "MIXINR Switch", "MIXINR" },
808
809 { "SPKOUTR Mixer", "IN4L Switch", "IN4L" },
810 { "SPKOUTR Mixer", "IN4R Switch", "IN4R" },
811 { "SPKOUTR Mixer", "DACL Switch", "DACL" },
812 { "SPKOUTR Mixer", "DACR Switch", "DACR" },
813 { "SPKOUTR Mixer", "MIXINL Switch", "MIXINL" },
814 { "SPKOUTR Mixer", "MIXINR Switch", "MIXINR" },
815
816 { "SPKOUTL PGA", "Mixer", "SPKOUTL Mixer" },
817 { "SPKOUTL PGA", "DAC", "DACL" },
818
819 { "SPKOUTR PGA", "Mixer", "SPKOUTR Mixer" },
820 { "SPKOUTR PGA", "DAC", "DACR" },
821
822 { "SPKOUTL Output", NULL, "SPKOUTL PGA" },
823 { "SPKOUTL Output", NULL, "SYSCLK" },
824 { "SPKOUTL Output", NULL, "TOCLK" },
825
826 { "SPKOUTR Output", NULL, "SPKOUTR PGA" },
827 { "SPKOUTR Output", NULL, "SYSCLK" },
828 { "SPKOUTR Output", NULL, "TOCLK" },
829
830 { "SPKOUTL", NULL, "SPKOUTL Output" },
831 { "SPKOUTR", NULL, "SPKOUTR Output" },
832};
833
834static int wm8962_add_widgets(struct snd_soc_codec *codec)
835{
836 struct wm8962_pdata *pdata = dev_get_platdata(codec->dev);
837
838 snd_soc_add_controls(codec, wm8962_snd_controls,
839 ARRAY_SIZE(wm8962_snd_controls));
840 if (pdata && pdata->spk_mono)
841 snd_soc_add_controls(codec, wm8962_spk_mono_controls,
842 ARRAY_SIZE(wm8962_spk_mono_controls));
843 else
844 snd_soc_add_controls(codec, wm8962_spk_stereo_controls,
845 ARRAY_SIZE(wm8962_spk_stereo_controls));
846
847
848 snd_soc_dapm_new_controls(codec, wm8962_dapm_widgets,
849 ARRAY_SIZE(wm8962_dapm_widgets));
850 if (pdata && pdata->spk_mono)
851 snd_soc_dapm_new_controls(codec, wm8962_dapm_spk_mono_widgets,
852 ARRAY_SIZE(wm8962_dapm_spk_mono_widgets));
853 else
854 snd_soc_dapm_new_controls(codec, wm8962_dapm_spk_stereo_widgets,
855 ARRAY_SIZE(wm8962_dapm_spk_stereo_widgets));
856
857 snd_soc_dapm_add_routes(codec, wm8962_intercon,
858 ARRAY_SIZE(wm8962_intercon));
859 if (pdata && pdata->spk_mono)
860 snd_soc_dapm_add_routes(codec, wm8962_spk_mono_intercon,
861 ARRAY_SIZE(wm8962_spk_mono_intercon));
862 else
863 snd_soc_dapm_add_routes(codec, wm8962_spk_stereo_intercon,
864 ARRAY_SIZE(wm8962_spk_stereo_intercon));
865
866
867 snd_soc_dapm_disable_pin(codec, "Beep");
868
869 return 0;
870}
871
872static void wm8962_sync_cache(struct snd_soc_codec *codec)
873{
874 struct wm8962_priv *wm8962 = snd_soc_codec_get_drvdata(codec);
875 int i;
876
877 if (!codec->cache_sync)
878 return;
879
880 dev_dbg(codec->dev, "Syncing cache\n");
881
882 codec->cache_only = 0;
883
884 /* Sync back cached values if they're different from the
885 * hardware default.
886 */
887 for (i = 1; i < ARRAY_SIZE(wm8962->reg_cache); i++) {
888 if (i == WM8962_SOFTWARE_RESET)
889 continue;
890 if (wm8962->reg_cache[i] == wm8962_reg[i])
891 continue;
892
893 snd_soc_write(codec, i, wm8962->reg_cache[i]);
894 }
895
896 codec->cache_sync = 0;
897}
898
899/* -1 for reserved values */
900static const int bclk_divs[] = {
901 1, -1, 2, 3, 4, -1, 6, 8, -1, 12, 16, 24, -1, 32, 32, 32
902};
903
904static void wm8962_configure_bclk(struct snd_soc_codec *codec)
905{
906 struct wm8962_priv *wm8962 = snd_soc_codec_get_drvdata(codec);
907 int dspclk, i;
908 int clocking2 = 0;
909 int aif2 = 0;
910
911 /* If the CODEC is powered on we can configure BCLK */
912 if (codec->bias_level != SND_SOC_BIAS_OFF) {
913 dev_dbg(codec->dev, "Bias is off, can't configure BCLK\n");
914 return;
915 }
916
917 if (!wm8962->bclk) {
918 dev_dbg(codec->dev, "No BCLK rate configured\n");
919 return;
920 }
921
922 dspclk = snd_soc_read(codec, WM8962_CLOCKING1);
923 if (dspclk < 0) {
924 dev_err(codec->dev, "Failed to read DSPCLK: %d\n", dspclk);
925 return;
926 }
927
928 dspclk = (dspclk & WM8962_DSPCLK_DIV_MASK) >> WM8962_DSPCLK_DIV_SHIFT;
929 switch (dspclk) {
930 case 0:
931 dspclk = wm8962->sysclk_rate;
932 break;
933 case 1:
934 dspclk = wm8962->sysclk_rate / 2;
935 break;
936 case 2:
937 dspclk = wm8962->sysclk_rate / 4;
938 break;
939 default:
940 dev_warn(codec->dev, "Unknown DSPCLK divisor read back\n");
941 dspclk = wm8962->sysclk;
942 }
943
944 dev_dbg(codec->dev, "DSPCLK is %dHz, BCLK %d\n", dspclk, wm8962->bclk);
945
946 /* We're expecting an exact match */
947 for (i = 0; i < ARRAY_SIZE(bclk_divs); i++) {
948 if (bclk_divs[i] < 0)
949 continue;
950
951 if (dspclk / bclk_divs[i] == wm8962->bclk) {
952 dev_dbg(codec->dev, "Selected BCLK_DIV %d for %dHz\n",
953 bclk_divs[i], wm8962->bclk);
954 clocking2 |= i;
955 break;
956 }
957 }
958 if (i == ARRAY_SIZE(bclk_divs)) {
959 dev_err(codec->dev, "Unsupported BCLK ratio %d\n",
960 dspclk / wm8962->bclk);
961 return;
962 }
963
964 aif2 |= wm8962->bclk / wm8962->lrclk;
965 dev_dbg(codec->dev, "Selected LRCLK divisor %d for %dHz\n",
966 wm8962->bclk / wm8962->lrclk, wm8962->lrclk);
967
968 snd_soc_update_bits(codec, WM8962_CLOCKING2,
969 WM8962_BCLK_DIV_MASK, clocking2);
970 snd_soc_update_bits(codec, WM8962_AUDIO_INTERFACE_2,
971 WM8962_AIF_RATE_MASK, aif2);
972}
973
974static int wm8962_set_bias_level(struct snd_soc_codec *codec,
975 enum snd_soc_bias_level level)
976{
977 struct wm8962_priv *wm8962 = snd_soc_codec_get_drvdata(codec);
978 int ret;
979
980 if (level == codec->bias_level)
981 return 0;
982
983 switch (level) {
984 case SND_SOC_BIAS_ON:
985 break;
986
987 case SND_SOC_BIAS_PREPARE:
988 /* VMID 2*50k */
989 snd_soc_update_bits(codec, WM8962_PWR_MGMT_1,
990 WM8962_VMID_SEL_MASK, 0x80);
991 break;
992
993 case SND_SOC_BIAS_STANDBY:
994 if (codec->bias_level == SND_SOC_BIAS_OFF) {
995 ret = regulator_bulk_enable(ARRAY_SIZE(wm8962->supplies),
996 wm8962->supplies);
997 if (ret != 0) {
998 dev_err(codec->dev,
999 "Failed to enable supplies: %d\n",
1000 ret);
1001 return ret;
1002 }
1003
1004 wm8962_sync_cache(codec);
1005
1006 snd_soc_update_bits(codec, WM8962_ANTI_POP,
1007 WM8962_STARTUP_BIAS_ENA |
1008 WM8962_VMID_BUF_ENA,
1009 WM8962_STARTUP_BIAS_ENA |
1010 WM8962_VMID_BUF_ENA);
1011
1012 /* Bias enable at 2*50k for ramp */
1013 snd_soc_update_bits(codec, WM8962_PWR_MGMT_1,
1014 WM8962_VMID_SEL_MASK |
1015 WM8962_BIAS_ENA,
1016 WM8962_BIAS_ENA | 0x180);
1017
1018 msleep(5);
1019
1020 snd_soc_update_bits(codec, WM8962_CLOCKING2,
1021 WM8962_CLKREG_OVD,
1022 WM8962_CLKREG_OVD);
1023
1024 wm8962_configure_bclk(codec);
1025 }
1026
1027 /* VMID 2*250k */
1028 snd_soc_update_bits(codec, WM8962_PWR_MGMT_1,
1029 WM8962_VMID_SEL_MASK, 0x100);
1030 break;
1031
1032 case SND_SOC_BIAS_OFF:
1033 snd_soc_update_bits(codec, WM8962_PWR_MGMT_1,
1034 WM8962_VMID_SEL_MASK | WM8962_BIAS_ENA, 0);
1035
1036 snd_soc_update_bits(codec, WM8962_ANTI_POP,
1037 WM8962_STARTUP_BIAS_ENA |
1038 WM8962_VMID_BUF_ENA, 0);
1039
1040 regulator_bulk_disable(ARRAY_SIZE(wm8962->supplies),
1041 wm8962->supplies);
1042 break;
1043 }
1044 codec->bias_level = level;
1045 return 0;
1046}
1047
1048static const struct {
1049 int rate;
1050 int reg;
1051} sr_vals[] = {
1052 { 48000, 0 },
1053 { 44100, 0 },
1054 { 32000, 1 },
1055 { 22050, 2 },
1056 { 24000, 2 },
1057 { 16000, 3 },
1058 { 11025, 4 },
1059 { 12000, 4 },
1060 { 8000, 5 },
1061 { 88200, 6 },
1062 { 96000, 6 },
1063};
1064
1065static const int sysclk_rates[] = {
1066 64, 128, 192, 256, 384, 512, 768, 1024, 1408, 1536,
1067};
1068
1069static int wm8962_hw_params(struct snd_pcm_substream *substream,
1070 struct snd_pcm_hw_params *params,
1071 struct snd_soc_dai *dai)
1072{
1073 struct snd_soc_pcm_runtime *rtd = substream->private_data;
1074 struct snd_soc_device *socdev = rtd->socdev;
1075 struct snd_soc_codec *codec = socdev->card->codec;
1076 struct wm8962_priv *wm8962 = snd_soc_codec_get_drvdata(codec);
1077 int rate = params_rate(params);
1078 int i;
1079 int aif0 = 0;
1080 int adctl3 = 0;
1081 int clocking4 = 0;
1082
1083 wm8962->bclk = snd_soc_params_to_bclk(params);
1084 wm8962->lrclk = params_rate(params);
1085
1086 for (i = 0; i < ARRAY_SIZE(sr_vals); i++) {
1087 if (sr_vals[i].rate == rate) {
1088 adctl3 |= sr_vals[i].reg;
1089 break;
1090 }
1091 }
1092 if (i == ARRAY_SIZE(sr_vals)) {
1093 dev_err(codec->dev, "Unsupported rate %dHz\n", rate);
1094 return -EINVAL;
1095 }
1096
1097 if (rate % 8000 == 0)
1098 adctl3 |= WM8962_SAMPLE_RATE_INT_MODE;
1099
1100 for (i = 0; i < ARRAY_SIZE(sysclk_rates); i++) {
1101 if (sysclk_rates[i] == wm8962->sysclk_rate / rate) {
1102 clocking4 |= i << WM8962_SYSCLK_RATE_SHIFT;
1103 break;
1104 }
1105 }
1106 if (i == ARRAY_SIZE(sysclk_rates)) {
1107 dev_err(codec->dev, "Unsupported sysclk ratio %d\n",
1108 wm8962->sysclk_rate / rate);
1109 return -EINVAL;
1110 }
1111
1112 switch (params_format(params)) {
1113 case SNDRV_PCM_FORMAT_S16_LE:
1114 break;
1115 case SNDRV_PCM_FORMAT_S20_3LE:
1116 aif0 |= 0x40;
1117 break;
1118 case SNDRV_PCM_FORMAT_S24_LE:
1119 aif0 |= 0x80;
1120 break;
1121 case SNDRV_PCM_FORMAT_S32_LE:
1122 aif0 |= 0xc0;
1123 break;
1124 default:
1125 return -EINVAL;
1126 }
1127
1128 snd_soc_update_bits(codec, WM8962_AUDIO_INTERFACE_0,
1129 WM8962_WL_MASK, aif0);
1130 snd_soc_update_bits(codec, WM8962_ADDITIONAL_CONTROL_3,
1131 WM8962_SAMPLE_RATE_INT_MODE |
1132 WM8962_SAMPLE_RATE_MASK, adctl3);
1133 snd_soc_update_bits(codec, WM8962_CLOCKING_4,
1134 WM8962_SYSCLK_RATE_MASK, clocking4);
1135
1136 wm8962_configure_bclk(codec);
1137
1138 return 0;
1139}
1140
1141static int wm8962_set_dai_sysclk(struct snd_soc_dai *dai, int clk_id,
1142 unsigned int freq, int dir)
1143{
1144 struct snd_soc_codec *codec = dai->codec;
1145 struct wm8962_priv *wm8962 = snd_soc_codec_get_drvdata(codec);
1146 int src;
1147
1148 switch (clk_id) {
1149 case WM8962_SYSCLK_MCLK:
1150 wm8962->sysclk = WM8962_SYSCLK_MCLK;
1151 src = 0;
1152 break;
1153 case WM8962_SYSCLK_FLL:
1154 wm8962->sysclk = WM8962_SYSCLK_FLL;
1155 src = 1 << WM8962_SYSCLK_SRC_SHIFT;
1156 WARN_ON(freq != wm8962->fll_fout);
1157 break;
1158 default:
1159 return -EINVAL;
1160 }
1161
1162 snd_soc_update_bits(codec, WM8962_CLOCKING2, WM8962_SYSCLK_SRC_MASK,
1163 src);
1164
1165 wm8962->sysclk_rate = freq;
1166
1167 return 0;
1168}
1169
1170static int wm8962_set_dai_fmt(struct snd_soc_dai *dai, unsigned int fmt)
1171{
1172 struct snd_soc_codec *codec = dai->codec;
1173 int aif0 = 0;
1174
1175 switch (fmt & SND_SOC_DAIFMT_FORMAT_MASK) {
1176 case SND_SOC_DAIFMT_DSP_A:
1177 aif0 |= WM8962_LRCLK_INV;
1178 case SND_SOC_DAIFMT_DSP_B:
1179 aif0 |= 3;
1180
1181 switch (fmt & SND_SOC_DAIFMT_INV_MASK) {
1182 case SND_SOC_DAIFMT_NB_NF:
1183 case SND_SOC_DAIFMT_IB_NF:
1184 break;
1185 default:
1186 return -EINVAL;
1187 }
1188 break;
1189
1190 case SND_SOC_DAIFMT_RIGHT_J:
1191 break;
1192 case SND_SOC_DAIFMT_LEFT_J:
1193 aif0 |= 1;
1194 break;
1195 case SND_SOC_DAIFMT_I2S:
1196 aif0 |= 2;
1197 break;
1198 default:
1199 return -EINVAL;
1200 }
1201
1202 switch (fmt & SND_SOC_DAIFMT_INV_MASK) {
1203 case SND_SOC_DAIFMT_NB_NF:
1204 break;
1205 case SND_SOC_DAIFMT_IB_NF:
1206 aif0 |= WM8962_BCLK_INV;
1207 break;
1208 case SND_SOC_DAIFMT_NB_IF:
1209 aif0 |= WM8962_LRCLK_INV;
1210 break;
1211 case SND_SOC_DAIFMT_IB_IF:
1212 aif0 |= WM8962_BCLK_INV | WM8962_LRCLK_INV;
1213 break;
1214 default:
1215 return -EINVAL;
1216 }
1217
1218 switch (fmt & SND_SOC_DAIFMT_MASTER_MASK) {
1219 case SND_SOC_DAIFMT_CBM_CFM:
1220 aif0 |= WM8962_MSTR;
1221 break;
1222 case SND_SOC_DAIFMT_CBS_CFS:
1223 break;
1224 default:
1225 return -EINVAL;
1226 }
1227
1228 snd_soc_update_bits(codec, WM8962_AUDIO_INTERFACE_0,
1229 WM8962_FMT_MASK | WM8962_BCLK_INV | WM8962_MSTR |
1230 WM8962_LRCLK_INV, aif0);
1231
1232 return 0;
1233}
1234
1235struct _fll_div {
1236 u16 fll_fratio;
1237 u16 fll_outdiv;
1238 u16 fll_refclk_div;
1239 u16 n;
1240 u16 theta;
1241 u16 lambda;
1242};
1243
1244/* The size in bits of the FLL divide multiplied by 10
1245 * to allow rounding later */
1246#define FIXED_FLL_SIZE ((1 << 16) * 10)
1247
1248static struct {
1249 unsigned int min;
1250 unsigned int max;
1251 u16 fll_fratio;
1252 int ratio;
1253} fll_fratios[] = {
1254 { 0, 64000, 4, 16 },
1255 { 64000, 128000, 3, 8 },
1256 { 128000, 256000, 2, 4 },
1257 { 256000, 1000000, 1, 2 },
1258 { 1000000, 13500000, 0, 1 },
1259};
1260
1261static int fll_factors(struct _fll_div *fll_div, unsigned int Fref,
1262 unsigned int Fout)
1263{
1264 unsigned int target;
1265 unsigned int div;
1266 unsigned int fratio, gcd_fll;
1267 int i;
1268
1269 /* Fref must be <=13.5MHz */
1270 div = 1;
1271 fll_div->fll_refclk_div = 0;
1272 while ((Fref / div) > 13500000) {
1273 div *= 2;
1274 fll_div->fll_refclk_div++;
1275
1276 if (div > 4) {
1277 pr_err("Can't scale %dMHz input down to <=13.5MHz\n",
1278 Fref);
1279 return -EINVAL;
1280 }
1281 }
1282
1283 pr_debug("FLL Fref=%u Fout=%u\n", Fref, Fout);
1284
1285 /* Apply the division for our remaining calculations */
1286 Fref /= div;
1287
1288 /* Fvco should be 90-100MHz; don't check the upper bound */
1289 div = 2;
1290 while (Fout * div < 90000000) {
1291 div++;
1292 if (div > 64) {
1293 pr_err("Unable to find FLL_OUTDIV for Fout=%uHz\n",
1294 Fout);
1295 return -EINVAL;
1296 }
1297 }
1298 target = Fout * div;
1299 fll_div->fll_outdiv = div - 1;
1300
1301 pr_debug("FLL Fvco=%dHz\n", target);
1302
1303 /* Find an appropraite FLL_FRATIO and factor it out of the target */
1304 for (i = 0; i < ARRAY_SIZE(fll_fratios); i++) {
1305 if (fll_fratios[i].min <= Fref && Fref <= fll_fratios[i].max) {
1306 fll_div->fll_fratio = fll_fratios[i].fll_fratio;
1307 fratio = fll_fratios[i].ratio;
1308 break;
1309 }
1310 }
1311 if (i == ARRAY_SIZE(fll_fratios)) {
1312 pr_err("Unable to find FLL_FRATIO for Fref=%uHz\n", Fref);
1313 return -EINVAL;
1314 }
1315
1316 fll_div->n = target / (fratio * Fref);
1317
1318 if (target % Fref == 0) {
1319 fll_div->theta = 0;
1320 fll_div->lambda = 0;
1321 } else {
1322 gcd_fll = gcd(target, fratio * Fref);
1323
1324 fll_div->theta = (target - (fll_div->n * fratio * Fref))
1325 / gcd_fll;
1326 fll_div->lambda = (fratio * Fref) / gcd_fll;
1327 }
1328
1329 pr_debug("FLL N=%x THETA=%x LAMBDA=%x\n",
1330 fll_div->n, fll_div->theta, fll_div->lambda);
1331 pr_debug("FLL_FRATIO=%x FLL_OUTDIV=%x FLL_REFCLK_DIV=%x\n",
1332 fll_div->fll_fratio, fll_div->fll_outdiv,
1333 fll_div->fll_refclk_div);
1334
1335 return 0;
1336}
1337
1338static int wm8962_set_fll(struct snd_soc_dai *dai, int fll_id, int source,
1339 unsigned int Fref, unsigned int Fout)
1340{
1341 struct snd_soc_codec *codec = dai->codec;
1342 struct wm8962_priv *wm8962 = snd_soc_codec_get_drvdata(codec);
1343 struct _fll_div fll_div;
1344 int ret;
1345 int fll1 = snd_soc_read(codec, WM8962_FLL_CONTROL_1);
1346
1347 /* Any change? */
1348 if (source == wm8962->fll_src && Fref == wm8962->fll_fref &&
1349 Fout == wm8962->fll_fout)
1350 return 0;
1351
1352 if (Fout == 0) {
1353 dev_dbg(codec->dev, "FLL disabled\n");
1354
1355 wm8962->fll_fref = 0;
1356 wm8962->fll_fout = 0;
1357
1358 snd_soc_update_bits(codec, WM8962_FLL_CONTROL_1,
1359 WM8962_FLL_ENA, 0);
1360
1361 return 0;
1362 }
1363
1364 ret = fll_factors(&fll_div, Fref, Fout);
1365 if (ret != 0)
1366 return ret;
1367
1368 switch (fll_id) {
1369 case WM8962_FLL_MCLK:
1370 case WM8962_FLL_BCLK:
1371 case WM8962_FLL_OSC:
1372 fll1 |= (fll_id - 1) << WM8962_FLL_REFCLK_SRC_SHIFT;
1373 break;
1374 case WM8962_FLL_INT:
1375 snd_soc_update_bits(codec, WM8962_FLL_CONTROL_1,
1376 WM8962_FLL_OSC_ENA, WM8962_FLL_OSC_ENA);
1377 snd_soc_update_bits(codec, WM8962_FLL_CONTROL_5,
1378 WM8962_FLL_FRC_NCO, WM8962_FLL_FRC_NCO);
1379 break;
1380 default:
1381 dev_err(codec->dev, "Unknown FLL source %d\n", ret);
1382 return -EINVAL;
1383 }
1384
1385 if (fll_div.theta || fll_div.lambda)
1386 fll1 |= WM8962_FLL_FRAC;
1387
1388 /* Stop the FLL while we reconfigure */
1389 snd_soc_update_bits(codec, WM8962_FLL_CONTROL_1, WM8962_FLL_ENA, 0);
1390
1391 snd_soc_update_bits(codec, WM8962_FLL_CONTROL_2,
1392 WM8962_FLL_OUTDIV_MASK |
1393 WM8962_FLL_REFCLK_DIV_MASK,
1394 (fll_div.fll_outdiv << WM8962_FLL_OUTDIV_SHIFT) |
1395 (fll_div.fll_refclk_div));
1396
1397 snd_soc_update_bits(codec, WM8962_FLL_CONTROL_3,
1398 WM8962_FLL_FRATIO_MASK, fll_div.fll_fratio);
1399
1400 snd_soc_write(codec, WM8962_FLL_CONTROL_6, fll_div.theta);
1401 snd_soc_write(codec, WM8962_FLL_CONTROL_7, fll_div.lambda);
1402 snd_soc_write(codec, WM8962_FLL_CONTROL_8, fll_div.n);
1403
1404 snd_soc_update_bits(codec, WM8962_FLL_CONTROL_1,
1405 WM8962_FLL_FRAC | WM8962_FLL_REFCLK_SRC_MASK |
1406 WM8962_FLL_ENA, fll1);
1407
1408 dev_dbg(codec->dev, "FLL configured for %dHz->%dHz\n", Fref, Fout);
1409
1410 wm8962->fll_fref = Fref;
1411 wm8962->fll_fout = Fout;
1412 wm8962->fll_src = source;
1413
1414 return 0;
1415}
1416
1417static int wm8962_mute(struct snd_soc_dai *dai, int mute)
1418{
1419 struct snd_soc_codec *codec = dai->codec;
1420 int val;
1421
1422 if (mute)
1423 val = WM8962_DAC_MUTE;
1424 else
1425 val = 0;
1426
1427 return snd_soc_update_bits(codec, WM8962_ADC_DAC_CONTROL_1,
1428 WM8962_DAC_MUTE, val);
1429}
1430
1431#define WM8962_RATES SNDRV_PCM_RATE_8000_96000
1432
1433#define WM8962_FORMATS (SNDRV_PCM_FMTBIT_S16_LE | SNDRV_PCM_FMTBIT_S20_3LE |\
1434 SNDRV_PCM_FMTBIT_S24_LE | SNDRV_PCM_FMTBIT_S32_LE)
1435
1436static struct snd_soc_dai_ops wm8962_dai_ops = {
1437 .hw_params = wm8962_hw_params,
1438 .set_sysclk = wm8962_set_dai_sysclk,
1439 .set_fmt = wm8962_set_dai_fmt,
1440 .set_pll = wm8962_set_fll,
1441 .digital_mute = wm8962_mute,
1442};
1443
1444struct snd_soc_dai wm8962_dai = {
1445 .name = "WM8962",
1446 .playback = {
1447 .stream_name = "Playback",
1448 .channels_min = 2,
1449 .channels_max = 2,
1450 .rates = WM8962_RATES,
1451 .formats = WM8962_FORMATS,
1452 },
1453 .capture = {
1454 .stream_name = "Capture",
1455 .channels_min = 2,
1456 .channels_max = 2,
1457 .rates = WM8962_RATES,
1458 .formats = WM8962_FORMATS,
1459 },
1460 .ops = &wm8962_dai_ops,
1461 .symmetric_rates = 1,
1462};
1463EXPORT_SYMBOL_GPL(wm8962_dai);
1464
1465static int wm8962_probe(struct platform_device *pdev)
1466{
1467 struct snd_soc_device *socdev = platform_get_drvdata(pdev);
1468 struct snd_soc_codec *codec;
1469 int ret = 0;
1470
1471 if (wm8962_codec == NULL) {
1472 dev_err(&pdev->dev, "Codec device not registered\n");
1473 return -ENODEV;
1474 }
1475
1476 socdev->card->codec = wm8962_codec;
1477 codec = wm8962_codec;
1478
1479 /* register pcms */
1480 ret = snd_soc_new_pcms(socdev, SNDRV_DEFAULT_IDX1, SNDRV_DEFAULT_STR1);
1481 if (ret < 0) {
1482 dev_err(codec->dev, "failed to create pcms: %d\n", ret);
1483 goto pcm_err;
1484 }
1485
1486 wm8962_add_widgets(codec);
1487
1488 return ret;
1489
1490pcm_err:
1491 return ret;
1492}
1493
1494static int wm8962_remove(struct platform_device *pdev)
1495{
1496 struct snd_soc_device *socdev = platform_get_drvdata(pdev);
1497
1498 snd_soc_free_pcms(socdev);
1499 snd_soc_dapm_free(socdev);
1500
1501 return 0;
1502}
1503
1504#ifdef CONFIG_PM
1505static int wm8962_resume(struct platform_device *pdev)
1506{
1507 struct snd_soc_device *socdev = platform_get_drvdata(pdev);
1508 struct snd_soc_codec *codec = socdev->card->codec;
1509 struct wm8962_priv *wm8962 = snd_soc_codec_get_drvdata(codec);
1510 u16 *reg_cache = codec->reg_cache;
1511 int i;
1512
1513 /* Restore the registers */
1514 for (i = 1; i < ARRAY_SIZE(wm8962->reg_cache); i++) {
1515 switch (i) {
1516 case WM8962_SOFTWARE_RESET:
1517 continue;
1518 default:
1519 break;
1520 }
1521
1522 if (reg_cache[i] != wm8962_reg[i])
1523 snd_soc_write(codec, i, reg_cache[i]);
1524 }
1525
1526 return 0;
1527}
1528#else
1529#define wm8962_resume NULL
1530#endif
1531
1532struct snd_soc_codec_device soc_codec_dev_wm8962 = {
1533 .probe = wm8962_probe,
1534 .remove = wm8962_remove,
1535 .resume = wm8962_resume,
1536};
1537EXPORT_SYMBOL_GPL(soc_codec_dev_wm8962);
1538
1539#if defined(CONFIG_INPUT) || defined(CONFIG_INPUT_MODULE)
1540static int beep_rates[] = {
1541 500, 1000, 2000, 4000,
1542};
1543
1544static void wm8962_beep_work(struct work_struct *work)
1545{
1546 struct wm8962_priv *wm8962 =
1547 container_of(work, struct wm8962_priv, beep_work);
1548 struct snd_soc_codec *codec = &wm8962->codec;
1549 int i;
1550 int reg = 0;
1551 int best = 0;
1552
1553 if (wm8962->beep_rate) {
1554 for (i = 0; i < ARRAY_SIZE(beep_rates); i++) {
1555 if (abs(wm8962->beep_rate - beep_rates[i]) <
1556 abs(wm8962->beep_rate - beep_rates[best]))
1557 best = i;
1558 }
1559
1560 dev_dbg(codec->dev, "Set beep rate %dHz for requested %dHz\n",
1561 beep_rates[best], wm8962->beep_rate);
1562
1563 reg = WM8962_BEEP_ENA | (best << WM8962_BEEP_RATE_SHIFT);
1564
1565 snd_soc_dapm_enable_pin(codec, "Beep");
1566 } else {
1567 dev_dbg(codec->dev, "Disabling beep\n");
1568 snd_soc_dapm_disable_pin(codec, "Beep");
1569 }
1570
1571 snd_soc_update_bits(codec, WM8962_BEEP_GENERATOR_1,
1572 WM8962_BEEP_ENA | WM8962_BEEP_RATE_MASK, reg);
1573
1574 snd_soc_dapm_sync(codec);
1575}
1576
1577/* For usability define a way of injecting beep events for the device -
1578 * many systems will not have a keyboard.
1579 */
1580static int wm8962_beep_event(struct input_dev *dev, unsigned int type,
1581 unsigned int code, int hz)
1582{
1583 struct snd_soc_codec *codec = input_get_drvdata(dev);
1584 struct wm8962_priv *wm8962 = snd_soc_codec_get_drvdata(codec);
1585
1586 dev_dbg(codec->dev, "Beep event %x %x\n", code, hz);
1587
1588 switch (code) {
1589 case SND_BELL:
1590 if (hz)
1591 hz = 1000;
1592 case SND_TONE:
1593 break;
1594 default:
1595 return -1;
1596 }
1597
1598 /* Kick the beep from a workqueue */
1599 wm8962->beep_rate = hz;
1600 schedule_work(&wm8962->beep_work);
1601 return 0;
1602}
1603
1604static ssize_t wm8962_beep_set(struct device *dev,
1605 struct device_attribute *attr,
1606 const char *buf, size_t count)
1607{
1608 struct wm8962_priv *wm8962 = dev_get_drvdata(dev);
1609 long int time;
1610
1611 strict_strtol(buf, 10, &time);
1612
1613 input_event(wm8962->beep, EV_SND, SND_TONE, time);
1614
1615 return count;
1616}
1617
1618static DEVICE_ATTR(beep, 0200, NULL, wm8962_beep_set);
1619
1620static void wm8962_init_beep(struct snd_soc_codec *codec)
1621{
1622 struct wm8962_priv *wm8962 = snd_soc_codec_get_drvdata(codec);
1623 int ret;
1624
1625 wm8962->beep = input_allocate_device();
1626 if (!wm8962->beep) {
1627 dev_err(codec->dev, "Failed to allocate beep device\n");
1628 return;
1629 }
1630
1631 INIT_WORK(&wm8962->beep_work, wm8962_beep_work);
1632 wm8962->beep_rate = 0;
1633
1634 wm8962->beep->name = "WM8962 Beep Generator";
1635 wm8962->beep->phys = dev_name(codec->dev);
1636 wm8962->beep->id.bustype = BUS_I2C;
1637
1638 wm8962->beep->evbit[0] = BIT_MASK(EV_SND);
1639 wm8962->beep->sndbit[0] = BIT_MASK(SND_BELL) | BIT_MASK(SND_TONE);
1640 wm8962->beep->event = wm8962_beep_event;
1641 wm8962->beep->dev.parent = codec->dev;
1642 input_set_drvdata(wm8962->beep, codec);
1643
1644 ret = input_register_device(wm8962->beep);
1645 if (ret != 0) {
1646 input_free_device(wm8962->beep);
1647 wm8962->beep = NULL;
1648 dev_err(codec->dev, "Failed to register beep device\n");
1649 }
1650
1651 ret = device_create_file(codec->dev, &dev_attr_beep);
1652 if (ret != 0) {
1653 dev_err(codec->dev, "Failed to create keyclick file: %d\n",
1654 ret);
1655 }
1656}
1657
1658static void wm8962_free_beep(struct snd_soc_codec *codec)
1659{
1660 struct wm8962_priv *wm8962 = snd_soc_codec_get_drvdata(codec);
1661
1662 device_remove_file(codec->dev, &dev_attr_beep);
1663 input_unregister_device(wm8962->beep);
1664 cancel_work_sync(&wm8962->beep_work);
1665 wm8962->beep = NULL;
1666
1667 snd_soc_update_bits(codec, WM8962_BEEP_GENERATOR_1, WM8962_BEEP_ENA,0);
1668}
1669#else
1670static void wm8962_init_beep(struct snd_soc_codec *codec)
1671{
1672}
1673
1674static void wm8962_free_beep(struct snd_soc_codec *codec)
1675{
1676}
1677#endif
1678
1679static int wm8962_register(struct wm8962_priv *wm8962,
1680 enum snd_soc_control_type control)
1681{
1682 int ret;
1683 struct snd_soc_codec *codec = &wm8962->codec;
1684 struct wm8962_pdata *pdata = dev_get_platdata(codec->dev);
1685 int i;
1686
1687 if (wm8962_codec) {
1688 dev_err(codec->dev, "Another WM8962 is registered\n");
1689 return -EINVAL;
1690 }
1691
1692 mutex_init(&codec->mutex);
1693 INIT_LIST_HEAD(&codec->dapm_widgets);
1694 INIT_LIST_HEAD(&codec->dapm_paths);
1695
1696 snd_soc_codec_set_drvdata(codec, wm8962);
1697 codec->name = "WM8962";
1698 codec->owner = THIS_MODULE;
1699 codec->bias_level = SND_SOC_BIAS_OFF;
1700 codec->set_bias_level = wm8962_set_bias_level;
1701 codec->dai = &wm8962_dai;
1702 codec->num_dai = 1;
1703 codec->reg_cache_size = WM8962_MAX_REGISTER;
1704 codec->reg_cache = &wm8962->reg_cache;
1705 codec->volatile_register = wm8962_volatile_register;
1706 codec->cache_sync = 1;
1707 codec->idle_bias_off = 1;
1708 codec->readable_register = wm8962_readable;
1709
1710 memcpy(codec->reg_cache, wm8962_reg, sizeof(wm8962_reg));
1711
1712 ret = snd_soc_codec_set_cache_io(codec, 16, 16, control);
1713 if (ret != 0) {
1714 dev_err(codec->dev, "Failed to set cache I/O: %d\n", ret);
1715 goto err;
1716 }
1717
1718 for (i = 0; i < ARRAY_SIZE(wm8962->supplies); i++)
1719 wm8962->supplies[i].supply = wm8962_supply_names[i];
1720
1721 ret = regulator_bulk_get(codec->dev, ARRAY_SIZE(wm8962->supplies),
1722 wm8962->supplies);
1723 if (ret != 0) {
1724 dev_err(codec->dev, "Failed to request supplies: %d\n", ret);
1725 goto err;
1726 }
1727
1728 wm8962->disable_nb[0].notifier_call = wm8962_regulator_event_0;
1729 wm8962->disable_nb[1].notifier_call = wm8962_regulator_event_1;
1730 wm8962->disable_nb[2].notifier_call = wm8962_regulator_event_2;
1731 wm8962->disable_nb[3].notifier_call = wm8962_regulator_event_3;
1732 wm8962->disable_nb[4].notifier_call = wm8962_regulator_event_4;
1733 wm8962->disable_nb[5].notifier_call = wm8962_regulator_event_5;
1734 wm8962->disable_nb[6].notifier_call = wm8962_regulator_event_6;
1735 wm8962->disable_nb[7].notifier_call = wm8962_regulator_event_7;
1736
1737 /* This should really be moved into the regulator core */
1738 for (i = 0; i < ARRAY_SIZE(wm8962->supplies); i++) {
1739 ret = regulator_register_notifier(wm8962->supplies[i].consumer,
1740 &wm8962->disable_nb[i]);
1741 if (ret != 0) {
1742 dev_err(codec->dev,
1743 "Failed to register regulator notifier: %d\n",
1744 ret);
1745 }
1746 }
1747
1748 ret = regulator_bulk_enable(ARRAY_SIZE(wm8962->supplies),
1749 wm8962->supplies);
1750 if (ret != 0) {
1751 dev_err(codec->dev, "Failed to enable supplies: %d\n", ret);
1752 goto err_get;
1753 }
1754
1755 ret = snd_soc_read(codec, WM8962_SOFTWARE_RESET);
1756 if (ret < 0) {
1757 dev_err(codec->dev, "Failed to read ID register\n");
1758 goto err_enable;
1759 }
1760 if (ret != wm8962_reg[WM8962_SOFTWARE_RESET]) {
1761 dev_err(codec->dev, "Device is not a WM8962, ID %x != %x\n",
1762 ret, wm8962_reg[WM8962_SOFTWARE_RESET]);
1763 ret = -EINVAL;
1764 goto err_enable;
1765 }
1766
1767 ret = snd_soc_read(codec, WM8962_RIGHT_INPUT_VOLUME);
1768 if (ret < 0) {
1769 dev_err(codec->dev, "Failed to read device revision: %d\n",
1770 ret);
1771 goto err_enable;
1772 }
1773
1774 dev_info(codec->dev, "customer id %x revision %c\n",
1775 (ret & WM8962_CUST_ID_MASK) >> WM8962_CUST_ID_SHIFT,
1776 ((ret & WM8962_CHIP_REV_MASK) >> WM8962_CHIP_REV_SHIFT)
1777 + 'A');
1778
1779 ret = wm8962_reset(codec);
1780 if (ret < 0) {
1781 dev_err(codec->dev, "Failed to issue reset\n");
1782 goto err_enable;
1783 }
1784
1785 /* SYSCLK defaults to on; make sure it is off so we can safely
1786 * write to registers if the device is declocked.
1787 */
1788 snd_soc_update_bits(codec, WM8962_CLOCKING2, WM8962_SYSCLK_ENA, 0);
1789
1790 regulator_bulk_disable(ARRAY_SIZE(wm8962->supplies), wm8962->supplies);
1791
1792 if (pdata) {
1793 /* Apply static configuration for GPIOs */
1794 for (i = 0; i < ARRAY_SIZE(pdata->gpio_init); i++)
1795 if (pdata->gpio_init[i])
1796 snd_soc_write(codec, 0x200 + i,
1797 pdata->gpio_init[i] & 0xffff);
1798
1799 /* Put the speakers into mono mode? */
1800 if (pdata->spk_mono)
1801 wm8962->reg_cache[WM8962_CLASS_D_CONTROL_2]
1802 |= WM8962_SPK_MONO;
1803 }
1804
1805 /* Latch volume update bits */
1806 wm8962->reg_cache[WM8962_LEFT_INPUT_VOLUME] |= WM8962_IN_VU;
1807 wm8962->reg_cache[WM8962_RIGHT_INPUT_VOLUME] |= WM8962_IN_VU;
1808 wm8962->reg_cache[WM8962_LEFT_ADC_VOLUME] |= WM8962_ADC_VU;
1809 wm8962->reg_cache[WM8962_RIGHT_ADC_VOLUME] |= WM8962_ADC_VU;
1810 wm8962->reg_cache[WM8962_LEFT_DAC_VOLUME] |= WM8962_DAC_VU;
1811 wm8962->reg_cache[WM8962_RIGHT_DAC_VOLUME] |= WM8962_DAC_VU;
1812 wm8962->reg_cache[WM8962_SPKOUTL_VOLUME] |= WM8962_SPKOUT_VU;
1813 wm8962->reg_cache[WM8962_SPKOUTR_VOLUME] |= WM8962_SPKOUT_VU;
1814 wm8962->reg_cache[WM8962_HPOUTL_VOLUME] |= WM8962_HPOUT_VU;
1815 wm8962->reg_cache[WM8962_HPOUTR_VOLUME] |= WM8962_HPOUT_VU;
1816
1817 wm8962_dai.dev = codec->dev;
1818
1819 wm8962_codec = codec;
1820
1821 ret = snd_soc_register_codec(codec);
1822 if (ret != 0) {
1823 dev_err(codec->dev, "Failed to register codec: %d\n", ret);
1824 return ret;
1825 }
1826
1827 ret = snd_soc_register_dai(&wm8962_dai);
1828 if (ret != 0) {
1829 dev_err(codec->dev, "Failed to register DAI: %d\n", ret);
1830 snd_soc_unregister_codec(codec);
1831 return ret;
1832 }
1833
1834 wm8962_init_beep(codec);
1835
1836 return 0;
1837
1838err_enable:
1839 regulator_bulk_disable(ARRAY_SIZE(wm8962->supplies), wm8962->supplies);
1840err_get:
1841 regulator_bulk_free(ARRAY_SIZE(wm8962->supplies), wm8962->supplies);
1842err:
1843 kfree(wm8962);
1844 return ret;
1845}
1846
1847static void wm8962_unregister(struct wm8962_priv *wm8962)
1848{
1849 int i;
1850
1851 wm8962_free_beep(&wm8962->codec);
1852 wm8962_set_bias_level(&wm8962->codec, SND_SOC_BIAS_OFF);
1853 for (i = 0; i < ARRAY_SIZE(wm8962->supplies); i++)
1854 regulator_unregister_notifier(wm8962->supplies[i].consumer,
1855 &wm8962->disable_nb[i]);
1856 regulator_bulk_free(ARRAY_SIZE(wm8962->supplies), wm8962->supplies);
1857 snd_soc_unregister_dai(&wm8962_dai);
1858 snd_soc_unregister_codec(&wm8962->codec);
1859 kfree(wm8962);
1860 wm8962_codec = NULL;
1861}
1862
1863#if defined(CONFIG_I2C) || defined(CONFIG_I2C_MODULE)
1864static __devinit int wm8962_i2c_probe(struct i2c_client *i2c,
1865 const struct i2c_device_id *id)
1866{
1867 struct wm8962_priv *wm8962;
1868 struct snd_soc_codec *codec;
1869
1870 wm8962 = kzalloc(sizeof(struct wm8962_priv), GFP_KERNEL);
1871 if (wm8962 == NULL)
1872 return -ENOMEM;
1873
1874 codec = &wm8962->codec;
1875 codec->hw_write = (hw_write_t)i2c_master_send;
1876
1877 i2c_set_clientdata(i2c, wm8962);
1878 codec->control_data = i2c;
1879
1880 codec->dev = &i2c->dev;
1881
1882 return wm8962_register(wm8962, SND_SOC_I2C);
1883}
1884
1885static __devexit int wm8962_i2c_remove(struct i2c_client *client)
1886{
1887 struct wm8962_priv *wm8962 = i2c_get_clientdata(client);
1888 wm8962_unregister(wm8962);
1889 return 0;
1890}
1891
1892static const struct i2c_device_id wm8962_i2c_id[] = {
1893 { "wm8962", 0 },
1894 { }
1895};
1896MODULE_DEVICE_TABLE(i2c, wm8962_i2c_id);
1897
1898static struct i2c_driver wm8962_i2c_driver = {
1899 .driver = {
1900 .name = "WM8962",
1901 .owner = THIS_MODULE,
1902 },
1903 .probe = wm8962_i2c_probe,
1904 .remove = __devexit_p(wm8962_i2c_remove),
1905 .id_table = wm8962_i2c_id,
1906};
1907#endif
1908
1909static int __init wm8962_modinit(void)
1910{
1911 int ret;
1912#if defined(CONFIG_I2C) || defined(CONFIG_I2C_MODULE)
1913 ret = i2c_add_driver(&wm8962_i2c_driver);
1914 if (ret != 0) {
1915 printk(KERN_ERR "Failed to register WM8962 I2C driver: %d\n",
1916 ret);
1917 }
1918#endif
1919 return 0;
1920}
1921module_init(wm8962_modinit);
1922
1923static void __exit wm8962_exit(void)
1924{
1925#if defined(CONFIG_I2C) || defined(CONFIG_I2C_MODULE)
1926 i2c_del_driver(&wm8962_i2c_driver);
1927#endif
1928}
1929module_exit(wm8962_exit);
1930
1931MODULE_DESCRIPTION("ASoC WM8962 driver");
1932MODULE_AUTHOR("Mark Brown <broonie@opensource.wolfsonmicro.com>");
1933MODULE_LICENSE("GPL");
diff --git a/sound/soc/codecs/wm8962.h b/sound/soc/codecs/wm8962.h
new file mode 100644
index 000000000000..bc0b1876174c
--- /dev/null
+++ b/sound/soc/codecs/wm8962.h
@@ -0,0 +1,3790 @@
1/*
2 * wm8962.h -- WM8962 ASoC driver
3 *
4 * Copyright 2010 Wolfson Microelectronics, plc
5 *
6 * Author: Mark Brown <broonie@opensource.wolfsonmicro.com>
7 *
8 * This program is free software; you can redistribute it and/or modify
9 * it under the terms of the GNU General Public License version 2 as
10 * published by the Free Software Foundation.
11 */
12
13#ifndef _WM8962_H
14#define _WM8962_H
15
16#include <asm/types.h>
17
18extern struct snd_soc_dai wm8962_dai;
19extern struct snd_soc_codec_device soc_codec_dev_wm8962;
20
21#define WM8962_SYSCLK_MCLK 1
22#define WM8962_SYSCLK_FLL 2
23#define WM8962_SYSCLK_PLL3 3
24
25#define WM8962_FLL 1
26
27#define WM8962_FLL_MCLK 1
28#define WM8962_FLL_BCLK 2
29#define WM8962_FLL_OSC 3
30#define WM8962_FLL_INT 4
31
32/*
33 * Register values.
34 */
35#define WM8962_LEFT_INPUT_VOLUME 0x00
36#define WM8962_RIGHT_INPUT_VOLUME 0x01
37#define WM8962_HPOUTL_VOLUME 0x02
38#define WM8962_HPOUTR_VOLUME 0x03
39#define WM8962_CLOCKING1 0x04
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41#define WM8962_ADC_DAC_CONTROL_2 0x06
42#define WM8962_AUDIO_INTERFACE_0 0x07
43#define WM8962_CLOCKING2 0x08
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49#define WM8962_ALC1 0x11
50#define WM8962_ALC2 0x12
51#define WM8962_ALC3 0x13
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54#define WM8962_RIGHT_ADC_VOLUME 0x16
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73#define WM8962_CLASS_D_CONTROL_1 0x31
74#define WM8962_CLASS_D_CONTROL_2 0x33
75#define WM8962_CLOCKING_4 0x38
76#define WM8962_DAC_DSP_MIXING_1 0x39
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83#define WM8962_ANALOGUE_HP_0 0x45
84#define WM8962_ANALOGUE_HP_2 0x47
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86#define WM8962_CHARGE_PUMP_B 0x52
87#define WM8962_WRITE_SEQUENCER_CONTROL_1 0x57
88#define WM8962_WRITE_SEQUENCER_CONTROL_2 0x5A
89#define WM8962_WRITE_SEQUENCER_CONTROL_3 0x5D
90#define WM8962_CONTROL_INTERFACE 0x5E
91#define WM8962_MIXER_ENABLES 0x63
92#define WM8962_HEADPHONE_MIXER_1 0x64
93#define WM8962_HEADPHONE_MIXER_2 0x65
94#define WM8962_HEADPHONE_MIXER_3 0x66
95#define WM8962_HEADPHONE_MIXER_4 0x67
96#define WM8962_SPEAKER_MIXER_1 0x69
97#define WM8962_SPEAKER_MIXER_2 0x6A
98#define WM8962_SPEAKER_MIXER_3 0x6B
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100#define WM8962_SPEAKER_MIXER_5 0x6D
101#define WM8962_BEEP_GENERATOR_1 0x6E
102#define WM8962_OSCILLATOR_TRIM_3 0x73
103#define WM8962_OSCILLATOR_TRIM_4 0x74
104#define WM8962_OSCILLATOR_TRIM_7 0x77
105#define WM8962_ANALOGUE_CLOCKING1 0x7C
106#define WM8962_ANALOGUE_CLOCKING2 0x7D
107#define WM8962_ANALOGUE_CLOCKING3 0x7E
108#define WM8962_PLL_SOFTWARE_RESET 0x7F
109#define WM8962_PLL2 0x81
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118#define WM8962_PLL_16 0x8F
119#define WM8962_FLL_CONTROL_1 0x9B
120#define WM8962_FLL_CONTROL_2 0x9C
121#define WM8962_FLL_CONTROL_3 0x9D
122#define WM8962_FLL_CONTROL_5 0x9F
123#define WM8962_FLL_CONTROL_6 0xA0
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187#define WM8962_GPIO_2 0x201
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189#define WM8962_GPIO_5 0x204
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193#define WM8962_INTERRUPT_STATUS_1_MASK 0x238
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196#define WM8962_IRQ_DEBOUNCE 0x248
197#define WM8962_MICINT_SOURCE_POL 0x24A
198#define WM8962_DSP2_POWER_MANAGEMENT 0x300
199#define WM8962_DSP2_EXECCONTROL 0x40D
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1176
1177/*
1178 * Field Definitions.
1179 */
1180
1181/*
1182 * R0 (0x00) - Left Input volume
1183 */
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1199
1200/*
1201 * R1 (0x01) - Right Input volume
1202 */
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1214#define WM8962_INPGAR_MUTE_MASK 0x0080 /* INPGAR_MUTE */
1215#define WM8962_INPGAR_MUTE_SHIFT 7 /* INPGAR_MUTE */
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1222#define WM8962_INR_VOL_SHIFT 0 /* INR_VOL - [5:0] */
1223#define WM8962_INR_VOL_WIDTH 6 /* INR_VOL - [5:0] */
1224
1225/*
1226 * R2 (0x02) - HPOUTL volume
1227 */
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1238#define WM8962_HPOUTL_VOL_WIDTH 7 /* HPOUTL_VOL - [6:0] */
1239
1240/*
1241 * R3 (0x03) - HPOUTR volume
1242 */
1243#define WM8962_HPOUT_VU 0x0100 /* HPOUT_VU */
1244#define WM8962_HPOUT_VU_MASK 0x0100 /* HPOUT_VU */
1245#define WM8962_HPOUT_VU_SHIFT 8 /* HPOUT_VU */
1246#define WM8962_HPOUT_VU_WIDTH 1 /* HPOUT_VU */
1247#define WM8962_HPOUTR_ZC 0x0080 /* HPOUTR_ZC */
1248#define WM8962_HPOUTR_ZC_MASK 0x0080 /* HPOUTR_ZC */
1249#define WM8962_HPOUTR_ZC_SHIFT 7 /* HPOUTR_ZC */
1250#define WM8962_HPOUTR_ZC_WIDTH 1 /* HPOUTR_ZC */
1251#define WM8962_HPOUTR_VOL_MASK 0x007F /* HPOUTR_VOL - [6:0] */
1252#define WM8962_HPOUTR_VOL_SHIFT 0 /* HPOUTR_VOL - [6:0] */
1253#define WM8962_HPOUTR_VOL_WIDTH 7 /* HPOUTR_VOL - [6:0] */
1254
1255/*
1256 * R4 (0x04) - Clocking1
1257 */
1258#define WM8962_DSPCLK_DIV_MASK 0x0600 /* DSPCLK_DIV - [10:9] */
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1260#define WM8962_DSPCLK_DIV_WIDTH 2 /* DSPCLK_DIV - [10:9] */
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1263#define WM8962_ADCSYS_CLK_DIV_WIDTH 3 /* ADCSYS_CLK_DIV - [8:6] */
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1265#define WM8962_DACSYS_CLK_DIV_SHIFT 3 /* DACSYS_CLK_DIV - [5:3] */
1266#define WM8962_DACSYS_CLK_DIV_WIDTH 3 /* DACSYS_CLK_DIV - [5:3] */
1267#define WM8962_MCLKDIV_MASK 0x0006 /* MCLKDIV - [2:1] */
1268#define WM8962_MCLKDIV_SHIFT 1 /* MCLKDIV - [2:1] */
1269#define WM8962_MCLKDIV_WIDTH 2 /* MCLKDIV - [2:1] */
1270
1271/*
1272 * R5 (0x05) - ADC & DAC Control 1
1273 */
1274#define WM8962_ADCR_DAT_INV 0x0040 /* ADCR_DAT_INV */
1275#define WM8962_ADCR_DAT_INV_MASK 0x0040 /* ADCR_DAT_INV */
1276#define WM8962_ADCR_DAT_INV_SHIFT 6 /* ADCR_DAT_INV */
1277#define WM8962_ADCR_DAT_INV_WIDTH 1 /* ADCR_DAT_INV */
1278#define WM8962_ADCL_DAT_INV 0x0020 /* ADCL_DAT_INV */
1279#define WM8962_ADCL_DAT_INV_MASK 0x0020 /* ADCL_DAT_INV */
1280#define WM8962_ADCL_DAT_INV_SHIFT 5 /* ADCL_DAT_INV */
1281#define WM8962_ADCL_DAT_INV_WIDTH 1 /* ADCL_DAT_INV */
1282#define WM8962_DAC_MUTE_RAMP 0x0010 /* DAC_MUTE_RAMP */
1283#define WM8962_DAC_MUTE_RAMP_MASK 0x0010 /* DAC_MUTE_RAMP */
1284#define WM8962_DAC_MUTE_RAMP_SHIFT 4 /* DAC_MUTE_RAMP */
1285#define WM8962_DAC_MUTE_RAMP_WIDTH 1 /* DAC_MUTE_RAMP */
1286#define WM8962_DAC_MUTE 0x0008 /* DAC_MUTE */
1287#define WM8962_DAC_MUTE_MASK 0x0008 /* DAC_MUTE */
1288#define WM8962_DAC_MUTE_SHIFT 3 /* DAC_MUTE */
1289#define WM8962_DAC_MUTE_WIDTH 1 /* DAC_MUTE */
1290#define WM8962_DAC_DEEMP_MASK 0x0006 /* DAC_DEEMP - [2:1] */
1291#define WM8962_DAC_DEEMP_SHIFT 1 /* DAC_DEEMP - [2:1] */
1292#define WM8962_DAC_DEEMP_WIDTH 2 /* DAC_DEEMP - [2:1] */
1293#define WM8962_ADC_HPF_DIS 0x0001 /* ADC_HPF_DIS */
1294#define WM8962_ADC_HPF_DIS_MASK 0x0001 /* ADC_HPF_DIS */
1295#define WM8962_ADC_HPF_DIS_SHIFT 0 /* ADC_HPF_DIS */
1296#define WM8962_ADC_HPF_DIS_WIDTH 1 /* ADC_HPF_DIS */
1297
1298/*
1299 * R6 (0x06) - ADC & DAC Control 2
1300 */
1301#define WM8962_ADC_HPF_SR_MASK 0x3000 /* ADC_HPF_SR - [13:12] */
1302#define WM8962_ADC_HPF_SR_SHIFT 12 /* ADC_HPF_SR - [13:12] */
1303#define WM8962_ADC_HPF_SR_WIDTH 2 /* ADC_HPF_SR - [13:12] */
1304#define WM8962_ADC_HPF_MODE 0x0400 /* ADC_HPF_MODE */
1305#define WM8962_ADC_HPF_MODE_MASK 0x0400 /* ADC_HPF_MODE */
1306#define WM8962_ADC_HPF_MODE_SHIFT 10 /* ADC_HPF_MODE */
1307#define WM8962_ADC_HPF_MODE_WIDTH 1 /* ADC_HPF_MODE */
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1309#define WM8962_ADC_HPF_CUT_SHIFT 7 /* ADC_HPF_CUT - [9:7] */
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1311#define WM8962_DACR_DAT_INV 0x0040 /* DACR_DAT_INV */
1312#define WM8962_DACR_DAT_INV_MASK 0x0040 /* DACR_DAT_INV */
1313#define WM8962_DACR_DAT_INV_SHIFT 6 /* DACR_DAT_INV */
1314#define WM8962_DACR_DAT_INV_WIDTH 1 /* DACR_DAT_INV */
1315#define WM8962_DACL_DAT_INV 0x0020 /* DACL_DAT_INV */
1316#define WM8962_DACL_DAT_INV_MASK 0x0020 /* DACL_DAT_INV */
1317#define WM8962_DACL_DAT_INV_SHIFT 5 /* DACL_DAT_INV */
1318#define WM8962_DACL_DAT_INV_WIDTH 1 /* DACL_DAT_INV */
1319#define WM8962_DAC_UNMUTE_RAMP 0x0008 /* DAC_UNMUTE_RAMP */
1320#define WM8962_DAC_UNMUTE_RAMP_MASK 0x0008 /* DAC_UNMUTE_RAMP */
1321#define WM8962_DAC_UNMUTE_RAMP_SHIFT 3 /* DAC_UNMUTE_RAMP */
1322#define WM8962_DAC_UNMUTE_RAMP_WIDTH 1 /* DAC_UNMUTE_RAMP */
1323#define WM8962_DAC_MUTERATE 0x0004 /* DAC_MUTERATE */
1324#define WM8962_DAC_MUTERATE_MASK 0x0004 /* DAC_MUTERATE */
1325#define WM8962_DAC_MUTERATE_SHIFT 2 /* DAC_MUTERATE */
1326#define WM8962_DAC_MUTERATE_WIDTH 1 /* DAC_MUTERATE */
1327#define WM8962_DAC_HP 0x0001 /* DAC_HP */
1328#define WM8962_DAC_HP_MASK 0x0001 /* DAC_HP */
1329#define WM8962_DAC_HP_SHIFT 0 /* DAC_HP */
1330#define WM8962_DAC_HP_WIDTH 1 /* DAC_HP */
1331
1332/*
1333 * R7 (0x07) - Audio Interface 0
1334 */
1335#define WM8962_AIFDAC_TDM_MODE 0x1000 /* AIFDAC_TDM_MODE */
1336#define WM8962_AIFDAC_TDM_MODE_MASK 0x1000 /* AIFDAC_TDM_MODE */
1337#define WM8962_AIFDAC_TDM_MODE_SHIFT 12 /* AIFDAC_TDM_MODE */
1338#define WM8962_AIFDAC_TDM_MODE_WIDTH 1 /* AIFDAC_TDM_MODE */
1339#define WM8962_AIFDAC_TDM_SLOT 0x0800 /* AIFDAC_TDM_SLOT */
1340#define WM8962_AIFDAC_TDM_SLOT_MASK 0x0800 /* AIFDAC_TDM_SLOT */
1341#define WM8962_AIFDAC_TDM_SLOT_SHIFT 11 /* AIFDAC_TDM_SLOT */
1342#define WM8962_AIFDAC_TDM_SLOT_WIDTH 1 /* AIFDAC_TDM_SLOT */
1343#define WM8962_AIFADC_TDM_MODE 0x0400 /* AIFADC_TDM_MODE */
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1345#define WM8962_AIFADC_TDM_MODE_SHIFT 10 /* AIFADC_TDM_MODE */
1346#define WM8962_AIFADC_TDM_MODE_WIDTH 1 /* AIFADC_TDM_MODE */
1347#define WM8962_AIFADC_TDM_SLOT 0x0200 /* AIFADC_TDM_SLOT */
1348#define WM8962_AIFADC_TDM_SLOT_MASK 0x0200 /* AIFADC_TDM_SLOT */
1349#define WM8962_AIFADC_TDM_SLOT_SHIFT 9 /* AIFADC_TDM_SLOT */
1350#define WM8962_AIFADC_TDM_SLOT_WIDTH 1 /* AIFADC_TDM_SLOT */
1351#define WM8962_ADC_LRSWAP 0x0100 /* ADC_LRSWAP */
1352#define WM8962_ADC_LRSWAP_MASK 0x0100 /* ADC_LRSWAP */
1353#define WM8962_ADC_LRSWAP_SHIFT 8 /* ADC_LRSWAP */
1354#define WM8962_ADC_LRSWAP_WIDTH 1 /* ADC_LRSWAP */
1355#define WM8962_BCLK_INV 0x0080 /* BCLK_INV */
1356#define WM8962_BCLK_INV_MASK 0x0080 /* BCLK_INV */
1357#define WM8962_BCLK_INV_SHIFT 7 /* BCLK_INV */
1358#define WM8962_BCLK_INV_WIDTH 1 /* BCLK_INV */
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1360#define WM8962_MSTR_MASK 0x0040 /* MSTR */
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1362#define WM8962_MSTR_WIDTH 1 /* MSTR */
1363#define WM8962_DAC_LRSWAP 0x0020 /* DAC_LRSWAP */
1364#define WM8962_DAC_LRSWAP_MASK 0x0020 /* DAC_LRSWAP */
1365#define WM8962_DAC_LRSWAP_SHIFT 5 /* DAC_LRSWAP */
1366#define WM8962_DAC_LRSWAP_WIDTH 1 /* DAC_LRSWAP */
1367#define WM8962_LRCLK_INV 0x0010 /* LRCLK_INV */
1368#define WM8962_LRCLK_INV_MASK 0x0010 /* LRCLK_INV */
1369#define WM8962_LRCLK_INV_SHIFT 4 /* LRCLK_INV */
1370#define WM8962_LRCLK_INV_WIDTH 1 /* LRCLK_INV */
1371#define WM8962_WL_MASK 0x000C /* WL - [3:2] */
1372#define WM8962_WL_SHIFT 2 /* WL - [3:2] */
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1374#define WM8962_FMT_MASK 0x0003 /* FMT - [1:0] */
1375#define WM8962_FMT_SHIFT 0 /* FMT - [1:0] */
1376#define WM8962_FMT_WIDTH 2 /* FMT - [1:0] */
1377
1378/*
1379 * R8 (0x08) - Clocking2
1380 */
1381#define WM8962_CLKREG_OVD 0x0800 /* CLKREG_OVD */
1382#define WM8962_CLKREG_OVD_MASK 0x0800 /* CLKREG_OVD */
1383#define WM8962_CLKREG_OVD_SHIFT 11 /* CLKREG_OVD */
1384#define WM8962_CLKREG_OVD_WIDTH 1 /* CLKREG_OVD */
1385#define WM8962_SYSCLK_SRC_MASK 0x0600 /* SYSCLK_SRC - [10:9] */
1386#define WM8962_SYSCLK_SRC_SHIFT 9 /* SYSCLK_SRC - [10:9] */
1387#define WM8962_SYSCLK_SRC_WIDTH 2 /* SYSCLK_SRC - [10:9] */
1388#define WM8962_CLASSD_CLK_DIV_MASK 0x01C0 /* CLASSD_CLK_DIV - [8:6] */
1389#define WM8962_CLASSD_CLK_DIV_SHIFT 6 /* CLASSD_CLK_DIV - [8:6] */
1390#define WM8962_CLASSD_CLK_DIV_WIDTH 3 /* CLASSD_CLK_DIV - [8:6] */
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1392#define WM8962_SYSCLK_ENA_MASK 0x0020 /* SYSCLK_ENA */
1393#define WM8962_SYSCLK_ENA_SHIFT 5 /* SYSCLK_ENA */
1394#define WM8962_SYSCLK_ENA_WIDTH 1 /* SYSCLK_ENA */
1395#define WM8962_BCLK_DIV_MASK 0x000F /* BCLK_DIV - [3:0] */
1396#define WM8962_BCLK_DIV_SHIFT 0 /* BCLK_DIV - [3:0] */
1397#define WM8962_BCLK_DIV_WIDTH 4 /* BCLK_DIV - [3:0] */
1398
1399/*
1400 * R9 (0x09) - Audio Interface 1
1401 */
1402#define WM8962_AUTOMUTE_STS 0x0800 /* AUTOMUTE_STS */
1403#define WM8962_AUTOMUTE_STS_MASK 0x0800 /* AUTOMUTE_STS */
1404#define WM8962_AUTOMUTE_STS_SHIFT 11 /* AUTOMUTE_STS */
1405#define WM8962_AUTOMUTE_STS_WIDTH 1 /* AUTOMUTE_STS */
1406#define WM8962_DAC_AUTOMUTE_SAMPLES_MASK 0x0300 /* DAC_AUTOMUTE_SAMPLES - [9:8] */
1407#define WM8962_DAC_AUTOMUTE_SAMPLES_SHIFT 8 /* DAC_AUTOMUTE_SAMPLES - [9:8] */
1408#define WM8962_DAC_AUTOMUTE_SAMPLES_WIDTH 2 /* DAC_AUTOMUTE_SAMPLES - [9:8] */
1409#define WM8962_DAC_AUTOMUTE 0x0080 /* DAC_AUTOMUTE */
1410#define WM8962_DAC_AUTOMUTE_MASK 0x0080 /* DAC_AUTOMUTE */
1411#define WM8962_DAC_AUTOMUTE_SHIFT 7 /* DAC_AUTOMUTE */
1412#define WM8962_DAC_AUTOMUTE_WIDTH 1 /* DAC_AUTOMUTE */
1413#define WM8962_DAC_COMP 0x0010 /* DAC_COMP */
1414#define WM8962_DAC_COMP_MASK 0x0010 /* DAC_COMP */
1415#define WM8962_DAC_COMP_SHIFT 4 /* DAC_COMP */
1416#define WM8962_DAC_COMP_WIDTH 1 /* DAC_COMP */
1417#define WM8962_DAC_COMPMODE 0x0008 /* DAC_COMPMODE */
1418#define WM8962_DAC_COMPMODE_MASK 0x0008 /* DAC_COMPMODE */
1419#define WM8962_DAC_COMPMODE_SHIFT 3 /* DAC_COMPMODE */
1420#define WM8962_DAC_COMPMODE_WIDTH 1 /* DAC_COMPMODE */
1421#define WM8962_ADC_COMP 0x0004 /* ADC_COMP */
1422#define WM8962_ADC_COMP_MASK 0x0004 /* ADC_COMP */
1423#define WM8962_ADC_COMP_SHIFT 2 /* ADC_COMP */
1424#define WM8962_ADC_COMP_WIDTH 1 /* ADC_COMP */
1425#define WM8962_ADC_COMPMODE 0x0002 /* ADC_COMPMODE */
1426#define WM8962_ADC_COMPMODE_MASK 0x0002 /* ADC_COMPMODE */
1427#define WM8962_ADC_COMPMODE_SHIFT 1 /* ADC_COMPMODE */
1428#define WM8962_ADC_COMPMODE_WIDTH 1 /* ADC_COMPMODE */
1429#define WM8962_LOOPBACK 0x0001 /* LOOPBACK */
1430#define WM8962_LOOPBACK_MASK 0x0001 /* LOOPBACK */
1431#define WM8962_LOOPBACK_SHIFT 0 /* LOOPBACK */
1432#define WM8962_LOOPBACK_WIDTH 1 /* LOOPBACK */
1433
1434/*
1435 * R10 (0x0A) - Left DAC volume
1436 */
1437#define WM8962_DAC_VU 0x0100 /* DAC_VU */
1438#define WM8962_DAC_VU_MASK 0x0100 /* DAC_VU */
1439#define WM8962_DAC_VU_SHIFT 8 /* DAC_VU */
1440#define WM8962_DAC_VU_WIDTH 1 /* DAC_VU */
1441#define WM8962_DACL_VOL_MASK 0x00FF /* DACL_VOL - [7:0] */
1442#define WM8962_DACL_VOL_SHIFT 0 /* DACL_VOL - [7:0] */
1443#define WM8962_DACL_VOL_WIDTH 8 /* DACL_VOL - [7:0] */
1444
1445/*
1446 * R11 (0x0B) - Right DAC volume
1447 */
1448#define WM8962_DAC_VU 0x0100 /* DAC_VU */
1449#define WM8962_DAC_VU_MASK 0x0100 /* DAC_VU */
1450#define WM8962_DAC_VU_SHIFT 8 /* DAC_VU */
1451#define WM8962_DAC_VU_WIDTH 1 /* DAC_VU */
1452#define WM8962_DACR_VOL_MASK 0x00FF /* DACR_VOL - [7:0] */
1453#define WM8962_DACR_VOL_SHIFT 0 /* DACR_VOL - [7:0] */
1454#define WM8962_DACR_VOL_WIDTH 8 /* DACR_VOL - [7:0] */
1455
1456/*
1457 * R14 (0x0E) - Audio Interface 2
1458 */
1459#define WM8962_AIF_RATE_MASK 0x07FF /* AIF_RATE - [10:0] */
1460#define WM8962_AIF_RATE_SHIFT 0 /* AIF_RATE - [10:0] */
1461#define WM8962_AIF_RATE_WIDTH 11 /* AIF_RATE - [10:0] */
1462
1463/*
1464 * R15 (0x0F) - Software Reset
1465 */
1466#define WM8962_SW_RESET_MASK 0xFFFF /* SW_RESET - [15:0] */
1467#define WM8962_SW_RESET_SHIFT 0 /* SW_RESET - [15:0] */
1468#define WM8962_SW_RESET_WIDTH 16 /* SW_RESET - [15:0] */
1469
1470/*
1471 * R17 (0x11) - ALC1
1472 */
1473#define WM8962_ALC_INACTIVE_ENA 0x0400 /* ALC_INACTIVE_ENA */
1474#define WM8962_ALC_INACTIVE_ENA_MASK 0x0400 /* ALC_INACTIVE_ENA */
1475#define WM8962_ALC_INACTIVE_ENA_SHIFT 10 /* ALC_INACTIVE_ENA */
1476#define WM8962_ALC_INACTIVE_ENA_WIDTH 1 /* ALC_INACTIVE_ENA */
1477#define WM8962_ALC_LVL_MODE 0x0200 /* ALC_LVL_MODE */
1478#define WM8962_ALC_LVL_MODE_MASK 0x0200 /* ALC_LVL_MODE */
1479#define WM8962_ALC_LVL_MODE_SHIFT 9 /* ALC_LVL_MODE */
1480#define WM8962_ALC_LVL_MODE_WIDTH 1 /* ALC_LVL_MODE */
1481#define WM8962_ALCL_ENA 0x0100 /* ALCL_ENA */
1482#define WM8962_ALCL_ENA_MASK 0x0100 /* ALCL_ENA */
1483#define WM8962_ALCL_ENA_SHIFT 8 /* ALCL_ENA */
1484#define WM8962_ALCL_ENA_WIDTH 1 /* ALCL_ENA */
1485#define WM8962_ALCR_ENA 0x0080 /* ALCR_ENA */
1486#define WM8962_ALCR_ENA_MASK 0x0080 /* ALCR_ENA */
1487#define WM8962_ALCR_ENA_SHIFT 7 /* ALCR_ENA */
1488#define WM8962_ALCR_ENA_WIDTH 1 /* ALCR_ENA */
1489#define WM8962_ALC_MAXGAIN_MASK 0x0070 /* ALC_MAXGAIN - [6:4] */
1490#define WM8962_ALC_MAXGAIN_SHIFT 4 /* ALC_MAXGAIN - [6:4] */
1491#define WM8962_ALC_MAXGAIN_WIDTH 3 /* ALC_MAXGAIN - [6:4] */
1492#define WM8962_ALC_LVL_MASK 0x000F /* ALC_LVL - [3:0] */
1493#define WM8962_ALC_LVL_SHIFT 0 /* ALC_LVL - [3:0] */
1494#define WM8962_ALC_LVL_WIDTH 4 /* ALC_LVL - [3:0] */
1495
1496/*
1497 * R18 (0x12) - ALC2
1498 */
1499#define WM8962_ALC_LOCK_STS 0x8000 /* ALC_LOCK_STS */
1500#define WM8962_ALC_LOCK_STS_MASK 0x8000 /* ALC_LOCK_STS */
1501#define WM8962_ALC_LOCK_STS_SHIFT 15 /* ALC_LOCK_STS */
1502#define WM8962_ALC_LOCK_STS_WIDTH 1 /* ALC_LOCK_STS */
1503#define WM8962_ALC_THRESH_STS 0x4000 /* ALC_THRESH_STS */
1504#define WM8962_ALC_THRESH_STS_MASK 0x4000 /* ALC_THRESH_STS */
1505#define WM8962_ALC_THRESH_STS_SHIFT 14 /* ALC_THRESH_STS */
1506#define WM8962_ALC_THRESH_STS_WIDTH 1 /* ALC_THRESH_STS */
1507#define WM8962_ALC_SAT_STS 0x2000 /* ALC_SAT_STS */
1508#define WM8962_ALC_SAT_STS_MASK 0x2000 /* ALC_SAT_STS */
1509#define WM8962_ALC_SAT_STS_SHIFT 13 /* ALC_SAT_STS */
1510#define WM8962_ALC_SAT_STS_WIDTH 1 /* ALC_SAT_STS */
1511#define WM8962_ALC_PKOVR_STS 0x1000 /* ALC_PKOVR_STS */
1512#define WM8962_ALC_PKOVR_STS_MASK 0x1000 /* ALC_PKOVR_STS */
1513#define WM8962_ALC_PKOVR_STS_SHIFT 12 /* ALC_PKOVR_STS */
1514#define WM8962_ALC_PKOVR_STS_WIDTH 1 /* ALC_PKOVR_STS */
1515#define WM8962_ALC_NGATE_STS 0x0800 /* ALC_NGATE_STS */
1516#define WM8962_ALC_NGATE_STS_MASK 0x0800 /* ALC_NGATE_STS */
1517#define WM8962_ALC_NGATE_STS_SHIFT 11 /* ALC_NGATE_STS */
1518#define WM8962_ALC_NGATE_STS_WIDTH 1 /* ALC_NGATE_STS */
1519#define WM8962_ALC_ZC 0x0080 /* ALC_ZC */
1520#define WM8962_ALC_ZC_MASK 0x0080 /* ALC_ZC */
1521#define WM8962_ALC_ZC_SHIFT 7 /* ALC_ZC */
1522#define WM8962_ALC_ZC_WIDTH 1 /* ALC_ZC */
1523#define WM8962_ALC_MINGAIN_MASK 0x0070 /* ALC_MINGAIN - [6:4] */
1524#define WM8962_ALC_MINGAIN_SHIFT 4 /* ALC_MINGAIN - [6:4] */
1525#define WM8962_ALC_MINGAIN_WIDTH 3 /* ALC_MINGAIN - [6:4] */
1526#define WM8962_ALC_HLD_MASK 0x000F /* ALC_HLD - [3:0] */
1527#define WM8962_ALC_HLD_SHIFT 0 /* ALC_HLD - [3:0] */
1528#define WM8962_ALC_HLD_WIDTH 4 /* ALC_HLD - [3:0] */
1529
1530/*
1531 * R19 (0x13) - ALC3
1532 */
1533#define WM8962_ALC_NGATE_GAIN_MASK 0x1C00 /* ALC_NGATE_GAIN - [12:10] */
1534#define WM8962_ALC_NGATE_GAIN_SHIFT 10 /* ALC_NGATE_GAIN - [12:10] */
1535#define WM8962_ALC_NGATE_GAIN_WIDTH 3 /* ALC_NGATE_GAIN - [12:10] */
1536#define WM8962_ALC_MODE 0x0100 /* ALC_MODE */
1537#define WM8962_ALC_MODE_MASK 0x0100 /* ALC_MODE */
1538#define WM8962_ALC_MODE_SHIFT 8 /* ALC_MODE */
1539#define WM8962_ALC_MODE_WIDTH 1 /* ALC_MODE */
1540#define WM8962_ALC_DCY_MASK 0x00F0 /* ALC_DCY - [7:4] */
1541#define WM8962_ALC_DCY_SHIFT 4 /* ALC_DCY - [7:4] */
1542#define WM8962_ALC_DCY_WIDTH 4 /* ALC_DCY - [7:4] */
1543#define WM8962_ALC_ATK_MASK 0x000F /* ALC_ATK - [3:0] */
1544#define WM8962_ALC_ATK_SHIFT 0 /* ALC_ATK - [3:0] */
1545#define WM8962_ALC_ATK_WIDTH 4 /* ALC_ATK - [3:0] */
1546
1547/*
1548 * R20 (0x14) - Noise Gate
1549 */
1550#define WM8962_ALC_NGATE_DCY_MASK 0xF000 /* ALC_NGATE_DCY - [15:12] */
1551#define WM8962_ALC_NGATE_DCY_SHIFT 12 /* ALC_NGATE_DCY - [15:12] */
1552#define WM8962_ALC_NGATE_DCY_WIDTH 4 /* ALC_NGATE_DCY - [15:12] */
1553#define WM8962_ALC_NGATE_ATK_MASK 0x0F00 /* ALC_NGATE_ATK - [11:8] */
1554#define WM8962_ALC_NGATE_ATK_SHIFT 8 /* ALC_NGATE_ATK - [11:8] */
1555#define WM8962_ALC_NGATE_ATK_WIDTH 4 /* ALC_NGATE_ATK - [11:8] */
1556#define WM8962_ALC_NGATE_THR_MASK 0x00F8 /* ALC_NGATE_THR - [7:3] */
1557#define WM8962_ALC_NGATE_THR_SHIFT 3 /* ALC_NGATE_THR - [7:3] */
1558#define WM8962_ALC_NGATE_THR_WIDTH 5 /* ALC_NGATE_THR - [7:3] */
1559#define WM8962_ALC_NGATE_MODE_MASK 0x0006 /* ALC_NGATE_MODE - [2:1] */
1560#define WM8962_ALC_NGATE_MODE_SHIFT 1 /* ALC_NGATE_MODE - [2:1] */
1561#define WM8962_ALC_NGATE_MODE_WIDTH 2 /* ALC_NGATE_MODE - [2:1] */
1562#define WM8962_ALC_NGATE_ENA 0x0001 /* ALC_NGATE_ENA */
1563#define WM8962_ALC_NGATE_ENA_MASK 0x0001 /* ALC_NGATE_ENA */
1564#define WM8962_ALC_NGATE_ENA_SHIFT 0 /* ALC_NGATE_ENA */
1565#define WM8962_ALC_NGATE_ENA_WIDTH 1 /* ALC_NGATE_ENA */
1566
1567/*
1568 * R21 (0x15) - Left ADC volume
1569 */
1570#define WM8962_ADC_VU 0x0100 /* ADC_VU */
1571#define WM8962_ADC_VU_MASK 0x0100 /* ADC_VU */
1572#define WM8962_ADC_VU_SHIFT 8 /* ADC_VU */
1573#define WM8962_ADC_VU_WIDTH 1 /* ADC_VU */
1574#define WM8962_ADCL_VOL_MASK 0x00FF /* ADCL_VOL - [7:0] */
1575#define WM8962_ADCL_VOL_SHIFT 0 /* ADCL_VOL - [7:0] */
1576#define WM8962_ADCL_VOL_WIDTH 8 /* ADCL_VOL - [7:0] */
1577
1578/*
1579 * R22 (0x16) - Right ADC volume
1580 */
1581#define WM8962_ADC_VU 0x0100 /* ADC_VU */
1582#define WM8962_ADC_VU_MASK 0x0100 /* ADC_VU */
1583#define WM8962_ADC_VU_SHIFT 8 /* ADC_VU */
1584#define WM8962_ADC_VU_WIDTH 1 /* ADC_VU */
1585#define WM8962_ADCR_VOL_MASK 0x00FF /* ADCR_VOL - [7:0] */
1586#define WM8962_ADCR_VOL_SHIFT 0 /* ADCR_VOL - [7:0] */
1587#define WM8962_ADCR_VOL_WIDTH 8 /* ADCR_VOL - [7:0] */
1588
1589/*
1590 * R23 (0x17) - Additional control(1)
1591 */
1592#define WM8962_THERR_ACT 0x0100 /* THERR_ACT */
1593#define WM8962_THERR_ACT_MASK 0x0100 /* THERR_ACT */
1594#define WM8962_THERR_ACT_SHIFT 8 /* THERR_ACT */
1595#define WM8962_THERR_ACT_WIDTH 1 /* THERR_ACT */
1596#define WM8962_ADC_BIAS 0x0040 /* ADC_BIAS */
1597#define WM8962_ADC_BIAS_MASK 0x0040 /* ADC_BIAS */
1598#define WM8962_ADC_BIAS_SHIFT 6 /* ADC_BIAS */
1599#define WM8962_ADC_BIAS_WIDTH 1 /* ADC_BIAS */
1600#define WM8962_ADC_HP 0x0020 /* ADC_HP */
1601#define WM8962_ADC_HP_MASK 0x0020 /* ADC_HP */
1602#define WM8962_ADC_HP_SHIFT 5 /* ADC_HP */
1603#define WM8962_ADC_HP_WIDTH 1 /* ADC_HP */
1604#define WM8962_TOCLK_ENA 0x0001 /* TOCLK_ENA */
1605#define WM8962_TOCLK_ENA_MASK 0x0001 /* TOCLK_ENA */
1606#define WM8962_TOCLK_ENA_SHIFT 0 /* TOCLK_ENA */
1607#define WM8962_TOCLK_ENA_WIDTH 1 /* TOCLK_ENA */
1608
1609/*
1610 * R24 (0x18) - Additional control(2)
1611 */
1612#define WM8962_AIF_TRI 0x0008 /* AIF_TRI */
1613#define WM8962_AIF_TRI_MASK 0x0008 /* AIF_TRI */
1614#define WM8962_AIF_TRI_SHIFT 3 /* AIF_TRI */
1615#define WM8962_AIF_TRI_WIDTH 1 /* AIF_TRI */
1616
1617/*
1618 * R25 (0x19) - Pwr Mgmt (1)
1619 */
1620#define WM8962_DMIC_ENA 0x0400 /* DMIC_ENA */
1621#define WM8962_DMIC_ENA_MASK 0x0400 /* DMIC_ENA */
1622#define WM8962_DMIC_ENA_SHIFT 10 /* DMIC_ENA */
1623#define WM8962_DMIC_ENA_WIDTH 1 /* DMIC_ENA */
1624#define WM8962_OPCLK_ENA 0x0200 /* OPCLK_ENA */
1625#define WM8962_OPCLK_ENA_MASK 0x0200 /* OPCLK_ENA */
1626#define WM8962_OPCLK_ENA_SHIFT 9 /* OPCLK_ENA */
1627#define WM8962_OPCLK_ENA_WIDTH 1 /* OPCLK_ENA */
1628#define WM8962_VMID_SEL_MASK 0x0180 /* VMID_SEL - [8:7] */
1629#define WM8962_VMID_SEL_SHIFT 7 /* VMID_SEL - [8:7] */
1630#define WM8962_VMID_SEL_WIDTH 2 /* VMID_SEL - [8:7] */
1631#define WM8962_BIAS_ENA 0x0040 /* BIAS_ENA */
1632#define WM8962_BIAS_ENA_MASK 0x0040 /* BIAS_ENA */
1633#define WM8962_BIAS_ENA_SHIFT 6 /* BIAS_ENA */
1634#define WM8962_BIAS_ENA_WIDTH 1 /* BIAS_ENA */
1635#define WM8962_INL_ENA 0x0020 /* INL_ENA */
1636#define WM8962_INL_ENA_MASK 0x0020 /* INL_ENA */
1637#define WM8962_INL_ENA_SHIFT 5 /* INL_ENA */
1638#define WM8962_INL_ENA_WIDTH 1 /* INL_ENA */
1639#define WM8962_INR_ENA 0x0010 /* INR_ENA */
1640#define WM8962_INR_ENA_MASK 0x0010 /* INR_ENA */
1641#define WM8962_INR_ENA_SHIFT 4 /* INR_ENA */
1642#define WM8962_INR_ENA_WIDTH 1 /* INR_ENA */
1643#define WM8962_ADCL_ENA 0x0008 /* ADCL_ENA */
1644#define WM8962_ADCL_ENA_MASK 0x0008 /* ADCL_ENA */
1645#define WM8962_ADCL_ENA_SHIFT 3 /* ADCL_ENA */
1646#define WM8962_ADCL_ENA_WIDTH 1 /* ADCL_ENA */
1647#define WM8962_ADCR_ENA 0x0004 /* ADCR_ENA */
1648#define WM8962_ADCR_ENA_MASK 0x0004 /* ADCR_ENA */
1649#define WM8962_ADCR_ENA_SHIFT 2 /* ADCR_ENA */
1650#define WM8962_ADCR_ENA_WIDTH 1 /* ADCR_ENA */
1651#define WM8962_MICBIAS_ENA 0x0002 /* MICBIAS_ENA */
1652#define WM8962_MICBIAS_ENA_MASK 0x0002 /* MICBIAS_ENA */
1653#define WM8962_MICBIAS_ENA_SHIFT 1 /* MICBIAS_ENA */
1654#define WM8962_MICBIAS_ENA_WIDTH 1 /* MICBIAS_ENA */
1655
1656/*
1657 * R26 (0x1A) - Pwr Mgmt (2)
1658 */
1659#define WM8962_DACL_ENA 0x0100 /* DACL_ENA */
1660#define WM8962_DACL_ENA_MASK 0x0100 /* DACL_ENA */
1661#define WM8962_DACL_ENA_SHIFT 8 /* DACL_ENA */
1662#define WM8962_DACL_ENA_WIDTH 1 /* DACL_ENA */
1663#define WM8962_DACR_ENA 0x0080 /* DACR_ENA */
1664#define WM8962_DACR_ENA_MASK 0x0080 /* DACR_ENA */
1665#define WM8962_DACR_ENA_SHIFT 7 /* DACR_ENA */
1666#define WM8962_DACR_ENA_WIDTH 1 /* DACR_ENA */
1667#define WM8962_HPOUTL_PGA_ENA 0x0040 /* HPOUTL_PGA_ENA */
1668#define WM8962_HPOUTL_PGA_ENA_MASK 0x0040 /* HPOUTL_PGA_ENA */
1669#define WM8962_HPOUTL_PGA_ENA_SHIFT 6 /* HPOUTL_PGA_ENA */
1670#define WM8962_HPOUTL_PGA_ENA_WIDTH 1 /* HPOUTL_PGA_ENA */
1671#define WM8962_HPOUTR_PGA_ENA 0x0020 /* HPOUTR_PGA_ENA */
1672#define WM8962_HPOUTR_PGA_ENA_MASK 0x0020 /* HPOUTR_PGA_ENA */
1673#define WM8962_HPOUTR_PGA_ENA_SHIFT 5 /* HPOUTR_PGA_ENA */
1674#define WM8962_HPOUTR_PGA_ENA_WIDTH 1 /* HPOUTR_PGA_ENA */
1675#define WM8962_SPKOUTL_PGA_ENA 0x0010 /* SPKOUTL_PGA_ENA */
1676#define WM8962_SPKOUTL_PGA_ENA_MASK 0x0010 /* SPKOUTL_PGA_ENA */
1677#define WM8962_SPKOUTL_PGA_ENA_SHIFT 4 /* SPKOUTL_PGA_ENA */
1678#define WM8962_SPKOUTL_PGA_ENA_WIDTH 1 /* SPKOUTL_PGA_ENA */
1679#define WM8962_SPKOUTR_PGA_ENA 0x0008 /* SPKOUTR_PGA_ENA */
1680#define WM8962_SPKOUTR_PGA_ENA_MASK 0x0008 /* SPKOUTR_PGA_ENA */
1681#define WM8962_SPKOUTR_PGA_ENA_SHIFT 3 /* SPKOUTR_PGA_ENA */
1682#define WM8962_SPKOUTR_PGA_ENA_WIDTH 1 /* SPKOUTR_PGA_ENA */
1683#define WM8962_HPOUTL_PGA_MUTE 0x0002 /* HPOUTL_PGA_MUTE */
1684#define WM8962_HPOUTL_PGA_MUTE_MASK 0x0002 /* HPOUTL_PGA_MUTE */
1685#define WM8962_HPOUTL_PGA_MUTE_SHIFT 1 /* HPOUTL_PGA_MUTE */
1686#define WM8962_HPOUTL_PGA_MUTE_WIDTH 1 /* HPOUTL_PGA_MUTE */
1687#define WM8962_HPOUTR_PGA_MUTE 0x0001 /* HPOUTR_PGA_MUTE */
1688#define WM8962_HPOUTR_PGA_MUTE_MASK 0x0001 /* HPOUTR_PGA_MUTE */
1689#define WM8962_HPOUTR_PGA_MUTE_SHIFT 0 /* HPOUTR_PGA_MUTE */
1690#define WM8962_HPOUTR_PGA_MUTE_WIDTH 1 /* HPOUTR_PGA_MUTE */
1691
1692/*
1693 * R27 (0x1B) - Additional Control (3)
1694 */
1695#define WM8962_SAMPLE_RATE_INT_MODE 0x0010 /* SAMPLE_RATE_INT_MODE */
1696#define WM8962_SAMPLE_RATE_INT_MODE_MASK 0x0010 /* SAMPLE_RATE_INT_MODE */
1697#define WM8962_SAMPLE_RATE_INT_MODE_SHIFT 4 /* SAMPLE_RATE_INT_MODE */
1698#define WM8962_SAMPLE_RATE_INT_MODE_WIDTH 1 /* SAMPLE_RATE_INT_MODE */
1699#define WM8962_SAMPLE_RATE_MASK 0x0007 /* SAMPLE_RATE - [2:0] */
1700#define WM8962_SAMPLE_RATE_SHIFT 0 /* SAMPLE_RATE - [2:0] */
1701#define WM8962_SAMPLE_RATE_WIDTH 3 /* SAMPLE_RATE - [2:0] */
1702
1703/*
1704 * R28 (0x1C) - Anti-pop
1705 */
1706#define WM8962_STARTUP_BIAS_ENA 0x0010 /* STARTUP_BIAS_ENA */
1707#define WM8962_STARTUP_BIAS_ENA_MASK 0x0010 /* STARTUP_BIAS_ENA */
1708#define WM8962_STARTUP_BIAS_ENA_SHIFT 4 /* STARTUP_BIAS_ENA */
1709#define WM8962_STARTUP_BIAS_ENA_WIDTH 1 /* STARTUP_BIAS_ENA */
1710#define WM8962_VMID_BUF_ENA 0x0008 /* VMID_BUF_ENA */
1711#define WM8962_VMID_BUF_ENA_MASK 0x0008 /* VMID_BUF_ENA */
1712#define WM8962_VMID_BUF_ENA_SHIFT 3 /* VMID_BUF_ENA */
1713#define WM8962_VMID_BUF_ENA_WIDTH 1 /* VMID_BUF_ENA */
1714#define WM8962_VMID_RAMP 0x0004 /* VMID_RAMP */
1715#define WM8962_VMID_RAMP_MASK 0x0004 /* VMID_RAMP */
1716#define WM8962_VMID_RAMP_SHIFT 2 /* VMID_RAMP */
1717#define WM8962_VMID_RAMP_WIDTH 1 /* VMID_RAMP */
1718
1719/*
1720 * R30 (0x1E) - Clocking 3
1721 */
1722#define WM8962_DBCLK_DIV_MASK 0xE000 /* DBCLK_DIV - [15:13] */
1723#define WM8962_DBCLK_DIV_SHIFT 13 /* DBCLK_DIV - [15:13] */
1724#define WM8962_DBCLK_DIV_WIDTH 3 /* DBCLK_DIV - [15:13] */
1725#define WM8962_OPCLK_DIV_MASK 0x1C00 /* OPCLK_DIV - [12:10] */
1726#define WM8962_OPCLK_DIV_SHIFT 10 /* OPCLK_DIV - [12:10] */
1727#define WM8962_OPCLK_DIV_WIDTH 3 /* OPCLK_DIV - [12:10] */
1728#define WM8962_TOCLK_DIV_MASK 0x0380 /* TOCLK_DIV - [9:7] */
1729#define WM8962_TOCLK_DIV_SHIFT 7 /* TOCLK_DIV - [9:7] */
1730#define WM8962_TOCLK_DIV_WIDTH 3 /* TOCLK_DIV - [9:7] */
1731#define WM8962_F256KCLK_DIV_MASK 0x007E /* F256KCLK_DIV - [6:1] */
1732#define WM8962_F256KCLK_DIV_SHIFT 1 /* F256KCLK_DIV - [6:1] */
1733#define WM8962_F256KCLK_DIV_WIDTH 6 /* F256KCLK_DIV - [6:1] */
1734
1735/*
1736 * R31 (0x1F) - Input mixer control (1)
1737 */
1738#define WM8962_MIXINL_MUTE 0x0008 /* MIXINL_MUTE */
1739#define WM8962_MIXINL_MUTE_MASK 0x0008 /* MIXINL_MUTE */
1740#define WM8962_MIXINL_MUTE_SHIFT 3 /* MIXINL_MUTE */
1741#define WM8962_MIXINL_MUTE_WIDTH 1 /* MIXINL_MUTE */
1742#define WM8962_MIXINR_MUTE 0x0004 /* MIXINR_MUTE */
1743#define WM8962_MIXINR_MUTE_MASK 0x0004 /* MIXINR_MUTE */
1744#define WM8962_MIXINR_MUTE_SHIFT 2 /* MIXINR_MUTE */
1745#define WM8962_MIXINR_MUTE_WIDTH 1 /* MIXINR_MUTE */
1746#define WM8962_MIXINL_ENA 0x0002 /* MIXINL_ENA */
1747#define WM8962_MIXINL_ENA_MASK 0x0002 /* MIXINL_ENA */
1748#define WM8962_MIXINL_ENA_SHIFT 1 /* MIXINL_ENA */
1749#define WM8962_MIXINL_ENA_WIDTH 1 /* MIXINL_ENA */
1750#define WM8962_MIXINR_ENA 0x0001 /* MIXINR_ENA */
1751#define WM8962_MIXINR_ENA_MASK 0x0001 /* MIXINR_ENA */
1752#define WM8962_MIXINR_ENA_SHIFT 0 /* MIXINR_ENA */
1753#define WM8962_MIXINR_ENA_WIDTH 1 /* MIXINR_ENA */
1754
1755/*
1756 * R32 (0x20) - Left input mixer volume
1757 */
1758#define WM8962_IN2L_MIXINL_VOL_MASK 0x01C0 /* IN2L_MIXINL_VOL - [8:6] */
1759#define WM8962_IN2L_MIXINL_VOL_SHIFT 6 /* IN2L_MIXINL_VOL - [8:6] */
1760#define WM8962_IN2L_MIXINL_VOL_WIDTH 3 /* IN2L_MIXINL_VOL - [8:6] */
1761#define WM8962_INPGAL_MIXINL_VOL_MASK 0x0038 /* INPGAL_MIXINL_VOL - [5:3] */
1762#define WM8962_INPGAL_MIXINL_VOL_SHIFT 3 /* INPGAL_MIXINL_VOL - [5:3] */
1763#define WM8962_INPGAL_MIXINL_VOL_WIDTH 3 /* INPGAL_MIXINL_VOL - [5:3] */
1764#define WM8962_IN3L_MIXINL_VOL_MASK 0x0007 /* IN3L_MIXINL_VOL - [2:0] */
1765#define WM8962_IN3L_MIXINL_VOL_SHIFT 0 /* IN3L_MIXINL_VOL - [2:0] */
1766#define WM8962_IN3L_MIXINL_VOL_WIDTH 3 /* IN3L_MIXINL_VOL - [2:0] */
1767
1768/*
1769 * R33 (0x21) - Right input mixer volume
1770 */
1771#define WM8962_IN2R_MIXINR_VOL_MASK 0x01C0 /* IN2R_MIXINR_VOL - [8:6] */
1772#define WM8962_IN2R_MIXINR_VOL_SHIFT 6 /* IN2R_MIXINR_VOL - [8:6] */
1773#define WM8962_IN2R_MIXINR_VOL_WIDTH 3 /* IN2R_MIXINR_VOL - [8:6] */
1774#define WM8962_INPGAR_MIXINR_VOL_MASK 0x0038 /* INPGAR_MIXINR_VOL - [5:3] */
1775#define WM8962_INPGAR_MIXINR_VOL_SHIFT 3 /* INPGAR_MIXINR_VOL - [5:3] */
1776#define WM8962_INPGAR_MIXINR_VOL_WIDTH 3 /* INPGAR_MIXINR_VOL - [5:3] */
1777#define WM8962_IN3R_MIXINR_VOL_MASK 0x0007 /* IN3R_MIXINR_VOL - [2:0] */
1778#define WM8962_IN3R_MIXINR_VOL_SHIFT 0 /* IN3R_MIXINR_VOL - [2:0] */
1779#define WM8962_IN3R_MIXINR_VOL_WIDTH 3 /* IN3R_MIXINR_VOL - [2:0] */
1780
1781/*
1782 * R34 (0x22) - Input mixer control (2)
1783 */
1784#define WM8962_IN2L_TO_MIXINL 0x0020 /* IN2L_TO_MIXINL */
1785#define WM8962_IN2L_TO_MIXINL_MASK 0x0020 /* IN2L_TO_MIXINL */
1786#define WM8962_IN2L_TO_MIXINL_SHIFT 5 /* IN2L_TO_MIXINL */
1787#define WM8962_IN2L_TO_MIXINL_WIDTH 1 /* IN2L_TO_MIXINL */
1788#define WM8962_IN3L_TO_MIXINL 0x0010 /* IN3L_TO_MIXINL */
1789#define WM8962_IN3L_TO_MIXINL_MASK 0x0010 /* IN3L_TO_MIXINL */
1790#define WM8962_IN3L_TO_MIXINL_SHIFT 4 /* IN3L_TO_MIXINL */
1791#define WM8962_IN3L_TO_MIXINL_WIDTH 1 /* IN3L_TO_MIXINL */
1792#define WM8962_INPGAL_TO_MIXINL 0x0008 /* INPGAL_TO_MIXINL */
1793#define WM8962_INPGAL_TO_MIXINL_MASK 0x0008 /* INPGAL_TO_MIXINL */
1794#define WM8962_INPGAL_TO_MIXINL_SHIFT 3 /* INPGAL_TO_MIXINL */
1795#define WM8962_INPGAL_TO_MIXINL_WIDTH 1 /* INPGAL_TO_MIXINL */
1796#define WM8962_IN2R_TO_MIXINR 0x0004 /* IN2R_TO_MIXINR */
1797#define WM8962_IN2R_TO_MIXINR_MASK 0x0004 /* IN2R_TO_MIXINR */
1798#define WM8962_IN2R_TO_MIXINR_SHIFT 2 /* IN2R_TO_MIXINR */
1799#define WM8962_IN2R_TO_MIXINR_WIDTH 1 /* IN2R_TO_MIXINR */
1800#define WM8962_IN3R_TO_MIXINR 0x0002 /* IN3R_TO_MIXINR */
1801#define WM8962_IN3R_TO_MIXINR_MASK 0x0002 /* IN3R_TO_MIXINR */
1802#define WM8962_IN3R_TO_MIXINR_SHIFT 1 /* IN3R_TO_MIXINR */
1803#define WM8962_IN3R_TO_MIXINR_WIDTH 1 /* IN3R_TO_MIXINR */
1804#define WM8962_INPGAR_TO_MIXINR 0x0001 /* INPGAR_TO_MIXINR */
1805#define WM8962_INPGAR_TO_MIXINR_MASK 0x0001 /* INPGAR_TO_MIXINR */
1806#define WM8962_INPGAR_TO_MIXINR_SHIFT 0 /* INPGAR_TO_MIXINR */
1807#define WM8962_INPGAR_TO_MIXINR_WIDTH 1 /* INPGAR_TO_MIXINR */
1808
1809/*
1810 * R35 (0x23) - Input bias control
1811 */
1812#define WM8962_MIXIN_BIAS_MASK 0x0038 /* MIXIN_BIAS - [5:3] */
1813#define WM8962_MIXIN_BIAS_SHIFT 3 /* MIXIN_BIAS - [5:3] */
1814#define WM8962_MIXIN_BIAS_WIDTH 3 /* MIXIN_BIAS - [5:3] */
1815#define WM8962_INPGA_BIAS_MASK 0x0007 /* INPGA_BIAS - [2:0] */
1816#define WM8962_INPGA_BIAS_SHIFT 0 /* INPGA_BIAS - [2:0] */
1817#define WM8962_INPGA_BIAS_WIDTH 3 /* INPGA_BIAS - [2:0] */
1818
1819/*
1820 * R37 (0x25) - Left input PGA control
1821 */
1822#define WM8962_INPGAL_ENA 0x0010 /* INPGAL_ENA */
1823#define WM8962_INPGAL_ENA_MASK 0x0010 /* INPGAL_ENA */
1824#define WM8962_INPGAL_ENA_SHIFT 4 /* INPGAL_ENA */
1825#define WM8962_INPGAL_ENA_WIDTH 1 /* INPGAL_ENA */
1826#define WM8962_IN1L_TO_INPGAL 0x0008 /* IN1L_TO_INPGAL */
1827#define WM8962_IN1L_TO_INPGAL_MASK 0x0008 /* IN1L_TO_INPGAL */
1828#define WM8962_IN1L_TO_INPGAL_SHIFT 3 /* IN1L_TO_INPGAL */
1829#define WM8962_IN1L_TO_INPGAL_WIDTH 1 /* IN1L_TO_INPGAL */
1830#define WM8962_IN2L_TO_INPGAL 0x0004 /* IN2L_TO_INPGAL */
1831#define WM8962_IN2L_TO_INPGAL_MASK 0x0004 /* IN2L_TO_INPGAL */
1832#define WM8962_IN2L_TO_INPGAL_SHIFT 2 /* IN2L_TO_INPGAL */
1833#define WM8962_IN2L_TO_INPGAL_WIDTH 1 /* IN2L_TO_INPGAL */
1834#define WM8962_IN3L_TO_INPGAL 0x0002 /* IN3L_TO_INPGAL */
1835#define WM8962_IN3L_TO_INPGAL_MASK 0x0002 /* IN3L_TO_INPGAL */
1836#define WM8962_IN3L_TO_INPGAL_SHIFT 1 /* IN3L_TO_INPGAL */
1837#define WM8962_IN3L_TO_INPGAL_WIDTH 1 /* IN3L_TO_INPGAL */
1838#define WM8962_IN4L_TO_INPGAL 0x0001 /* IN4L_TO_INPGAL */
1839#define WM8962_IN4L_TO_INPGAL_MASK 0x0001 /* IN4L_TO_INPGAL */
1840#define WM8962_IN4L_TO_INPGAL_SHIFT 0 /* IN4L_TO_INPGAL */
1841#define WM8962_IN4L_TO_INPGAL_WIDTH 1 /* IN4L_TO_INPGAL */
1842
1843/*
1844 * R38 (0x26) - Right input PGA control
1845 */
1846#define WM8962_INPGAR_ENA 0x0010 /* INPGAR_ENA */
1847#define WM8962_INPGAR_ENA_MASK 0x0010 /* INPGAR_ENA */
1848#define WM8962_INPGAR_ENA_SHIFT 4 /* INPGAR_ENA */
1849#define WM8962_INPGAR_ENA_WIDTH 1 /* INPGAR_ENA */
1850#define WM8962_IN1R_TO_INPGAR 0x0008 /* IN1R_TO_INPGAR */
1851#define WM8962_IN1R_TO_INPGAR_MASK 0x0008 /* IN1R_TO_INPGAR */
1852#define WM8962_IN1R_TO_INPGAR_SHIFT 3 /* IN1R_TO_INPGAR */
1853#define WM8962_IN1R_TO_INPGAR_WIDTH 1 /* IN1R_TO_INPGAR */
1854#define WM8962_IN2R_TO_INPGAR 0x0004 /* IN2R_TO_INPGAR */
1855#define WM8962_IN2R_TO_INPGAR_MASK 0x0004 /* IN2R_TO_INPGAR */
1856#define WM8962_IN2R_TO_INPGAR_SHIFT 2 /* IN2R_TO_INPGAR */
1857#define WM8962_IN2R_TO_INPGAR_WIDTH 1 /* IN2R_TO_INPGAR */
1858#define WM8962_IN3R_TO_INPGAR 0x0002 /* IN3R_TO_INPGAR */
1859#define WM8962_IN3R_TO_INPGAR_MASK 0x0002 /* IN3R_TO_INPGAR */
1860#define WM8962_IN3R_TO_INPGAR_SHIFT 1 /* IN3R_TO_INPGAR */
1861#define WM8962_IN3R_TO_INPGAR_WIDTH 1 /* IN3R_TO_INPGAR */
1862#define WM8962_IN4R_TO_INPGAR 0x0001 /* IN4R_TO_INPGAR */
1863#define WM8962_IN4R_TO_INPGAR_MASK 0x0001 /* IN4R_TO_INPGAR */
1864#define WM8962_IN4R_TO_INPGAR_SHIFT 0 /* IN4R_TO_INPGAR */
1865#define WM8962_IN4R_TO_INPGAR_WIDTH 1 /* IN4R_TO_INPGAR */
1866
1867/*
1868 * R40 (0x28) - SPKOUTL volume
1869 */
1870#define WM8962_SPKOUT_VU 0x0100 /* SPKOUT_VU */
1871#define WM8962_SPKOUT_VU_MASK 0x0100 /* SPKOUT_VU */
1872#define WM8962_SPKOUT_VU_SHIFT 8 /* SPKOUT_VU */
1873#define WM8962_SPKOUT_VU_WIDTH 1 /* SPKOUT_VU */
1874#define WM8962_SPKOUTL_ZC 0x0080 /* SPKOUTL_ZC */
1875#define WM8962_SPKOUTL_ZC_MASK 0x0080 /* SPKOUTL_ZC */
1876#define WM8962_SPKOUTL_ZC_SHIFT 7 /* SPKOUTL_ZC */
1877#define WM8962_SPKOUTL_ZC_WIDTH 1 /* SPKOUTL_ZC */
1878#define WM8962_SPKOUTL_VOL_MASK 0x007F /* SPKOUTL_VOL - [6:0] */
1879#define WM8962_SPKOUTL_VOL_SHIFT 0 /* SPKOUTL_VOL - [6:0] */
1880#define WM8962_SPKOUTL_VOL_WIDTH 7 /* SPKOUTL_VOL - [6:0] */
1881
1882/*
1883 * R41 (0x29) - SPKOUTR volume
1884 */
1885#define WM8962_SPKOUTR_ZC 0x0080 /* SPKOUTR_ZC */
1886#define WM8962_SPKOUTR_ZC_MASK 0x0080 /* SPKOUTR_ZC */
1887#define WM8962_SPKOUTR_ZC_SHIFT 7 /* SPKOUTR_ZC */
1888#define WM8962_SPKOUTR_ZC_WIDTH 1 /* SPKOUTR_ZC */
1889#define WM8962_SPKOUTR_VOL_MASK 0x007F /* SPKOUTR_VOL - [6:0] */
1890#define WM8962_SPKOUTR_VOL_SHIFT 0 /* SPKOUTR_VOL - [6:0] */
1891#define WM8962_SPKOUTR_VOL_WIDTH 7 /* SPKOUTR_VOL - [6:0] */
1892
1893/*
1894 * R47 (0x2F) - Thermal Shutdown Status
1895 */
1896#define WM8962_TEMP_ERR_HP 0x0008 /* TEMP_ERR_HP */
1897#define WM8962_TEMP_ERR_HP_MASK 0x0008 /* TEMP_ERR_HP */
1898#define WM8962_TEMP_ERR_HP_SHIFT 3 /* TEMP_ERR_HP */
1899#define WM8962_TEMP_ERR_HP_WIDTH 1 /* TEMP_ERR_HP */
1900#define WM8962_TEMP_WARN_HP 0x0004 /* TEMP_WARN_HP */
1901#define WM8962_TEMP_WARN_HP_MASK 0x0004 /* TEMP_WARN_HP */
1902#define WM8962_TEMP_WARN_HP_SHIFT 2 /* TEMP_WARN_HP */
1903#define WM8962_TEMP_WARN_HP_WIDTH 1 /* TEMP_WARN_HP */
1904#define WM8962_TEMP_ERR_SPK 0x0002 /* TEMP_ERR_SPK */
1905#define WM8962_TEMP_ERR_SPK_MASK 0x0002 /* TEMP_ERR_SPK */
1906#define WM8962_TEMP_ERR_SPK_SHIFT 1 /* TEMP_ERR_SPK */
1907#define WM8962_TEMP_ERR_SPK_WIDTH 1 /* TEMP_ERR_SPK */
1908#define WM8962_TEMP_WARN_SPK 0x0001 /* TEMP_WARN_SPK */
1909#define WM8962_TEMP_WARN_SPK_MASK 0x0001 /* TEMP_WARN_SPK */
1910#define WM8962_TEMP_WARN_SPK_SHIFT 0 /* TEMP_WARN_SPK */
1911#define WM8962_TEMP_WARN_SPK_WIDTH 1 /* TEMP_WARN_SPK */
1912
1913/*
1914 * R48 (0x30) - Additional Control (4)
1915 */
1916#define WM8962_MICDET_THR_MASK 0x7000 /* MICDET_THR - [14:12] */
1917#define WM8962_MICDET_THR_SHIFT 12 /* MICDET_THR - [14:12] */
1918#define WM8962_MICDET_THR_WIDTH 3 /* MICDET_THR - [14:12] */
1919#define WM8962_MICSHORT_THR_MASK 0x0C00 /* MICSHORT_THR - [11:10] */
1920#define WM8962_MICSHORT_THR_SHIFT 10 /* MICSHORT_THR - [11:10] */
1921#define WM8962_MICSHORT_THR_WIDTH 2 /* MICSHORT_THR - [11:10] */
1922#define WM8962_MICDET_ENA 0x0200 /* MICDET_ENA */
1923#define WM8962_MICDET_ENA_MASK 0x0200 /* MICDET_ENA */
1924#define WM8962_MICDET_ENA_SHIFT 9 /* MICDET_ENA */
1925#define WM8962_MICDET_ENA_WIDTH 1 /* MICDET_ENA */
1926#define WM8962_MICDET_STS 0x0080 /* MICDET_STS */
1927#define WM8962_MICDET_STS_MASK 0x0080 /* MICDET_STS */
1928#define WM8962_MICDET_STS_SHIFT 7 /* MICDET_STS */
1929#define WM8962_MICDET_STS_WIDTH 1 /* MICDET_STS */
1930#define WM8962_MICSHORT_STS 0x0040 /* MICSHORT_STS */
1931#define WM8962_MICSHORT_STS_MASK 0x0040 /* MICSHORT_STS */
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1946
1947/*
1948 * R49 (0x31) - Class D Control 1
1949 */
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1963#define WM8962_SPKOUTR_PGA_MUTE_MASK 0x0001 /* SPKOUTR_PGA_MUTE */
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1965#define WM8962_SPKOUTR_PGA_MUTE_WIDTH 1 /* SPKOUTR_PGA_MUTE */
1966
1967/*
1968 * R51 (0x33) - Class D Control 2
1969 */
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1971#define WM8962_SPK_MONO_MASK 0x0040 /* SPK_MONO */
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1977
1978/*
1979 * R56 (0x38) - Clocking 4
1980 */
1981#define WM8962_SYSCLK_RATE_MASK 0x001E /* SYSCLK_RATE - [4:1] */
1982#define WM8962_SYSCLK_RATE_SHIFT 1 /* SYSCLK_RATE - [4:1] */
1983#define WM8962_SYSCLK_RATE_WIDTH 4 /* SYSCLK_RATE - [4:1] */
1984
1985/*
1986 * R57 (0x39) - DAC DSP Mixing (1)
1987 */
1988#define WM8962_DAC_MONOMIX 0x0200 /* DAC_MONOMIX */
1989#define WM8962_DAC_MONOMIX_MASK 0x0200 /* DAC_MONOMIX */
1990#define WM8962_DAC_MONOMIX_SHIFT 9 /* DAC_MONOMIX */
1991#define WM8962_DAC_MONOMIX_WIDTH 1 /* DAC_MONOMIX */
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1996#define WM8962_ADC_TO_DACR_SHIFT 2 /* ADC_TO_DACR - [3:2] */
1997#define WM8962_ADC_TO_DACR_WIDTH 2 /* ADC_TO_DACR - [3:2] */
1998
1999/*
2000 * R58 (0x3A) - DAC DSP Mixing (2)
2001 */
2002#define WM8962_ADCL_DAC_SVOL_MASK 0x00F0 /* ADCL_DAC_SVOL - [7:4] */
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2004#define WM8962_ADCL_DAC_SVOL_WIDTH 4 /* ADCL_DAC_SVOL - [7:4] */
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2007#define WM8962_ADC_TO_DACL_WIDTH 2 /* ADC_TO_DACL - [3:2] */
2008
2009/*
2010 * R60 (0x3C) - DC Servo 0
2011 */
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2028
2029/*
2030 * R61 (0x3D) - DC Servo 1
2031 */
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2055#define WM8962_HP1R_DCS_SYNC_WIDTH 1 /* HP1R_DCS_SYNC */
2056
2057/*
2058 * R64 (0x40) - DC Servo 4
2059 */
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2062#define WM8962_HP1_DCS_SYNC_STEPS_WIDTH 7 /* HP1_DCS_SYNC_STEPS - [13:7] */
2063
2064/*
2065 * R66 (0x42) - DC Servo 6
2066 */
2067#define WM8962_DCS_STARTUP_DONE_INL 0x0400 /* DCS_STARTUP_DONE_INL */
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2072#define WM8962_DCS_STARTUP_DONE_INR_MASK 0x0200 /* DCS_STARTUP_DONE_INR */
2073#define WM8962_DCS_STARTUP_DONE_INR_SHIFT 9 /* DCS_STARTUP_DONE_INR */
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2075#define WM8962_DCS_STARTUP_DONE_HP1L 0x0100 /* DCS_STARTUP_DONE_HP1L */
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2077#define WM8962_DCS_STARTUP_DONE_HP1L_SHIFT 8 /* DCS_STARTUP_DONE_HP1L */
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2081#define WM8962_DCS_STARTUP_DONE_HP1R_SHIFT 7 /* DCS_STARTUP_DONE_HP1R */
2082#define WM8962_DCS_STARTUP_DONE_HP1R_WIDTH 1 /* DCS_STARTUP_DONE_HP1R */
2083
2084/*
2085 * R68 (0x44) - Analogue PGA Bias
2086 */
2087#define WM8962_HP_PGAS_BIAS_MASK 0x0007 /* HP_PGAS_BIAS - [2:0] */
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2089#define WM8962_HP_PGAS_BIAS_WIDTH 3 /* HP_PGAS_BIAS - [2:0] */
2090
2091/*
2092 * R69 (0x45) - Analogue HP 0
2093 */
2094#define WM8962_HP1L_RMV_SHORT 0x0080 /* HP1L_RMV_SHORT */
2095#define WM8962_HP1L_RMV_SHORT_MASK 0x0080 /* HP1L_RMV_SHORT */
2096#define WM8962_HP1L_RMV_SHORT_SHIFT 7 /* HP1L_RMV_SHORT */
2097#define WM8962_HP1L_RMV_SHORT_WIDTH 1 /* HP1L_RMV_SHORT */
2098#define WM8962_HP1L_ENA_OUTP 0x0040 /* HP1L_ENA_OUTP */
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2101#define WM8962_HP1L_ENA_OUTP_WIDTH 1 /* HP1L_ENA_OUTP */
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2105#define WM8962_HP1L_ENA_DLY_WIDTH 1 /* HP1L_ENA_DLY */
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2109#define WM8962_HP1L_ENA_WIDTH 1 /* HP1L_ENA */
2110#define WM8962_HP1R_RMV_SHORT 0x0008 /* HP1R_RMV_SHORT */
2111#define WM8962_HP1R_RMV_SHORT_MASK 0x0008 /* HP1R_RMV_SHORT */
2112#define WM8962_HP1R_RMV_SHORT_SHIFT 3 /* HP1R_RMV_SHORT */
2113#define WM8962_HP1R_RMV_SHORT_WIDTH 1 /* HP1R_RMV_SHORT */
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2115#define WM8962_HP1R_ENA_OUTP_MASK 0x0004 /* HP1R_ENA_OUTP */
2116#define WM8962_HP1R_ENA_OUTP_SHIFT 2 /* HP1R_ENA_OUTP */
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2122#define WM8962_HP1R_ENA 0x0001 /* HP1R_ENA */
2123#define WM8962_HP1R_ENA_MASK 0x0001 /* HP1R_ENA */
2124#define WM8962_HP1R_ENA_SHIFT 0 /* HP1R_ENA */
2125#define WM8962_HP1R_ENA_WIDTH 1 /* HP1R_ENA */
2126
2127/*
2128 * R71 (0x47) - Analogue HP 2
2129 */
2130#define WM8962_HP1L_VOL_MASK 0x01C0 /* HP1L_VOL - [8:6] */
2131#define WM8962_HP1L_VOL_SHIFT 6 /* HP1L_VOL - [8:6] */
2132#define WM8962_HP1L_VOL_WIDTH 3 /* HP1L_VOL - [8:6] */
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2134#define WM8962_HP1R_VOL_SHIFT 3 /* HP1R_VOL - [5:3] */
2135#define WM8962_HP1R_VOL_WIDTH 3 /* HP1R_VOL - [5:3] */
2136#define WM8962_HP_BIAS_BOOST_MASK 0x0007 /* HP_BIAS_BOOST - [2:0] */
2137#define WM8962_HP_BIAS_BOOST_SHIFT 0 /* HP_BIAS_BOOST - [2:0] */
2138#define WM8962_HP_BIAS_BOOST_WIDTH 3 /* HP_BIAS_BOOST - [2:0] */
2139
2140/*
2141 * R72 (0x48) - Charge Pump 1
2142 */
2143#define WM8962_CP_ENA 0x0001 /* CP_ENA */
2144#define WM8962_CP_ENA_MASK 0x0001 /* CP_ENA */
2145#define WM8962_CP_ENA_SHIFT 0 /* CP_ENA */
2146#define WM8962_CP_ENA_WIDTH 1 /* CP_ENA */
2147
2148/*
2149 * R82 (0x52) - Charge Pump B
2150 */
2151#define WM8962_CP_DYN_PWR 0x0001 /* CP_DYN_PWR */
2152#define WM8962_CP_DYN_PWR_MASK 0x0001 /* CP_DYN_PWR */
2153#define WM8962_CP_DYN_PWR_SHIFT 0 /* CP_DYN_PWR */
2154#define WM8962_CP_DYN_PWR_WIDTH 1 /* CP_DYN_PWR */
2155
2156/*
2157 * R87 (0x57) - Write Sequencer Control 1
2158 */
2159#define WM8962_WSEQ_AUTOSEQ_ENA 0x0080 /* WSEQ_AUTOSEQ_ENA */
2160#define WM8962_WSEQ_AUTOSEQ_ENA_MASK 0x0080 /* WSEQ_AUTOSEQ_ENA */
2161#define WM8962_WSEQ_AUTOSEQ_ENA_SHIFT 7 /* WSEQ_AUTOSEQ_ENA */
2162#define WM8962_WSEQ_AUTOSEQ_ENA_WIDTH 1 /* WSEQ_AUTOSEQ_ENA */
2163#define WM8962_WSEQ_ENA 0x0020 /* WSEQ_ENA */
2164#define WM8962_WSEQ_ENA_MASK 0x0020 /* WSEQ_ENA */
2165#define WM8962_WSEQ_ENA_SHIFT 5 /* WSEQ_ENA */
2166#define WM8962_WSEQ_ENA_WIDTH 1 /* WSEQ_ENA */
2167
2168/*
2169 * R90 (0x5A) - Write Sequencer Control 2
2170 */
2171#define WM8962_WSEQ_ABORT 0x0100 /* WSEQ_ABORT */
2172#define WM8962_WSEQ_ABORT_MASK 0x0100 /* WSEQ_ABORT */
2173#define WM8962_WSEQ_ABORT_SHIFT 8 /* WSEQ_ABORT */
2174#define WM8962_WSEQ_ABORT_WIDTH 1 /* WSEQ_ABORT */
2175#define WM8962_WSEQ_START 0x0080 /* WSEQ_START */
2176#define WM8962_WSEQ_START_MASK 0x0080 /* WSEQ_START */
2177#define WM8962_WSEQ_START_SHIFT 7 /* WSEQ_START */
2178#define WM8962_WSEQ_START_WIDTH 1 /* WSEQ_START */
2179#define WM8962_WSEQ_START_INDEX_MASK 0x007F /* WSEQ_START_INDEX - [6:0] */
2180#define WM8962_WSEQ_START_INDEX_SHIFT 0 /* WSEQ_START_INDEX - [6:0] */
2181#define WM8962_WSEQ_START_INDEX_WIDTH 7 /* WSEQ_START_INDEX - [6:0] */
2182
2183/*
2184 * R93 (0x5D) - Write Sequencer Control 3
2185 */
2186#define WM8962_WSEQ_CURRENT_INDEX_MASK 0x03F8 /* WSEQ_CURRENT_INDEX - [9:3] */
2187#define WM8962_WSEQ_CURRENT_INDEX_SHIFT 3 /* WSEQ_CURRENT_INDEX - [9:3] */
2188#define WM8962_WSEQ_CURRENT_INDEX_WIDTH 7 /* WSEQ_CURRENT_INDEX - [9:3] */
2189#define WM8962_WSEQ_BUSY 0x0001 /* WSEQ_BUSY */
2190#define WM8962_WSEQ_BUSY_MASK 0x0001 /* WSEQ_BUSY */
2191#define WM8962_WSEQ_BUSY_SHIFT 0 /* WSEQ_BUSY */
2192#define WM8962_WSEQ_BUSY_WIDTH 1 /* WSEQ_BUSY */
2193
2194/*
2195 * R94 (0x5E) - Control Interface
2196 */
2197#define WM8962_SPI_CONTRD 0x0040 /* SPI_CONTRD */
2198#define WM8962_SPI_CONTRD_MASK 0x0040 /* SPI_CONTRD */
2199#define WM8962_SPI_CONTRD_SHIFT 6 /* SPI_CONTRD */
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2201#define WM8962_SPI_4WIRE 0x0020 /* SPI_4WIRE */
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2209
2210/*
2211 * R99 (0x63) - Mixer Enables
2212 */
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2229
2230/*
2231 * R100 (0x64) - Headphone Mixer (1)
2232 */
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2243#define WM8962_DACR_TO_HPMIXL_SHIFT 4 /* DACR_TO_HPMIXL */
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2246#define WM8962_MIXINL_TO_HPMIXL_MASK 0x0008 /* MIXINL_TO_HPMIXL */
2247#define WM8962_MIXINL_TO_HPMIXL_SHIFT 3 /* MIXINL_TO_HPMIXL */
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2251#define WM8962_MIXINR_TO_HPMIXL_SHIFT 2 /* MIXINR_TO_HPMIXL */
2252#define WM8962_MIXINR_TO_HPMIXL_WIDTH 1 /* MIXINR_TO_HPMIXL */
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2254#define WM8962_IN4L_TO_HPMIXL_MASK 0x0002 /* IN4L_TO_HPMIXL */
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2256#define WM8962_IN4L_TO_HPMIXL_WIDTH 1 /* IN4L_TO_HPMIXL */
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2258#define WM8962_IN4R_TO_HPMIXL_MASK 0x0001 /* IN4R_TO_HPMIXL */
2259#define WM8962_IN4R_TO_HPMIXL_SHIFT 0 /* IN4R_TO_HPMIXL */
2260#define WM8962_IN4R_TO_HPMIXL_WIDTH 1 /* IN4R_TO_HPMIXL */
2261
2262/*
2263 * R101 (0x65) - Headphone Mixer (2)
2264 */
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2266#define WM8962_HPMIXR_TO_HPOUTR_PGA_MASK 0x0080 /* HPMIXR_TO_HPOUTR_PGA */
2267#define WM8962_HPMIXR_TO_HPOUTR_PGA_SHIFT 7 /* HPMIXR_TO_HPOUTR_PGA */
2268#define WM8962_HPMIXR_TO_HPOUTR_PGA_WIDTH 1 /* HPMIXR_TO_HPOUTR_PGA */
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2271#define WM8962_DACL_TO_HPMIXR_SHIFT 5 /* DACL_TO_HPMIXR */
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2275#define WM8962_DACR_TO_HPMIXR_SHIFT 4 /* DACR_TO_HPMIXR */
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2278#define WM8962_MIXINL_TO_HPMIXR_MASK 0x0008 /* MIXINL_TO_HPMIXR */
2279#define WM8962_MIXINL_TO_HPMIXR_SHIFT 3 /* MIXINL_TO_HPMIXR */
2280#define WM8962_MIXINL_TO_HPMIXR_WIDTH 1 /* MIXINL_TO_HPMIXR */
2281#define WM8962_MIXINR_TO_HPMIXR 0x0004 /* MIXINR_TO_HPMIXR */
2282#define WM8962_MIXINR_TO_HPMIXR_MASK 0x0004 /* MIXINR_TO_HPMIXR */
2283#define WM8962_MIXINR_TO_HPMIXR_SHIFT 2 /* MIXINR_TO_HPMIXR */
2284#define WM8962_MIXINR_TO_HPMIXR_WIDTH 1 /* MIXINR_TO_HPMIXR */
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2286#define WM8962_IN4L_TO_HPMIXR_MASK 0x0002 /* IN4L_TO_HPMIXR */
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2288#define WM8962_IN4L_TO_HPMIXR_WIDTH 1 /* IN4L_TO_HPMIXR */
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2291#define WM8962_IN4R_TO_HPMIXR_SHIFT 0 /* IN4R_TO_HPMIXR */
2292#define WM8962_IN4R_TO_HPMIXR_WIDTH 1 /* IN4R_TO_HPMIXR */
2293
2294/*
2295 * R102 (0x66) - Headphone Mixer (3)
2296 */
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2298#define WM8962_HPMIXL_MUTE_MASK 0x0100 /* HPMIXL_MUTE */
2299#define WM8962_HPMIXL_MUTE_SHIFT 8 /* HPMIXL_MUTE */
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2301#define WM8962_MIXINL_HPMIXL_VOL 0x0080 /* MIXINL_HPMIXL_VOL */
2302#define WM8962_MIXINL_HPMIXL_VOL_MASK 0x0080 /* MIXINL_HPMIXL_VOL */
2303#define WM8962_MIXINL_HPMIXL_VOL_SHIFT 7 /* MIXINL_HPMIXL_VOL */
2304#define WM8962_MIXINL_HPMIXL_VOL_WIDTH 1 /* MIXINL_HPMIXL_VOL */
2305#define WM8962_MIXINR_HPMIXL_VOL 0x0040 /* MIXINR_HPMIXL_VOL */
2306#define WM8962_MIXINR_HPMIXL_VOL_MASK 0x0040 /* MIXINR_HPMIXL_VOL */
2307#define WM8962_MIXINR_HPMIXL_VOL_SHIFT 6 /* MIXINR_HPMIXL_VOL */
2308#define WM8962_MIXINR_HPMIXL_VOL_WIDTH 1 /* MIXINR_HPMIXL_VOL */
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2313#define WM8962_IN4R_HPMIXL_VOL_SHIFT 0 /* IN4R_HPMIXL_VOL - [2:0] */
2314#define WM8962_IN4R_HPMIXL_VOL_WIDTH 3 /* IN4R_HPMIXL_VOL - [2:0] */
2315
2316/*
2317 * R103 (0x67) - Headphone Mixer (4)
2318 */
2319#define WM8962_HPMIXR_MUTE 0x0100 /* HPMIXR_MUTE */
2320#define WM8962_HPMIXR_MUTE_MASK 0x0100 /* HPMIXR_MUTE */
2321#define WM8962_HPMIXR_MUTE_SHIFT 8 /* HPMIXR_MUTE */
2322#define WM8962_HPMIXR_MUTE_WIDTH 1 /* HPMIXR_MUTE */
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2324#define WM8962_MIXINL_HPMIXR_VOL_MASK 0x0080 /* MIXINL_HPMIXR_VOL */
2325#define WM8962_MIXINL_HPMIXR_VOL_SHIFT 7 /* MIXINL_HPMIXR_VOL */
2326#define WM8962_MIXINL_HPMIXR_VOL_WIDTH 1 /* MIXINL_HPMIXR_VOL */
2327#define WM8962_MIXINR_HPMIXR_VOL 0x0040 /* MIXINR_HPMIXR_VOL */
2328#define WM8962_MIXINR_HPMIXR_VOL_MASK 0x0040 /* MIXINR_HPMIXR_VOL */
2329#define WM8962_MIXINR_HPMIXR_VOL_SHIFT 6 /* MIXINR_HPMIXR_VOL */
2330#define WM8962_MIXINR_HPMIXR_VOL_WIDTH 1 /* MIXINR_HPMIXR_VOL */
2331#define WM8962_IN4L_HPMIXR_VOL_MASK 0x0038 /* IN4L_HPMIXR_VOL - [5:3] */
2332#define WM8962_IN4L_HPMIXR_VOL_SHIFT 3 /* IN4L_HPMIXR_VOL - [5:3] */
2333#define WM8962_IN4L_HPMIXR_VOL_WIDTH 3 /* IN4L_HPMIXR_VOL - [5:3] */
2334#define WM8962_IN4R_HPMIXR_VOL_MASK 0x0007 /* IN4R_HPMIXR_VOL - [2:0] */
2335#define WM8962_IN4R_HPMIXR_VOL_SHIFT 0 /* IN4R_HPMIXR_VOL - [2:0] */
2336#define WM8962_IN4R_HPMIXR_VOL_WIDTH 3 /* IN4R_HPMIXR_VOL - [2:0] */
2337
2338/*
2339 * R105 (0x69) - Speaker Mixer (1)
2340 */
2341#define WM8962_SPKMIXL_TO_SPKOUTL_PGA 0x0080 /* SPKMIXL_TO_SPKOUTL_PGA */
2342#define WM8962_SPKMIXL_TO_SPKOUTL_PGA_MASK 0x0080 /* SPKMIXL_TO_SPKOUTL_PGA */
2343#define WM8962_SPKMIXL_TO_SPKOUTL_PGA_SHIFT 7 /* SPKMIXL_TO_SPKOUTL_PGA */
2344#define WM8962_SPKMIXL_TO_SPKOUTL_PGA_WIDTH 1 /* SPKMIXL_TO_SPKOUTL_PGA */
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2347#define WM8962_DACL_TO_SPKMIXL_SHIFT 5 /* DACL_TO_SPKMIXL */
2348#define WM8962_DACL_TO_SPKMIXL_WIDTH 1 /* DACL_TO_SPKMIXL */
2349#define WM8962_DACR_TO_SPKMIXL 0x0010 /* DACR_TO_SPKMIXL */
2350#define WM8962_DACR_TO_SPKMIXL_MASK 0x0010 /* DACR_TO_SPKMIXL */
2351#define WM8962_DACR_TO_SPKMIXL_SHIFT 4 /* DACR_TO_SPKMIXL */
2352#define WM8962_DACR_TO_SPKMIXL_WIDTH 1 /* DACR_TO_SPKMIXL */
2353#define WM8962_MIXINL_TO_SPKMIXL 0x0008 /* MIXINL_TO_SPKMIXL */
2354#define WM8962_MIXINL_TO_SPKMIXL_MASK 0x0008 /* MIXINL_TO_SPKMIXL */
2355#define WM8962_MIXINL_TO_SPKMIXL_SHIFT 3 /* MIXINL_TO_SPKMIXL */
2356#define WM8962_MIXINL_TO_SPKMIXL_WIDTH 1 /* MIXINL_TO_SPKMIXL */
2357#define WM8962_MIXINR_TO_SPKMIXL 0x0004 /* MIXINR_TO_SPKMIXL */
2358#define WM8962_MIXINR_TO_SPKMIXL_MASK 0x0004 /* MIXINR_TO_SPKMIXL */
2359#define WM8962_MIXINR_TO_SPKMIXL_SHIFT 2 /* MIXINR_TO_SPKMIXL */
2360#define WM8962_MIXINR_TO_SPKMIXL_WIDTH 1 /* MIXINR_TO_SPKMIXL */
2361#define WM8962_IN4L_TO_SPKMIXL 0x0002 /* IN4L_TO_SPKMIXL */
2362#define WM8962_IN4L_TO_SPKMIXL_MASK 0x0002 /* IN4L_TO_SPKMIXL */
2363#define WM8962_IN4L_TO_SPKMIXL_SHIFT 1 /* IN4L_TO_SPKMIXL */
2364#define WM8962_IN4L_TO_SPKMIXL_WIDTH 1 /* IN4L_TO_SPKMIXL */
2365#define WM8962_IN4R_TO_SPKMIXL 0x0001 /* IN4R_TO_SPKMIXL */
2366#define WM8962_IN4R_TO_SPKMIXL_MASK 0x0001 /* IN4R_TO_SPKMIXL */
2367#define WM8962_IN4R_TO_SPKMIXL_SHIFT 0 /* IN4R_TO_SPKMIXL */
2368#define WM8962_IN4R_TO_SPKMIXL_WIDTH 1 /* IN4R_TO_SPKMIXL */
2369
2370/*
2371 * R106 (0x6A) - Speaker Mixer (2)
2372 */
2373#define WM8962_SPKMIXR_TO_SPKOUTR_PGA 0x0080 /* SPKMIXR_TO_SPKOUTR_PGA */
2374#define WM8962_SPKMIXR_TO_SPKOUTR_PGA_MASK 0x0080 /* SPKMIXR_TO_SPKOUTR_PGA */
2375#define WM8962_SPKMIXR_TO_SPKOUTR_PGA_SHIFT 7 /* SPKMIXR_TO_SPKOUTR_PGA */
2376#define WM8962_SPKMIXR_TO_SPKOUTR_PGA_WIDTH 1 /* SPKMIXR_TO_SPKOUTR_PGA */
2377#define WM8962_DACL_TO_SPKMIXR 0x0020 /* DACL_TO_SPKMIXR */
2378#define WM8962_DACL_TO_SPKMIXR_MASK 0x0020 /* DACL_TO_SPKMIXR */
2379#define WM8962_DACL_TO_SPKMIXR_SHIFT 5 /* DACL_TO_SPKMIXR */
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2383#define WM8962_DACR_TO_SPKMIXR_SHIFT 4 /* DACR_TO_SPKMIXR */
2384#define WM8962_DACR_TO_SPKMIXR_WIDTH 1 /* DACR_TO_SPKMIXR */
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2386#define WM8962_MIXINL_TO_SPKMIXR_MASK 0x0008 /* MIXINL_TO_SPKMIXR */
2387#define WM8962_MIXINL_TO_SPKMIXR_SHIFT 3 /* MIXINL_TO_SPKMIXR */
2388#define WM8962_MIXINL_TO_SPKMIXR_WIDTH 1 /* MIXINL_TO_SPKMIXR */
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2390#define WM8962_MIXINR_TO_SPKMIXR_MASK 0x0004 /* MIXINR_TO_SPKMIXR */
2391#define WM8962_MIXINR_TO_SPKMIXR_SHIFT 2 /* MIXINR_TO_SPKMIXR */
2392#define WM8962_MIXINR_TO_SPKMIXR_WIDTH 1 /* MIXINR_TO_SPKMIXR */
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2394#define WM8962_IN4L_TO_SPKMIXR_MASK 0x0002 /* IN4L_TO_SPKMIXR */
2395#define WM8962_IN4L_TO_SPKMIXR_SHIFT 1 /* IN4L_TO_SPKMIXR */
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2398#define WM8962_IN4R_TO_SPKMIXR_MASK 0x0001 /* IN4R_TO_SPKMIXR */
2399#define WM8962_IN4R_TO_SPKMIXR_SHIFT 0 /* IN4R_TO_SPKMIXR */
2400#define WM8962_IN4R_TO_SPKMIXR_WIDTH 1 /* IN4R_TO_SPKMIXR */
2401
2402/*
2403 * R107 (0x6B) - Speaker Mixer (3)
2404 */
2405#define WM8962_SPKMIXL_MUTE 0x0100 /* SPKMIXL_MUTE */
2406#define WM8962_SPKMIXL_MUTE_MASK 0x0100 /* SPKMIXL_MUTE */
2407#define WM8962_SPKMIXL_MUTE_SHIFT 8 /* SPKMIXL_MUTE */
2408#define WM8962_SPKMIXL_MUTE_WIDTH 1 /* SPKMIXL_MUTE */
2409#define WM8962_MIXINL_SPKMIXL_VOL 0x0080 /* MIXINL_SPKMIXL_VOL */
2410#define WM8962_MIXINL_SPKMIXL_VOL_MASK 0x0080 /* MIXINL_SPKMIXL_VOL */
2411#define WM8962_MIXINL_SPKMIXL_VOL_SHIFT 7 /* MIXINL_SPKMIXL_VOL */
2412#define WM8962_MIXINL_SPKMIXL_VOL_WIDTH 1 /* MIXINL_SPKMIXL_VOL */
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2414#define WM8962_MIXINR_SPKMIXL_VOL_MASK 0x0040 /* MIXINR_SPKMIXL_VOL */
2415#define WM8962_MIXINR_SPKMIXL_VOL_SHIFT 6 /* MIXINR_SPKMIXL_VOL */
2416#define WM8962_MIXINR_SPKMIXL_VOL_WIDTH 1 /* MIXINR_SPKMIXL_VOL */
2417#define WM8962_IN4L_SPKMIXL_VOL_MASK 0x0038 /* IN4L_SPKMIXL_VOL - [5:3] */
2418#define WM8962_IN4L_SPKMIXL_VOL_SHIFT 3 /* IN4L_SPKMIXL_VOL - [5:3] */
2419#define WM8962_IN4L_SPKMIXL_VOL_WIDTH 3 /* IN4L_SPKMIXL_VOL - [5:3] */
2420#define WM8962_IN4R_SPKMIXL_VOL_MASK 0x0007 /* IN4R_SPKMIXL_VOL - [2:0] */
2421#define WM8962_IN4R_SPKMIXL_VOL_SHIFT 0 /* IN4R_SPKMIXL_VOL - [2:0] */
2422#define WM8962_IN4R_SPKMIXL_VOL_WIDTH 3 /* IN4R_SPKMIXL_VOL - [2:0] */
2423
2424/*
2425 * R108 (0x6C) - Speaker Mixer (4)
2426 */
2427#define WM8962_SPKMIXR_MUTE 0x0100 /* SPKMIXR_MUTE */
2428#define WM8962_SPKMIXR_MUTE_MASK 0x0100 /* SPKMIXR_MUTE */
2429#define WM8962_SPKMIXR_MUTE_SHIFT 8 /* SPKMIXR_MUTE */
2430#define WM8962_SPKMIXR_MUTE_WIDTH 1 /* SPKMIXR_MUTE */
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2432#define WM8962_MIXINL_SPKMIXR_VOL_MASK 0x0080 /* MIXINL_SPKMIXR_VOL */
2433#define WM8962_MIXINL_SPKMIXR_VOL_SHIFT 7 /* MIXINL_SPKMIXR_VOL */
2434#define WM8962_MIXINL_SPKMIXR_VOL_WIDTH 1 /* MIXINL_SPKMIXR_VOL */
2435#define WM8962_MIXINR_SPKMIXR_VOL 0x0040 /* MIXINR_SPKMIXR_VOL */
2436#define WM8962_MIXINR_SPKMIXR_VOL_MASK 0x0040 /* MIXINR_SPKMIXR_VOL */
2437#define WM8962_MIXINR_SPKMIXR_VOL_SHIFT 6 /* MIXINR_SPKMIXR_VOL */
2438#define WM8962_MIXINR_SPKMIXR_VOL_WIDTH 1 /* MIXINR_SPKMIXR_VOL */
2439#define WM8962_IN4L_SPKMIXR_VOL_MASK 0x0038 /* IN4L_SPKMIXR_VOL - [5:3] */
2440#define WM8962_IN4L_SPKMIXR_VOL_SHIFT 3 /* IN4L_SPKMIXR_VOL - [5:3] */
2441#define WM8962_IN4L_SPKMIXR_VOL_WIDTH 3 /* IN4L_SPKMIXR_VOL - [5:3] */
2442#define WM8962_IN4R_SPKMIXR_VOL_MASK 0x0007 /* IN4R_SPKMIXR_VOL - [2:0] */
2443#define WM8962_IN4R_SPKMIXR_VOL_SHIFT 0 /* IN4R_SPKMIXR_VOL - [2:0] */
2444#define WM8962_IN4R_SPKMIXR_VOL_WIDTH 3 /* IN4R_SPKMIXR_VOL - [2:0] */
2445
2446/*
2447 * R109 (0x6D) - Speaker Mixer (5)
2448 */
2449#define WM8962_DACL_SPKMIXL_VOL 0x0080 /* DACL_SPKMIXL_VOL */
2450#define WM8962_DACL_SPKMIXL_VOL_MASK 0x0080 /* DACL_SPKMIXL_VOL */
2451#define WM8962_DACL_SPKMIXL_VOL_SHIFT 7 /* DACL_SPKMIXL_VOL */
2452#define WM8962_DACL_SPKMIXL_VOL_WIDTH 1 /* DACL_SPKMIXL_VOL */
2453#define WM8962_DACR_SPKMIXL_VOL 0x0040 /* DACR_SPKMIXL_VOL */
2454#define WM8962_DACR_SPKMIXL_VOL_MASK 0x0040 /* DACR_SPKMIXL_VOL */
2455#define WM8962_DACR_SPKMIXL_VOL_SHIFT 6 /* DACR_SPKMIXL_VOL */
2456#define WM8962_DACR_SPKMIXL_VOL_WIDTH 1 /* DACR_SPKMIXL_VOL */
2457#define WM8962_DACL_SPKMIXR_VOL 0x0020 /* DACL_SPKMIXR_VOL */
2458#define WM8962_DACL_SPKMIXR_VOL_MASK 0x0020 /* DACL_SPKMIXR_VOL */
2459#define WM8962_DACL_SPKMIXR_VOL_SHIFT 5 /* DACL_SPKMIXR_VOL */
2460#define WM8962_DACL_SPKMIXR_VOL_WIDTH 1 /* DACL_SPKMIXR_VOL */
2461#define WM8962_DACR_SPKMIXR_VOL 0x0010 /* DACR_SPKMIXR_VOL */
2462#define WM8962_DACR_SPKMIXR_VOL_MASK 0x0010 /* DACR_SPKMIXR_VOL */
2463#define WM8962_DACR_SPKMIXR_VOL_SHIFT 4 /* DACR_SPKMIXR_VOL */
2464#define WM8962_DACR_SPKMIXR_VOL_WIDTH 1 /* DACR_SPKMIXR_VOL */
2465
2466/*
2467 * R110 (0x6E) - Beep Generator (1)
2468 */
2469#define WM8962_BEEP_GAIN_MASK 0x00F0 /* BEEP_GAIN - [7:4] */
2470#define WM8962_BEEP_GAIN_SHIFT 4 /* BEEP_GAIN - [7:4] */
2471#define WM8962_BEEP_GAIN_WIDTH 4 /* BEEP_GAIN - [7:4] */
2472#define WM8962_BEEP_RATE_MASK 0x0006 /* BEEP_RATE - [2:1] */
2473#define WM8962_BEEP_RATE_SHIFT 1 /* BEEP_RATE - [2:1] */
2474#define WM8962_BEEP_RATE_WIDTH 2 /* BEEP_RATE - [2:1] */
2475#define WM8962_BEEP_ENA 0x0001 /* BEEP_ENA */
2476#define WM8962_BEEP_ENA_MASK 0x0001 /* BEEP_ENA */
2477#define WM8962_BEEP_ENA_SHIFT 0 /* BEEP_ENA */
2478#define WM8962_BEEP_ENA_WIDTH 1 /* BEEP_ENA */
2479
2480/*
2481 * R115 (0x73) - Oscillator Trim (3)
2482 */
2483#define WM8962_OSC_TRIM_XTI_MASK 0x001F /* OSC_TRIM_XTI - [4:0] */
2484#define WM8962_OSC_TRIM_XTI_SHIFT 0 /* OSC_TRIM_XTI - [4:0] */
2485#define WM8962_OSC_TRIM_XTI_WIDTH 5 /* OSC_TRIM_XTI - [4:0] */
2486
2487/*
2488 * R116 (0x74) - Oscillator Trim (4)
2489 */
2490#define WM8962_OSC_TRIM_XTO_MASK 0x001F /* OSC_TRIM_XTO - [4:0] */
2491#define WM8962_OSC_TRIM_XTO_SHIFT 0 /* OSC_TRIM_XTO - [4:0] */
2492#define WM8962_OSC_TRIM_XTO_WIDTH 5 /* OSC_TRIM_XTO - [4:0] */
2493
2494/*
2495 * R119 (0x77) - Oscillator Trim (7)
2496 */
2497#define WM8962_XTO_CAP_SEL_MASK 0x00F0 /* XTO_CAP_SEL - [7:4] */
2498#define WM8962_XTO_CAP_SEL_SHIFT 4 /* XTO_CAP_SEL - [7:4] */
2499#define WM8962_XTO_CAP_SEL_WIDTH 4 /* XTO_CAP_SEL - [7:4] */
2500#define WM8962_XTI_CAP_SEL_MASK 0x000F /* XTI_CAP_SEL - [3:0] */
2501#define WM8962_XTI_CAP_SEL_SHIFT 0 /* XTI_CAP_SEL - [3:0] */
2502#define WM8962_XTI_CAP_SEL_WIDTH 4 /* XTI_CAP_SEL - [3:0] */
2503
2504/*
2505 * R124 (0x7C) - Analogue Clocking1
2506 */
2507#define WM8962_CLKOUT2_SEL_MASK 0x0060 /* CLKOUT2_SEL - [6:5] */
2508#define WM8962_CLKOUT2_SEL_SHIFT 5 /* CLKOUT2_SEL - [6:5] */
2509#define WM8962_CLKOUT2_SEL_WIDTH 2 /* CLKOUT2_SEL - [6:5] */
2510#define WM8962_CLKOUT3_SEL_MASK 0x0018 /* CLKOUT3_SEL - [4:3] */
2511#define WM8962_CLKOUT3_SEL_SHIFT 3 /* CLKOUT3_SEL - [4:3] */
2512#define WM8962_CLKOUT3_SEL_WIDTH 2 /* CLKOUT3_SEL - [4:3] */
2513#define WM8962_CLKOUT5_SEL 0x0001 /* CLKOUT5_SEL */
2514#define WM8962_CLKOUT5_SEL_MASK 0x0001 /* CLKOUT5_SEL */
2515#define WM8962_CLKOUT5_SEL_SHIFT 0 /* CLKOUT5_SEL */
2516#define WM8962_CLKOUT5_SEL_WIDTH 1 /* CLKOUT5_SEL */
2517
2518/*
2519 * R125 (0x7D) - Analogue Clocking2
2520 */
2521#define WM8962_PLL2_OUTDIV 0x0080 /* PLL2_OUTDIV */
2522#define WM8962_PLL2_OUTDIV_MASK 0x0080 /* PLL2_OUTDIV */
2523#define WM8962_PLL2_OUTDIV_SHIFT 7 /* PLL2_OUTDIV */
2524#define WM8962_PLL2_OUTDIV_WIDTH 1 /* PLL2_OUTDIV */
2525#define WM8962_PLL3_OUTDIV 0x0040 /* PLL3_OUTDIV */
2526#define WM8962_PLL3_OUTDIV_MASK 0x0040 /* PLL3_OUTDIV */
2527#define WM8962_PLL3_OUTDIV_SHIFT 6 /* PLL3_OUTDIV */
2528#define WM8962_PLL3_OUTDIV_WIDTH 1 /* PLL3_OUTDIV */
2529#define WM8962_PLL_SYSCLK_DIV_MASK 0x0018 /* PLL_SYSCLK_DIV - [4:3] */
2530#define WM8962_PLL_SYSCLK_DIV_SHIFT 3 /* PLL_SYSCLK_DIV - [4:3] */
2531#define WM8962_PLL_SYSCLK_DIV_WIDTH 2 /* PLL_SYSCLK_DIV - [4:3] */
2532#define WM8962_CLKOUT3_DIV 0x0004 /* CLKOUT3_DIV */
2533#define WM8962_CLKOUT3_DIV_MASK 0x0004 /* CLKOUT3_DIV */
2534#define WM8962_CLKOUT3_DIV_SHIFT 2 /* CLKOUT3_DIV */
2535#define WM8962_CLKOUT3_DIV_WIDTH 1 /* CLKOUT3_DIV */
2536#define WM8962_CLKOUT2_DIV 0x0002 /* CLKOUT2_DIV */
2537#define WM8962_CLKOUT2_DIV_MASK 0x0002 /* CLKOUT2_DIV */
2538#define WM8962_CLKOUT2_DIV_SHIFT 1 /* CLKOUT2_DIV */
2539#define WM8962_CLKOUT2_DIV_WIDTH 1 /* CLKOUT2_DIV */
2540#define WM8962_CLKOUT5_DIV 0x0001 /* CLKOUT5_DIV */
2541#define WM8962_CLKOUT5_DIV_MASK 0x0001 /* CLKOUT5_DIV */
2542#define WM8962_CLKOUT5_DIV_SHIFT 0 /* CLKOUT5_DIV */
2543#define WM8962_CLKOUT5_DIV_WIDTH 1 /* CLKOUT5_DIV */
2544
2545/*
2546 * R126 (0x7E) - Analogue Clocking3
2547 */
2548#define WM8962_CLKOUT2_OE 0x0008 /* CLKOUT2_OE */
2549#define WM8962_CLKOUT2_OE_MASK 0x0008 /* CLKOUT2_OE */
2550#define WM8962_CLKOUT2_OE_SHIFT 3 /* CLKOUT2_OE */
2551#define WM8962_CLKOUT2_OE_WIDTH 1 /* CLKOUT2_OE */
2552#define WM8962_CLKOUT3_OE 0x0004 /* CLKOUT3_OE */
2553#define WM8962_CLKOUT3_OE_MASK 0x0004 /* CLKOUT3_OE */
2554#define WM8962_CLKOUT3_OE_SHIFT 2 /* CLKOUT3_OE */
2555#define WM8962_CLKOUT3_OE_WIDTH 1 /* CLKOUT3_OE */
2556#define WM8962_CLKOUT5_OE 0x0001 /* CLKOUT5_OE */
2557#define WM8962_CLKOUT5_OE_MASK 0x0001 /* CLKOUT5_OE */
2558#define WM8962_CLKOUT5_OE_SHIFT 0 /* CLKOUT5_OE */
2559#define WM8962_CLKOUT5_OE_WIDTH 1 /* CLKOUT5_OE */
2560
2561/*
2562 * R127 (0x7F) - PLL Software Reset
2563 */
2564#define WM8962_SW_RESET_PLL_MASK 0xFFFF /* SW_RESET_PLL - [15:0] */
2565#define WM8962_SW_RESET_PLL_SHIFT 0 /* SW_RESET_PLL - [15:0] */
2566#define WM8962_SW_RESET_PLL_WIDTH 16 /* SW_RESET_PLL - [15:0] */
2567
2568/*
2569 * R129 (0x81) - PLL2
2570 */
2571#define WM8962_OSC_ENA 0x0080 /* OSC_ENA */
2572#define WM8962_OSC_ENA_MASK 0x0080 /* OSC_ENA */
2573#define WM8962_OSC_ENA_SHIFT 7 /* OSC_ENA */
2574#define WM8962_OSC_ENA_WIDTH 1 /* OSC_ENA */
2575#define WM8962_PLL2_ENA 0x0020 /* PLL2_ENA */
2576#define WM8962_PLL2_ENA_MASK 0x0020 /* PLL2_ENA */
2577#define WM8962_PLL2_ENA_SHIFT 5 /* PLL2_ENA */
2578#define WM8962_PLL2_ENA_WIDTH 1 /* PLL2_ENA */
2579#define WM8962_PLL3_ENA 0x0010 /* PLL3_ENA */
2580#define WM8962_PLL3_ENA_MASK 0x0010 /* PLL3_ENA */
2581#define WM8962_PLL3_ENA_SHIFT 4 /* PLL3_ENA */
2582#define WM8962_PLL3_ENA_WIDTH 1 /* PLL3_ENA */
2583
2584/*
2585 * R131 (0x83) - PLL 4
2586 */
2587#define WM8962_PLL_CLK_SRC 0x0002 /* PLL_CLK_SRC */
2588#define WM8962_PLL_CLK_SRC_MASK 0x0002 /* PLL_CLK_SRC */
2589#define WM8962_PLL_CLK_SRC_SHIFT 1 /* PLL_CLK_SRC */
2590#define WM8962_PLL_CLK_SRC_WIDTH 1 /* PLL_CLK_SRC */
2591#define WM8962_FLL_TO_PLL3 0x0001 /* FLL_TO_PLL3 */
2592#define WM8962_FLL_TO_PLL3_MASK 0x0001 /* FLL_TO_PLL3 */
2593#define WM8962_FLL_TO_PLL3_SHIFT 0 /* FLL_TO_PLL3 */
2594#define WM8962_FLL_TO_PLL3_WIDTH 1 /* FLL_TO_PLL3 */
2595
2596/*
2597 * R136 (0x88) - PLL 9
2598 */
2599#define WM8962_PLL2_FRAC 0x0040 /* PLL2_FRAC */
2600#define WM8962_PLL2_FRAC_MASK 0x0040 /* PLL2_FRAC */
2601#define WM8962_PLL2_FRAC_SHIFT 6 /* PLL2_FRAC */
2602#define WM8962_PLL2_FRAC_WIDTH 1 /* PLL2_FRAC */
2603#define WM8962_PLL2_N_MASK 0x001F /* PLL2_N - [4:0] */
2604#define WM8962_PLL2_N_SHIFT 0 /* PLL2_N - [4:0] */
2605#define WM8962_PLL2_N_WIDTH 5 /* PLL2_N - [4:0] */
2606
2607/*
2608 * R137 (0x89) - PLL 10
2609 */
2610#define WM8962_PLL2_K_MASK 0x00FF /* PLL2_K - [7:0] */
2611#define WM8962_PLL2_K_SHIFT 0 /* PLL2_K - [7:0] */
2612#define WM8962_PLL2_K_WIDTH 8 /* PLL2_K - [7:0] */
2613
2614/*
2615 * R138 (0x8A) - PLL 11
2616 */
2617#define WM8962_PLL2_K_MASK 0x00FF /* PLL2_K - [7:0] */
2618#define WM8962_PLL2_K_SHIFT 0 /* PLL2_K - [7:0] */
2619#define WM8962_PLL2_K_WIDTH 8 /* PLL2_K - [7:0] */
2620
2621/*
2622 * R139 (0x8B) - PLL 12
2623 */
2624#define WM8962_PLL2_K_MASK 0x00FF /* PLL2_K - [7:0] */
2625#define WM8962_PLL2_K_SHIFT 0 /* PLL2_K - [7:0] */
2626#define WM8962_PLL2_K_WIDTH 8 /* PLL2_K - [7:0] */
2627
2628/*
2629 * R140 (0x8C) - PLL 13
2630 */
2631#define WM8962_PLL3_FRAC 0x0040 /* PLL3_FRAC */
2632#define WM8962_PLL3_FRAC_MASK 0x0040 /* PLL3_FRAC */
2633#define WM8962_PLL3_FRAC_SHIFT 6 /* PLL3_FRAC */
2634#define WM8962_PLL3_FRAC_WIDTH 1 /* PLL3_FRAC */
2635#define WM8962_PLL3_N_MASK 0x001F /* PLL3_N - [4:0] */
2636#define WM8962_PLL3_N_SHIFT 0 /* PLL3_N - [4:0] */
2637#define WM8962_PLL3_N_WIDTH 5 /* PLL3_N - [4:0] */
2638
2639/*
2640 * R141 (0x8D) - PLL 14
2641 */
2642#define WM8962_PLL3_K_MASK 0x00FF /* PLL3_K - [7:0] */
2643#define WM8962_PLL3_K_SHIFT 0 /* PLL3_K - [7:0] */
2644#define WM8962_PLL3_K_WIDTH 8 /* PLL3_K - [7:0] */
2645
2646/*
2647 * R142 (0x8E) - PLL 15
2648 */
2649#define WM8962_PLL3_K_MASK 0x00FF /* PLL3_K - [7:0] */
2650#define WM8962_PLL3_K_SHIFT 0 /* PLL3_K - [7:0] */
2651#define WM8962_PLL3_K_WIDTH 8 /* PLL3_K - [7:0] */
2652
2653/*
2654 * R143 (0x8F) - PLL 16
2655 */
2656#define WM8962_PLL3_K_MASK 0x00FF /* PLL3_K - [7:0] */
2657#define WM8962_PLL3_K_SHIFT 0 /* PLL3_K - [7:0] */
2658#define WM8962_PLL3_K_WIDTH 8 /* PLL3_K - [7:0] */
2659
2660/*
2661 * R155 (0x9B) - FLL Control (1)
2662 */
2663#define WM8962_FLL_REFCLK_SRC_MASK 0x0060 /* FLL_REFCLK_SRC - [6:5] */
2664#define WM8962_FLL_REFCLK_SRC_SHIFT 5 /* FLL_REFCLK_SRC - [6:5] */
2665#define WM8962_FLL_REFCLK_SRC_WIDTH 2 /* FLL_REFCLK_SRC - [6:5] */
2666#define WM8962_FLL_FRAC 0x0004 /* FLL_FRAC */
2667#define WM8962_FLL_FRAC_MASK 0x0004 /* FLL_FRAC */
2668#define WM8962_FLL_FRAC_SHIFT 2 /* FLL_FRAC */
2669#define WM8962_FLL_FRAC_WIDTH 1 /* FLL_FRAC */
2670#define WM8962_FLL_OSC_ENA 0x0002 /* FLL_OSC_ENA */
2671#define WM8962_FLL_OSC_ENA_MASK 0x0002 /* FLL_OSC_ENA */
2672#define WM8962_FLL_OSC_ENA_SHIFT 1 /* FLL_OSC_ENA */
2673#define WM8962_FLL_OSC_ENA_WIDTH 1 /* FLL_OSC_ENA */
2674#define WM8962_FLL_ENA 0x0001 /* FLL_ENA */
2675#define WM8962_FLL_ENA_MASK 0x0001 /* FLL_ENA */
2676#define WM8962_FLL_ENA_SHIFT 0 /* FLL_ENA */
2677#define WM8962_FLL_ENA_WIDTH 1 /* FLL_ENA */
2678
2679/*
2680 * R156 (0x9C) - FLL Control (2)
2681 */
2682#define WM8962_FLL_OUTDIV_MASK 0x01F8 /* FLL_OUTDIV - [8:3] */
2683#define WM8962_FLL_OUTDIV_SHIFT 3 /* FLL_OUTDIV - [8:3] */
2684#define WM8962_FLL_OUTDIV_WIDTH 6 /* FLL_OUTDIV - [8:3] */
2685#define WM8962_FLL_REFCLK_DIV_MASK 0x0003 /* FLL_REFCLK_DIV - [1:0] */
2686#define WM8962_FLL_REFCLK_DIV_SHIFT 0 /* FLL_REFCLK_DIV - [1:0] */
2687#define WM8962_FLL_REFCLK_DIV_WIDTH 2 /* FLL_REFCLK_DIV - [1:0] */
2688
2689/*
2690 * R157 (0x9D) - FLL Control (3)
2691 */
2692#define WM8962_FLL_FRATIO_MASK 0x0007 /* FLL_FRATIO - [2:0] */
2693#define WM8962_FLL_FRATIO_SHIFT 0 /* FLL_FRATIO - [2:0] */
2694#define WM8962_FLL_FRATIO_WIDTH 3 /* FLL_FRATIO - [2:0] */
2695
2696/*
2697 * R159 (0x9F) - FLL Control (5)
2698 */
2699#define WM8962_FLL_FRC_NCO_VAL_MASK 0x007E /* FLL_FRC_NCO_VAL - [6:1] */
2700#define WM8962_FLL_FRC_NCO_VAL_SHIFT 1 /* FLL_FRC_NCO_VAL - [6:1] */
2701#define WM8962_FLL_FRC_NCO_VAL_WIDTH 6 /* FLL_FRC_NCO_VAL - [6:1] */
2702#define WM8962_FLL_FRC_NCO 0x0001 /* FLL_FRC_NCO */
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2706
2707/*
2708 * R160 (0xA0) - FLL Control (6)
2709 */
2710#define WM8962_FLL_THETA_MASK 0xFFFF /* FLL_THETA - [15:0] */
2711#define WM8962_FLL_THETA_SHIFT 0 /* FLL_THETA - [15:0] */
2712#define WM8962_FLL_THETA_WIDTH 16 /* FLL_THETA - [15:0] */
2713
2714/*
2715 * R161 (0xA1) - FLL Control (7)
2716 */
2717#define WM8962_FLL_LAMBDA_MASK 0xFFFF /* FLL_LAMBDA - [15:0] */
2718#define WM8962_FLL_LAMBDA_SHIFT 0 /* FLL_LAMBDA - [15:0] */
2719#define WM8962_FLL_LAMBDA_WIDTH 16 /* FLL_LAMBDA - [15:0] */
2720
2721/*
2722 * R162 (0xA2) - FLL Control (8)
2723 */
2724#define WM8962_FLL_N_MASK 0x03FF /* FLL_N - [9:0] */
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2726#define WM8962_FLL_N_WIDTH 10 /* FLL_N - [9:0] */
2727
2728/*
2729 * R252 (0xFC) - General test 1
2730 */
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2733#define WM8962_REG_SYNC_SHIFT 2 /* REG_SYNC */
2734#define WM8962_REG_SYNC_WIDTH 1 /* REG_SYNC */
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2737#define WM8962_AUTO_INC_SHIFT 0 /* AUTO_INC */
2738#define WM8962_AUTO_INC_WIDTH 1 /* AUTO_INC */
2739
2740/*
2741 * R256 (0x100) - DF1
2742 */
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2744#define WM8962_DRC_DF1_ENA_MASK 0x0008 /* DRC_DF1_ENA */
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2758#define WM8962_DF1_ENA_WIDTH 1 /* DF1_ENA */
2759
2760/*
2761 * R257 (0x101) - DF2
2762 */
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2766
2767/*
2768 * R258 (0x102) - DF3
2769 */
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2773
2774/*
2775 * R259 (0x103) - DF4
2776 */
2777#define WM8962_DF1_COEFF_L2_MASK 0xFFFF /* DF1_COEFF_L2 - [15:0] */
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2780
2781/*
2782 * R260 (0x104) - DF5
2783 */
2784#define WM8962_DF1_COEFF_R0_MASK 0xFFFF /* DF1_COEFF_R0 - [15:0] */
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2787
2788/*
2789 * R261 (0x105) - DF6
2790 */
2791#define WM8962_DF1_COEFF_R1_MASK 0xFFFF /* DF1_COEFF_R1 - [15:0] */
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2794
2795/*
2796 * R262 (0x106) - DF7
2797 */
2798#define WM8962_DF1_COEFF_R2_MASK 0xFFFF /* DF1_COEFF_R2 - [15:0] */
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2800#define WM8962_DF1_COEFF_R2_WIDTH 16 /* DF1_COEFF_R2 - [15:0] */
2801
2802/*
2803 * R264 (0x108) - LHPF1
2804 */
2805#define WM8962_LHPF_MODE 0x0002 /* LHPF_MODE */
2806#define WM8962_LHPF_MODE_MASK 0x0002 /* LHPF_MODE */
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2811#define WM8962_LHPF_ENA_SHIFT 0 /* LHPF_ENA */
2812#define WM8962_LHPF_ENA_WIDTH 1 /* LHPF_ENA */
2813
2814/*
2815 * R265 (0x109) - LHPF2
2816 */
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2820
2821/*
2822 * R268 (0x10C) - THREED1
2823 */
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2825#define WM8962_ADC_MONOMIX_MASK 0x0040 /* ADC_MONOMIX */
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2827#define WM8962_ADC_MONOMIX_WIDTH 1 /* ADC_MONOMIX */
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2831#define WM8962_THREED_SIGN_L_WIDTH 1 /* THREED_SIGN_L */
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2833#define WM8962_THREED_SIGN_R_MASK 0x0010 /* THREED_SIGN_R */
2834#define WM8962_THREED_SIGN_R_SHIFT 4 /* THREED_SIGN_R */
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2837#define WM8962_THREED_LHPF_MODE_MASK 0x0004 /* THREED_LHPF_MODE */
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2848
2849/*
2850 * R269 (0x10D) - THREED2
2851 */
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2856#define WM8962_THREED_CGAINL_SHIFT 6 /* THREED_CGAINL - [10:6] */
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2860#define WM8962_THREED_DELAYL_WIDTH 4 /* THREED_DELAYL - [5:2] */
2861
2862/*
2863 * R270 (0x10E) - THREED3
2864 */
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2868
2869/*
2870 * R271 (0x10F) - THREED4
2871 */
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2877#define WM8962_THREED_CGAINR_WIDTH 5 /* THREED_CGAINR - [10:6] */
2878#define WM8962_THREED_DELAYR_MASK 0x003C /* THREED_DELAYR - [5:2] */
2879#define WM8962_THREED_DELAYR_SHIFT 2 /* THREED_DELAYR - [5:2] */
2880#define WM8962_THREED_DELAYR_WIDTH 4 /* THREED_DELAYR - [5:2] */
2881
2882/*
2883 * R276 (0x114) - DRC 1
2884 */
2885#define WM8962_DRC_SIG_DET_RMS_MASK 0x7C00 /* DRC_SIG_DET_RMS - [14:10] */
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2901#define WM8962_DRC_SIG_DET_SHIFT 5 /* DRC_SIG_DET */
2902#define WM8962_DRC_SIG_DET_WIDTH 1 /* DRC_SIG_DET */
2903#define WM8962_DRC_KNEE2_OP_ENA 0x0010 /* DRC_KNEE2_OP_ENA */
2904#define WM8962_DRC_KNEE2_OP_ENA_MASK 0x0010 /* DRC_KNEE2_OP_ENA */
2905#define WM8962_DRC_KNEE2_OP_ENA_SHIFT 4 /* DRC_KNEE2_OP_ENA */
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2910#define WM8962_DRC_QR_WIDTH 1 /* DRC_QR */
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2922#define WM8962_DRC_ENA_WIDTH 1 /* DRC_ENA */
2923
2924/*
2925 * R277 (0x115) - DRC 2
2926 */
2927#define WM8962_DRC_ATK_MASK 0x1E00 /* DRC_ATK - [12:9] */
2928#define WM8962_DRC_ATK_SHIFT 9 /* DRC_ATK - [12:9] */
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2930#define WM8962_DRC_DCY_MASK 0x01E0 /* DRC_DCY - [8:5] */
2931#define WM8962_DRC_DCY_SHIFT 5 /* DRC_DCY - [8:5] */
2932#define WM8962_DRC_DCY_WIDTH 4 /* DRC_DCY - [8:5] */
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2934#define WM8962_DRC_MINGAIN_SHIFT 2 /* DRC_MINGAIN - [4:2] */
2935#define WM8962_DRC_MINGAIN_WIDTH 3 /* DRC_MINGAIN - [4:2] */
2936#define WM8962_DRC_MAXGAIN_MASK 0x0003 /* DRC_MAXGAIN - [1:0] */
2937#define WM8962_DRC_MAXGAIN_SHIFT 0 /* DRC_MAXGAIN - [1:0] */
2938#define WM8962_DRC_MAXGAIN_WIDTH 2 /* DRC_MAXGAIN - [1:0] */
2939
2940/*
2941 * R278 (0x116) - DRC 3
2942 */
2943#define WM8962_DRC_NG_MINGAIN_MASK 0xF000 /* DRC_NG_MINGAIN - [15:12] */
2944#define WM8962_DRC_NG_MINGAIN_SHIFT 12 /* DRC_NG_MINGAIN - [15:12] */
2945#define WM8962_DRC_NG_MINGAIN_WIDTH 4 /* DRC_NG_MINGAIN - [15:12] */
2946#define WM8962_DRC_QR_THR_MASK 0x0C00 /* DRC_QR_THR - [11:10] */
2947#define WM8962_DRC_QR_THR_SHIFT 10 /* DRC_QR_THR - [11:10] */
2948#define WM8962_DRC_QR_THR_WIDTH 2 /* DRC_QR_THR - [11:10] */
2949#define WM8962_DRC_QR_DCY_MASK 0x0300 /* DRC_QR_DCY - [9:8] */
2950#define WM8962_DRC_QR_DCY_SHIFT 8 /* DRC_QR_DCY - [9:8] */
2951#define WM8962_DRC_QR_DCY_WIDTH 2 /* DRC_QR_DCY - [9:8] */
2952#define WM8962_DRC_NG_EXP_MASK 0x00C0 /* DRC_NG_EXP - [7:6] */
2953#define WM8962_DRC_NG_EXP_SHIFT 6 /* DRC_NG_EXP - [7:6] */
2954#define WM8962_DRC_NG_EXP_WIDTH 2 /* DRC_NG_EXP - [7:6] */
2955#define WM8962_DRC_HI_COMP_MASK 0x0038 /* DRC_HI_COMP - [5:3] */
2956#define WM8962_DRC_HI_COMP_SHIFT 3 /* DRC_HI_COMP - [5:3] */
2957#define WM8962_DRC_HI_COMP_WIDTH 3 /* DRC_HI_COMP - [5:3] */
2958#define WM8962_DRC_LO_COMP_MASK 0x0007 /* DRC_LO_COMP - [2:0] */
2959#define WM8962_DRC_LO_COMP_SHIFT 0 /* DRC_LO_COMP - [2:0] */
2960#define WM8962_DRC_LO_COMP_WIDTH 3 /* DRC_LO_COMP - [2:0] */
2961
2962/*
2963 * R279 (0x117) - DRC 4
2964 */
2965#define WM8962_DRC_KNEE_IP_MASK 0x07E0 /* DRC_KNEE_IP - [10:5] */
2966#define WM8962_DRC_KNEE_IP_SHIFT 5 /* DRC_KNEE_IP - [10:5] */
2967#define WM8962_DRC_KNEE_IP_WIDTH 6 /* DRC_KNEE_IP - [10:5] */
2968#define WM8962_DRC_KNEE_OP_MASK 0x001F /* DRC_KNEE_OP - [4:0] */
2969#define WM8962_DRC_KNEE_OP_SHIFT 0 /* DRC_KNEE_OP - [4:0] */
2970#define WM8962_DRC_KNEE_OP_WIDTH 5 /* DRC_KNEE_OP - [4:0] */
2971
2972/*
2973 * R280 (0x118) - DRC 5
2974 */
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3419
3420/*
3421 * R561 (0x231) - Interrupt Status 2
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3479
3480/*
3481 * R568 (0x238) - Interrupt Status 1 Mask
3482 */
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3491
3492/*
3493 * R569 (0x239) - Interrupt Status 2 Mask
3494 */
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3497#define WM8962_IM_MICSCD_EINT_SHIFT 15 /* IM_MICSCD_EINT */
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3520#define WM8962_IM_ALC_PKOVR_EINT_MASK 0x0200 /* IM_ALC_PKOVR_EINT */
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3539#define WM8962_IM_PLL3_LOCK_EINT 0x0008 /* IM_PLL3_LOCK_EINT */
3540#define WM8962_IM_PLL3_LOCK_EINT_MASK 0x0008 /* IM_PLL3_LOCK_EINT */
3541#define WM8962_IM_PLL3_LOCK_EINT_SHIFT 3 /* IM_PLL3_LOCK_EINT */
3542#define WM8962_IM_PLL3_LOCK_EINT_WIDTH 1 /* IM_PLL3_LOCK_EINT */
3543#define WM8962_IM_PLL2_LOCK_EINT 0x0004 /* IM_PLL2_LOCK_EINT */
3544#define WM8962_IM_PLL2_LOCK_EINT_MASK 0x0004 /* IM_PLL2_LOCK_EINT */
3545#define WM8962_IM_PLL2_LOCK_EINT_SHIFT 2 /* IM_PLL2_LOCK_EINT */
3546#define WM8962_IM_PLL2_LOCK_EINT_WIDTH 1 /* IM_PLL2_LOCK_EINT */
3547#define WM8962_IM_TEMP_SHUT_EINT 0x0001 /* IM_TEMP_SHUT_EINT */
3548#define WM8962_IM_TEMP_SHUT_EINT_MASK 0x0001 /* IM_TEMP_SHUT_EINT */
3549#define WM8962_IM_TEMP_SHUT_EINT_SHIFT 0 /* IM_TEMP_SHUT_EINT */
3550#define WM8962_IM_TEMP_SHUT_EINT_WIDTH 1 /* IM_TEMP_SHUT_EINT */
3551
3552/*
3553 * R576 (0x240) - Interrupt Control
3554 */
3555#define WM8962_IRQ_POL 0x0001 /* IRQ_POL */
3556#define WM8962_IRQ_POL_MASK 0x0001 /* IRQ_POL */
3557#define WM8962_IRQ_POL_SHIFT 0 /* IRQ_POL */
3558#define WM8962_IRQ_POL_WIDTH 1 /* IRQ_POL */
3559
3560/*
3561 * R584 (0x248) - IRQ Debounce
3562 */
3563#define WM8962_FLL_LOCK_DB 0x0020 /* FLL_LOCK_DB */
3564#define WM8962_FLL_LOCK_DB_MASK 0x0020 /* FLL_LOCK_DB */
3565#define WM8962_FLL_LOCK_DB_SHIFT 5 /* FLL_LOCK_DB */
3566#define WM8962_FLL_LOCK_DB_WIDTH 1 /* FLL_LOCK_DB */
3567#define WM8962_PLL3_LOCK_DB 0x0008 /* PLL3_LOCK_DB */
3568#define WM8962_PLL3_LOCK_DB_MASK 0x0008 /* PLL3_LOCK_DB */
3569#define WM8962_PLL3_LOCK_DB_SHIFT 3 /* PLL3_LOCK_DB */
3570#define WM8962_PLL3_LOCK_DB_WIDTH 1 /* PLL3_LOCK_DB */
3571#define WM8962_PLL2_LOCK_DB 0x0004 /* PLL2_LOCK_DB */
3572#define WM8962_PLL2_LOCK_DB_MASK 0x0004 /* PLL2_LOCK_DB */
3573#define WM8962_PLL2_LOCK_DB_SHIFT 2 /* PLL2_LOCK_DB */
3574#define WM8962_PLL2_LOCK_DB_WIDTH 1 /* PLL2_LOCK_DB */
3575#define WM8962_TEMP_SHUT_DB 0x0001 /* TEMP_SHUT_DB */
3576#define WM8962_TEMP_SHUT_DB_MASK 0x0001 /* TEMP_SHUT_DB */
3577#define WM8962_TEMP_SHUT_DB_SHIFT 0 /* TEMP_SHUT_DB */
3578#define WM8962_TEMP_SHUT_DB_WIDTH 1 /* TEMP_SHUT_DB */
3579
3580/*
3581 * R586 (0x24A) - MICINT Source Pol
3582 */
3583#define WM8962_MICSCD_IRQ_POL 0x8000 /* MICSCD_IRQ_POL */
3584#define WM8962_MICSCD_IRQ_POL_MASK 0x8000 /* MICSCD_IRQ_POL */
3585#define WM8962_MICSCD_IRQ_POL_SHIFT 15 /* MICSCD_IRQ_POL */
3586#define WM8962_MICSCD_IRQ_POL_WIDTH 1 /* MICSCD_IRQ_POL */
3587#define WM8962_MICD_IRQ_POL 0x4000 /* MICD_IRQ_POL */
3588#define WM8962_MICD_IRQ_POL_MASK 0x4000 /* MICD_IRQ_POL */
3589#define WM8962_MICD_IRQ_POL_SHIFT 14 /* MICD_IRQ_POL */
3590#define WM8962_MICD_IRQ_POL_WIDTH 1 /* MICD_IRQ_POL */
3591
3592/*
3593 * R768 (0x300) - DSP2 Power Management
3594 */
3595#define WM8962_DSP2_ENA 0x0001 /* DSP2_ENA */
3596#define WM8962_DSP2_ENA_MASK 0x0001 /* DSP2_ENA */
3597#define WM8962_DSP2_ENA_SHIFT 0 /* DSP2_ENA */
3598#define WM8962_DSP2_ENA_WIDTH 1 /* DSP2_ENA */
3599
3600/*
3601 * R1037 (0x40D) - DSP2_ExecControl
3602 */
3603#define WM8962_DSP2_STOPC 0x0020 /* DSP2_STOPC */
3604#define WM8962_DSP2_STOPC_MASK 0x0020 /* DSP2_STOPC */
3605#define WM8962_DSP2_STOPC_SHIFT 5 /* DSP2_STOPC */
3606#define WM8962_DSP2_STOPC_WIDTH 1 /* DSP2_STOPC */
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3608#define WM8962_DSP2_STOPS_MASK 0x0010 /* DSP2_STOPS */
3609#define WM8962_DSP2_STOPS_SHIFT 4 /* DSP2_STOPS */
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3612#define WM8962_DSP2_STOPI_MASK 0x0008 /* DSP2_STOPI */
3613#define WM8962_DSP2_STOPI_SHIFT 3 /* DSP2_STOPI */
3614#define WM8962_DSP2_STOPI_WIDTH 1 /* DSP2_STOPI */
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3620#define WM8962_DSP2_RUNR_MASK 0x0002 /* DSP2_RUNR */
3621#define WM8962_DSP2_RUNR_SHIFT 1 /* DSP2_RUNR */
3622#define WM8962_DSP2_RUNR_WIDTH 1 /* DSP2_RUNR */
3623#define WM8962_DSP2_RUN 0x0001 /* DSP2_RUN */
3624#define WM8962_DSP2_RUN_MASK 0x0001 /* DSP2_RUN */
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3626#define WM8962_DSP2_RUN_WIDTH 1 /* DSP2_RUN */
3627
3628/*
3629 * R8192 (0x2000) - DSP2 Instruction RAM 0
3630 */
3631#define WM8962_DSP2_INSTR_RAM_1024_10_9_0_MASK 0x03FF /* DSP2_INSTR_RAM_1024_10_9_0 - [9:0] */
3632#define WM8962_DSP2_INSTR_RAM_1024_10_9_0_SHIFT 0 /* DSP2_INSTR_RAM_1024_10_9_0 - [9:0] */
3633#define WM8962_DSP2_INSTR_RAM_1024_10_9_0_WIDTH 10 /* DSP2_INSTR_RAM_1024_10_9_0 - [9:0] */
3634
3635/*
3636 * R9216 (0x2400) - DSP2 Address RAM 2
3637 */
3638#define WM8962_DSP2_ADDR_RAM_1024_38_37_32_MASK 0x003F /* DSP2_ADDR_RAM_1024_38_37_32 - [5:0] */
3639#define WM8962_DSP2_ADDR_RAM_1024_38_37_32_SHIFT 0 /* DSP2_ADDR_RAM_1024_38_37_32 - [5:0] */
3640#define WM8962_DSP2_ADDR_RAM_1024_38_37_32_WIDTH 6 /* DSP2_ADDR_RAM_1024_38_37_32 - [5:0] */
3641
3642/*
3643 * R9217 (0x2401) - DSP2 Address RAM 1
3644 */
3645#define WM8962_DSP2_ADDR_RAM_1024_38_31_16_MASK 0xFFFF /* DSP2_ADDR_RAM_1024_38_31_16 - [15:0] */
3646#define WM8962_DSP2_ADDR_RAM_1024_38_31_16_SHIFT 0 /* DSP2_ADDR_RAM_1024_38_31_16 - [15:0] */
3647#define WM8962_DSP2_ADDR_RAM_1024_38_31_16_WIDTH 16 /* DSP2_ADDR_RAM_1024_38_31_16 - [15:0] */
3648
3649/*
3650 * R9218 (0x2402) - DSP2 Address RAM 0
3651 */
3652#define WM8962_DSP2_ADDR_RAM_1024_38_15_0_MASK 0xFFFF /* DSP2_ADDR_RAM_1024_38_15_0 - [15:0] */
3653#define WM8962_DSP2_ADDR_RAM_1024_38_15_0_SHIFT 0 /* DSP2_ADDR_RAM_1024_38_15_0 - [15:0] */
3654#define WM8962_DSP2_ADDR_RAM_1024_38_15_0_WIDTH 16 /* DSP2_ADDR_RAM_1024_38_15_0 - [15:0] */
3655
3656/*
3657 * R12288 (0x3000) - DSP2 Data1 RAM 1
3658 */
3659#define WM8962_DSP2_DATA1_RAM_384_24_23_16_MASK 0x00FF /* DSP2_DATA1_RAM_384_24_23_16 - [7:0] */
3660#define WM8962_DSP2_DATA1_RAM_384_24_23_16_SHIFT 0 /* DSP2_DATA1_RAM_384_24_23_16 - [7:0] */
3661#define WM8962_DSP2_DATA1_RAM_384_24_23_16_WIDTH 8 /* DSP2_DATA1_RAM_384_24_23_16 - [7:0] */
3662
3663/*
3664 * R12289 (0x3001) - DSP2 Data1 RAM 0
3665 */
3666#define WM8962_DSP2_DATA1_RAM_384_24_15_0_MASK 0xFFFF /* DSP2_DATA1_RAM_384_24_15_0 - [15:0] */
3667#define WM8962_DSP2_DATA1_RAM_384_24_15_0_SHIFT 0 /* DSP2_DATA1_RAM_384_24_15_0 - [15:0] */
3668#define WM8962_DSP2_DATA1_RAM_384_24_15_0_WIDTH 16 /* DSP2_DATA1_RAM_384_24_15_0 - [15:0] */
3669
3670/*
3671 * R13312 (0x3400) - DSP2 Data2 RAM 1
3672 */
3673#define WM8962_DSP2_DATA2_RAM_384_24_23_16_MASK 0x00FF /* DSP2_DATA2_RAM_384_24_23_16 - [7:0] */
3674#define WM8962_DSP2_DATA2_RAM_384_24_23_16_SHIFT 0 /* DSP2_DATA2_RAM_384_24_23_16 - [7:0] */
3675#define WM8962_DSP2_DATA2_RAM_384_24_23_16_WIDTH 8 /* DSP2_DATA2_RAM_384_24_23_16 - [7:0] */
3676
3677/*
3678 * R13313 (0x3401) - DSP2 Data2 RAM 0
3679 */
3680#define WM8962_DSP2_DATA2_RAM_384_24_15_0_MASK 0xFFFF /* DSP2_DATA2_RAM_384_24_15_0 - [15:0] */
3681#define WM8962_DSP2_DATA2_RAM_384_24_15_0_SHIFT 0 /* DSP2_DATA2_RAM_384_24_15_0 - [15:0] */
3682#define WM8962_DSP2_DATA2_RAM_384_24_15_0_WIDTH 16 /* DSP2_DATA2_RAM_384_24_15_0 - [15:0] */
3683
3684/*
3685 * R14336 (0x3800) - DSP2 Data3 RAM 1
3686 */
3687#define WM8962_DSP2_DATA3_RAM_384_24_23_16_MASK 0x00FF /* DSP2_DATA3_RAM_384_24_23_16 - [7:0] */
3688#define WM8962_DSP2_DATA3_RAM_384_24_23_16_SHIFT 0 /* DSP2_DATA3_RAM_384_24_23_16 - [7:0] */
3689#define WM8962_DSP2_DATA3_RAM_384_24_23_16_WIDTH 8 /* DSP2_DATA3_RAM_384_24_23_16 - [7:0] */
3690
3691/*
3692 * R14337 (0x3801) - DSP2 Data3 RAM 0
3693 */
3694#define WM8962_DSP2_DATA3_RAM_384_24_15_0_MASK 0xFFFF /* DSP2_DATA3_RAM_384_24_15_0 - [15:0] */
3695#define WM8962_DSP2_DATA3_RAM_384_24_15_0_SHIFT 0 /* DSP2_DATA3_RAM_384_24_15_0 - [15:0] */
3696#define WM8962_DSP2_DATA3_RAM_384_24_15_0_WIDTH 16 /* DSP2_DATA3_RAM_384_24_15_0 - [15:0] */
3697
3698/*
3699 * R15360 (0x3C00) - DSP2 Coeff RAM 0
3700 */
3701#define WM8962_DSP2_CMAP_RAM_384_11_10_0_MASK 0x07FF /* DSP2_CMAP_RAM_384_11_10_0 - [10:0] */
3702#define WM8962_DSP2_CMAP_RAM_384_11_10_0_SHIFT 0 /* DSP2_CMAP_RAM_384_11_10_0 - [10:0] */
3703#define WM8962_DSP2_CMAP_RAM_384_11_10_0_WIDTH 11 /* DSP2_CMAP_RAM_384_11_10_0 - [10:0] */
3704
3705/*
3706 * R16384 (0x4000) - RETUNEADC_SHARED_COEFF_1
3707 */
3708#define WM8962_ADC_RETUNE_SCV 0x0080 /* ADC_RETUNE_SCV */
3709#define WM8962_ADC_RETUNE_SCV_MASK 0x0080 /* ADC_RETUNE_SCV */
3710#define WM8962_ADC_RETUNE_SCV_SHIFT 7 /* ADC_RETUNE_SCV */
3711#define WM8962_ADC_RETUNE_SCV_WIDTH 1 /* ADC_RETUNE_SCV */
3712#define WM8962_RETUNEADC_SHARED_COEFF_22_16_MASK 0x007F /* RETUNEADC_SHARED_COEFF_22_16 - [6:0] */
3713#define WM8962_RETUNEADC_SHARED_COEFF_22_16_SHIFT 0 /* RETUNEADC_SHARED_COEFF_22_16 - [6:0] */
3714#define WM8962_RETUNEADC_SHARED_COEFF_22_16_WIDTH 7 /* RETUNEADC_SHARED_COEFF_22_16 - [6:0] */
3715
3716/*
3717 * R16385 (0x4001) - RETUNEADC_SHARED_COEFF_0
3718 */
3719#define WM8962_RETUNEADC_SHARED_COEFF_15_00_MASK 0xFFFF /* RETUNEADC_SHARED_COEFF_15_00 - [15:0] */
3720#define WM8962_RETUNEADC_SHARED_COEFF_15_00_SHIFT 0 /* RETUNEADC_SHARED_COEFF_15_00 - [15:0] */
3721#define WM8962_RETUNEADC_SHARED_COEFF_15_00_WIDTH 16 /* RETUNEADC_SHARED_COEFF_15_00 - [15:0] */
3722
3723/*
3724 * R16386 (0x4002) - RETUNEDAC_SHARED_COEFF_1
3725 */
3726#define WM8962_DAC_RETUNE_SCV 0x0080 /* DAC_RETUNE_SCV */
3727#define WM8962_DAC_RETUNE_SCV_MASK 0x0080 /* DAC_RETUNE_SCV */
3728#define WM8962_DAC_RETUNE_SCV_SHIFT 7 /* DAC_RETUNE_SCV */
3729#define WM8962_DAC_RETUNE_SCV_WIDTH 1 /* DAC_RETUNE_SCV */
3730#define WM8962_RETUNEDAC_SHARED_COEFF_23_16_MASK 0x007F /* RETUNEDAC_SHARED_COEFF_23_16 - [6:0] */
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3733
3734/*
3735 * R16387 (0x4003) - RETUNEDAC_SHARED_COEFF_0
3736 */
3737#define WM8962_RETUNEDAC_SHARED_COEFF_15_00_MASK 0xFFFF /* RETUNEDAC_SHARED_COEFF_15_00 - [15:0] */
3738#define WM8962_RETUNEDAC_SHARED_COEFF_15_00_SHIFT 0 /* RETUNEDAC_SHARED_COEFF_15_00 - [15:0] */
3739#define WM8962_RETUNEDAC_SHARED_COEFF_15_00_WIDTH 16 /* RETUNEDAC_SHARED_COEFF_15_00 - [15:0] */
3740
3741/*
3742 * R16388 (0x4004) - SOUNDSTAGE_ENABLES_1
3743 */
3744#define WM8962_SOUNDSTAGE_ENABLES_23_16_MASK 0x00FF /* SOUNDSTAGE_ENABLES_23_16 - [7:0] */
3745#define WM8962_SOUNDSTAGE_ENABLES_23_16_SHIFT 0 /* SOUNDSTAGE_ENABLES_23_16 - [7:0] */
3746#define WM8962_SOUNDSTAGE_ENABLES_23_16_WIDTH 8 /* SOUNDSTAGE_ENABLES_23_16 - [7:0] */
3747
3748/*
3749 * R16389 (0x4005) - SOUNDSTAGE_ENABLES_0
3750 */
3751#define WM8962_SOUNDSTAGE_ENABLES_15_06_MASK 0xFFC0 /* SOUNDSTAGE_ENABLES_15_06 - [15:6] */
3752#define WM8962_SOUNDSTAGE_ENABLES_15_06_SHIFT 6 /* SOUNDSTAGE_ENABLES_15_06 - [15:6] */
3753#define WM8962_SOUNDSTAGE_ENABLES_15_06_WIDTH 10 /* SOUNDSTAGE_ENABLES_15_06 - [15:6] */
3754#define WM8962_RTN_ADC_ENA 0x0020 /* RTN_ADC_ENA */
3755#define WM8962_RTN_ADC_ENA_MASK 0x0020 /* RTN_ADC_ENA */
3756#define WM8962_RTN_ADC_ENA_SHIFT 5 /* RTN_ADC_ENA */
3757#define WM8962_RTN_ADC_ENA_WIDTH 1 /* RTN_ADC_ENA */
3758#define WM8962_RTN_DAC_ENA 0x0010 /* RTN_DAC_ENA */
3759#define WM8962_RTN_DAC_ENA_MASK 0x0010 /* RTN_DAC_ENA */
3760#define WM8962_RTN_DAC_ENA_SHIFT 4 /* RTN_DAC_ENA */
3761#define WM8962_RTN_DAC_ENA_WIDTH 1 /* RTN_DAC_ENA */
3762#define WM8962_HDBASS_ENA 0x0008 /* HDBASS_ENA */
3763#define WM8962_HDBASS_ENA_MASK 0x0008 /* HDBASS_ENA */
3764#define WM8962_HDBASS_ENA_SHIFT 3 /* HDBASS_ENA */
3765#define WM8962_HDBASS_ENA_WIDTH 1 /* HDBASS_ENA */
3766#define WM8962_HPF2_ENA 0x0004 /* HPF2_ENA */
3767#define WM8962_HPF2_ENA_MASK 0x0004 /* HPF2_ENA */
3768#define WM8962_HPF2_ENA_SHIFT 2 /* HPF2_ENA */
3769#define WM8962_HPF2_ENA_WIDTH 1 /* HPF2_ENA */
3770#define WM8962_HPF1_ENA 0x0002 /* HPF1_ENA */
3771#define WM8962_HPF1_ENA_MASK 0x0002 /* HPF1_ENA */
3772#define WM8962_HPF1_ENA_SHIFT 1 /* HPF1_ENA */
3773#define WM8962_HPF1_ENA_WIDTH 1 /* HPF1_ENA */
3774#define WM8962_VSS_ENA 0x0001 /* VSS_ENA */
3775#define WM8962_VSS_ENA_MASK 0x0001 /* VSS_ENA */
3776#define WM8962_VSS_ENA_SHIFT 0 /* VSS_ENA */
3777#define WM8962_VSS_ENA_WIDTH 1 /* VSS_ENA */
3778
3779extern const u16 wm8962_reg[WM8962_MAX_REGISTER + 1];
3780
3781struct wm8962_reg_access {
3782 u16 read;
3783 u16 write;
3784 u16 vol;
3785};
3786
3787extern
3788const struct wm8962_reg_access wm8962_reg_access[WM8962_MAX_REGISTER + 1];
3789
3790#endif
generated by cgit v1.2.2 (git 2.25.0) at 2025-02-18 12:02:26 -0500