summaryrefslogtreecommitdiffstats
path: root/drivers/reset
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authorKunihiko Hayashi <hayashi.kunihiko@socionext.com>2018-03-30 05:44:43 -0400
committerPhilipp Zabel <p.zabel@pengutronix.de>2018-04-27 05:55:59 -0400
commitfdc0f235d19492e64914ee60bb93a34d063a319b (patch)
treec19b3eb2f2988bd6f24d7ca74e79f372c8f4623a /drivers/reset
parente6914365fd280fce303a89b8a8d4529af5a2e0f9 (diff)
reset: uniphier: add PCIe reset control support
Add reset lines for PCIe controller on UniPhier SoCs. This adds support for Pro5, LD20 and PXs3. Signed-off-by: Kunihiko Hayashi <hayashi.kunihiko@socionext.com> Acked-by: Masahiro Yamada <yamada.masahiro@socionext.com> Signed-off-by: Philipp Zabel <p.zabel@pengutronix.de>
Diffstat (limited to 'drivers/reset')
-rw-r--r--drivers/reset/reset-uniphier.c3
1 files changed, 3 insertions, 0 deletions
diff --git a/drivers/reset/reset-uniphier.c b/drivers/reset/reset-uniphier.c
index ac18f2f27881..d044b717fe49 100644
--- a/drivers/reset/reset-uniphier.c
+++ b/drivers/reset/reset-uniphier.c
@@ -73,6 +73,7 @@ static const struct uniphier_reset_data uniphier_pro5_sys_reset_data[] = {
73 UNIPHIER_RESETX(12, 0x2000, 6), /* GIO (PCIe, USB3) */ 73 UNIPHIER_RESETX(12, 0x2000, 6), /* GIO (PCIe, USB3) */
74 UNIPHIER_RESETX(14, 0x2000, 17), /* USB30 */ 74 UNIPHIER_RESETX(14, 0x2000, 17), /* USB30 */
75 UNIPHIER_RESETX(15, 0x2004, 17), /* USB31 */ 75 UNIPHIER_RESETX(15, 0x2004, 17), /* USB31 */
76 UNIPHIER_RESETX(24, 0x2008, 2), /* PCIe */
76 UNIPHIER_RESETX(40, 0x2000, 13), /* AIO */ 77 UNIPHIER_RESETX(40, 0x2000, 13), /* AIO */
77 UNIPHIER_RESET_END, 78 UNIPHIER_RESET_END,
78}; 79};
@@ -115,6 +116,7 @@ static const struct uniphier_reset_data uniphier_ld20_sys_reset_data[] = {
115 UNIPHIER_RESETX(17, 0x200c, 13), /* USB30-PHY1 */ 116 UNIPHIER_RESETX(17, 0x200c, 13), /* USB30-PHY1 */
116 UNIPHIER_RESETX(18, 0x200c, 14), /* USB30-PHY2 */ 117 UNIPHIER_RESETX(18, 0x200c, 14), /* USB30-PHY2 */
117 UNIPHIER_RESETX(19, 0x200c, 15), /* USB30-PHY3 */ 118 UNIPHIER_RESETX(19, 0x200c, 15), /* USB30-PHY3 */
119 UNIPHIER_RESETX(24, 0x200c, 4), /* PCIe */
118 UNIPHIER_RESETX(40, 0x2008, 0), /* AIO */ 120 UNIPHIER_RESETX(40, 0x2008, 0), /* AIO */
119 UNIPHIER_RESETX(41, 0x2008, 1), /* EVEA */ 121 UNIPHIER_RESETX(41, 0x2008, 1), /* EVEA */
120 UNIPHIER_RESETX(42, 0x2010, 2), /* EXIV */ 122 UNIPHIER_RESETX(42, 0x2010, 2), /* EXIV */
@@ -134,6 +136,7 @@ static const struct uniphier_reset_data uniphier_pxs3_sys_reset_data[] = {
134 UNIPHIER_RESETX(18, 0x200c, 20), /* USB30-PHY2 */ 136 UNIPHIER_RESETX(18, 0x200c, 20), /* USB30-PHY2 */
135 UNIPHIER_RESETX(20, 0x200c, 17), /* USB31-PHY0 */ 137 UNIPHIER_RESETX(20, 0x200c, 17), /* USB31-PHY0 */
136 UNIPHIER_RESETX(21, 0x200c, 19), /* USB31-PHY1 */ 138 UNIPHIER_RESETX(21, 0x200c, 19), /* USB31-PHY1 */
139 UNIPHIER_RESETX(24, 0x200c, 3), /* PCIe */
137 UNIPHIER_RESET_END, 140 UNIPHIER_RESET_END,
138}; 141};
139 142